CA-IF4023

CA-IF4023 上海川土微电子有限公司 修订版 A CA-IF4023 AISG 开关键控同轴调制解调收发器 1. 产品特性 3. 概述 • • • • • • • • • • • 模拟电源电压范围： 3V 至 5.5V 逻辑电源电压范围：1.6V 至 5.5V 接收机具有 –15dBm 至 +5dBm 的宽输入动态范围 发射机输出功率可在 5.4dBm 至 12dBm 范围内调节 符合 AISG 3.0 标准的发射特性 低功耗待机模式 针对 RS-485 总线仲裁的方向控制 支持所有 AISG 信号速率：9.6kbps、38.4kbps、 115.2kbps 片上集成中心频率 2.176MHz 的有源带通滤波器 3mm × 3mm 16 引脚四方扁平无引线 (QFN) 封装 工作温度范围–40°C~125°C CA-IF4023 是一款符合 AISG 3.0 标准的全集成收发 器。 CA-IF4023 接收机具有 20dB 的输入动态范围，集成 一个中心频率为 2.176MHz 的窄带有源带通滤波器，保 证即使在有干扰信号的情况下，接收机仍然有能力解调 出有用信号。 CA-IF4023 发射机同样集成了中心频率为 2.176MHz 的窄带有源带通滤波器，保证输出频谱满足 AISG 3.0 标 准，输出功率在 5.4dBm 至 12dBm 范围内可通过片外电 阻调节以补偿同轴电缆上的功率损失。 CA-IF4023 支持针对 RS-485 总线仲裁的方向控制功 能，支持片外晶振、振荡器或其他片外时钟源输入。 2. 应用 • • • AISG 针对天线线路器件的接口 塔顶放大器 (TMA) 通用调制解调器 (Modem) 接口 器件信息 零件号 封装 封装尺寸(标称值) CA-IF4023 QFN16 3mm × 3mm 简化功能框图 RES VL BIAS 1.5V VCC XTAL1 XTAL2 TXIN DIRMD1 DIRMD2 DIR RXOUT GND Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 TXOUT OOK modulator Bandpass filter SYNCOUT Direction detection state machine REF CA-IF4023 OOK demodulator RXI N Bandpass filter CA-IF4023 修订版 A 上海川土微电子有限公司 订购指南 4. 表 4-1 有效订购零件编号 2 型号 封装 CA-IF4023 QFN16 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IF4023 上海川土微电子有限公司 修订版 A 目录 7.5.6. 7.5.7. 发射机特性 ....................................................... 7 转换时间特性 ................................................... 7 1. 产品特性 ............................................................1 2. 应用 ...................................................................1 3. 概述 ...................................................................1 8. 参数测量信息................................................... 11 4. 订购指南 ............................................................2 9. 详细说明 .......................................................... 13 5. 修改历史 ............................................................3 9.1. 工作原理 .......................................................... 13 6. 引脚功能描述.....................................................4 9.2. 真值表 .............................................................. 14 7. 产品规格 ............................................................5 典型特性 ............................................................ 8 应用信息 ................................................... 15 10. 7.1. 绝对最大额定值 1 ..............................................5 10.1. 发射频谱 .......................................................... 15 7.2. ESD 额定值 ........................................................5 10.2. 输出功率 .......................................................... 15 7.3. 建议工作条件.....................................................5 10.3. 解调阈值 .......................................................... 15 7.4. 热量信息.............................................................6 10.4. 外部时钟 .......................................................... 15 7.5. 电气特性.............................................................6 7.5.1. 7.5.2. 7.5.3. 7.5.4. 7.5.5. 5. 7.6. 直流特性 ............................................................6 逻辑输入和输出 ................................................6 XTAL 输入和 SYNCOUT 输出 ........................6 接收机滤波特性 ................................................6 接收机特性 ........................................................7 封装信息 ................................................... 17 11. 12. 11.1. 封装信息表 ...................................................... 17 11.2. QFN16 外形尺寸 .............................................. 17 卷带信息 ................................................... 18 修改历史 2020 年 10 月 29 日 修订版 A • 初始版本 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 3 CA-IF4023 修订版 A 上海川土微电子有限公司 引脚功能描述 6. VCC CA-IF4023 (Top View) VL EP 图 6-1 CA-IF4023 引脚图 表 6-1 CA-IF4023 引脚功能描述 引脚名称 引脚编号 类型 SYNCOUT 1 输出 TXIN VL RXOUT DIR DIRMD2 DIRMD1 GND RES BIAS RXIN TXOUT VCC XTAL1 XTAL2 GND EP 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 — 输入 电源 输出 输出 输入 输入 地 输入 输出 输入 输出 电源 输入 输入 地 — 4 描述 同步时钟输出，以漏端开路形式输出 XTAL1/2 输入的源时钟，使用时建议外接 1kΩ 电阻 到电源 VCC 发射端数字信号输入端口 逻辑电源端口，1.6V 至 5.5V 接收端数字信号输出 信号方向指示逻辑输出，检测到 RXIN 有信号时置高 信号速率控制端口，DIRMD[2:1]: [L, L] = 9.6kbps; [L, H] = 38.4kbps; [H, L] = 115.2kbps; [H, H] = 待机模式 地 发射端输出功率控制端口，外接从 BIAS 端口引出的分压电阻 参考电压输出端口，外接分压电阻到 RES 端口，使用时建议接 1μF 到地去耦电容 接收端输入信号端口 发射端输出信号端口 模拟电源端口，3.0V 至 5.5V 外接晶振输入端口，若 XTAL1 直接外接振荡器或锁相环的输出时钟时，请将 XTAL2 接地 地 底部散热盘，使用时建议接地 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IF4023 上海川土微电子有限公司 7. 产品规格 7.1. 修订版 A 绝对最大额定值 1 参数 最小值 最大值 –0.3 6.0 –0.3 VCC + 0.3 –0.3 VL + 0.3 –20 20 内部限流 电源电压 模拟端口对地电压 RXIN,TXOUT, XTAL1, XTAL2, SYNCOUT, RES, BIAS 逻辑端口对地电压 TXIN, RXOUT, DIR, DIRMD1, DIRMD2 逻辑端口输出电流 TXOUT 端口输出电流 VCC, VL VIO VIO IO IO 单位 V V V mA 内部限流 IO SYNCOUT 端口输出电流 结温 TJ -40 150 °C TSTG 存储温度范围 –65 150 °C 备注: 1. 等于或超出上述绝对最大额定值可能会导致产品永久性损坏。这只是额定最值，并不能以这些条件或者在任何其它超出本技术规 范操作章节中所示规格的条件下，推断产品能否正常工作。长期在超出最大额定值条件下工作会影响产品的可靠性。 7.2. ESD 额定值 VESD 静电放电 人体模型 (HBM)，根据 ANSI/ESDA/JEDEC JS-001，所有引脚 1 人体模型 (HBM)，根据 ANSI/ESDA/JEDEC JS-001，RXIN 或 TXOUT 对 GND 组件充电模式(CDM)，根据 JESD22-C101，所有引脚 数值 ±2000 ±8000 ±1000 单位 最大值 5.5 5.5 1.12 115.2 VL Vcc 0.3 x VL 0.3 x Vcc 单位 V V V kbps V 备注: 1. JEDEC 文件 JEP155 规定 500V HBM 可通过标准 ESD 控制过程实现安全制造。 7.3. 建议工作条件 参数 VCC VL VIN 1/tUI 最小值 3 1.6 模拟电源电压 逻辑电源电压 RXIN 输入信号幅度 信号速率 VIH 高电平输入阈值 VIL 低电平输入阈值 R1 R2 RSYNC VRES fOSC CC CBIAS TA TJ BIAS 和 RES 端口间电阻 RES 和 GND 端口间电阻 SYNCOUT 的上拉电阻 RES 端口电压 振荡器频率 RXIN 端口与线缆间的隔直电容 BIAS 端口与 GND 间的去耦电容 环境温度 结温 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 TXIN, DIRMD1, DIRMD2 XTAL1, XTAL2 TXIN, DIRMD1, DIRMD2 XTAL1, XTAL2 典型值 5 3.3 9.6 0.7 x VL 0.7 x Vcc 0 0 4.1 10 1 0.7 –30ppm –40 -40 8.704 100 1 1.5 30ppm 125 150 V V kΩ kΩ kΩ V MHz nF μF °C °C 5 CA-IF4023 修订版 A 7.4. 热量信息 上海川土微电子有限公司 QFN16 51.6 69.5 24.2 26.1 热量表 RθJA RθJC(top) RθJB RθJC(bottom) 7.5. IC 结至环境的热阻 IC 结到壳（顶部）热阻 IC 结对板热阻 IC 结到壳（底部）热阻 单位 °C/W °C/W °C/W °C/W 电气特性 以建议工作条件为准，除非另有说明。 7.5.1. 直流特性 参数 ICC 模拟电源电流 IL PSRR_RX1 PSRR_TX2 TJSD_RISE TJSD_FALL TJSD_HYS 逻辑电源电流 接收机电源抑制比 接收机电源抑制比 上升热关断温度 下降热关断温度 热关断温度迟滞窗口 测试条件 TXIN = L (调制态) TXIN = H (静默态) DIRMD1 = L TXIN = 115.2kbps, DIRMD2 = H 50%占空比 DIRMD1 = DIRMD2 = H (待机模式) TXIN = H, RXIN = 直流输入 VTXIN = VL VTXIN = 0 最小值 典型值 30.5 30 最大值 44 43 单位 mA mA 30.3 44 mA 13.5 25 50 mA μA dB dB °C °C °C 最大值 单位 V V μA μA μA μA 45 45 180 150 30 备注: 1. 定义为在直流处的∆VRXIN/∆VCC。 2. 定义为在直流处的∆VTXOUT/∆VCC。 7.5.2. 逻辑输入和输出 参数 高逻辑输入电平 RXOUT, DIR 低逻辑输入电平 RXOUT, DIR 高逻辑输入电流 TXIN 低逻辑输入电流 TXIN 高逻辑输入电流 DIRMD1/2 低逻辑输入电流 DIRMD1/2 VOH VOL IIH IIL IIH IIL 7.5.3. 参数 高电平输入电流 低电平输入电流 低电平输出电压 测试条件 VXTAL = VCC VXTAL = 0V 输出灌电流 3.3mA 最小值 测试条件 最小值 1.1 典型值 0.1 x VL 1 –1 50 –1 典型值 最大值 10 0.4 单位 μA μA V 最大值 4.17 单位 MHz 4.17 MHz –1 接收机滤波特性 fPB 参数 接收机通带频率 fREJ 接收机干扰抑制频率 tnoise_filter 接收机去抖动时间 6 最小值 0.9 x VL XTAL 输入和 SYNCOUT 输出 IXTAL_IH IXTAL_IL VSYNC_OL 7.5.4. 测试条件 输出拉电流 3.3mA 输出灌电流 3.3mA VTXIN = VL VTXIN = 0V VDIRMD1/2 = VL VDIRMD1/2 = 0V VRXIN = 1.12VP-P 2.176MHz 载波幅度为 112.4mVP-P， 带 外杂散信号幅度为 800mVP-P DIRMD1/2 设置为 9.6kbps 速率 DIRMD1/2 设置为>9.6kbps 速率 典型值 1.1 4 2 μs μs Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IF4023 上海川土微电子有限公司 7.5.5. 接收机特性 修订版 A 参数 测试条件 VIT 接收机输入阈值 fRXIN = 2.176MHz ZIN 接收机输入阻抗 f = fO 7.5.6. 最小值 –18 79.6 11 典型值 –15 112.4 18 最大值 –12 158.8 单位 dBm mVP-P kΩ 最小值 10.5 2.12 典型值 12 2.52 5.38 1.17 2.176 最大值 单位 dBm VP-P dBm VP-P MHz ppm mVP-P dBm 发射机特性 参数 测试条件 VRES = 1.5V（最大） TXOUT 输出电压幅度 VOUT VRES = 0.7V （最小） TXOUT 输出频率 TXOUT 输出频率变化 fO ∆fO1 输出泄漏功率 POZ TXIN = VL TXOUT 输出端 线缆端 输出频谱掩膜 2 ZO TXOUT 输出阻抗 ISC TXOUT 输出短路电流 直流 fSW = 10MHz 短路至 GND 或 VCC 6.28 1.3 ±100 1 –60 符合 AISG 频谱掩膜标准（3GPP TS 37.461 规范） ， 见图 10-1 0.03 3.5 ±200 Ω mA 备注: 1. 2. 输出频率的变化主要取决于片外晶振频率的变化。 在 RXIN 和 GND 之间接 470pF 电容，频率超过 150MHz 以上的测试结果由测试仪器的设置决定。 7.5.7. 转换时间特性 参数 tRX 接收机传输延时 tR, tF 接收机输出上升下降时间 tTX tDIR_SKEW1 发射机传输延时 DIR 相对 RXOUT 的延时 tDIR DIR 为高电平时长 ∆DC 接收机输出信号占空比变化 测试条件 RXIN 到 RXOUT, DIRMD1 = DIRMD2 = 0V RXIN 到 RXOUT, DIRMD1 = VL, DIRMD2 = 0V (38.4kbps), 或 DIRMD1 = 0V, DIRMD2 = VL (115.2kbps) tR: 10%至 90%; tF: 90%至 10%; RL = 1kΩ, CL = 10pF TXIN 到 TXOUT 最小值 270 DIRMD1 = DIRMD2 = 0V (9.6kbps) DIRMD1 = VL, DIRMD2 = 0V (38.4kbps) DIRMD1 = 0V, DIRMD2 = VL (115.2kbps) RXIN = 0dBm RXIN 灌入 50%占空 比、2.176MHz 正弦 RXIN = –10dBm OOK 调制信号 2 典型值 7 最大值 10 单位 μs 5 10 μs 8 20 ns 3 μs ns 670 1667 417 137 μs ±10 ±10 % 备注: 1. 2. 见图 8-2。 ±2μs 的包络上升下降时间。 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 7 CA-IF4023 修订版 A 7.6. 典型特性 上海川土微电子有限公司 以建议工作条件为准，除非另有说明。 8 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IF4023 上海川土微电子有限公司 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 修订版 A 9 CA-IF4023 修订版 A 10 上海川土微电子有限公司 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IF4023 上海川土微电子有限公司 8. 参数测量信息 修订版 A R array XTAL1 8.704 MHz crystal RES TXOUT XTAL2 TXIN 50Ω Signal Generator RXIN Coax out CC 50Ω VL 0.5VL TXIN tTX Vpk 0.5Vpk TXOUT 备注: 1. 信号发生器产生的数字信号要求为 50%占空比，上升下降时间小于 6ns，正常输出高低电平分别为 3.3V 和 0V。 2. CC 取值建议为 100nF 或者 220nF。 3. 电阻阵列的取值描述见 10.2 小节。 4. 8.704MHz 的晶振或其他片外时钟源的使用说明见 10.4 小节。 图 8-1 发射链路传输延时和输出信号幅度测试电路和波形示意图 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 11 CA-IF4023 修订版 A 上海川土微电子有限公司 50Ω C pk pk L L RX DIR_ SKEW L L 图 8-2 接收链路传输延时和方向指示信号 DIR 测试电路和波形示意图 12 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IF4023 上海川土微电子有限公司 9. 详细说明 修订版 A 工作原理 CA-IF4023 是一款符合 AISG 3.0 标准的全集成收发器。 CA-IF4023 接收链路包括一个中心频率为 2.176MHz 的窄带带通滤波器（Bandpass filter）、OOK 解调器（OOK demodulator）、输出驱动器，能够在有干扰信号的情况下正确地解调出有用信号。接收链路的解调阈值典型值为– 15±2dBm，符合 AISG 标准规范。 CA-IF4023 发射链路包括 OOK 信号调制器（OOK modulator）、符合 AISG 频谱掩膜的带通滤波器和输出放大器。发 射链路输出功率可通过片外电阻网络调节，以补偿片外电路和同轴线缆导致的功率损失，可调范围为+5.4dBm 到 +12dBm（线缆输出端相应的为–0.6dBm 到+6dBm） 。8.704MHz 的片外晶振从 XTAL1 和 XTAL2 端口输入产生 OOK 调制载 波信号，同样可以使用片外相同频率的时钟信号从 XTAL1 端口输入作为载波信号，此时 XTAL2 端口须接地。 9.1. TXIN RXIN RXOUT IDLE (LOGICAL HIGH) IDLE STOP BIT IDLE START BIT BIT0 = 1 BIT1 = 1 BIT2 = 1 BIT3 = 0 BIT4 = 0 BIT5 = 1 BIT6 = 1 BIT7 = 0 STOP BIT tRX DIR = 1 DIR = 1 FOR OTHER 16 BIT-TIMES DIR tDIR_ SKEW 图 9-1 通信信号从 RXIN 传输到 RXOUT 的时序图 TXIN TXOUT & RXIN IDLE START BIT BIT0 = 1 BIT1 = 1 BIT2 = 1 BIT3 = 0 BIT4 = 0 BIT5 = 1 BIT6 = 1 BIT7 = 0 STOP BIT IDLE STOP BIT tTX RXOUT DIR IDLE (LOGICAL HIGH) IDLE (LOGICAL LOW) 图 9-2 通信信号从 TXIN 传输到 TXOUT 的时序图 CA-IF4023 提供一个方向指示输出端口（DIR）用来指示信号流的方向，帮助 RS-485 更快捷方便地进行总线判决。 如在塔顶的应用中（如图 10-3 所示） ，DIR 可被用来控制 RS-485 的 DE（发射机输出使能）和 RE（接收机输入使能）， 当信号从 RXIN 传输到 RXOUT，DIR 将被置高；反之，当有信号从 TXIN 传输到 TXOUT 或者 TXIN 和 RXIN 均无信号时， DIR 将被置低；若在 RXIN 和 TXIN 处均有信号，芯片内部的方向检测状态机（Direction detection state machine）会进行 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 13 CA-IF4023 修订版 A 上海川土微电子有限公司 判决，若接收链路的信号先到状态机处，则 CA-IF4023 进入接收模式，屏蔽发射链路，反之 CA-IF4023 进入发射模式， 屏蔽接收链路，在实际使用时应合理安排时序，避免进入此种状态。 图 9-1 和图 9-2 显示了 DIR 的具体指示功能： 1）当 RXIN 和 TXIN 均没有信号时，芯片进入默认的空闲（IDLE）状态，此时 DIR 被置低，RXOUT 被置高，TXOUT 进入静默态； 2）当芯片内部的状态机检测到信号从 RXIN 传输到 RXOUT，芯片进入接收模式，此时 DIR 被置高，RXOUT 响应 RXIN 的信号，输出对应的解调信号，在 RXOUT 最后一次变高后再延长 16 个 BIT 时间，接收模式结束，然后 DIR 被置 低，芯片进入空闲状态； 3）当芯片内部的状态机检测到信号从 TXIN 传输到 TXOUT，芯片进入发射模式，DIR 被置低，TXOUT 响应 TXIN 的 信号，RXOUT 不响应 RXIN 的信号且被置高，在 TXIN 最后一次变高后再延长 16 个 BIT 时间，发射模式结束，进入空闲 状态。 端口 DIRMD1 和 DIRMD2 用来设置不同信号速率下的 BIT 时间，如表 9-1 所示。当 DIRMD1 和 DIRMD2 均被拉高至 VL 时，芯片进入待机模式，此时 RXOUT 被置高，不解调 RXIN 的任何输入信号，DIR 被置低，整个芯片的供电电流下 降。 9.2. 真值表 表 9-1 DIRMD1 和 DIRMD2 功能定义 DIRMD21 DIRMD11 AISG 速率 (kbps) 单 BIT 时间 (μs) 0 0 9.6 104.16 0 1 38.4 26.04 1 0 115.2 8.68 1 1 待机 2 待机 2 备注: 1. DIRMD1 和 DIRMD2 端口在芯片内部通过电阻下拉到 GND。 2. 待机模式下 RXOUT 置高，TXOUT 静默态，不响应任何输入信号。 14 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IF4023 上海川土微电子有限公司 10. 应用信息 修订版 A 10.1. 发射频谱 +5dBm -5dBm -5dBm -25dBm -25dBm fo 200kHz -36dBm -36dBm -67dBm 400kHz 9kHz 1MHz 1MHz -125dBm 10MHz 20MHz 30MHz 400MHz 12.75GHz 图 10-1 符合 AISG TS 37.461 标准 50%占空比 OOK 调制信号发射频谱掩膜 图 10-1 显示了 AISG 标准规定的 OOK 调制信号频谱掩膜。实际应用时，如图 10-2 和图 10-3 所示，在 RXIN 端口和 GND 之间接一个 470pF 的电容来滤除频率在 25MHz 以上的谐波以更好地满足频谱掩膜的要求。在 TXOUT 和 RXIN 之间 接 50Ω 电阻，对于信号从 TXIN 传输到 TXOUT 而言，50Ω 电阻相当于串联在 TXOUT 和线缆之间，而对于 RXIN 端接收到 的信号而言，50Ω 电阻相当于并联关系。为了更好地抑制电源上的干扰，TXOUT 的直流工作点偏置在 1.5V 左右，同时 芯片为了避免 TXOUT 的直流工作点受到线缆侧的影响，通过隔直电容连接到线缆上。 10.2. 输出功率 CA-IF4023 发射链路的输出功率可以通过片外电阻调节，如图 10-2 和图 10-3 所示，电阻 R1 接在 BIAS 和 RES 之间， 电阻 R2 接在 RES 和 GND 之间，在 BIAS 和 GND 之间建议接一个 1μF 的去耦电容。TXOUT 的输出电压幅度和 R1、R2 之 间的关系为： VTXOUT(VP-P) = 2.52VP-P x R2 / (R1 + R2) 其中 R2 / (R1 + R2)的值可在 0.467 和 1 之间变化，当 R1 为 0Ω 时，TXOUT 输出最大幅度为 2.52V，TXOUT 输出的最 小幅度为 1.17V，折算到 50Ω 上的输出功率为 5.4dBm，相当于线缆的输出功率为–0.6dBm。AISG 标准要求线缆输出端 功率为 3dBm，相当于 TXOUT 输出电压幅度为 1.78VP-P，因此根据上述关系建议选取 R1 = 4.1kΩ，R2 = 10kΩ。 10.3. 解调阈值 CA-IF4023 接收链路最大输入信号为 1.12VP-P，折算到 50Ω 上接收功率为 5dBm。解调阈值为–15dBm (112.4mVP-P) ± 3dB，这规定了芯片内部能够完成正确解调的最小输入信号幅度。为避免接收机饱和，其他任何功率高于 5dBm 的相邻 载波频率必须低于 1.1MHz 或者高于 4.17MHz。 10.4. 外部时钟 CA-IF4023 需要外部提供调制载波信号，且为满足 AISG 标准规定的±100ppm 的频率稳定度指标，要求 8.704MHz 的 片外晶振具有±30ppm 的频率稳定度，如图 10-2 和图 10-3 所示，建议在 XTAL1 和 XTAL2 分别接一个 40pF（±10%）的电 容到 GND。CA-IF4023 可通过 SYNCOUT 端口共享出 XTAL1 和 XTAL2 输入的源时钟信号，将 SYNCOUT 端口通过 1kΩ 电阻 上拉至 VCC。若基站端作为主设备，塔端作为从设备，则基站端的 CA-IF4023 的 SYNCOUT 将源时钟信号通过串接一个 10kΩ 电阻输出至塔端的 CA-IF4023 的 XTAL1，其 XTAL2 端口此时须接地。 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 15 CA-IF4023 修订版 A 上海川土微电子有限公司 1μF R2 0.1μF 0.1μF R1 RES BIAS VL VCC Power 3.3V supply 5V 1.5v XTAL1 TXOUT OOK modulator XTAL2 TXIN Bandpass filter DIRMD1 DIRMD2 FPGA /MCU DIR 50Ω Coax cable SYNCOUT Direction detection state machine RXOUT CA-IF4023 REF OOK demodulator GND AC coupling 470pF RXI N Bandpass filter 图 10-2 CA-IF4023 连接基站端的典型应用图 1μF R2 0.1μF 0.1μF R1 RES XTAL1 XTAL2 TXIN 5V RS-485 BUS to TMA/RET GND 1.5v TXOUT OOK modulator Band pass filter DIRMD1 DIRMD2 RS-485 A B BIAS VL VCC Power 3.3V supply 5V RO RE DE DI DIR RXOUT GND Coax cable 50Ω SYNCOUT Direction detection state machine 470pF REF CA-IF4023 OOK demodulator AC coupling RXI N Band pass filter 图 10-3 CA-IF4023 连接塔端的典型应用图 16 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IF4023 上海川土微电子有限公司 11. 封装信息 修订版 A 11.1. 封装信息表 可订购型号 封装类型 引脚数量 包装数量 环保要求 CA-IF4023 QFN16 16 3000 Green (RoHS & no Sb/Br) 湿度敏感等级 峰值温度 Level-1-260C-1 YEAR 工作温度 器件标识 –40°C~125°C 4023 11.2. QFN16 外形尺寸 备注: 1. 图中所有数值单位为毫米。 图 11-1 QFN16 封装尺寸图 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 17 CA-IF4023 修订版 A 12. 卷带信息 上海川土微电子有限公司 TAPE DIMENSIONS REEL DIMENSIONS A0 B0 K0 W P1 Dimension designed to accommodate the component width Dimension designed to accommodate the component length Dimension designed to accommodate the component thickness Overall width of the carrier tape Pitch between successive cavity centers QUADRANT ASSIGNMENTS FOR PIN 1 ORIENTATION IN TAPE *All dimensions are nominal 18 Device Package Type Package Drawing Pins SPQ CA-IF4023 QFN16 / 16 3000 Reel Diameter (mm) 330 Reel Width W1 (mm) 12.4 A0 (mm) B0 (mm) K0 (mm) P1 (mm) W (mm) Pin1 Quadrant 3.6 3.6 1.2 8.0 12.0 Q1 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IF4023 上海川土微电子有限公司 修订版 A 重要声明 上述资料仅供参考使用，用于协助 Chipanalog 客户进行设计与研发。Chipanalog 有权在不事先通知的情况下，保 留因技术革新而改变上述资料的权利。 Chipanalog 产品全部经过出厂测试。 针对具体的实际应用，客户需负责自行评估，并确定是否适用。Chipanalog 对客户使用所述资源的授权仅限于开发所涉及 Chipanalog 产品的相关应用， 除此之外不得复制或展示所述资源， 如 因使用所述资源而产生任何索赔、 赔偿、 成本、 损失及债务等， Chipanalog 对此概不负责。 商标信息 Chipanalog Inc.®、Chipanalog®为 Chipanalog 的注册商标。 http://www.chipanalog.com Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 19