Fremont Micro Devices
FT61F08X
高性能 RISC CPU
外设特性
增加到 49 条指令
指令周期可选：1T / 2T / 4T
存储架构
程序 ROM: 8k x 14 bits
数据 RAM: 1k x 8 bits
数据 EEPROM: 256 x 8 bits
扇区程序代码保护 (扇区=1k x 14bits)
支持 IAP，VDD ≥ 2.7V
16 层硬件堆栈
GPIO
30 个方向独立控制的通用 IO
30 个上拉独立控制的管脚
30 个上拉独立控制的管脚
30 个唤醒管脚：边沿或电平检测
ADC 输入通道：AN0 - AN7
外部复位管脚：PC0
30 个可编程源电流管脚：2/4/14/26mA@5V
30 个可编程灌电流管脚：max. 62mA@5V
特殊单片机特性
工作温度范围：-40 ─85°C
宽工作电压范围：1.9 ─ 5.5V
DC – 8MHz: VDD ≥ 1.9V
DC – 16MHz: VDD ≥2.7V
时钟源
两个内部时钟
16M 高速高精度 HIRC
32k 低速低功耗 LIRC
晶体振荡器和外部时钟输入
晶体时钟缺失检测
晶体时钟配置下的双速时钟启动
慢时钟周期测量
带 7 位预分频的 16 位看门狗，时钟源可选
上电复位延时计数器
低功耗模式 SLEEP
系统时钟可选择保持运行或关闭
低电压复位 LVR:
2.0, 2.2, 2.5, 2.8, 3.1, 3.6, 4.1V
低电压检测 LVD:
内部电压：2.0, 2.4, 2.8, 3.0, 3.6, 4.0V
或检测外部输入，可当比较器用
支持 ISP 和在线调试 OCD
3 个硬件断点
软复位，单步，暂停，跳跃等
封 装 形 式 : SOP24, SSOP24, TSSOP24,
SOP28, SSOP28, LQFP32
ＦＭＤ授权代理商：深圳市浩瑞佳电子科技有限公司
TEL:+86-0755-89519740
-1-
支持管脚第二功能的重映射
通信接口
UART
I2C, 主从机
SPI, 主从机
12 bit SAR ADC (x1)
8 个外部通道 + 1 个¼ VDD 通道
内部参考电压：VDD, 0.5V, 2V, 3V
外部参考：VREFP, VREFN
手动和自动触发方式
支持延时触发
TIM1-16bit
带 16 位预分频的 16 位定时器
自动重载
时钟源：系统时钟，HIRC 以及倍频时
钟（晶体或 HIRC 的二倍频），LIRC
周期、占空比寄存器双缓冲设计
4 个独立的捕捉/比较/PWM 通道
PWM 支持沿对齐，中心对齐，单次脉
冲模式
3 组带死区控制的互补 PWM 输出
前沿消隐
故障刹车控制
TIM2-16bit
带 15 位预分频的 16 位定时器
自动重载
时钟源：系统时钟，HIRC 以及倍频时
钟（晶体或 HIRC 的二倍频），LIRC
周期、占空比寄存器双缓冲设计
3 个独立的捕捉/比较/PWM 通道
TIM4-8bit，带 8bit 预分频的基本定时器，
时钟源可选
Rev1.05
２０２０－５－２９
HRJ:www.sika-wen.com
FMD:www.fremontmicro.com
Fremont Micro Devices
FT61F08X
选型表
型号
PROM(字) DROM(B) SRAM(B) I/Os ADC通道
Timers
I2C/
SPI/
UART
支持
I2CRMAP
FT61F086A-RB
FT61F086E-RB
FT61F086-ERB
FT61F086E-ERB
FT61F086-TRB
FT61F086E-TRB
FT61F087-RB
FT61F087E-RB
FT61F087-ERB
FT61F088-LRB
FT61F088E-LRB
22
8k
256
7
1k
3
1/1/1
25
26
封装
SOP24
SSOP24
TSSOP24
SOP28
8
30
SSOP28
LQFP32
注意：I2CRMAP 功能，见 UCFG2[4]位描述。
芯片版本历史
版本
A
描述
初版
B
C
D
E
内部优化（ESD/EFT）
F
G
H
I
功能增加：
外部复位改为可以进串口
PB3 的 I2C_SDA 与 PA0 的 SPI_MOSI 对调，PB2 的 I2C_SCL 和 PA1 的 SPI_MISO
对调，见 4.11.3 小节
DROM 添加 program only mode，见 8.8.6 小节
J
内部优化
rev1.05
-2-
2020-5-29
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FT61F08X
目录
高性能 RISC CPU..................................................................................................... - 1 特殊单片机特性 ........................................................................................................ - 1 外设特性
............................................................................................................... - 1 -
选型表
............................................................................................................... - 2 -
芯片版本历史 ............................................................................................................ - 2 1.
2.
系统功能框图及脚位 ............................................................................................................... 16
1.1.
脚位图......................................................................................................................... 17
1.2.
管脚描述 ..................................................................................................................... 19
程序存储器 ............................................................................................................................. 20
2.1.
3.
将程序存储器当作数据存储器读取 ............................................................................. 20
2.1.1.
RETW 指令 ................................................................................................ 21
2.1.2.
使用 FSR 间接读取 ..................................................................................... 21
数据存储器 ............................................................................................................................. 22
3.1.
3.2.
3.3.
3.4.
数据存储器构成 .......................................................................................................... 22
3.1.1.
内核寄存器 ................................................................................................. 23
3.1.2.
状态寄存器 ................................................................................................. 23
特殊功能寄存器 .......................................................................................................... 24
3.2.1.
通用 RAM ................................................................................................... 24
3.2.2.
GPR 的线性访问 ........................................................................................ 24
3.2.3.
公共 RAM ................................................................................................... 25
3.2.4.
存储区地址映射 .......................................................................................... 26
3.2.5.
Bank11，bank12 和 bank31 ...................................................................... 28
3.2.6.
Bank31 的影子寄存器 ................................................................................ 28
堆栈 ............................................................................................................................ 29
3.3.1.
访问堆栈 ..................................................................................................... 29
3.3.2.
上溢/下溢复位............................................................................................. 30
间接寻址 ..................................................................................................................... 30
3.4.1.
传统数据存储器 .......................................................................................... 31
3.4.2.
线性数据存储器 .......................................................................................... 31
rev1.05
-3-
2020-5-29
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3.4.3.
4.
FT61F08X
闪存程序存储器 .......................................................................................... 32
复位源 .................................................................................................................................... 33
4.1.
上电复位 ..................................................................................................................... 33
4.1.1.
上电复位流程.............................................................................................. 34
4.2.
低电压复位 ................................................................................................................. 35
4.3.
上电复位延时 .............................................................................................................. 35
4.4.
非法指令复位 .............................................................................................................. 36
4.5.
软件复位 ..................................................................................................................... 36
4.6.
EMC 复位 ................................................................................................................... 36
4.7.
上电配置过程(BOOT) ................................................................................................. 36
4.7.1.
4.8.
4.9.
可触发 BOOT 过程的复位源汇总 ................................................................ 37
LVD 低电压侦测.......................................................................................................... 37
4.8.1.
检测外部电压.............................................................................................. 37
4.8.2.
LVD 中断 .................................................................................................... 37
复位时序 ..................................................................................................................... 38
4.9.1.
上电复位时序 1 ........................................................................................... 38
4.9.2.
上电复位时序 2 ........................................................................................... 38
4.9.3.
上电复位时序 3 ........................................................................................... 39
4.10. 复位源标志位 .............................................................................................................. 39
4.10.1.
PCON 寄存器，地址 0x96.......................................................................... 40
4.10.2.
LVDCON 寄存器，地址 0x199 ................................................................... 41
4.11. 配置寄存器汇总 .......................................................................................................... 42
5.
4.11.1.
UCFG0，PROM 地址 0x8000 .................................................................... 42
4.11.2.
UCFG1，PROM 地址 0x8001 .................................................................... 43
4.11.3.
UCFG2，PROM 地址 0x8002 .................................................................... 44
4.11.4.
UCFG3，PROM 地址 0x8003 .................................................................... 45
4.11.5.
DCFG0，PROM 地址 0x8047 .................................................................... 45
时钟源 .................................................................................................................................... 46
5.1.
时钟源模式 ................................................................................................................. 46
5.2.
外部时钟模式 .............................................................................................................. 47
rev1.05
-4-
2020-5-29
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5.3.
5.2.1.
振荡器起振定时器（OST） ........................................................................ 47
5.2.2.
EC 模式 ...................................................................................................... 47
5.2.3.
LP 和 XT 模式 ............................................................................................. 47
5.2.4.
内部时钟模式.............................................................................................. 47
5.2.5.
频率选择位（MCKCF） ............................................................................. 48
5.2.6.
HIRC 和 LIRC 时钟切换时序 ...................................................................... 48
5.2.7.
HIRC 时钟特殊功能 .................................................................................... 49
时钟切换 ..................................................................................................................... 49
5.3.1.
系统时钟选择（SCS）位 ........................................................................... 49
5.3.2.
振荡器起振超时状态（OSTS）位 .............................................................. 50
5.3.3.
双速时钟启动模式 ...................................................................................... 50
5.3.4.
双速启动模式配置 ...................................................................................... 50
5.3.5.
双速启动顺序.............................................................................................. 51
5.3.6.
故障保护时钟监控器 ................................................................................... 51
5.3.7.
故障保护检测.............................................................................................. 51
5.3.8.
故障保护操作.............................................................................................. 51
5.3.9.
故障保护条件清除 ...................................................................................... 52
5.3.10.
复位或从休眠中唤醒 ................................................................................... 52
5.4.
外设时钟门控 .............................................................................................................. 52
5.5.
时钟输出 ..................................................................................................................... 53
5.5.1.
5.6.
6.
FT61F08X
时钟输出注意.............................................................................................. 53
与时钟源相关寄存器汇总 ............................................................................................ 53
5.6.1.
OSCCON 寄存器，地址 0x99 .................................................................... 54
5.6.2.
OSCTUNE 寄存器，地址 0x98 .................................................................. 54
5.6.3.
PCKEN 寄存器，地址 0x9A ....................................................................... 55
5.6.4.
CKOCON 寄存器，地址 0x95 .................................................................... 56
5.6.5.
TCKSRC 寄存器，地址 0x31F ................................................................... 57
中断 ........................................................................................................................................ 58
6.1.
中断的使能 ................................................................................................................. 58
6.2.
中断的响应时间 .......................................................................................................... 58
rev1.05
-5-
2020-5-29
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7.
6.3.
睡眠下的中断 .............................................................................................................. 59
6.4.
现场保护 ..................................................................................................................... 59
6.5.
与中断相关寄存器汇总 ............................................................................................... 59
6.5.1.
INTCON 寄存器，地址 0x0B ...................................................................... 60
6.5.2.
PIR1 寄存器，地址 0x11 ............................................................................ 61
6.5.3.
PIE1 寄存器，地址 0x91 ............................................................................ 61
睡眠模式................................................................................................................................. 62
7.1.
睡眠的唤醒 ................................................................................................................. 62
7.1.1.
8.
FT61F08X
使用中断唤醒.............................................................................................. 63
7.2.
睡眠的系统时钟 .......................................................................................................... 63
7.3.
与睡眠模式相关寄存器汇总 ........................................................................................ 63
数据 EEPROM 和 FLASH ...................................................................................................... 64
8.1.
EEADRL 和 EEADRH 寄存器 ..................................................................................... 64
8.1.1.
8.2.
8.3.
EECON1 和 EECON2 寄存器 .................................................................... 65
使用数据 EEPROM..................................................................................................... 65
8.2.1.
读数据 EEPROM 存储器 ............................................................................ 65
8.2.2.
写数据 EEPROM 存储器 ............................................................................ 66
8.2.3.
防止误写操作的保护措施............................................................................ 66
8.2.4.
关于 GIE 的清 0 .......................................................................................... 67
闪存程序存储器概述 ................................................................................................... 68
8.3.1.
读闪存程序存储器 ...................................................................................... 68
8.3.2.
擦除闪存程序存储器 ................................................................................... 69
8.3.3.
写闪存程序存储器 ...................................................................................... 70
8.4.
修改闪存程序存储器 ................................................................................................... 71
8.5.
配置字 UCFGx/FCFGx 读访问 ................................................................................... 72
8.6.
写校验......................................................................................................................... 72
8.7.
FLASH 内容保护......................................................................................................... 72
8.8.
与 EEPROM 相关寄存器汇总 ..................................................................................... 73
8.8.1.
EEDAT 寄存器，地址 0x193, 0x194 .......................................................... 73
8.8.2.
EEADR 寄存器，地址 0x191, 0x192 .......................................................... 74
rev1.05
-6-
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9.
FT61F08X
8.8.3.
EECON1 寄存器，地址 0x195 ................................................................... 75
8.8.4.
EECON2 寄存器，地址 0x196 ................................................................... 76
8.8.5.
EECON3 寄存器，地址 0x198 ................................................................... 76
8.8.6.
EECON4 寄存器，地址 0x391 ................................................................... 77
12bit ADC 模块 ...................................................................................................................... 78
9.1
9.2
ADC 的配置 ................................................................................................................ 79
9.1.1
校准 ADC ................................................................................................... 79
9.1.2
端口配置 ..................................................................................................... 79
9.1.3
通道选择 ..................................................................................................... 79
9.1.4
触发方式选择.............................................................................................. 80
9.1.5
触发源选择 ................................................................................................. 80
9.1.6
触发类型选择.............................................................................................. 80
9.1.7
触发延时配置.............................................................................................. 80
9.1.8
ADC 参考电压 ............................................................................................ 80
9.1.9
转换时钟 ..................................................................................................... 81
9.1.10
中断 ............................................................................................................ 82
9.1.11
转换结果的格式 .......................................................................................... 83
9.1.12
阈值比较 ..................................................................................................... 83
ADC 的工作原理 ......................................................................................................... 84
9.2.1
启动自动校准.............................................................................................. 84
9.2.2
启动转换 ..................................................................................................... 84
9.2.3
转换完成 ..................................................................................................... 84
9.2.4
终止转换 ..................................................................................................... 84
9.2.5
休眠模式下 ADC 的工作 ............................................................................. 85
9.2.6
外部触发器 ................................................................................................. 85
9.2.7
A/D 转换步骤 .............................................................................................. 86
9.3
A/D 采集时间要求 ....................................................................................................... 87
9.4
与 ADC 相关寄存器汇总 ............................................................................................. 88
9.4.1
ADRESL，地址 0x9B ................................................................................. 89
9.4.2
ADRESH，地址 0x9C ................................................................................ 89
rev1.05
-7-
2020-5-29
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FT61F08X
9.4.3
ADCON0，地址 0x9D ................................................................................ 90
9.4.4
ADCON1，地址 0x9E ................................................................................ 91
9.4.5
ADCON2，地址 0x9F ................................................................................ 92
9.4.6
ADDLY/LEBPRL，地址 0x1F ..................................................................... 93
9.4.7
ADCON3，地址 0x41A .............................................................................. 93
9.4.8
ADCMPH，地址 0x41B .............................................................................. 94
10. 高级定时器 TIM1 .................................................................................................................... 95
10.1. 特性 ............................................................................................................................ 95
10.2. 原理框图 ..................................................................................................................... 95
10.3. 功能描述 ..................................................................................................................... 96
10.3.1.
计数基本单元.............................................................................................. 96
10.3.2.
计数控制器 ............................................................................................... 105
10.3.3.
捕捉比较通道............................................................................................ 110
10.3.4.
TIM1 中断 ................................................................................................. 123
10.3.5.
故障刹车源 ............................................................................................... 123
10.3.6.
前沿消隐 ................................................................................................... 125
10.4. 与 TIM1 相关寄存器汇总 ........................................................................................... 126
10.4.1.
TIM1CR1，地址：0x211.......................................................................... 127
10.4.2.
TIM1SMCR，地址：0x213 ...................................................................... 128
10.4.3.
TIM1IER，地址：0x215 ........................................................................... 129
10.4.4.
TIM1SR1，地址：0x216 .......................................................................... 130
10.4.5.
TIM1SR2，地址：0x217 .......................................................................... 131
10.4.6.
TIM1EGR，地址：0x218 ......................................................................... 131
10.4.7.
TIM1CCMR1，地址：0x219 .................................................................... 132
10.4.8.
TIM1CCMR2，地址：0x21A .................................................................... 134
10.4.9.
TIM1CCMR3，地址：0x21B .................................................................... 135
10.4.10. TIM1CCMR4，地址：0x21C ................................................................... 136
10.4.11. TIM1CCER1，地址：0x21D .................................................................... 137
10.4.12. TIM1CCER2，地址：0x21E .................................................................... 138
10.4.13. TIM1CNTRH，地址：0x28C.................................................................... 138
rev1.05
-8-
2020-5-29
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FT61F08X
10.4.14. TIM1CNTRL，地址：0x28D .................................................................... 138
10.4.15. TIM1PSCRH，地址：0x28E .................................................................... 138
10.4.16. TIM1PSCRL，地址：0x28F..................................................................... 139
10.4.17. TIM1ARRH，地址：0x290....................................................................... 139
10.4.18. TIM1ARRL，地址：0x291 ....................................................................... 139
10.4.19. TIM1RCR，地址：0x292 ......................................................................... 140
10.4.20. TIM1CCR1H，地址：0x293 .................................................................... 140
10.4.21. TIM1CCR1L，地址：0x294 ..................................................................... 140
10.4.22. TIM1CCR2H，地址：0x295 .................................................................... 141
10.4.23. TIM1CCR2L，地址：0x296 ..................................................................... 141
10.4.24. TIM1CCR3H，地址：0x297 .................................................................... 141
10.4.25. TIM1CCR3L，地址：0x298 ..................................................................... 142
10.4.26. TIM1CCR4H，地址：0x299 .................................................................... 142
10.4.27. TIM1CCR4L，地址：0x29A..................................................................... 142
10.4.28. TIM1BKR，地址：0x29B ......................................................................... 143
10.4.29. TIM1DTR，地址：0x29C ......................................................................... 144
10.4.30. TIM1OISR，地址：0x29D ....................................................................... 144
10.4.31. LEBCON 寄存器，地址 0x41C ................................................................. 145
11. 通用定时器 TIM2 .................................................................................................................. 146
11.1. 特性 .......................................................................................................................... 146
11.2. 原理框图 ................................................................................................................... 146
11.3. 功能描述 ................................................................................................................... 147
11.3.1.
计数基本单元............................................................................................ 147
11.3.2.
捕捉比较通道............................................................................................ 148
11.3.3.
TIM2 中断 ................................................................................................. 150
11.4. 与 TIM2 相关寄存器汇总 ........................................................................................... 150
11.4.1.
TIM2CR1，地址 0x30C ............................................................................ 151
11.4.2.
TIM2IER，地址 0x30D ............................................................................. 151
11.4.3.
TIM2SR1，地址 0x30E ............................................................................ 152
11.4.4.
TIM2SR2，地址 0x30F ............................................................................ 152
rev1.05
-9-
2020-5-29
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FT61F08X
11.4.5.
TIM2EGR，地址 0x310 ............................................................................ 153
11.4.6.
TIM2CCMR1，地址 0x311 ....................................................................... 154
11.4.7.
TIM2CCMR2，地址 0x312 ....................................................................... 156
11.4.8.
TIM2CCMR3，地址 0x313 ....................................................................... 157
11.4.9.
TIM2CCER1，地址 0x314 ....................................................................... 158
11.4.10. TIM2CCER2，地址 0x315 ....................................................................... 158
11.4.11. TIM2CNTRH，地址 0x316 ....................................................................... 159
11.4.12. TIM2CNTRL，地址 0x317 ....................................................................... 159
11.4.13. TIM2PSCR，地址 0x318 ......................................................................... 159
11.4.14. TIM2ARRH，地址 0x319 ......................................................................... 159
11.4.15. TIM2ARRL，地址 0x31A ......................................................................... 160
11.4.16. TIM2CCR1H，地址 0x31B ....................................................................... 160
11.4.17. TIM2CCR1L，地址 0x31C ....................................................................... 160
11.4.18. TIM2CCR2H，地址 0x31D ...................................................................... 161
11.4.19. TIM2CCR2L，地址 0x31E ....................................................................... 161
11.4.20. TIM2CCR3H，地址 0x29E ....................................................................... 161
11.4.21. TIM2CCR3L，地址 0x29F ....................................................................... 161
12. 基本定时器 TIM4 .................................................................................................................. 162
12.1. 特性 .......................................................................................................................... 162
12.2. 原理框图 ................................................................................................................... 162
12.3. TIM4 时钟源.............................................................................................................. 162
12.4. 预分频器 ................................................................................................................... 162
12.5. TIM4 中断 ................................................................................................................. 163
12.6. TIM4 寄存器表 .......................................................................................................... 163
12.6.1.
TIM4CR1，地址 0x111 ............................................................................ 164
12.6.2.
TIM4IER，地址 0x112 ............................................................................. 164
12.6.3.
TIM4SR，地址 0x113 .............................................................................. 165
12.6.4.
TIM4EGR，地址 0x114 ............................................................................ 165
12.6.5.
TIM4CNTR，地址 0x115 ......................................................................... 165
12.6.6.
TIM4PSCR，地址 0x116 ......................................................................... 166
rev1.05
- 10 -
2020-5-29
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12.6.7.
FT61F08X
TIM4ARR，地址 0x117 ............................................................................ 166
13. SPI 接口 ............................................................................................................................... 167
13.1. 功能特性 ................................................................................................................... 167
13.2. 功能描述 ................................................................................................................... 167
13.2.1.
一般描述 ................................................................................................... 167
13.2.2.
配置 SPI ................................................................................................... 170
13.2.3.
数据处理流程............................................................................................ 170
13.2.4.
睡眠模式唤醒............................................................................................ 171
13.2.5.
CRC 处理流程 .......................................................................................... 172
13.3. 与 SPI 相关寄存器汇总 ............................................................................................. 172
13.3.1.
SPIDATA 寄存器，地址 0x015 ................................................................. 173
13.3.2.
SPICTRL 寄存器，地址 0x016 ................................................................. 173
13.3.3.
SPICFG 寄存器，地址 0x017 ................................................................... 174
13.3.4.
SPISCR 寄存器，地址 0x018 ................................................................... 175
13.3.5.
SPICRCPOL 寄存器，地址 0x019 ........................................................... 175
13.3.6.
SPIRXCRC 寄存器，地址 0x01A ............................................................. 175
13.3.7.
SPITXCRC 寄存器，地址 0x01B ............................................................. 176
13.3.8.
SPIIER 寄存器，地址 0x01C.................................................................... 176
13.3.9.
SPICTRL2 寄存器，地址 0x01D .............................................................. 177
13.3.10. SPISTAT 寄存器，地址 0x01E ................................................................. 178
14. I2C 接口 ............................................................................................................................... 179
14.1. I2C 的工作原理 ......................................................................................................... 179
14.1.1.
主机发送 ................................................................................................... 180
14.1.2.
主机接收 ................................................................................................... 181
14.1.3.
从机发送 ................................................................................................... 182
14.1.4.
从机接收 ................................................................................................... 183
14.1.5.
General Call ............................................................................................. 183
14.2. 与 I2C 相关寄存器汇总 ............................................................................................. 184
14.2.1.
I2CCR1 寄存器，地址 0x40C ................................................................... 184
14.2.2.
I2CCR2 寄存器，地址 0x40D ................................................................... 185
rev1.05
- 11 -
2020-5-29
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FT61F08X
14.2.3.
I2CCR3 寄存器，地址 0x40E ................................................................... 186
14.2.4.
I2COARL 寄存器，地址 0x40F ................................................................ 186
14.2.5.
I2COARH 寄存器，地址 0x410 ................................................................ 186
14.2.6.
I2CFREQ 寄存器，地址 0x411 ................................................................ 187
14.2.7.
I2CDR 寄存器，地址 0x412 ..................................................................... 187
14.2.8.
I2CCMD 寄存器，地址 0x413 .................................................................. 188
14.2.9.
I2CCCRL 寄存器，地址 0x414 ................................................................. 188
14.2.10. I2CCCRH 寄存器，地址 0x415 ................................................................ 189
14.2.11. I2CITR 寄存器，地址 0x416..................................................................... 190
14.2.12. I2CSR1 寄存器，地址 0x417 ................................................................... 191
14.2.13. I2CSR2 寄存器，地址 0x418 ................................................................... 192
14.2.14. I2CSR3 寄存器，地址 0x419 ................................................................... 193
15. USART 接口 ......................................................................................................................... 194
15.1. 功能特性 ................................................................................................................... 194
15.2. 功能描述 ................................................................................................................... 195
15.2.1.
一般描述 ................................................................................................... 195
15.2.2.
异步工作模式............................................................................................ 196
15.2.3.
同步工作模式............................................................................................ 197
15.2.4.
半双工模式 ............................................................................................... 197
15.2.5.
红外工作模式............................................................................................ 198
15.2.6.
智能卡模式 ............................................................................................... 199
15.2.7.
LIN Master 模式 ....................................................................................... 200
15.2.8.
多芯片通信模式 ........................................................................................ 201
15.2.9.
自动波特率检测 ........................................................................................ 202
15.3. 与 USART 相关寄存器汇总 ....................................................................................... 203
15.3.1.
URDATAL 寄存器，地址 0x48C............................................................... 203
15.3.2.
URDATAH 寄存器，地址 0x48D .............................................................. 203
15.3.3.
URIER 寄存器，地址 0x48E .................................................................... 204
15.3.4.
URLCR 寄存器，地址 0x48F ................................................................... 205
15.3.5.
URLCREXT 寄存器，地址 0x490 ............................................................. 205
rev1.05
- 12 -
2020-5-29
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FT61F08X
15.3.6.
URMCR 寄存器，地址 0x491 ................................................................... 206
15.3.7.
URLSR 寄存器，地址 0x492 .................................................................... 207
15.3.8.
URRAR 寄存器，地址 0x493 ................................................................... 208
15.3.9.
URDLL 寄存器，地址 0x494 .................................................................... 208
15.3.10. URDLH 寄存器，地址 0x495 .................................................................... 208
15.3.11. URABCR 寄存器，地址 0x496 ................................................................. 209
15.3.12. URSYNCR 寄存器，地址 0x497 .............................................................. 209
15.3.13. URLINCR 寄存器，地址 0x498 ................................................................ 210
15.3.14. URSDCR0 寄存器，地址 0x499 ............................................................... 210
15.3.15. URSDCR1 寄存器，地址 0x49A .............................................................. 211
15.3.16. URSDCR2 寄存器，地址 0x49B .............................................................. 211
15.3.17. URTC 寄存器，地址 0x49C ..................................................................... 211
16. GPIO .................................................................................................................................... 212
16.1. 端口和 TRIS 寄存器 .................................................................................................. 213
16.2. 弱上拉....................................................................................................................... 213
16.3. 弱下拉....................................................................................................................... 213
16.4. 开漏输出 ................................................................................................................... 213
16.5. ANSELA 寄存器 ....................................................................................................... 214
16.6. 源电流选择 ............................................................................................................... 214
16.7. 灌电流选择 ............................................................................................................... 214
16.8. 管脚输出的优先级 ..................................................................................................... 214
16.9. PORTx 功能及优先级 ............................................................................................... 215
16.10. 管脚功能重映射 ........................................................................................................ 216
16.11. 外部中断 ................................................................................................................... 216
16.12. 关于读端口 PORTx ................................................................................................... 217
16.13. 与端口相关寄存器汇总 ............................................................................................. 219
16.13.1. PSRC0，地址 0x11A ............................................................................... 220
16.13.2. PSRC1，地址 0x11B ............................................................................... 220
16.13.3. PSINK0，地址 0x19A .............................................................................. 220
16.13.4. PSINK1，地址 0x19B .............................................................................. 221
rev1.05
- 13 -
2020-5-29
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FT61F08X
16.13.5. PSINK2，地址 0x19C .............................................................................. 221
16.13.6. PSINK3，地址 0x19D .............................................................................. 221
16.13.7. ITYPE0，地址 0x11E ............................................................................... 222
16.13.8. ITYPE1，地址 0x11F ............................................................................... 222
16.13.9. AFP0，地址 0x19E .................................................................................. 223
16.13.10. AFP1，地址 0x19F .................................................................................. 223
16.13.11. AFP2，地址 0x11D .................................................................................. 224
16.13.12. EPS0，地址 0x118 .................................................................................. 224
16.13.13. EPS1，地址 0x119 .................................................................................. 225
16.13.14. EPIF0，地址 0x14 .................................................................................... 225
16.13.15. EPIE0，地址 0x94 ................................................................................... 226
16.13.16. ODCON0，地址 0x21F ............................................................................ 226
16.13.17. PORTx，地址 0x0C, 0D, 0E, 0F .............................................................. 226
16.13.18. TRISx，地址 0x8C, 8D, 8E, 8F ................................................................ 227
16.13.19. LATx，地址 0x10C, 10D, 10E, 10F ......................................................... 227
16.13.20. WPUx，地址 0x18C, 18D, 18E, 18F ........................................................ 227
16.13.21. WPDx，地址 0x20C, 20D, 20E, 20F ........................................................ 228
16.13.22. ANSELA，地址 0x197 ............................................................................. 228
17. 看门狗定时器 ....................................................................................................................... 229
17.1. 看门狗时钟源 ............................................................................................................ 230
17.2. 与看门狗相关寄存器汇总 .......................................................................................... 230
17.2.1.
WDTCON 寄存器，地址 0x97 .................................................................. 231
17.2.2.
MISC0 寄存器，地址 0x11C .................................................................... 232
18. 慢时钟测量 ........................................................................................................................... 233
18.1. 测量原理 ................................................................................................................... 233
18.2. 上电自动测量 ............................................................................................................ 234
18.3. 操作步骤 ................................................................................................................... 235
18.4. 与慢时钟测量相关寄存器汇总 ................................................................................... 235
18.4.1.
MSCKCON 寄存器，地址 0x41D ............................................................. 236
18.4.2.
SOSCPR 寄存器，地址 0x41E，41F ....................................................... 236
rev1.05
- 14 -
2020-5-29
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FT61F08X
19. 指令集汇总 ........................................................................................................................... 237
19.1. 读-修改-写（RMW）指令 ......................................................................................... 238
19.1. 指令详细描述 ............................................................................................................ 239
20. 芯片的电气特性 .................................................................................................................... 249
20.1. 极限参数 ................................................................................................................... 249
20.2. 内置高频振荡器（HIRC） ........................................................................................ 249
20.3. 内置低频振荡器（LIRC） ......................................................................................... 249
20.4. 低电压复位电路（LVR） .......................................................................................... 250
20.5. 低电压侦测电路（LVD） .......................................................................................... 250
20.6. 上电复位电路（POR） ............................................................................................. 250
20.7. I/O PAD 电路 ............................................................................................................ 251
20.8. 总体工作电流（IDD） ................................................................................................ 251
20.9. AC 电气参数 ............................................................................................................. 252
20.10. 12bit ADC 特性 ......................................................................................................... 253
20.11. 存储器编程特性 ........................................................................................................ 254
20.12. 直流和交流特性曲线图 ............................................................................................. 254
20.12.1. HIRC vs VDD ( TA=25°C ) ......................................................................... 254
20.12.2. LIRC vs VDD ( TA=25°C ) .......................................................................... 255
20.12.3. 不同 VDD 下， IDD vs Freq ( 1T, TA=25°C ) ............................................... 255
20.12.4. 不同 VDD 下， IDD vs Freq ( 2T, TA=25°C ) ............................................... 256
20.12.5. 不同 VDD 下，ISB (睡眠电流) 随温度变化曲线 ........................................... 256
20.12.6. 不同温度下，IOH ( level -2mA ) vs VOH @VDD=5V..................................... 257
20.12.7. 不同温度下，IOH ( level -4mA ) vs VOH @VDD=5V..................................... 257
20.12.8. 不同温度下，IOH ( level -14mA ) vs VOH @VDD=5V................................... 258
20.12.9. 不同温度下，IOH ( level -26mA ) vs VOH @VDD=5V................................... 258
20.12.10. 不同温度下，IOL ( L0 ) vs VOL @VDD=5V .................................................. 259
20.12.11. 不同温度下，IOL ( L1) vs VOL @VDD=5V ................................................... 259
21. 芯片封装信息 ....................................................................................................................... 260
附录 1，文档更改历史 ................................................................................................................. 266
rev1.05
- 15 -
2020-5-29
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FT61F08X
1. 系统功能框图及脚位
POR_RSTN
BOR_RSTN
IRCCK
CLKC
EC/XTCK
IO_CTRL
SRAM
1KB
TIMx
RSTC/OST/
PWRT/BOOT
SFR_BUS
SFR
SFR_BUS
STALL
ADC
CFG
PDAT
PADDR
CPU
PWM
EEADDR
USART
EEWDAT
EDAT
SPI
IO
I2C
DROM
256B
FLASH
8 Kw
EPI
ADDR & WDAT BUS
CTRL BUS
SCK
OCD
SDA
CMDs
Note: 1 word= 14 bits here.
图 1.1 芯片整体功能框图
rev1.05
- 16 -
2020-5-29
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FT61F08X
1.1. 脚位图
GND
1
24
VDD
SPI_NSS/TIM2_CH3/VREFP/PB5
2
23
PB6/VREFN/ISPDAT/[UART_TX]/[I2C_SDA]
TIM1_CH3/PB4
3
TIM1_BKIN/I2C_SDA/PB3
4
[ADC_ETR]/I2C_SCL/PB2
5
TIM1_ETR/PC4
6
[TIM1_CH3N]/PC5
7
[TIM1_CH2N]/PC6
8
[UART_CK]/[TIM1_CH1]/PD1
9
[TIM1_CH2]/PD2
10
[SPI_SCK]/[TIM1_CH3]/PD3
11
FT61F086A-RB 22
FT61F086E-RB
21
(SOP24)
20
FT61F086-ERB 19
FT61F086E-ERB
18
(SSOP24)
17
FT61F086-TRB 16
FT61F086E-TRB
15
(TSSOP24)
14
CLKO/TIM1_CH4/AN7/PB1
12
13
PB7/AN0/OSC2/[SPI_MOSI]/ELVD3
PC1/AN1/OSC1/[SPI_MISO]/ELVD2
PC0/AN2/ELVD1/MCLRB/TIM1_CH1N
PA7/UART_RX/AN3/ELVD0
PA6/UART_TX/AN4
PA4/AN5/TIM2_CH2/ADC_ETR
PA2/ISPCK/[I2C_SCL]/[UART_RX]
PA1/SPI_MISO/TIM1_CH2
PA0/SPI_MOSI/TIM1_CH1
PB0/SPI_SCK/TIM1_CH3N/[TIM2_CH1]
图 1.2 SOP24/SSOP24/TSSOP24 脚位
注意：以上 SOP24/SSOP24/TSSOP24 脚位中，PC7 是内部接地的，使用时请勿输出高或上拉。
ADC_ETR/TIM2_CH2/AN5/PA4
1
28
PA3/AN6/TIM1_CH2N
TIM2_CH1/UART_CK/PA5
2
27
NC
AN4/UART_TX/PA6
3
26
PA2/ISPCK/[I2C_SCL]/[UART_RX]
ELVD0/AN3/UART_RX/PA7
4
25
PB6/VREFN/ISPDAT/[UART_TX]/[I2C_SDA]
[TIM1_CH4]/PD5
5
24
VDD
TIM1_CH1N/MCLRB/ELVD1/AN2/PC0
6
23
PA1/SPI_MISO/TIM1_CH2
ELVD2/[SPI_MISO]/OSC1/AN1/PC1
7
PA0/SPI_MOSI/TIM1_CH1
ELVD3/[SPI_MOSI]/OSC2/AN0/PB7
8
FT61F087-RB 22
21
SOP28
TIM1_CH3/PB4
9
20
PB0/SPI_SCK/TIM1_CH3N/[TIM2_CH1]
PC3
10
19
PB1/AN7/TIM1_CH4/CLKO
TIM1_BKIN/I2C_SDA/PB3
11
18
PD3/[TIM1_CH3]/[SPI_SCK]
[ADC_ETR]/I2C_SCL/PB2
12
17
PD1/[TIM1_CH1]/[UART_CK]
TIM1_ETR/PC4
13
16
PD0/[SPI_NSS]
[TIM1_CH3N]/PC5
14
15
PC6/[TIM1_CH2N]
GND
图 1.3 SOP28 脚位 1
ADC_ETR/TIM2_CH2/AN5/PA4
1
28
PA3/AN6/TIM1_CH2N
TIM2_CH1/UART_CK/PA5
2
27
PD4/[TIM1_BKIN]/[CLKO]
AN4/UART_TX/PA6
3
26
PA2/ISPCK/[I2C_SCL]/[UART_RX]
ELVD0/AN3/UART_RX/PA7
4
25
PB6/VREFN/ISPDAT/[UART_TX]/[I2C_SDA]
[TIM1_CH4]/PD5
5
24
VDD
TIM1_CH1N/MCLRB/ELVD1/AN2/PC0
6
23
PA1/SPI_MISO/TIM1_CH2
7 FT61F087E-RB 22
8
21
SOP28
PA0/SPI_MOSI/TIM1_CH1
9
20
PB0/SPI_SCK/TIM1_CH3N/[TIM2_CH1]
PC3
10
19
PB1/AN7/TIM1_CH4/CLKO
TIM1_BKIN/I2C_SDA/PB3
11
18
PD3/[TIM1_CH3]/[SPI_SCK]
[ADC_ETR]/I2C_SCL/PB2
12
17
PD1/[TIM1_CH1]/[UART_CK]
TIM1_ETR/PC4
13
16
PD0/[SPI_NSS]
[TIM1_CH3N]/PC5
14
15
PC6/[TIM1_CH2N]
ELVD2/[SPI_MISO]/OSC1/AN1/PC1
ELVD3/[SPI_MOSI]/OSC2/AN0/PB7
TIM1_CH3/PB4
GND
图 1.4 SOP28 脚位 2
rev1.05
- 17 -
2020-5-29
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FT61F08X
[CLKO]/[TIM1_BKIN]/PD4
1
28
PA2/ISPCK/[I2C_SCL]/[UART_RX]
TIM1_CH2N/AN6/PA3
2
27
PB6/VREFN/ISPDAT/[UART_TX]/[I2C_SDA]
ADC_ETR/TIM2_CH2/AN5/PA4
3
26
PB4/TIM1_CH3
TIM2_CH1/UART_CK/PA5
4
25
PC3
[AT0]/AN4/UART_TX/PA6
5
24
PC4/TIM1_ETR
[AT1]/ELVD0/AN3/UART_RX/PA7
6
23
PC5/[TIM1_CH3N]
7 FT61F087-ERB 22
8
21
SSOP28
PC6/[TIM1_CH2N]
ELVD2/[SPI_MISO]/OSC1/AN1/PC1
9
20
VDD
ELVD3/[SPI_MOSI]/OSC2/AN0/PB7
10
19
GND
SPI_NSS/TIM2_CH3/VREFP/PB5
11
18
PA0/SPI_MOSI/TIM1_CH1
[TIM1_CH1N]/PC7
12
17
PB1/AN7/TIM1_CH4/CLKO
[SPI_NSS]/PD0
13
16
PD3/[TIM1_CH3]/[SPI_SCK]
[UART_CK]/[TIM1_CH1]/PD1
14
15
PD2/[TIM1_CH2]
TIM1_CH1N/MCLRB/ELVD1/AN2/PC0
GND
PB3/I2C_SDA/TIM1_BKIN
PD5/[TIM1_CH4]
PA7/UART_RX/AN3/ELVD0
PA6/UART_TX/AN4
PA5/UART_CK/TIM2_CH1
PA4/AN5/TIM2_CH2/ADC_ETR
PA3/AN6/TIM1_CH2N
PA2/ISPCK/[I2C_SCL]/[UART_RX]
PD4/[TIM1_BKIN]/[CLKO]
图 1.5 SSOP28 脚位
32 31 30 29 28 27 26 25
TIM1_CH1N/MCLRB/ELVD1/AN2/PC0
ELVD2/[SPI_MISO]/OSC1/AN1/PC1
ELVD3/[SPI_MOSI]/OSC2/AN0/PB7
GND
[I2C_SDA]/[UART_TX]/ISPDAT/VREFN/PB6
VDD
SPI_NSS/TIM2_CH3/VREFP/PB5
PC2
1
2
3
4
5
6
7
8
FT61F088-LRB
FT61F088E-LRB
LQFP32
24
23
22
21
20
19
18
17
PA1/SPI_MISO/TIM1_CH2
PA0/SPI_MOSI/TIM1_CH1
PB0/SPI_SCK/TIM1_CH3N/[TIM2_CH1]
PB1/AN7/TIM1_CH4/CLKO
PD3/[TIM1_CH3]/[SPI_SCK]
PD2/[TIM1_CH2]
PD1/[TIM1_CH1]/[UART_CK]
PD0/[SPI_NSS]
9 10 11 12 13 14 15 16
PC7/[TIM1_CH1N]
PC6/[TIM1_CH2N]
PC5/[TIM1_CH3N]
PC4/TIM1_ETR
PB2/I2C_SCL/[ADC_ETR]
PB3/I2C_SDA/TIM1_BKIN
PC3
PB4/TIM1_CH3
图 1.6 LQFP32 脚位
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1.2. 管脚描述
INT
HS
Main
input
output
func.
IO
√
√
PC0
TIM1_CH1N
PC1/AN1/OSC1/[SPI_MISO]/ELVD2
IO
√
√
PC1
SPI_MISO
3
PB7/AN0/OSC2/[SPI_MOSI]/ELVD3
IO
√
√
PB7
SPI_MOSI
4
GND
Ground
—
—
5
PB6/ISPDAT/[I2C_SDA]/[UART_TX]
IO
√
√
6
VDD
Supply
—
—
7
PB5/TIM2_CH3/SPI_NSS
IO
√
√
PB5
TIM2_CH3
8
PC2
IO
√
√
PC2
—
9
PB4/TIM1_CH3
IO
√
√
PB4
TIM1_CH3
10
PC3
IO
√
√
PC3
—
11
PB3/I2C_SDA/TIM1_BKIN
IO
√
√
PB3
I2C_SDA
12
PB2/I2C_SCL/[ADC_ETR]
IO
√
√
PB2
I2C_SCL
13
PC4/TIM1_ETR
IO
√
√
PC4
TIM1_ETR
14
PC5/[TIM1_CH3N]
IO
√
√
PC5
TIM1_CH3N
15
PC6/[TIM1_CH2N]
IO
√
√
PC6
TIM1_CH2N
16
PC7/[TIM1_CH1N]
IO
√
√
PC7
TIM1_CH1N
17
PD0/[SPI_NSS]
IO
√
√
PD0
SPI_NSS
18
PD1/[TIM1_CH1]/[UART_CK]
IO
√
√
PD1
TIM1_CH1
19
PD2/[TIM1_CH2]
IO
√
√
PD2
TIM1_CH2
20
PD3/[TIM1_CH3]/[SPI_SCK]
IO
√
√
PD3
TIM1_CH3
21
PB1/TIM1_CH4/CLKO/AN7
IO
√
√
PB1
TIM1_CH4
22
PB0/SPI_SCK/TIM1_CH3N/[TIM2_CH1]
IO
√
√
PB0
SPI_SCK
23
PA0/SPI_MOSI/TIM1_CH1
IO
√
√
PA0
SPI_MOSI
24
PA1/SPI_MISO/TIM1_CH2
IO
√
√
PA1
SPI_MISO
25
PD4/[TIM1_BKIN]/[CLKO]
IO
√
√
PD4
TIM1_BKIN
26
PA2/ISPCK/[I2C_SCL]/[UART_RX]
IO
√
√
PA2
I2C_SCL
27
PA3/AN6/TIM1_CH2N
IO
√
√
PA3
AN6
28
PA4/AN5/TIM2_CH2/ADC_ETR
IO
√
√
PA4
AN5
29
PA5/VREF/UART_CK/TIM2_CH1
IO
√
√
PA5
UART_CK
30
PA6/UART_TX/AN4
IO
√
√
PA6
UART_TX
31
PA7/UART_RX/AN3/ELVD0
IO
√
√
PA7
UART_RX
32
PD5/[TIM1_CH4]
IO
√
√
PD5
TIM1_CH4
LQFP32
Pin name
Type
1
PC0/AN2/MCLRB/TIM1_CH1N/ELVD1
2
Default AF
Ground
PB6
I2C_SDA
Power
注释：
INT input: 中断输入；HS output: 可编程灌电流输出
Main func: 管脚主要功能
Default AF: 管脚第二功能映射
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2. 程序存储器
0x0000
Implemented
0x8000
0x8001
0x8002
0x8003
...
0x8040
0x8041
0x8042
...
0x8060
0x8061
...
0x8080
...
0x80FF
UCFG0
UCFG1
UCFG2
...
...
FCFG0
FCFG1
FCFG2
...
...
...
FMD INFO0
...
FMD INFO1
0x1FFF
0x2000
USER
Main
Area
Reserved
Not Implemented
FACT&
INFO
0x7FFF
0x8000
Implemented
0x80FF
USER/
FACT/
INFO
Pages
图 1.4 程序存储区地址空间
程序地址计数器 PC 为 15 位(0x0000 ~ 0x7FFF)，最多支持 32k 地址空间。芯片实现了 8k 的程序存储器
（0x0000 ~ 0x1FFF），外加上 2 个额外的用户配置区，工厂配置区，以及 2 个信息区 INFO0/INFO1。
8k 程序存储器由 128 页组成，每页 64 个 word（1word= 14bits），地址范围为 0x0000~0x1FFF，当程
序地址超过 0x1FFF 将导致回卷到 0x0000。
另外的 4 个 NVM 区分别占一个单独的页，每页 64 word，其编址从 0x8000 开始，到 0x80FF 结束。
2.1. 将程序存储器当作数据存储器读取
有两种方法可访问程序存储器中的常数。第一种方法是使用 RETW 指令表。第二种方法是设置 FSR 指
向程序存储器。
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2.1.1. RETW 指令
RETW 指令用于提供对常数表的访问。
例 2.1 给出了创建这种表的推荐方法。
Constants ; example 2.1
BRW ;Add Index in W to program counter to ;select data
RETW DATA0 ;Index0 data
RETW DATA1 ;Index1 data
RETW DATA2
RETW DATA3
my_function
;… LOTS OF CODE…
LDWI DATA_INDEX
call constants
; THE CONSTANT IS IN W
BRW 指令使得这种类型的表实现起来非常简单。如果代码必须保持与前几代单片机之间的可移植性，则
BRW 指令不适用，因此必须使用较老的表读取方法。
2.1.2. 使用 FSR 间接读取
可将程序存储器当作数据存储器进行访问，方法是将 FSRxH 寄存器的 bit7 置 1 并读取与之配对的 INDFx
寄存器。MOVIW 指令会将已寻址到的字的低 8 位保存在 W 寄存器中。无法通过 INDF 寄存器执行写
程序存储器操作。通过 FSR 访问程序存储器的指令需要一个额外的指令周期才能完成。例 2.2 演示了通
过 FSR 访问程序存储器的过程。
如果标号指向程序存储器中的单元，HIGH 伪指令将 bit置 1。
constants
; example 2.2
RETW DATA0 ; Index0 data
RETW DATA1 ; Index1 data
RETW DATA2
RETW DATA3
my_function
;… LOTS OF CODE…
LDWI LOW constants
STR FSR1L
LDWI HIGH constants
STR FSR1H
MOVIW 0[FSR1] ; THE PROGRAM MEMORY IS IN W
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3. 数据存储器
3.1. 数据存储器构成
数据存储器划分为 32 存储区，每个存储区大小为 128 个字节，每个存储区由以下部分组成：
12 个内核寄存器
最多 20 个特殊功能寄存器
最多 80 字节的通用 RAM
16 字节的共用 RAM
可通过将存储区号写入存储区选择寄存器（Bank Select Register，BSREG）来选择有效存储区。未实
现的存储器将读为 0。所有的数据存储器都可以直接访问（通过使用文件寄存器的指令），或通过 2 个文
件选择寄存器（FSR）间接访问。更多信息，请参见第 3.4 节“间接寻址”。
数据存储器使用一个 12 位地址。地址的高 5 位用于定义存储区地址，低 7 位用于选择该存储区中的寄
存器/RAM。
存储区（页）划分：
地址
BANKx
0x000
内核寄存器，12个字节
0x00B
0x00C
SFR，20个字节
0x01F
0x020
SRAM，80个字节
0x06F
0x070
共用RAM，16个字节
0x07F
图 3.1 存储区构成
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3.1.1. 内核寄存器
内核寄存器包含直接影响 MCU 基本操作的寄存器。这些寄存器包括：
INDF0
INDF1
PCL
STATUS
FSR0 低字节
FSR0 高字节
FSR1 低字节
FSR1 高字节
BSREG
WREG
PCLATH
INTCON
注：内核寄存器位于数据存储器每个存储区的前 12 个地址单元。
3.1.2. 状态寄存器
如寄存器 3.1 所示，状态（STATUS）寄存器包含：
ALU 的算术运算状态
复位状态
数据存储器（SRAM）的存储区选择位
和其他寄存器一样，状态寄存器也可以作为任何指令的目标寄存器。如果一条影响 Z、DC 或 C 位的指
令以状态寄存器作为目标寄存器，将禁止写这三位。根据器件逻辑，这些位会被置 1 或清零。 此外，
也不能写 TO 和 PD 位。因此，当执行一条把状态寄存器作为目标寄存器的指令后，状态寄存器的结果可
能和预想的不一样。
例如，执行 CLRR STATUS 指令会清零该寄存器的高 3 位并将 Z 位置 1。从而使状态寄存器的值为
“000uu1uu”（其中 u 表示不变）。
因此，建议仅使用 BCR、BSR、SWAPR 和 STR 指令来改变状态寄存器，因为这些指令不影响任何状
态位。欲知其他不会影响任何状态位的指令，请参见“指令集汇总”。
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寄存器 3.1 STATUS 寄存器
Bit
7
6
5
4
3
2
1
0
Name
—
/TO
/PD
Z
DC
C
Reset
NA
1
1
x
x
x
Type
RO-0
RO
RO
RW
RW
RW
Bit
Name
7:5
NA
Function
未实现，读 0
超时标志位
4
/TO
1 = 在上电后，执行了CLRWDT指令或SLEEP指令
0 = 发生了 WDT 超时
掉电标志位
3
/PD
1 = 上电复位后或执行了CLRWDT指令
0 = 执行了 SLEEP 指令
零状态位
2
Z
1 = 算术运算或逻辑运算结果为零
0 = 算术运算或逻辑运算结果不为零
半进位/ 半借位标志位（ADDWR、ADDWI、SUBWI 和SUBWR指令） (1)
1
DC
1 = 结果的第4个低位向高位发生了进位
0 = 结果的第 4 个低位未向高位发生进位
进位/借位标志位(1) （ADDWR、ADDWI、SUBWI 和SUBWR指令） (1)
0
C
1 = 结果的最高位发生了进位
0 = 结果的最高位未发生进位
注意：
1. 对于借位 C，极性是相反的。减法指令通过加上第二个操作数的二进制补码实现。对于移位指令（RRF
和 RLF），此位值来自源寄存器的最高位或最低位。
3.2. 特殊功能寄存器
特殊功能寄存器是应用程序用来控制器件中外设功能所需操作的寄存器。与外设操作有关的寄存器将在
本数据手册中的相应外设章节中讲述。
3.2.1. 通用 RAM
数据存储器的每个存储区中的 GPR 最多有 80 个字节。
3.2.2. GPR 的线性访问
可以通过 FSR 以非分区方法访问通用 RAM。这可以简化对大存储器结构的访问。更多信息，请参见第
3.6.2 节“线性数据存储器”。
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3.2.3. 公共 RAM
从所有存储区都可以访问 16 字节的公共 RAM。
地址
BANK0
0x000
地址
内核寄存器，12个字节
0x00B
0x00C
0x01F
0x020
内核寄存器，12个字节
共用RAM，16个字节
0x07F
BANK4
0x200
内核寄存器，12个字节
0x20B
0x20C
0x21F
0x220
0x26F
0x270
0x480
内核寄存器，12个字节
0x40B
0x40C
0x3EF
0x3F0
0x3FF
BANK10
地址
0x500
地址
0xF80
0xF8B
0xF8C
UART
BANK31
内核寄存器，12个字节
内核寄存器，12个字节
0x50B
0x50C
0x49F
0x4A0
共用RAM，16个字节
共用RAM，16个字节
内核寄存器，12个字节
I2C
SRAM，80个字节
SRAM，80个字节
0x37F
BANK9
保留
0x39F
0x3A0
0x36F
0x370
0x48B
0x48C
0x41F
0x420
0x38B
0x38C
TIM2
共用RAM，16个字节
BANK7
内核寄存器，12个字节
内核寄存器，12个字节
SRAM，80个字节
地址
地址
0x380
0x31F
0x320
0x2FF
BANK8
BANK6
TIM1_2OF2
共用RAM，16个字节
地址
地址
0x30B
0x30C
0x2EF
0x2F0
0x27F
0x1FF
0x300
0x29F
0x2A0
共用RAM，16个字节
共用RAM，16个字节
内核寄存器，12个字节
SRAM，80个字节
0x400
BANK5
0x28B
0x28C
WPDx/TIM1_1OF2
0x1EF
0x1F0
0x17F
0x280
SRAM，80个字节
SRAM，80个字节
共用RAM，16个字节
地址
WPUx/EE
0x19F
0x1A0
0x16F
0x170
0x0FF
内核寄存器，12个字节
0x18B
0x18C
LATx/TIM4
SRAM，80个字节
BANK3
0x180
0x11F
0x120
0x0EF
0x0F0
地址
内核寄存器，12个字节
TRISx/PIE/ADC
SRAM，80个字节
BANK2
0x10B
0x10C
0x09F
0x0A0
0x06F
0x070
地址
0x100
0x08B
0x08C
PORTx/PIR/SPI
地址
BANK1
0x080
TEST SFR，2个字节
保留
0x51F
0x520
未实现，保留
0xFE3
0xFE4
SRAM，80个字节
SRAM，80个字节
SRAM，80个字节
影子寄存器
0x46F
0x470
0x4EF
0x4F0
共用RAM，16个字节
0x47F
共用RAM，16个字节
0x4FF
0xFEF
0xFF0
0x56F
0x570
共用RAM，16个字节
共用RAM，16个字节
0x57F
0xFFF
图 3.2 存储区地址映射
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F r e m o n t
M i c r o
D e v i c e s
F T 6 1 F 0 8 X
3.2.4. 存储区地址映射
BANK0~BANK5
地址
BANK0
地址
BANK1
地址
BANK2
地址
BANK3
地址
BANK4
地址
BANK5
000h
001h
002h
003h
004h
005h
006h
007h
008h
009h
00Ah
00Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
080h
081h
082h
083h
084h
085h
086h
087h
088h
089h
08Ah
08Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
100h
101h
102h
103h
104h
105h
106h
107h
108h
109h
10Ah
10Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
180h
181h
182h
183h
184h
185h
186h
187h
188h
189h
18Ah
18Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
200h
201h
202h
203h
204h
205h
206h
207h
208h
209h
20Ah
20Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
280h
281h
282h
283h
284h
285h
286h
287h
288h
289h
28Ah
28Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
00Ch
00Dh
00Eh
00Fh
010h
011h
012h
013h
014h
015h
016h
017h
018h
019h
01Ah
01Bh
01Ch
01Dh
01Eh
01Fh
020~06F
070~07F
PORTA
PORTB
PORTC
PORTD
—
PIR1
—
—
EPIF0
SPIDATA
SPICTRL
SPICFG
SPISCR
SPICRCPOL
SPIRXCRC
SPITXCRC
SPIIER
SPICTRL2
SPISTAT
ADDLY
GPR, 80B
公共 RAM
08Ch
08Dh
08Eh
08Fh
090h
091h
092h
093h
094h
095h
096h
097h
098h
099h
09Ah
09Bh
09Ch
09Dh
09Eh
09Fh
0A0~0EF
0F0~0FF
TRISA
TRISB
TRISC
TRISD
—
PIE1
—
—
EPIE0
CKOCON
PCON
WDTCON
OSCTUNE
OSCCON
PCKEN
ADRESL
ADRESH
ADCON0
ADCON1
ADCON2
GPR, 80B
公共 RAM
10Ch
10Dh
10Eh
10Fh
110h
111h
112h
113h
114h
115h
116h
117h
118h
119h
11Ah
11Bh
11Ch
11Dh
11Eh
11Fh
120~16F
170~17F
LATA
LATB
LATC
LATD
—
TIM4CR1
TIM4IER
TIM4SR
TIM4EGR
TIM4CNTR
TIM4PSCR
TIM4ARR
EPS0
EPS1
PSRC0
PSRC1
MISC0
AFP2
ITYPE0
ITYPE1
GPR, 80B
公共 RAM
18Ch
18Dh
18Eh
18Fh
190h
191h
192h
193h
194h
195h
196h
197h
198h
199h
19Ah
19Bh
19Ch
19Dh
19Eh
19Fh
1A0~1EF
1F0~1FF
20Ch
20Dh
20Eh
20Fh
210h
211h
212h
213h
214h
215h
216h
217h
218h
219h
21Ah
21Bh
21Ch
21Dh
21Eh
21Fh
220~26F
270~27F
WPDA
WPDB
WPDC
WPDD
—
TIM1CR1
—
TIM1SMCR
—
TIM1IER
TIM1SR1
TIM1SR2
TIM1EGR
TIM1CCMR1
TIM1CCMR2
TIM1CCMR3
TIM1CCMR4
TIM1CCER1
TIM1CCER2
ODCON0
GPR, 80B
公共 RAM
28Ch
28Dh
28Eh
28Fh
290h
291h
292h
293h
294h
295h
296h
297h
298h
299h
29Ah
29Bh
29Ch
29Dh
29Eh
29Fh
2A0~2EF
2F0~2FF
TIM1CNTRH
TIM1CNTRL
TIM1PSCRH
TIM1PSCRL
TIM1ARRH
TIM1ARRL
TIM1RCR
TIM1CCR1H
TIM1CCR1L
TIM1CCR2H
TIM1CCR2L
TIM1CCR3H
TIM1CCR3L
TIM1CCR4H
TIM1CCR4L
TIM1BKR
TIM1DTR
TIM1OISR
TIM2CCR3H
TIM2CCR3L
GPR, 80B
公共 RAM
rev1.05
- 26 -
WPUA
WPUB
WPUC
WPUD
—
EEADRL
EEADRH
EEDATL
EEDATH
EECON1
EECON2
ANSELA
EECON3
LVDCON
PSINK0
PSINK1
PSINK2
PSINK3
AFP0
AFP1
GPR, 80B
公共 RAM
2020-5-29
F r e m o n t
M i c r o
D e v i c e s
F T 6 1 F 0 8 X
BANK6~BANK10
地址
BANK6
地址
BANK7
地址
BANK8
地址
BANK9
地址
BANK10
地址
BANK31
300h
301h
302h
303h
304h
305h
306h
307h
308h
309h
30Ah
30Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
380h
381h
382h
383h
384h
385h
386h
387h
388h
389h
38Ah
38Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
400h
401h
402h
403h
404h
405h
406h
407h
408h
409h
40Ah
40Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
480h
481h
482h
483h
484h
485h
486h
487h
488h
489h
48Ah
48Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
500h
501h
502h
503h
504h
505h
506h
507h
508h
509h
50Ah
50Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
F80h
F81h
F82h
F83h
F84h
F85h
F86h
F87h
F88h
F89h
F8Ah
F8Bh
INDF0
INDF1
PCL
STATUS
FSR0L
FSR0H
FSR1L
FSR1H
BSREG
WREG
PCLATH
INTCON
30Ch
TIM2CR1
38Ch
—
40Ch
I2CCR1
48Ch
URDATAL
50Ch
—
F8Ch
—
30Dh
30Eh
30Fh
310h
311h
312h
313h
314h
315h
316h
317h
318h
319h
31Ah
31Bh
31Ch
31Dh
31Eh
31Fh
320~36F
370~37F
TIM2IER
TIM2SR1
TIM2SR2
TIM2EGR
TIM2CCMR1
TIM2CCMR2
TIM2CCMR3
TIM2CCER1
TIM2CCER2
TIM2CNTRH
TIM2CNTRL
TIM2PSCR
TIM2ARRH
TIM2ARRL
TIM2CCR1H
TIM2CCR1L
TIM2CCR2H
TIM2CCR2L
TCKSRC
GPR, 80B
公共 RAM
38Dh
38Eh
38Fh
390h
391h
392h
393h
394h
395h
396h
397h
398h
399h
39Ah
39Bh
39Ch
39Dh
39Eh
39Fh
3A0~3EF
3F0~3FF
—
—
—
—
EECON4
—
—
—
—
—
—
—
—
—
—
—
—
—
—
GPR, 80B
公共 RAM
40Dh
40Eh
40Fh
410h
411h
412h
413h
414h
415h
416h
417h
418h
419h
41Ah
41Bh
41Ch
41Dh
41Eh
41Fh
420~46F
470~47F
I2CCR2
I2CCR3
I2COARL
I2COARH
I2CFREQ
I2CDR
I2CCMD
I2CCCRL
I2CCCRH
I2CITR
I2CSR1
I2CSR2
I2CSR3
ADCON3
ADCMPH
LEBCON
MSCKCON
SOSCPRL
SOSCPRH
GPR, 80B
公共 RAM
48Dh
48Eh
48Fh
490h
491h
492h
493h
494h
495h
496h
497h
498h
499h
49Ah
49Bh
49Ch
49Dh
49Eh
49Fh
4A0~4EF
4F0~4FF
URDATAH
URIER
URLCR
URLCREXT
URMCR
URLSR
URRAR
URDLL
URDLH
URABCR
URSYNCR
URLINCR
URSDCR0
URSDCR1
URSDCR2
URTC
—
—
—
GPR, 80B
公共 RAM
50Dh
50Eh
50Fh
510h
511h
512h
513h
514h
515h
516h
517h
518h
519h
51Ah
51Bh
51Ch
51Dh
51Eh
51Fh
520~56F
570~57F
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
GPR, 80B
公共 RAM
F8Dh
F8Eh
F8Fh
F90h
F91h
F92h
F93h
F94h
F95h
F96h
F97h
F98h
F99h
F9Ah
F9Bh
F9Ch
F9Dh
F9Eh
F9Fh
FE4~FEF
FF0~FFF
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
Shadow reg
公共 RAM
rev1.05
- 27 -
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FT61F08X
3.2.5. Bank11，bank12 和 bank31
地址
BANK11
地址
BANK12
地址
BANK31
地址
BANK31
580h
581h
INDF0
INDF1
600h
601h
INDF0
INDF1
F90h
F91h
—
—
FA7h
FA8h
—
—
582h
PCL
602h
PCL
F92h
—
FA9h
—
583h
STATUS
603h
STATUS
F93h
—
FAAh
—
584h
FSR0L
604h
FSR0L
F94h
—
FABh
—
585h
FSR0H
605h
FSR0H
F95h
—
FACh
—
586h
FSR1L
606h
FSR1L
F96h
—
FADh
—
587h
FSR1H
607h
FSR1H
F97h
—
...
—
588h
BSREG
608h
BSREG
F98h
—
FE3h
—
STATUS_SHAD
589h
WREG
609h
WREG
F99h
—
FE4h
58Ah
PCLATH
60Ah
PCLATH
F9Ah
—
FE5h
WREG_SHAD
58Bh
INTCON
60Bh
INTCON
F9Bh
—
FE6h
BSREG_SHAD
58Ch
—
60Ch
—
F9Ch
—
FE7h
PCLATH_SHAD
...
—
...
—
F9Dh
—
FE8h
FSR0L_SHAD
59Fh
—
61Fh
—
F9Eh
—
FE9h
FSR0H_SHAD
F9Fh
—
FEAh
FSR1L_SHAD
FA0h
—
FEBh
FSR1H_SHAD
5A0h
620h
5A1h
...
5A2h
GPR, 48B
FA1h
—
FECh
—
650h
—
FA2h
—
FEDh
STKPTR
...
...
—
FA3h
—
FEEh
TOSL
...
—
FA4h
—
FEFh
TOSH
5EFh
66Fh
—
FA5h
—
670~67F
公共 RAM
FA6h
—
FF0h ~
FFFh
公共 RAM
5A3h
64Fh
GPR, 80B
5A4h
5F0~5FF
公共 RAM
3.2.6. Bank31 的影子寄存器
CPU 在进入中断时，硬件会自动把 W 寄存器，STATUS 寄存器（TO 和 PD 状态标志位除外）
，BSR 寄
存器，FSR 寄存器以及 PCLATH 寄存器保存到处于 bank31 的影子寄存中，在退出中断时再把它们恢复
到对应的寄存器，节省软件的开销。
rev1.05
地址
寄存器名称
FE4h
STATUS_SHAD
FE5h
WREG_SHAD
FE6h
BSREG_SHAD
FE7h
PCLATH_SHAD
FE8h
FSR0L_SHAD
FE9h
FSR0H_SHAD
FEAh
FSR1L_SHAD
FEBh
FSR1H_SHAD
FECh
—
FEDh
STKPTR
FEEh
TOSL
FEFh
TOSH
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FT61F08X
3.3. 堆栈
FT61F08X 有一个 16 级深 x15 位宽的硬件堆栈。
堆栈空间不属于程序存储空间或数据存储空间的一部分。
当执行 LCALL 或 CALLW 指令或由于中断导致程序跳转时，PC 的值会被压入堆栈。当执行 RET、RETW
或 RETI 指令时，PC 值从堆栈弹出。PCLATH 的值不受压栈或出栈操作的影响。
连续压栈 17 次后将产生上溢，上溢标志位 STKOVF 上溢置 1。
同理，如果弹栈次数大于压栈次数，则产生下溢，标志位 STKUNF 将被置 1，无论是上溢还是下溢都将
导致一次系统复位，而且 16 级的堆栈将全部清 0。
3.3.1. 访问堆栈
可通过 TOSH、TOSL 和 STKPTR 寄存器来使用堆栈。STKPTR 是堆栈指针的当前值。TOSH:TOSL 寄
存器对指向栈顶。这两个寄存器都可读写。由于 PC 的大小为 15 位，故 TOS 划分为 TOSH 和 TOSL 两
部分。要访问堆栈，可调整用来定位 TOSH:TOSL 的 STKPTR 值，然后对 TOSH:TOSL 执行读/写操作。
STKPTR 为 5 位，允许检测上溢和下溢。
在正常程序运行期间，LCALL、CALLW 和中断会使 STKPTR 值递增 1，而 RETW、RET 和 RETI 会使
STKPTR 值递减 1。任何时候都可以检查 STKPTR，以查看可用堆栈空间。STKPTR 总是指向堆栈中的
当前使用单元。因此，LCALL 或 CALLW 指令会使 STKPTR 值递增 1，然后写 PC，而返回操作则会卸
载 PC，然后使 STKPTR 值递减 1。
注意：在允许中断的情况下修改 STKPTR 时应谨慎。
0x0F
0x0E
0x0D
0x0C
0x0B
0x0A
0x09
0x08
0x07
0x06
0x05
0x04
初始堆栈配置：
复位后，堆栈为空。堆栈指针指向地址
0x1F，TOSH/L寄存返回0。
0x03
0x02
0x01
0x00
TOSH:TOSL
0x0000
STKPTR=0x1F
图 3.3 软件访问堆栈
rev1.05
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3.3.2. 上溢/下溢复位
在压满 16 级后再执行压栈操作，或者在弹出第 1 级后再执行出栈操作，PCON 寄存器中的相应位（分
别为 STKOVF 或 STKUNF）会置 1，从而使器件复位。
3.4. 间接寻址
INDFn 寄存器不是物理寄存器。任何访问 INDFn 寄存器的指令，实际上都是访问由文件选择寄存器（FSR）
指定的地址处的寄存器。如果 FSRn 地址指定了 2 个 INDFn 寄存器中的任何一个，执行读操作会返回 0，
而写操作无法实现（尽管状态位会受影响）。可通过 FSRnH 和 FSRnL 对来创建 FSRn 寄存器值。FSR
寄存器形成的 16 位地址允许对 65536 个地址单元的空间进行寻址。
这些地址单元可划分为 3 个存储区：
传统数据存储器
线性数据存储器
闪存程序存储器
0x0000
传统数据存储区
0x0FFF
0x1000
Reserved
Not Implemented
0x1FFF
0x2000
线性数据存储区
0x29AF
0x29B0
0x7FFF
0x8000
FSR寻址
范围
Reserved
Not Implemented
PROM(FLASH)
0xFFFF
图 3.4 间接寻址
rev1.05
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3.4.1. 传统数据存储器
传统数据存储器指的是从 FSR 地址 0x000 到 FSR 地址 0xFFF 的区域。此地址对应于所有 SFR、GPR
和公共寄存器的绝对地址。
间接寻址
直接寻址
4
BSR
0
6
Opcode
7
0
0
bank选择
FSRxH
0
0
bank选择
00001
00010
...
FSRxL
0
0 0
单元选择
00000
7
单元选择
11111
0x00
...
0x7F
BANK0 BANK1 BANK2
...
BANK31
图 3.5 传统数据存储器映射
3.4.2. 线性数据存储器
线性数据存储器指的是从 FSR 地址 0x2000 到 FSR 地址 0x29AF 的区域。该区域为虚拟区域，它指向所
有存储区中 80 字节的 GPR 存储区块。
未实现的存储区读为 0x00。使用线性数据存储器区域允许缓冲区大于 80 字节，因为当 FSR 增大到超过
一个存储区时，会直接转到下一个存储区的 GPR 存储器。线性数据存储器区域不包含 16 字节的公共存
储器。
7
0
FSRxH
0
0
7
FSRxL
0
1 0
单元选择
0x2000
0x20
Bank0
0x6F
0xA0
Bank1
0xEF
0x120
Bank2
0x16F
...
0xF20
Bank30
0x29AF 0xF6F
图 3.6 线性数据存储区映射
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3.4.3. 闪存程序存储器
要使常数的访问更为容易，可将整个闪存程序存储器映射到 FSR 地址空间的高半部分。当 FSRnH 的
MSB 置 1 时，低 15 位就是可通过 INDF 进行访问的程序存储器的地址。只有每个存储单元的低 8 位可
通过 INDF 进行访问。通过 FSR/INDF 接口无法对闪存程序存储器执行写操作。所有通过 FSR/INDF 接
口对闪存程序存储器进行访问的指令都需要一个额外的指令周期才能完成。
7
FSRxH
0
7
FSRxL
0
1
单元选择
0x8000
0x0000
PROM
(低8位)
0x7FFF
0xFFFF
图 3.7 程序存储区映射
下图给出了 CPU 使用 FSRn 间接寻址 PROM 的时序，共占 2 个指令周期。
instr_clk
prom_rdat
xxxF INDFn
prom[FSRn]
2个指令周期
ireg
xxxF INDFn(LDR or MOVIW)
prom_addr
0x8000
sfr_addr
0x8000
sfr_rdat
next PC
prom[FSRn]
图 3.8 间接寻址读程序存储器
rev1.05
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4. 复位源
有以下 7 种复位源：
上电复位
低电压复位
看门狗复位
非法指令复位
软件复位
EMC 复位
外部管脚复位
堆栈溢出复位（见 3.3.2 小节）
EMC failure
detect
External Reset
/MCLR pin
/Sleep
WDT
Module
SOFTRST
Detect
WDT
Time-out
Reset
VDD Rise
Detet
VDD
Brown Out
Reset
BOR_EN
IREG
IRERR
Detect
S
_
Q
R
Q
System
reset
PWRT
LIRC
11-bit ripple counter
Enable PWRT
图 4.1 复位框图
4.1. 上电复位
片上的 POR 电路会将芯片保持在复位状态直到 VDD 电源电压达到足够高，上电复位释放后，系统复位
不会立即释放，还要等一个约 4ms 的延时，期间数字电路保持在复位状态。
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4.1.1. 上电复位流程
上电复位/
欠压复位
可以在此
期间进入
串口
延时4ms(8ms)
NO
读NVM(BOOT)
使用内部快时钟
是否为串口模
式？
系统保持
在复位状
态
上电配置过程
NO
DCFG0=0x5A
YES
YES
PWRTEB=0?
YES
延时约64ms
YES
双速启动?
NO
晶体模式?
N
OST对晶体计数
LP:4096/16384
XT:1024
NO
Y
从PC=0取指，执行
程序
图 4.1.1 上电复位流程图
rev1.05
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4.2. 低电压复位
低电压复位由 UCFG1位和 SLVREN 位来控制。低电压复位就是指当电源电压低于 VBOR 门限电
压时所产生的复位。不过当 VDD 电压低于 VBOR 不超过 TBOR（4~5 个慢时钟周期）时间时，低电压复
位可能不会发生。
如果 BOR（低电压复位）是使能（UCFG1=00）的，那么最大 VDD 电压上升时间的要求就不存在。
BOR 电路会将芯片控制在复位状态，一直到 VDD 电压达到 VBOR 门限电压以上。
当 UCFG1=10 时，BOR 电路关闭将由 CPU 的运行状态决定：CPU 正常工作时 BOR 电路工作，
CPU 处于睡眠模式时 BOR 电路自动关闭，这样可以方便的使系统功耗降至更低水平。
VDD
VBOR
TBOR
≈4ms
Internal reset
图 4.2.1 欠压复位
注意：
1. TBOR 时间约为 122~152μs；
2. 电压恢复正常之后，内部复位不会立即释放，而是要等约为 4ms 的时间。
4.3. 上电复位延时
复位模块内置了一个 11 位的上电复位定时器 PWRT 模块，它和 WDT 复用同一个计数器，它为上电复位
和低电压复位提供一个固定的 64ms（正常情况下）的定时。这个定时器由内部慢时钟驱动。芯片在 PWRT
溢出之前都是被保持在复位状态，这段时间能保证 VDD 上升到足够高的电压使得系统能正常工作。
可通过系统寄存器（UCFG0）来使能。另外需要注意的是，由于由内部慢时钟驱动，定时的实际时间长
度是随温度，电压等条件变化而变化的，这个时间不是一个精准参数。
rev1.05
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4.4. 非法指令复位
当 CPU 的指令寄存器取指到非法指令（未定义的操作码）时，标志位 IERRF（PCON.4）将被置位，同
时系统将进行复位。利用此功能可增加系统的抗干扰能力。
以下是非法指令汇总表格：
未定义指令编码
b
b
b
b
00
0000
0000
2~7
00
0000
0000
C~F
00
0000
4~5
xxxx
00
0000
0110
0/1, 8~F
00
0000
0111
xxxx
00
0001
1~7
xxxx
4.5. 软件复位
增强型内核实现了一条软件复位指令，助记符为 RESET，它提供给软件执行硬件复位的方法，复位标志
为 SRSTF（PCON.2）。
4.6. EMC 复位
配置区有一冗余寄存器 DCFG0，上电复位值为 0x5A，在配置过程中它被位于 NVM 区的 0x8047 单元低
8 位覆盖，如果其值不等于 0x5A，则 EMC 硬件检测逻辑会发出一次复位，标志位 EMCF 置 1，重启上
电配置过程（读 NVM 区），直到读到正确的值为止（处于调试模式时，该功能自动禁止）。
在程序运行过程中，EMC 检测模块一直判断 DCFG0 的值，当发生某种 EMC 干扰导致其值发生变化时，
（DCFG0≠0x5A）也将引发 EMC 复位，重启读 NVM 区的过程。
4.7. 上电配置过程(BOOT)
发生上电复位、低电压复位后，除了固有的 4ms 复位延时外，还有一个初始化配置寄存器 UCFGx 的动
作。该动作从 PROM 的保留地址读取内容写到 UCFGx，待所有配置地址读取完成后，才可以释放系统
复位，如图 4.7.1 和图 4.7.2 的所示，该过程大概需要 24μs。
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4.7.1. 可触发 BOOT 过程的复位源汇总
复位源
可触发 Boot
可配置/配置位
上电复位
NA
低电压复位
NA
EMC 复位
NA
看门狗复位
非法指令复位
Y，BRSTEN，FCFG0.0
外部管脚复位
–
NA
堆栈溢出复位
4.8. LVD 低电压侦测
除了低电压复位功能外，芯片还内置有低电压侦测功能。当电源电压低于设置的电压档位（由 LVDCON
的 LVDL选择）超过 TLVD（4 到 5 个慢时钟周期）以上时，标志位 LVDW 将会被置 1，软件可以利
用此位来监控电源电压。如果电源电压大于 LVDL 设置的电压档，该标志位会自动清除，换言之，LVDW
位不具有锁存功能。
4.8.1. 检测外部电压
除了可以监控片内 VDD 外，LVD 模块还具备检测外部电压的功能。寄存器位 LVDM 决定了 LVD 作用于
VDD 还是外部电压，当它为 1 时表示对外部管脚 ELVDx 进行监控。外部 LVD 管脚一共有 4 种选择，由
寄存器 ELVDS控制。当配置为 ELVD 功能时，管脚斯密特输入被关闭以防漏电。
检测外部电压（LVDM=1）时，LVD 的极性是相反的，即该模块只有检测到外部电压高于所设阈值且时
间超过 TLVD 时，LVDW 和 LVDIF 标志位才会置高。
注意：PC0 的外部复位功能优先级高于外部 LVD 功能，换言之，当配置为外部复位管脚时，外部 LVD
的检测是无效的，不管 ELVDS 以及 LVDM 为何值。
4.8.2. LVD 中断
除了通过轮询 LVDW 位了解低电压侦测事件外，软件还可以能过中断的方式来获得低电压的情况。当低
电压侦测事件发生后，LVDIF 位自动置 1，它是一个电平触发锁存器，只能通过软件清 0，清 0 的前提是
电源电压恢复到 LVDL设置的水平以上，LVD 事件结束。
当 PEIE 和 LVDIE 被置 1 且 LVDIF 为 1 时，睡眠状态下 LVD 中断标志位还可以作为一个唤醒源，如果
之前 GIE=1，则唤醒后 CPU 进入中断处理。
rev1.05
- 37 -
2020-5-29
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FT61F08X
4.9. 复位时序
4.9.1. 上电复位时序 1
禁止 PWRT，内部时钟模式
1
2
3
4
5
6
7
8
9
10
9
10
VDD
POR_RSTN
~4ms
boot, ~24us
BOOT_EN
SYS_RSTN
图 4.7.1 上电复位时序，使用内部时钟，PWRT 禁止
4.9.2. 上电复位时序 2
使能 PWRT，内部时钟模式
1
2
3
4
5
6
7
8
VDD
POR_RSTN
BOOT_EN
4ms delay
boot, ~24us
PWRTE
BOOT_END
PWRT_OV
PWRT, 64ms
MCLRB
SYS_RSTN
图 4.7.2 上电复位时序，使用内部时钟，PWRT 使能
rev1.05
- 38 -
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FT61F08X
4.9.3. 上电复位时序 3
使能 PWRT，晶体时钟模式，双速启动禁止
VDD
POR_RSTN
~4ms延时
读NVM(BOOT)
BOOT_EN
BOOT_END
PWRT延时
PWRTEB
PWRT_OV
OST计数
OST_OV
IREG
INST1
INST2
图 4.7.2 上电复位时序，使用内部时钟，PWRT 使能
4.10. 复位源标志位
以下复位事件都有对应的寄存器标志位记录，相关寄存器为 PCON，供软件查询。
上电复位（PORF）
欠压复位（BORF）
RESET 指令复位（SRSTF）
堆栈上溢复位（STKOVF）
堆栈下溢复位（STKUNF）
非法指令复位（IERRF）
EMC 复位（EMCF）
MCLR 复位（MCLRF）
rev1.05
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FT61F08X
4.10.1. PCON 寄存器，地址 0x96
Bit
7
6
5
4
3
2
1
0
Name
STKOVF
STKUNF
EMCF
IERRF
/MCLRF
/SRSTF
/PORF
/BORF
POR val.
0
0
0
0
1
1
0
1
BOR val.
0
0
0
0
1
1
1
0
Other rst.
Q
Q
Q
Q
Q
Q
U
U
Type
RW-0
RW-0
RW-0
RW-0
RW-1
RW-1
RW-1
RW-1
符号解释：
Q：取决于所发生的复位
U：保持不变
RW-0：软件只能写 0，不能写 1，只能由相关硬件事件置 1
RW-1：软件只能写 1，不能写 0，只能由相关硬件事件清 0
Bit
Name
Function
堆栈上溢标志位，高有效
7
STKOVF
0：未发生堆栈上溢，或该位由软件清 0
1：发生了堆栈上溢
堆栈下溢标志位，高有效
6
STKUNF
0：未发生堆栈下溢，或该位由软件清 0
1：发生了堆栈下溢
EMC 复位标志，高有效
5
EMCF
0：未发生 EMC 复位或由软件清 0
1：发生了 EMC 复位复位
非法指令复位标志，高有效
4
IERRF
0：未发生非法指令复位或由软件清 0
1：发生了非法指令复位复位
外部复位标志，低有效
3
/MCLRF
0：发生了 MCLR 复位
1：未发生 MCLR 复位或由软件置 1
软件复位标志，低有效
2
/SRSTF
0：执行了 RESET 指令
1：未执行 RESET 指令，或由软件置 1
上电复位标志，低有效
1
/PORF
0：发生了上电复位
1：没发生上电复位或者由软件置 1
PORF 在上电复位后值为 0，此后软件应该将其置 1
低电压复位标志，低有效
0：发生了低电压复位
0
/BORF
1：没发生低电压复位或者由软件置 1
/BOR 在上电复位后其值不确定，必须由软件置 1。发生后续复位后，通过查询此位来确定是
否低电压复位
rev1.05
- 40 -
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FT61F08X
4.10.2. LVDCON 寄存器，地址 0x199
Bit
7
6
5
4
3
Name
SLVREN
LVDM
—
LVDEN
LVDW
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
2
1
0
LVDL
Function
软件控制 LVR 使能位，当 UCFG1为 01 时：
1 = 打开 LVR
7
SLVREN
0 = 禁止 LVR
当 UCFG1不为 01 时，此位无实际意义
注意：发生欠压复位时，该位不会清 0。其它任何复位都可将其清 0
LVD 模块检测电压源选择
6
LVDM
1 = 检测外部管脚 PC0（这时如果 LVDEN 为 1，PC0 变为模拟管脚）
0 = 检测内部电压
5
N/A
保留位，不要写 1
低电压侦测使能
4
LVDEN
1：开启 LVD 侦测功能
0：关闭 LVD 侦测功能
低电压标志位，只读
当 LVDM 为 0 时：
1：VDD 掉到了 LVDL[2:0]所设置的电压超过 122μs 以上
3
LVDW
0：VDD 正常，高于 LVDL[2:0]所设置的电压
当 LVDM 为 1 时：
1：所选外部管脚电压高于 LVDL[2:0]所设置的电压超过 122μs 以上
0：所选外部管脚电压低于 LVDL[2:0]所设置的电压
低电压侦测选择位
2:0
LVDL
rev1.05
值
检测电压
000
保留
001
保留
010
2.0V
011
2.4V
100
2.8V
101
3.0V
110
3.6V
111
4.0V
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2020-5-29
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FT61F08X
4.11. 配置寄存器汇总
4.11.1. UCFG0，PROM 地址 0x8000
Bit
7
6
5
4
3
Name
Reserved
CPB
MCLRE
PWRTEB
WDTE
FOSC
POR val.
1
1
0
1
0
111
位
名称
7
N/A
2
1
0
描述
保留位，请保持该位置 1
Flash 全区域（8k words）保护设置
1：不对 Flash 进行全区域保护
6
CPB
0：启用 Flash 全区域保护，除了 CPU 取指，CPU 或外部串口皆读返回 0
注意：
此位只能由 1 改写为 0，而不能由 0 改写为 1。由 0 改写成 1 的唯一方法是进行一次包括
USER_OPT 在内的片擦操作，并且重新上电后 CPB 才变为 1
5
MCLRE
4
PWRTEB
3
WDTE
1：PC0/MCLR 为复位脚功能
0：PC0/MCLR 脚为 GPIO
1：PWRT 禁止
0：PWRT 使能
1：WDT 使能，程序不能禁止
0：WDT 禁止，但程序可通过设置 WDTCON 的 SWDTEN 位将 WDT 使能
000：LP 低速晶振模式，PC1/PB7 接低速晶体
2:0
FOSC
001：XT 高速晶振模式，PC1/PB7 接高速晶体
010：外部时钟模式，PB7 为 IO 功能，PC1 接时钟输入
其它：INTOSCIO 模式，PC1 和 PB7 皆为 GPIO 引脚
rev1.05
- 42 -
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FT61F08X
4.11.2. UCFG1，PROM 地址 0x8001
Bit
7
Name
POR val.
位
6
5
OSTPER
0
1
4
3
2
TSEL
IESO
FSCMEN
LVREN
2’b11
1
1
2’b11
名称
1
0
描述
OST 定时器周期选择
00：512
7:6
OSTPER
01：1024(default)
10：2048
11：4096（LP 模式时为 32768）
指令周期选择位
5:4
TSEL
00，01：1T
10：2T
11：4T
双速时钟使能
3
IESO
1：使能双速时钟模式
0：禁止双速时钟模式
时钟故障监视使能（当使用 EC 或者 XT、LP 模式时）
2
FSCMEN
1：使能时钟故障监视
0：禁止时钟故障监视
低电压复位选择
00：使能低电压复位
1:0
LVREN
01：LVR 由 LVDCON 的 SLVREN 决定
10：MCU 正常模式时开启 LVR，睡眠模式时关闭 LVR，跟 SLVREN 位无关
11：禁止低电压复位
rev1.05
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FT61F08X
4.11.3. UCFG2，PROM 地址 0x8002
Bit
7
6
5
4
Name
—
—
—
I2CRMAP
LVRS[3:0]
POR val.
0
0
1
1
4’b0000
位
名称
7:3
N/A
3
2
1
0
描述
保留位
（仅适用于 I 以上版本芯片，A~H 版本无实际意义）
1：I2C_SDA 复用在 PA0，I2C_SCL 复用在 PA1
4
I2CRMAP
SPI_MOSI 复用在 PB3，SPI_MISO 复用在 PB2
0：I2C_SDA 复用在 PB3，I2C_SCL 复用在 PB2，
SPI_MOSI 复用在 PA0，SPI_MISO 复用在 PA1（跟 A~H 版本保持一致）
低电压复位阈值选择
数值
电压
1010
1011
1100
1101
保留
1110
1111
3:0
rev1.05
LVRS[3:0]
0000
0001
0000
保留
0011
2.0V
0100
2.2V
0101
2.5V
0110
2.8V
0111
3.1V
1000
3.6V
1001
4.1V
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2020-5-29
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FT61F08X
4.11.4. UCFG3，PROM 地址 0x8003
Bit
7
6
5
4
Name
POR val.
3
2
1
0
1
1
1
1
FSECPB0
1
位
1
1
1
名称
描述
Flash 扇区保护设置，低有效
主程序区的 8k words 分成 8 个扇区，每扇区大小 1k words
7:0
FSECPB0
Bitx:
0：扇区 x 被保护，软件和串口皆不能读，编程，页擦除（64 words）
1：扇区 x 不被保护，软件和串口可自由读，编程，页擦除（64words）
4.11.5. DCFG0，PROM 地址 0x8047
EMC 模块保护寄存器
Bit
7
6
5
4
Name
POR val.
位
3
2
1
0
1
0
1
0
DCFG0
0
1
0
1
名称
描述
EMC 模块检测寄存器
7:0
DCFG0
0x5A：CPU 正常运行，EMC 不产生复位
其它值：在非串口模式下，EMC 将产生复位，并触发 boot，重读 NVM
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FT61F08X
5. 时钟源
C1
OSC2
32768Hz
16MHz
/Sleep
MCKCF
XT/LP/EC
OSC1
C2
1:1
1:2
1:4
1:8
1:16
1:32
1:64
1:128
32K
0111
0110
0101
System Clock(MCLK)
0100
0011
0010
Timers
0001
I2C
1xxx
UART1
SPI
0000
Peripheral clock enable
ADC
CCOSEL[2:0]
HIRC
/8
LIRC
0
1
Power-up timer (PWRT)
Fail safe clock monitor(FSCM)
ADC
~
LFMOD
T2CKSRC[2:0]
MCLK
HIRC
HIRC*2
XT/EC
T2CK
To TIM2
XT*2/EC*2
LIRC
LP
LP*2/EC*2
~
256K Internal Osc
FOSC
Configuration Word Register)
(SCS, OSCCON Register)
Prescaler
16M Internal Osc
Peripheral clock enable
MCLK
HIRC
LIRC
XT/LP/EC
T1CK
Configurable clock
output
T2CK
T1CKSRC[2:0]
MCLK
HIRC
HIRC*2
T1CK
XT/EC
To TIM1
XT*2/EC*2
LIRC
LP
LP*2/EC*2
WCKSEL[1:0]
T4CKS[1:0]
LIRC
MCLK
HIRC
LP
XT
To TIM4
HIRC
To WDT
LP
XT
5.1 系统时钟源框图
时钟源包含 4 个时钟源：2 个内置振荡器，1 个外部晶体振荡器，1 个外部时钟灌入源。内置振荡器包括
1 个内部 16M 高速精准振荡器(HIRC)，1 个内部 32k/256k(LIRC)低速低功耗振荡器。这些时钟或振荡器
结合预分频器可以给系统提供各种频率的时钟源。同时内部高速振荡器可以通过 OSCTUNE 寄存器对振
荡器的频率进行调节校准。
5.1. 时钟源模式
时钟源模式分为外部和内部模式。
外部时钟模式依靠外部电路提供时钟源，比如外部时钟 EC 模式，晶体谐振器 XT、LP 模式。
内部时钟模式内置于振荡器模块中，振荡器模块有 16MHz 高频振荡器和 32kHz 低频振荡器。可通过
OSCCON 寄存器的系统时钟选择位（SCS）来选择内部高速或者外部时钟源。
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5.2. 外部时钟模式
5.2.1. 振荡器起振定时器（OST）
如果振荡器模块配置为 LP、XT 模式，振荡器起振定时器（OST）根据配置字 OSTPER对来自 OSC1
的振荡计数。用户可以根据不同应用要求，通过设置 OSTPER 位调节 OST 计数的次数。这发生在上电
复位（POR）之后或上电延时定时器（PWRT）延时结束（如果被使能）时，或从休眠中唤醒后，或故
障保护条件清除后。在此期间，程序计数器不递增，程序执行暂停。OST 确保使用石英晶体谐振器或陶
瓷谐振器的振荡器电路已经启动并向振荡器模块提供稳定的系统时钟信号。当在时钟源之间切换时，需
要一定的延时以使新时钟稳定。
注意：OST 复用了 WDT 定时器，故在 OST 对晶体时钟计数时，WDT 功能被屏蔽，待 OST 发生溢出后，
WDT 功能才恢复（如果此前 WDT 被使能的话）。当系统时钟切换到 LP 或者 XT 模式时，看门狗计数器
会被清零。
5.2.2. EC 模式
外部时钟模式允许外部产生的逻辑电平作为系统时钟源。工作在此模式下时，外部时钟源连接到 OSC1
输入，OSC2 引脚可用作通用 I/O。
当选取 EC 模式时，振荡器起振定时器（OST）被禁止。因此，上电复位（POR）后或者从休眠中唤醒
后的操作不存在延时。MCU 被唤醒后再次启动外部时钟，器件恢复工作，就好像没有停止过一样。
5.2.3. LP 和 XT 模式
LP 和 XT 模式支持连接到 OSC1 和 OSC2 的石英晶体谐振器或陶瓷谐振器，模式选择内部反相放大器的
低或高增益设定，以支持各种谐振器类型及速度。
LP 振荡器模式选择内部反相放大器的最低增益设定。该模式设计仅用于驱动 32.768 kHz 音叉式晶振（钟
表晶振）。
XT 振荡器模式选择内部反相放大器的高增益设定。
5.2.4. 内部时钟模式
振荡器模块有两个独立的内部振荡器，可配置或选取为系统时钟源。
1. HIRC（高频内部振荡器）出厂时已校准，工作频率为 16MHz。
2. LIRC（低频内部振荡器）未经校准，工作频率为 32 kHz。软件对 OSCCON 寄存器的系统时钟选择
位 MCKCF进行写操作，可选择系统时钟速度。
可通过 OSCCON 寄存器的系统时钟选择（SCS）位，在外部或内部高速时钟源之间选择系统时钟。
注意：OSCCON 寄存器的 LFMOD 可以选择 LIRC 是 32kHz 或者 256kHz，但看门狗固定使用 32kHz，
不管 LFMOD 为何值。
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5.2.5. 频率选择位（MCKCF）
外部晶体时钟，16MHz HIRC 和 32kHz LIRC 的输出连接到预分频器和多路复用器（见图 5.1）。OSCCON
寄存器的内部振荡器频率选择位 MCKCF用于选择不同的分频输出。可通过软件选择以下各分频比
或频率：
1:1
1:2
1:4
1:8（复位后的缺省值）
1:16
1:32
1:64
1:128
32 kHz（LIRC）
5.2.6. HIRC 和 LIRC 时钟切换时序
当在 LIRC 和 HIRC 之间切换时，新的振荡器可能为了省电已经关闭（见图 5.2 和图 5.3）。在这种情况下，
OSCCON 寄存器的 MCKCF 位被修改之后、频率选择生效之前，存在一个延时。OSCCON 寄存器的 LTS
和 HTS 位将反映 LIRC 和 HIRC 振荡器的当前活动状态。频率选择时序如下：
1. OSCCON 寄存器的 MCKCF位被修改
2. 如果新时钟是关闭的，会有一个时钟的启动延时
3. 时钟切换电路等待当前时钟的 2 个下降沿的到来
4. CLKOUT 保持为低，时钟切换电路等待两个新时钟下降沿的到来
5. 现在 CLKOUT 连接到新时钟。OSCCON 寄存器的 HTS 和 LTS 位被更新
6. 时钟切换完成
HIRC启动时间
HIRC
LIRC
2个下降沿关闭系统时钟
MCKCF
MCKCF=0
2个下降沿完成切换
MCKCF/=0
MCLK
图 5.2 由慢时钟切换到快时钟
HIRC
慢时钟启动时间
LIRC
2个慢时钟下降沿后
MCKCF
MCKCF/=0
MCKCF=0
2个下降沿
MCLK
图 5.3 由快时钟切换到慢时钟
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5.2.7. HIRC 时钟特殊功能
FT61F08X 内 建 了 一 个 振 荡 频 率 可 调 的 高 精 度 HIRC 作 为 系 统 时 钟 ， 出 厂 时 被 精 确 地 调 校 至
16MHz@5V/25℃，用户可以通过编程器的 Code Option 校准系统时钟。校准过程是过滤掉制程上的偏
差 对 精度 造成 的 影响 。此 HIRC 受 工 作 的环 境温 度 和工 作电 压 影响 会有 一 定的 漂移 ， 对于 压漂
（4.5V~5.5V）以及（-20℃~85℃）的温漂一般状况会在±1%以内。
FT61F08X 有一个特殊的功能：用户可修改 OSCTUNE 的值来对 HIRC 频率作调整。
OSCTUNE 的值确保 HIRC 在上电后准确工作在 16MHz。此数值的初始值每颗 IC 都会有差异。初始值
为 OSCTUNE[s]，此时芯片工作在 16MHz，每改变 1 个 LSb 则 HIRC 频率变化约为 80kHz。OSCTUNE[6:0]
和 HIRC 输出的关系如下：
OSCTUNE[6:0]值
HIRC 实际输出频率（16M 为例）,单位 kHz
OSCTUNE[s]-n
(16000-n*80)
…..
…..
OSCTUNE[s]-2
16000-2*80=15840
OSCTUNE[s]-1
16000-1*80=15920
OSCTUNE[s]
16000
OSCTUNE[s]+1
16000+1*80=16080
OSCTUNE[s]+2
16000+2*80=16160
…..
…..
OSCTUNE[s]+n
(16000+n*80)
5.3. 时钟切换
通过软件对 OSCCON 寄存器的系统时钟选择（SCS）位进行操作，可将系统时钟源在外部和内部高速
时钟源之间切换。
5.3.1. 系统时钟选择（SCS）位
OSCCON 寄存器的系统时钟选择（SCS）位选择用于 CPU 和外设的系统时钟源。
OSCCON 寄存器的位 SCS = 0 时，系统时钟源由配置字寄存器（UCFG0）中 FOSC位的配置决
定。
OSCCON 寄存器的位 SCS = 1 时，忽略 FOSC位，根据 OSCCON 寄存器的 MCKCF位决定
系统时钟源：HIRC 的分频时钟或者 32k 时钟。
注：
1． 任何由硬件引起的时钟切换（可能产生自双速启动或故障保护时钟监控器）都不会更新 OSCCON 寄
存器的 SCS 位。用户应该监控 OSCCON 寄存器的 OSTS 位以确定当前的系统时钟源；
2． 当 MCKCF等于 0 时，无论 SCS 为何值，系统时钟都选择内部慢时钟。
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5.3.2. 振荡器起振超时状态（OSTS）位
OSCCON 寄存器的振荡器起振超时状态（OSTS）位用于指示系统时钟是来自外部时钟源，还是来自内
部时钟源。外部时钟源由配置字寄存器（UCFG0）的 FOSC定义。OSTS 还特别指明在 LP 或 XT
模式下，振荡器起振定时器（OST）是否已超时。
5.3.3. 双速时钟启动模式
双速启动模式通过最大限度地缩短外部振荡器起振与代码执行之间的延时，进一步节省了功耗。对于频
繁使用休眠模式的应用，双速启动模式将在器件唤醒后除去外部振荡器的起振时间，从而可降低器件的
总体功耗。该模式使得应用能够从休眠中唤醒，将 INTOSC 用作时钟源执行数条指令，然后再返回休眠
状态而无需等待主振荡器的稳定。
注：执行 SLEEP 指令将中止振荡器起振时间，并使 OSCCON 寄存器的 OSTS 位保持清零。
当振荡器模块配置为 LP 或 XT 模式时，振荡器起振定时器（OST）使能（见第 5.2.1 节“振荡器起振定时
器”）。OST 将暂停程序执行，直到完成配置字 OSTPER位要求的计数次数。双速启动模式在 OST
计数时使用内部振荡器进行工作，使代码执行的延时最大限度地缩短。当 OST 计数到 OSTPER位
要求的计数次数且 OSCCON 寄存器的 OSTS 位置 1 时，程序执行切换至外部振荡器。
注：
1.系统时钟配置为外部晶振模式时，同时使能了双速模式，在 OST 未计数到 OSTPER 要求的数值时，
CLRWDT 指令不能清除看门狗计数器，也就是说此时 OST 计数不能被中断；
2.系统时钟配置为外部晶振模式时，同时使能了双速模式，在 OST 未计数到 OSTPER 要求的数值时，
执行 sleep 指令时，看门狗计数器被清零，此时的 OST 计数被清零。
5.3.4. 双速启动模式配置
通过以下设定来配置双速启动模式：
配置字寄存器（UCFG1）中的位 IESO = 1；内部/外部切换位（使能双速启动模式）
寄存器的位 SCS = 0
配置字寄存器（UCFG0）中的 FOSC配置为 LP 或 XT 模式
在下列操作之后，进入双速启动模式：
上电复位（POR）且上电延时定时器（PWRT）
延时结束（使能时）后，或者从休眠状态唤醒
如果外部时钟振荡器配置为除 LP 或 XT 模式以外的任一模式，那么双速启动将被禁止。这是因为 POR
后或从休眠中退出时，外部时钟振荡器不需要稳定时间。
rev1.05
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2020-5-29
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5.3.5. 双速启动顺序
1.
2.
3.
4.
5.
6.
7.
从上电复位或休眠中唤醒
使用内部振荡器以 OSCCON 寄存器的 MCKCF位设置的频率开始执行指令
OST 使能，计数 OSTPER位要求的计数次数
OST 超时，等待内部振荡器下降沿的到来
OSTS 置 1
系统时钟保持为低，直到新时钟下一个下降沿的到来（LP 或 XT 模式）
系统时钟切换到外部时钟源
5.3.6. 故障保护时钟监控器
故障保护时钟监控器（FSCM）使得器件在出现外部振荡器故障时仍能继续工作。FSCM 能在振荡器起
振延时定时器（OST）到期后的任一时刻检测振荡器故障。FSCM 通过将配置字寄存器（UCFG1）中的
FSCMEN 位置 1 来使能。FSCM 可用于所有外部振荡模式（LP、XT 和 EC）。
边沿触发寄存器
外部时钟
（LP/HS/EC)
S
R
SET
CLR
Q
Q
时钟故障信号
LIRC
~32KHz
分频器
÷64
采样时钟产生
图 5.4 FSCM 原理框图
5.3.7. 故障保护检测
FSCM 模块通过将外部振荡器与 FSCM 采样时钟比较来检测振荡器故障。LIRC 除以 64，就产生了采样
时钟。请参见图 5.4。故障检测器内部有一个锁存器。在外部时钟的每个下降沿，锁存器被置 1。在采样
时钟的每个上升沿，锁存器被清零。如果采样时钟的整个半周期流逝而主时钟依然未进入低电平，就检
测到故障。
5.3.8. 故障保护操作
当外部时钟出现故障时，FSCM 将器件时钟切换到内部时钟源，并将 PIR1 寄存器的 OSFIF 标志位置 1。
如果在 PIR1 寄存器的 OSFIE 位置 1 的同时将该标志位置 1，将产生中断。固件随后会采取措施减轻可
能由故障时钟所产生的问题。系统时钟将继续来自内部时钟源，直到器件固件成功重启外部振荡器并切
换回外部操作。
FSCM 所选的内部时钟源由 OSCCON 寄存器的 MCKCF位决定。这使内部振荡器可以在故障发生
前就得以配置。
rev1.05
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5.3.9. 故障保护条件清除
复位、执行 SLEEP 指令或翻转 OSCCON 寄存器的 SCS 位后，故障保护条件被清除。OSCCON 寄存
器的 SCS 位被修改后，OST 将重新启动。OST 运行时，器件继续从 OSCCON 中选定的 INTOSC 进行
操作。OST 超时后，故障保护条件被清除，器件将从外部时钟源进行操作。必须先清除故障保护条件，
才能清零 OSFIF 标志位。
5.3.10. 复位或从休眠中唤醒
FSCM 设计为能在振荡器起振延时定时器（OST）到期后的任一时刻检测振荡器故障。OST 的使用场合
为从休眠状态唤醒后以及任何类型的复位后。OST 不能在 EC 时钟模式下使用，所以一旦复位或唤醒完
成，FSCM 就处于激活状态。当 FSCM 被使能时，双速启动也被使能。因此，当 OST 运行时，器件总
是处于代码执行阶段。
注：由于振荡器起振时间的范围变化较大，在振荡器起振期间（从复位或休眠中退出时），故障保护电路
不处于激活状态。经过一段适当的时间后，用户应检查 OSCCON 寄存器的 OSTS 位，以验证振荡器是
否已成功起振以及系统时钟是否切换成功。
5.4. 外设时钟门控
关闭未使用外设的时钟可降低功耗。外设的时钟门控模式可以对以下外设的时钟随时打开或者关闭：
ADC
I2C
SPI
UART
TIM1/2/3
系统复位后，所有的外设时钟均处于关闭的状态。用户可以通过配置 PCKEN 寄存器对应的位来打开相
应的外设时钟。但是如果需要禁止某个外设，必须在其时钟被停止之前进行。
如果要使能某个外设，则需要先使能对应外设的时钟，然后再使能对应外设。外设时钟控制只是控制其
模块的系统时钟。
TIM1/2/4 计数时钟也受 PCKEN 寄存器控制，当 PCKEN 寄存器对应的位置 1 时，则 TIMER 的计数时钟
和寄存器操作时钟同时打开。
注意：
1. 在睡眠模式下，当 SYSON=1 时，无论 TIM1/2 的时钟源是否为系统时钟，其时钟源都会打开；当
SYSON=0 时，TIM1/2 时钟源关闭。
2. ADC 的转换时钟源打开或者关闭与系统进入睡眠模式无关。
3. 慢时钟测量时，慢时钟的打开与关闭也与系统时钟进入睡眠模式无关。
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5.5. 时钟输出
可以将芯片内部的时钟源输出到芯片的 CLKO 管脚上，可以选择以下几种时钟源输出：
系统时钟
内部高速时钟
XT 晶振时钟
LP 晶振时钟
外部时钟
内部慢时钟
TIM1/TIM2 时钟
这些时钟的输出选择和输出控制位于 CKOCON 寄存器。当时钟正在输出时，CCORDY 被硬件置 1。
当输出某个时钟时，对应的时钟源也同时被打开。通过清零 CCOEN 位禁止时钟的输出。时钟输出关闭
动作完成之后，CCORDY 位才能被硬件清零。
注意：
1. 在睡眠模式下，CCO 的输出与 SYSON 相关，当 SYSON=1 时，CCO 继续输出进入睡眠之前所选
的时钟；当 SYSON=0 时，CCO 暂停输出时钟，当系统退出睡眠状态后，继续输出所选时钟；
2. 当系统时钟为 XT 模式时，即使输出时钟选择了 LP 时钟，输出时钟也是 XT 时钟；
3. 当系统时钟为 LP 模式时，即使输出时钟选择了 XT 时钟，输出时钟也是 LP 时钟；
4. 当 FOSC选择为内部时钟源时，输出时钟选择了 LP、XT 或者 EC 时钟，输出时钟端口则不会
输出时钟；
5.5.1. 时钟输出注意
MCU 处于工作模式时，被选择为时钟输出的时钟源将自动使能，例如当前系统时钟为 HSI，时钟输出选
择为 XT 晶振时钟且 CCOEN 为 1，则对应的 XT 晶振电路打开，相关管脚也变成 OSC1, OSC2 功能。
UCFG0 配置选项的优先级要高于 CKOCON 寄存器的优先级，例如配置选项选择 XT 作为系统时钟，时
钟输出配置 LP 或 EC 是不起作用的，反之亦然。
5.6. 与时钟源相关寄存器汇总
名称
地址
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
复位值
UCFG0
0x8000
—
CPB
MCLRE
PWRTEB
WDTE
FOSC2
FOSC1
FOSC0
-qqq qqqq
OSCTUNE
0x98
—
OSCCON
0x99
PCKEN
0x9A
TKEN
I2CEN
CKOCON
0x95
SYSON
CCORDY
TCKSRC
0x31F
LFMOD
rev1.05
TUN[6:0]
MCKCF[3:0]
UARTEN
SPICKEN
OSTS
HTS
LTS
SCS
0100 x000
TIM4EN
TIM2EN
TIM1EN
ADCEN
0000 0000
CCOEN
0010 0000
DTYSEL[1:0]
CCOSEL[2:0]
—
T2CKSRC[2:0]
- 53 -
-xxx xxxx
T1CKSRC[2:0]
0000 -000
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5.6.1. OSCCON 寄存器，地址 0x99
Bit
7
6
5
4
3
2
1
0
Name
MCKCF[3:0]
OSTS
HTS
LTS
SCS
Reset
4’b0100
x
0
0
0
TYPE
RW
RO
RO
RO
RW
2
1
0
RW
RW
RW
Bit
Name
Function
主时钟（系统时钟）分频比选择
7:4
MCKCF[3:0]
值
分频比或 LIRC 选择
0111
1:1
0110
1:2
0101
1:4
0100
1:8(default)
0011
1:16
0010
1:32
0001
1:64
1xxx
1:128
0000
32kHz(LIRC)
振荡器起振超时状态位
3
OSTS
1 = 器件运行在 FOSC指定的外部时钟之下
0 = 器件运行在内部振荡器之下
高速内部时钟状态
2
HTS
1 = HIRC is ready
0 = HIRC is not ready
低速内部时钟状态
1
LTS
1 = LIRC is ready
0 = LIRC is not ready
系统时钟选择位
0
SCS
1 = 系统时钟选择为内部振荡器
0 = 时钟源由 FOSC决定
5.6.2. OSCTUNE 寄存器，地址 0x98
Bit
7
6
Name
—
TUN[6:0]
Reset
0
6’bxx_xxxx
TYPE
RO-0
RW
Bit
Name
7
N/A
6:0
TUN[6:0]
rev1.05
5
RW
4
RW
3
RW
Function
保留位，读 0
内部高速时钟频率调节位，见HIRC时钟特殊功能
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FT61F08X
5.6.3. PCKEN 寄存器，地址 0x9A
Bit
7
6
5
4
3
2
1
0
Name
—
I2CEN
UARTEN
SPICKEN
TIM4EN
TIM2EN
TIM1EN
ADCEN
Reset
0
0
0
0
0
0
0
0
TYPE
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
7
N/A
Function
保留位
I2C 模块时钟使能位：
6
I2CEN
1 = 打开时钟
0 = 关闭时钟
UART 模块时钟使能位：
5
UARTEN
1 = 打开时钟
0 = 关闭时钟
SPI 模块时钟使能位：
4
SPICKEN
1 = 打开时钟
0 = 关闭时钟
TIM4 模块时钟使能位：
3
TIM4EN
1 = 打开时钟
0 = 关闭时钟
TIM2 模块时钟使能位：
2
TIM2EN
1 = 打开时钟
0 = 关闭时钟
TIM1 模块时钟使能位：
1
TIM1EN
1 = 打开时钟
0 = 关闭时钟
ADC 模块时钟使能位：
0
ADCEN
1 = 打开时钟
0 = 关闭时钟
rev1.05
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FT61F08X
5.6.4. CKOCON 寄存器，地址 0x95
Bit
7
6
Name
SYSON
CCORDY
Reset
0
0
1
0
0
0
0
0
TYPE
RW
RO
RW
RW
RW
RW
RW
RW
Bit
5
4
3
DTYSEL
2
1
0
CCOSEL[2:0]
Name
CCOEN
Function
睡眠状态下的系统时钟控制位
7
SYSON
1 = 睡眠状态下，系统时钟保持运行
0 = 睡眠状态下，系统时钟关闭
时钟输出标志位，只读
6
CCORDY
1 = 时钟输出已准备好
0 = 时钟未输出
TIM1/TIM2 倍频时钟占空比调节位
00：2ns 延迟
5:4
DTYSEL
01：3ns 延迟
10：4ns 延迟
11：7ns 延迟
输出时钟选择位：
000：MCLK/系统时钟
001：HIRC
010：LIRC
3:1
CCOSEL[2:0]
011：XT
100：T1CK
101：T2CK
110：LP
111：EC
时钟输出使能位：
0
CCOEN
1 = 使能时钟输出
0 = 禁止时钟输出
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5.6.5. TCKSRC 寄存器，地址 0x31F
Bit
7
Name
LFMOD
Reset
0
0
0
0
—
0
0
0
TYPE
RW
RW
RW
RW
RO-0
RW
RW
RW
Bit
6
5
4
T2CKSRC
3
2
—
Name
1
0
T1CKSRC
Function
低频内振模式：
7
LFMOD
1 = 256k 振荡频率模式
0 = 32k 振荡频率模式
TIM2 时钟源选择位
6:4
T2CKSRC
3
N/A
值
时钟源
000
系统时钟/主时钟
001
HIRC
010
XT 时钟/外部时钟
011
HIRC 的 2 倍频
100
XT 时钟/外部时钟的 2 倍频
101
LIRC
110
LP 时钟/外部时钟
111
LP 时钟/外部时钟的 2 位频
保留位，读 0
TIM1 时钟源选择位
2:0
T1CKSRC
值
时钟源
000
系统时钟/主时钟
001
HIRC
010
XT 时钟/外部时钟
011
HIRC 的 2 倍频
100
XT 时钟/外部时钟的 2 倍频
101
LIRC
110
LP 时钟/外部时钟
111
LP 时钟/外部时钟的 2 位频
注意：
1. 当系统时钟配置选项选择 XT 模式时，TIMx 时钟源就不能选择 LP 或者 LP 的 2 倍频；
2.
同样地，当系统时钟配置为 LP 模式时，TIMx 时钟源就不能选择 XT 或者 XT 的 2 倍频；
3.
当 FOSC配置为内部时钟时，TIMx 时钟源被配置为 LP、XT 或者 EC 时钟源，此时 TIMx 无时
钟源输入；
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- 57 -
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6. 中断
ADC_INT
CKMEA_INT
TOUCH_INT
TIM1_INT
to Wakeup
EEIE
EEIF
OSFIE
OSFIF
interrupt
to CPU
LVDIE
LVDIF
PEIE
GIE
USART_INT
PINx_INT
SPI_INT
I2C_INT
TIM2_INT
TIM4_INT
外设中断
图 6.1 中断逻辑框图
FT61F08x 有以下中断源，部分中断可以把 CPU 从睡眠状态唤醒：
外部管脚中断
ADC 中断
LVD 中断
EEPROM 写完成中断
慢时钟测量完成中断
时钟缺失中断
TIMx 中断
SPI 中断
I2C 中断
USART 中断
6.1. 中断的使能
由图 6.1 可以看出，要想使用中断，除了该中断的相关使能位（xxxIE）需要置 1 外，总中断开关（GIE）
也需要打开。
ADC，慢时钟测量，TIMx，外部管脚，SPI，I2C 以及 USART 模块被归类了外设中断，除了其自身的中
断使能要打开外，另外一个外设总中断开关 PEIE 也需要置 1。
另外，各中断标志位的置起并跟中断使能位无关。
6.2. 中断的响应时间
中断响应延时定义为从发生中断事件到开始执行中断向量处的代码所需要的时间。正常情况下（即不是
处于 EEPROM 或 FLASH 的写周期），同步中断的响应延时为 3 或 4 个指令周期。对于异步中断，响应
延时为 3 至 5 个指令周期，具体取决于中断发生的时间和正在执行的指令。
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6.3. 睡眠下的中断
由于睡眠状态下系统时钟被关闭，部分使用系统时钟作为时钟的外设将停止工作。可以将 CPU 唤醒的中
断源有：
外部管脚中断
EEPROM 写完成中断
LVD 中断
TIMx 中断（使用慢时钟时）
ADC 中断
需要注意的是，唤醒 CPU 并不要求 GIE 使能。GIE 为 0 时，CPU 唤醒后将执行 SLEEP 指令后面的代
码，而非中断向量。
当 CKOCON.SYSON 为 1 时，系统时钟保持运行，所以其它直接使用系统时钟的外设也可以把 CPU 唤
醒，换言之，在这种条件下，所有中断都能唤醒 CPU。
注意，由于同步带来的延时，在对中断标志位清 0 之后，至少要等两条指令才可以执行 SLEEP 指令，
否则 MCU 将不会进入睡眠。
6.4. 现场保护
进入中断时，中断控制单元将返回的 PC 地址保存在堆栈中。而且，以下寄存器自动保存在影子寄存器
中：
W 寄存器
STATUS 寄存器（TO 和 PD 状态标志位除外）
BSREG 寄存器
FSR 寄存器
PCLATH 寄存器
退出中断服务程序时，这些寄存器将自动恢复。在 ISR 期间对这些寄存器所做的任何修改都将丢失。如
果需要修改任何这些寄存器，应修改相应的影子寄存器，并在退出 ISR 时恢复此新值。影子寄存器在
Bank31 中，可读写。根据用户应用程序的要求，可能还需要保存其他寄存器，这些额外的寄存器则需要
用户自行处理。
6.5. 与中断相关寄存器汇总
名称
地址
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
复位值
INTCON
0x0B
GIE
PEIE
EEIE
LVDIE
OSFIE
EEIF
LVDIF
OSFIF
0000 0000
PIE1
0x91
—
—
—
—
—
—
CKMIE
ADCIE
---- -000
PIR1
0x11
—
—
—
—
—
—
CKMIF
ADCIF
---- -000
EPIF0
0x14
外部管脚中断标志位
0000 0000
EPIE0
0x94
外部管脚中断使能位
0000 0000
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6.5.1. INTCON 寄存器，地址 0x0B
Bit
7
6
5
4
3
2
1
0
Name
GIE
PEIE
EEIE
LVDIE
OSFIE
EEIF
LVDIF
OSFIF
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
7
GIE
Function
全局中断使能
1 = 打开全局中断
0 = 关闭全局中断
外设中断使能
6
PEIE
1 = 打开外设中断
0 = 关闭外设中断
EEPROM写完成中断使能
5
EEIE
1 = 打开EE中断
0 = 关闭 EE 中断
LVD中断使能
4
LVDIE
1 = 打开LVD中断t
0 = 关闭 LVD 中断
时钟缺失中断使能
3
OSFIE
1 = 打开时钟缺失中断
0 = 关闭时钟缺失中断 t
EEPROM写完成标志位（写1清0，写0无效）
2
EEIF
1 = EEPROM完成写操作
0 = EEPROM 写操作未完成，或已由软件清 0
LVD中断标志位（写1清0，写0无效）
1
LVDIF
1 = 发生欠压事件（当LVDM为1时，则表示外部管脚电压高于所设阈值）
0 = 未发生欠压事件，或已由软件清 0
0
OSFIF
rev1.05
1 = 发生了时钟缺失事件（写1清0，写0无效）
0 = 未发生时钟缺失事件，或已由软件清0
- 60 -
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6.5.2. PIR1 寄存器，地址 0x11
Bit
7
6
5
4
3
2
1
0
Name
—
—
—
—
—
—
CKMIF
ADCIF
Reset
—
—
—
—
—
—
0
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RW
RW
RW
Bit
Name
Function
7:3
N/A
未实现，读 0
2
N/A
保留位，请勿写 1
1
CKMIF
慢时钟测量完成中断标志位
1 = 测量慢时钟操作完成 （写1清0，写0无效）
0 = 测量慢时钟未完成，或已由软件清 0
ADC 转换完成中断标志位
0
ADCIF
1 = ADC转换完成（写1清0，写0无效）
0 = ADC 转换未完成，或已由软件清 0
6.5.3. PIE1 寄存器，地址 0x91
Bit
7
6
5
4
3
2
1
0
Name
—
—
—
—
—
—
CKMIE
ADCIE
Reset
—
—
—
—
—
—
0
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RW
RW
RW
Bit
Name
Function
7:3
N/A
未实现，读 0
2
N/A
保留位，请勿写 1
慢时钟测量完成中断使能
1
CKMIE
1 = 允许慢时钟测量中断
0 = 禁止慢时钟测量中断
ADC 转换完成中断使能
0
ADCIE
1 = 允许ADC转换中断
0 = 禁止 ADC 转换中断
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- 61 -
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7. 睡眠模式
器件通过执行 SLEEP 指令进入睡眠模式。
进入休眠模式时，MCU 的状态如下：
1. WDT 将清零但是保持运行（如果使能了在休眠期间工作）
2. STATUS 寄存器的 PD 位清零
3. STATUS 寄存器的 TO 位置 1
4. CPU 时钟停止
5. 32kHz LIRC 不受影响，并且由其提供时钟的外设可以在休眠模式下继续工作
6. LP 晶体振荡器不受影响（当 TIMx 使用它作为工作时钟时）
7. ADC 不受影响（如果选择了专用 FRC 时钟）
8. I/O 端口保持执行 SLEEP 指令之前的状态（驱动为高电平、低电平或高阻态）
9. WDT 之外的复位不受休眠模式影响
关于外设在休眠期间工作的更多详细信息，请参见各个章节。
要最大程度地降低电流消耗，应考虑以下条件：
1. I/O 引脚不应悬空，I/O 作为输入时可打开内部的上拉或下拉
2. 外部电路从 I/O 引脚灌电流
3. 内部电路从 I/O 引脚拉电流
4. 内部弱上拉的引脚
5. 模块使用 31kHz LIRC
6. 模块使用 LP 振荡器
7.1. 睡眠的唤醒
可以通过下列任一事件将器件从休眠状态唤醒：
1. MCLR 引脚上的外部复位输入（如果使能）
2. BOR 复位（如果使能）
3. POR 复位
4. 看门狗定时器（如果使能）溢出
5. 任何外部中断
6. 能够在休眠期间运行的外设产生的中断（更多信息请参见各个外设）
前 3 个事件会使器件复位，后 3 个事件认为是程序执行的延续。
当执行 SLEEP 指令时，下一条指令（PC+1）被预先取出。如果希望通过中断事件唤醒器件，则必须允
许相应的中断允许位。唤醒与 GIE 位的状态无关，如果 GIE 位被禁止，器件将继续执行 SLEEP 指令后
的指令。如果 GIE 位被允许，器件先执行 SLEEP 指令后的指令，然后将调用中断服务程序。如果不想
执行 SLEEP 指令后的指令，用户应该在 SLEEP 指令后面放置一条 NOP 指令。
器件从休眠模式唤醒时，WDT 清零，与唤醒的原因无关。
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7.1.1. 使用中断唤醒
当禁止全局中断（GIE 被清零），并且有任一中断源中断标志位置 1 且其中断被使能时，将会发生下列某
一事件：
如果在执行 SLEEP 指令之前发生中断
SLEEP 指令将作为 NOP 执行
WDT 和 WDT 预分频器不会清零
STATUS 寄存器的 TO 位不会置 1
STATUS 寄存器的 PD 位不会清零
如果在执行 SLEEP 指令期间或之后发生中断
SLEEP 指令将完全执行
器件将立即从休眠模式唤醒
WDT 和 WDT 预分频器将清零
STATUS 寄存器的 TO 位将置 1
STATUS 寄存器的 PD 位将清零
要确定是否执行了 SLEEP 指令，可以测试 PD 位。如果 PD 位置 1，则说明 SLEEP 指令被作为一条 NOP
指令执行了。
7.2. 睡眠的系统时钟
进入睡眠状态后，CPU 时钟停止，PC 停留在 SLEEP 的下一条地址。默认情况下，系统时钟也会被关闭。
但如果 SYSON 位置 1 时，系统时钟将一直保持运行，在这种情况下，被选择为系统时钟的 HIRC，XT，
LIRC 振荡器将不会被关闭。
注意：如果要使用 FLASH 或数据 EEPROM 的写完成中断唤醒，SYSON 必须置 1。
7.3. 与睡眠模式相关寄存器汇总
名称
地址
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
复位值
STATUS
0x03
—
—
—
TO
PD
Z
DC
C
---q quuu
INTCON
0x0B
GIE
PEIE
EEIE
LVDIE
OSFIE
EEIF
LVDIF
OSFIF
0000 0000
PIE1
0x91
—
—
—
—
—
—
CKMIE
ADCIE
---- -000
PIR1
0x11
—
—
—
—
—
—
CKMIF
ADCIF
---- -000
EPIF0
0x14
外部管脚中断标志位
0000 0000
EPIE0
0x94
外部管脚中断使能位
0000 0000
rev1.05
- 63 -
2020-5-29
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8. 数据 EEPROM 和 FLASH
数据 EEPROM 和闪存程序存储器是可读可写的。这两种存储器没有直接映射到数据存储器空间，而是
通过特殊功能寄存器（SFR）间接寻址。有 7 个 SFR 用于访问这两种存储器：
EECON1
EECON2
EECON3
EEDATL
EEDATH
EEADRL
EEADRH
当与数据 EEPROM 模块接口时，EEDATL 寄存器存放要读写的 8 位数据，EEADRL 寄存器存放被访问
的 EEDATL 单元的地址。这些器件具有 256 字节的数据 EEPROM，地址范围从 0h 到 0FFh。
访问程序存储器模块时，EEDATH:EEDATL 寄存器对形成双字节字，存放要读/写的 14 位数据，而
EEADRL 和 EEADRH 寄存器形成双字节字，存放被读取的程序存储单元的 15 位地址。
EEPROM 数据存储器允许以字节为单位进行读写。EEPROM 字节写操作会自动擦除目标存储单元并写
入新数据（在写入前擦除）。写入时间由片上定时器控制。写入和擦除电压由片上电荷泵产生，此电荷泵
能在器件电压范围内正常工作，用于字节或字操作。
器件能否对程序存储器的特定块执行写操作取决于配置字寄存器位 FSECPB0的设置。然而，始终
允许程序存储器的读操作。
当器件被代码保护时，调试接口将不再能访问数据或程序存储器。在代码保护时，CPU 仍可继续读写数
据 EEPROM 存储器和闪存程序存储器。
8.1. EEADRL 和 EEADRH 寄存器
EEADRH:EEADRL 寄存器对可以寻址最大 256 字节的数据 EEPROM 或最大 32k 字的程序存储器。
当选择程序地址值时，地址的高字节写入 EEADRH 寄存器而低字节被写入 EEADRL 寄存器。当选择
EEPROM 地址值时，只将地址的低字节写入 EEADRL 寄存器。
rev1.05
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8.1.1. EECON1 和 EECON2 寄存器
EECON1 是访问 EE 存储器的控制寄存器。
控制位 EEPGD 决定访问的是程序存储器还是数据存储器。当它为 0 时，任何后续操作都将针对 EEPROM
存储器进行。当置 1 时，任何后续操作都将针对程序存储器进行。复位后，EEPGD 清 0，即默认选中
EEPROM。
控制位 RD 和 WR 分别启动读和写。用软件只能将这些位置 1 而无法清零。在读或写操作完成后，由硬
件将它们清零。由于无法用软件将 WR 位清零，可避免因意外而过早地终止写操作。
当 WREN 位置 1 时，允许执行写操作。上电时，WREN 位被清零。在正常运行中当写操作被复位中断
时，WRERR 位置 1。在这些情况下，复位后用户可以检查 WRERR 位并执行相应的错误处理程序。当
写操作完成时，PIR2 寄存器的中断标志位 EEIF 被置 1。该标志位必须用软件清零。
读 EECON2 得到的是全 0。EECON2 寄存器仅在数据 EEPROM 写过程中使用。要使能写操作，必须将
特定模式写入 EECON2。
8.2. 使用数据 EEPROM
数据 EEPROM 是高耐久性、可字节寻址的阵列，已将其优化以便存储频繁更改的信息（例如：程序变
量或其他经常更新的数据）。软件开发者应将不频繁更改的变量（例如常量、ID 和校准值等）存储在闪存
程序存储器中，以免超出 EEPROM 字节最大的写允许次数。
8.2.1. 读数据 EEPROM 存储器
要读取数据存储单元，用户必须先把 EECON3 的 DRDEN 置 1 并等待 0.2μs，然后把地址写入 EEADRL
寄存器，清零 EECON1 寄存器的 EEPGD 和 CFGS 控制位，再置 1 控制位 RD。在紧接着的下一个周期，
EEDATL 寄存器中就有了数据；因此，该数据可由下一条指令读取。EEDATL 将把此值保持至下一次读
取或用户向该单元写入数据时（在写操作过程中）为止。
例 8.2.1，读数据 EEPROM
BANKSEL EEADRL
;
LDWI DATA_EE_ADDR ;
STR EEADRL
;Data Memory
;Address to read
BCR EECON1, CFGS ;Deselect Config space
BCR EECON1, EEPGD ;Point to DATA memory
BSR EECON1, RD
;EE Read
LDR EEDATL, W
;W = EEDATL
注意：
1. 无论 CPB 为何值，软件总是可以读取 EEPROM；
2. 所需数据读完后，用户要清 DRDEN 以节省功耗；
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8.2.2. 写数据 EEPROM 存储器
要写 EEPROM 数据存储单元，用户应首先将该单元的地址写入 EEADRL 寄存器并将数据写入 EEDATL
寄存器。然后用户必须按特定顺序开始写入每个字节，且要确保 EECON3.DRDEN 清 0。
如果未完全按照上述顺序（即，首先将 55h 写入 EECON2，随后将 AAh 写入 EECON2，最后将 WR 位
置 1）逐字节写入，将不会启动写操作。在该代码段中应禁止中断。
此外，必须将 EECON1 中的 WREN 位置 1 以使能写操作。这种机制可防止由于代码执行错误（异常）
导致误写数据 EEPROM。除了更新 EEPROM 时以外，用户应始终保持 WREN 位清零。WREN 位不能
由硬件清零。
一个写序列启动后，清零 WREN 位将不会影响此写周期。除非 WREN 位置 1，否则 WR 位将无法置 1。
写周期完成时，WR 位由硬件清零并且 EE 写完成中断标志位（EEIF）置 1。用户可以允许中断或查询
此位。EEIF 必须用软件清零。
注意：
软件对 EECON1.WR 写 1 后，至少等待一个系统时钟（NOP 或者任何别的指令）软件才能对该位进行
读判断，否则将读回 0，进而影响程序的流程（比如误认为写结束）。
8.2.3. 防止误写操作的保护措施
有些情况下，用户并不希望向数据 EEPROM 存储器写入数据。为了防止 EEPROM 误写操作，器件内建
了各种保护机制。上电时，清零 WREN。同时，上电延时定时器（64ms 的延时）也会阻止对 EEPROM
进行写操作。
写启动序列和 WREN 位共同防止在以下情况下发生意外写操作：
欠压
电源故障
软件故障
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8.2.4. 关于 GIE 的清 0
在启动 EEPROM 和 FLASH 写之前，需要对 EECON2 顺序写 0x55 和 0xAA，且不能被打断。所以在做
该开锁动作前应把 GIE 清 0 以屏蔽可能的中断。而由于中断的响应延时为 2 个 NOP，故在第一次清 GIE
后，等两个 NOP 再次判断 GIE 是否为 0，如以下代码示：
GIE= 0;
NOP;
NOP;
while (GIE) { GIE= 0;};
MCLK
CLK_Q1
软件写DRDEN
DRDEN
EEADR
A0
在下一指令周期锁存
EEDAT
D0
0.2us
IREG
BSR EECON1, RD
DROM_RD
图 8.2.1 2T 模式下软件读 EEPROM 时序
例 8.2.2 写数据 EEPROM
该程序流
不能被中
断
BANKSEL EEADRL
LDWI DATA_EE_ADDR
STR EEADRL
LDWI DATA_EE_DATA
STR EEDATL
BCR EECON1, CFGS
BCR EECON1, EEPGD
BSR EECON1, WREN
;
;
;Data Memory Address to write
;
;Data Memory Value to write
;Deselect Configuration space
;Point to DATA memory
;Enable writes
BCR INTCON, GIE
NOP
NOP
BTSC INTCON, GIE
GOTO $-1
;Disable INTs.
LDWI 55h
STR EECON2
LDWI 0AAh
STR EECON2
;
;Write 55h
;
;Write AAh
BSR EECON1, WR
BSR INTCON, GIE
BCR EECON1, WREN
BTSC EECON1, WR
LJUMP $-2
;Set WR bit to begin write
;Enable Interrupts
;Disable writes
;Wait for write to complete
;Done
;Test again
注意：
1. 数据 EEPROM 写周期并不暂停指令的执行。
2. 清完 GIE 之后等待两个 NOP 再判断一个 GIE 是否被清掉，以避免因中断返回的 GIE 置 1。
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8.3. 闪存程序存储器概述
了解闪存程序存储器结构对于擦除和编程操作非常重要。闪存程序存储器按行排列。每行包括固定数量
的 14 位程序存储器字。行是用户软件可擦除的最小块大小。只有当目标地址位于未受写保护的存储器段
内（由配置字寄存器的 CPB 和 FSECPB0 定义），才能对闪存程序存储器进行写或擦除操作。擦除某行
后，用户可以对该行的部分或全部进行重新编程。写入程序存储器行的数据将被写入 14 位宽的数据写锁
存器中。用户不能直接访问这些写锁存器，但是可以通过对 EEDATH:EEDATL 寄存器对的连续写入来加
载写锁存器的内容。
数据写锁存器数并不等于行单元数，例如 FT61F08x 一行有 64 个单元，但只有 1 个写锁存器。编程时，
用户软件需要填充该组写锁存器并多次启动编程操作，才能完全重新编程擦除的行（页）。例如，具有
64 字的行大小和 1 个写锁存器的器件需要将数据装入写锁存器并启动编程操作 64 次。
注：如果用户只想修改部分以前编程的行，那么必须读取整行的内容并保存在 RAM 中，然后进行擦除。
8.3.1. 读闪存程序存储器
要读程序存储单元，用户必须：
1) 将最低有效地址位和最高有效地址位写入 EEADRH:EEADRL 寄存器对
2) 将 EECON1 寄存器的 CFGS 位清零
3) 将 EECON1 寄存器的 EEPGD 控制位置 1
4) 然后，将 EECON1 寄存器的控制位 RD 置 1
一旦将读控制位置 1，闪存程序存储器控制器将使用第二个指令周期读取数据。这会导致紧跟“BSR
EECON1,RD”指令后的第二条指令被忽略。在紧接着的下一个周期，EEDATH:EEDATL 寄存器对中就有
数据了，因此可在随后的指令中将该数据读作两个字节。
EEDATH:EEDATL 寄存器对将把此值保存至下一次读操作或用户向该单元写入数据时为止。
注：
1. 要求程序存储器读操作后的两条指令为 NOP。这可以防止用户在 RD 位置 1 后的下一条指令执行双
周期指令；
2. 不管 CP 位的设置如何，软件都可以读取闪存程序存储器；
例 8.3.1 读程序存储器
* This code block will read 1 word of program
* memory at the memory address: PROG_ADDR_HI: PROG_ADDR_LO
* data will be returned in the variables: PROG_DATA_HI, PROG_DATA_LO
BANKSEL EEADRL
; Select Bank for EEPROM registers
LDWI PROG_ADDR_LO
;
STR EEADRL
; Store LSB of address
LDWI PROG_ADDR_HI
;
STR EEADRH
; Store MSB of address
BCR EECON1,CFGS
BSR EECON1,EEPGD
BCR INTCON,GIE
BSR EECON1,RD
NOP
NOP
BSR INTCON,GIE
LDR EEDATL,W
STR PROG_DATA_LO
LDR EEDATH,W
STR PROG_DATA_HI
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; Do not select Configuration Space
; Select Program Memory
; Disable interrupts
; Initiate read
; Executed(Figure 8.3.1)
; Ignored(Figure 8.3.1)
; Restore interrupts
; Get LSB of word
; Store in user location
; Get MSB of word
; Store in user location
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8.3.2. 擦除闪存程序存储器
当执行代码时，程序存储器只能按行擦除。要擦除行：
1) 将要擦除的新行地址装入 EEADRH:EEADRL 寄存器对
2) 将 EECON1 寄存器的 CFGS 位清零
3) 将 EECON1 寄存器的 EEPGD、FREE 和 WREN 位置 1
4) 依次将 55h 和 Aah 写入 EECON2（闪存编程解锁序列）
5) 将 EECON1 寄存器的控制位 WR 置 1，以开始擦除操作
6) 查询 EECON1 寄存器的 FREE 位，以确定行擦除何时结束
参见例 8.3.2。
例 8.3.2 程序存储器的行擦除
; This row erase routine assumes the following:
; 1. A valid address within the erase block is loaded in ADDRH:ADDRL
; 2. ADDRH and ADDRL are located in shared data memory 0x70 - 0x7F (common RAM)
BCR INTCON,GIE
; Disable ints so required sequences will execute properly
NOP
NOP
BTSC INTCON, GIE
GOTO $-1
BANKSEL EEADRL
LDR ADDRL,W
; Load lower 8 bits of erase address boundary
STR EEADRL
LDR ADDRH,W
; Load upper 6 bits of erase address boundary
STR EEADRH
BSR EECON1,EEPGD ; Point to program memory
BCR EECON1,CFGS
; Not configuration space
BSR EECON1,FREE
; Specify an erase operation
BSR EECON1,WREN ; Enable writes
该程序流
不能被中
断
LDWI 55h ; Start of required sequence to initiate erase
STR EECON2
; Write 55h
LDWI 0AAh
;
STR EECON2
; Write AAh
BSR EECON1,WR
; Set WR bit to begin erase
NOP
; Any instructions here are ignored as processor
; halts to begin erase sequence
NOP
; Processor will stop here and wait for erase complete.
; after Erase processor continues with 3rd instruction
BCR EECON1,WREN ; Disable writes
BSR INTCON,GIE
; Enable interrupts
在“BSR EECON1,WR”指令后，处理器需要两个周期来设置擦除操作。用户必须在 WR 位置 1 后，执行
两条 NOP 指令。处理器将暂停内部操作，通常为 2ms 擦除时间。这不是休眠模式，因为时钟和外设将
继续运行。擦除周期后，处理器从 EECON1 写指令后的第三条指令继续操作。
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8.3.3. 写闪存程序存储器
使用以下步骤编程程序存储器：
1) 装入要编程的字的起始地址
2) 将数据装入写锁存器
3) 启动编程操作
4) 重复第 1 至 3 步，直到写入所有数据
写入程序存储器之前，要写入的字必须已擦除或者以前未写入过。程序存储器一次只能擦除一行。启动
写操作时不会自动擦除。
程序存储器一次只能写入一个字，请参见图 8.3.2（对带 1 个写锁存器的程序存储器进行字写操作）。程
序存储器写操作完成时，写锁存器将复位为 0x3FFF。
应完成以下步骤，以装载写锁存器和编程程序存储块。可按以下步骤操作：装载数据到写锁存器，启动
编程序列。需要特殊的解锁序列才能将数据装入写锁存器或启动闪存编程操作，不应中断此解锁序列。
1) 将 EECON1 寄存器的 EEPGD 和 WREN 位置 1
2) 将 EECON1 寄存器的 CFGS 位清零
3) 将要写入的单元地址装入 EEADRH:EEADRL 寄存器对
4) 依次将 55h 和 Aah 写入 EECON2，然后将 EECON1 寄存器的 WR 位置 1（闪存编程解锁序列）
5) 等待约 2ms 时间，锁存器数据写入程序存储器
例 8.3.3 给出了完整的单字写序列示例。将初始地址装入 EEADRH:EEADRL 寄存器对，数据通过间接寻
址载入。
7
5
0 7
EEDATH
0
EEDATL
14
EEADRL=0~3
写锁存器
14
程序存储器FLASH
图 8.3.2 对带 1 个写锁存器的 FLASH 进行写操作
注： 例 8.3.3 中提供的代码序列必须重复多次，以完全编程擦除的程序存储器行。
例如，对于 FT61F08x 系列芯片，一行（页）有 64 个 WORD，该代码序列需要重复 64 遍。
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例 8.3.3 对包含 1 个写锁存器的 FLASH 编程
; This write routine assumes the following:
; 1. The 2 bytes of data are loaded, starting at the address in DATA_ADDR
; 2. Each word of data to be written is made up of two adjacent bytes in DATA_ADDR, stored in little endian format
; 3. A valid starting address is loaded in ADDRH:ADDRL
; 4. ADDRH and ADDRL are located in shared data memory 0x70 - 0x7F (common RAM);
BCR INTCON,GIE
; Disable ints so required sequences will execute properly
NOP
NOP
BTSC INTCON, GIE
GOTO $-1
BANKSEL EEADRH ; Bank 3
LDR ADDRH,W
; Load target address
STR EEADRH
;
LDR ADDRL,W
;
STR EEADRL
;
LDWI LOW DATA_ADDR ; Load initial data address
STR FSR0L ;
LDWI HIGH DATA_ADDR ; Load initial data address
STR FSR0H ;
BSR EECON1,EEPGD ; Point to program memory
BCR EECON1,CFGS ; Not configuration space
BSR EECON1,WREN ; Enable writes
MOVIW FSR0++
STR EEDATL
MOVIW FSR0++
STR EEDATH
; Load first data byte into lower
;
; Load second data byte into upper
;
START_WRITE
该程序流
不能被中
断
LDWI 55h
STR EECON2
LDWI 0AAh
STR EECON2
BSR EECON1,WR
NOP
NOP
; Start of required write sequence:
; Write 55h
;
; Write AAh
; Set WR bit to begin write
; Any instructions here are ignored as processor
; halts to begin write sequence
; Processor will stop here and wait for write complete.
; after write processor continues with 3rd instruction
BCR EECON1,WREN ; Disable writes
BSR INTCON,GIE
; Enable interrupts
8.4. 修改闪存程序存储器
修改程序存储器行中的现有数据，并且该行内的数据必须保留时，必须首先读取它并将其保存在 RAM 映
像中。
使用以下步骤修改程序存储器：
1) 装入要修改的行的起始地址
2) 从行中读取现有数据并将其保存到 RAM 映像中
3) 修改 RAM 映像以包含要写入到程序存储器的新数据
4) 装入要重新写入的行的起始地址
5) 擦除程序存储器行
6) 将来自 RAM 映像的数据装入写锁存器
7) 启动编程操作
根据需要重复第 6 至 7 步多次，以对擦除行进行重新编程。
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8.5. 配置字 UCFGx/FCFGx 读访问
当 EECON1 寄存器中的 CFGS=1 时，不是访问程序存储器或 EEPROM 数据存储器，而是访问配置字
UCFGx。这是 PC=1 时指向的区域，即当软件发起读操作时，地址是[0x8000+EADDR]，但不是所
有的地址都可访问，对于未实现的单元，读返回未定义。
8.6. 写校验
根据具体应用，将写入数据 EEPROM 或者程序存储器中的值对照期望写入的值进行校验（见例 9.6.1）
是一个良好的编程习惯。例 8.6.1 显示了如何校验对 EEPROM 的写操作。
例 8.6.1 对数据 EEPROM 写校验
BANKSEL EEDATL ;
LDR EEDATL, W
;EEDATL not changed from previous write
BSR EECON1, RD
;YES, Read the value written
XORWR EEDATL, W ;
BTSS STATUS, Z
;Is data the same
LJUMP WRITE_ERR ;No, handle error
;Yes, continue
8.7. FLASH 内容保护
FLASH 控制器内置加密保护单元，具备以下特性：
全区加密，由 CPB 位控制
分扇区加密，1 扇区=1k words，由 FSECPB0 寄存器控制
解除加密只能通过执行一次包含 UCFG 页在内的全芯片擦除
全加密和分扇区加密区别如下表：
加密方式
CPU 取指
软件读
软件写
串口读
串口写
无
√
√
√(2)
√
√
全区
√
√
√(2)
(1)
(4)
分扇区
√
(1)
(3)
(3)
(5)
注意：
1) EEDAT 保持旧值不变；
2) 软件不可以编程或擦除 UCFG 页；
3) 只可以读未加密的扇区；
4) 只允许串口做包括 UCFG 在内的全芯片擦除；
5) 只允许串口做包括 UCFG 在内的全芯片擦除，或者对未加密的扇区做页擦除，编程；
6) 任何情况下，软件都不可以做全芯片擦除以及 FCFG 区的编程和擦除
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8.8. 与 EEPROM 相关寄存器汇总
名称
地址
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
复位值
INTCON
0x0B
GIE
PEIE
EEIE
LVDIE
OSFIE
EEIF
LVDIF
OSFIF
0000 0000
EECON1
0x195
EEPGD
CFGS
—
FREE
WRERR
WREN
WR
RD
00-0 x000
EECON2
0x196
EECON3
0x198
EEADRH
0x192
EEADRL
0x191
EEPROM 地址低 8 位
0000 0000
EEDATL
0x193
EEPROM 数据低 8 位
xxxx xxxx
EEDATH
0x194
—
—
EECON4
0x391
—
PONLY
EEPROM 写控制寄存器 2
---- ----
—
DRDEN
—
EEPROM 地址高 7 位
-000 0000
EEPROM 数据高 6 位
—
—
—
---- ---0
--xx xxxx
—
—
—
-0-- ----
8.8.1. EEDAT 寄存器，地址 0x193, 0x194
EEDATL, SFR 地址 0x193
Bit
7
6
5
4
Name
3
2
1
0
EEDAT[7:0]
Reset
x
x
x
x
x
x
x
x
Type
RW
RW
RW
RW
RW
RW
RW
RW
5
4
3
2
1
0
EEDATH, SFR 地址 0x194
Bit
7
6
Name
—
—
Reset
—
—
x
x
x
x
x
x
Type
RO-0
RO-0
RW
RW
RW
RW
RW
RW
Bit
Name
15:14
N/A
13:0
EEDAT
rev1.05
EEDAT[13:8]
Function
保留位，读 0
EEPROM/FLASH 读写数据寄存器
在写周期（约 2ms）内，该寄存器不可写
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8.8.2. EEADR 寄存器，地址 0x191, 0x192
EEADRL, SFR 地址 0x191
Bit
7
6
5
4
Name
3
2
1
0
EEADR[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
5
4
3
2
1
0
EEADRH, SFR 地址 0x192
Bit
7
6
Name
—
Reset
—
0
0
0
0
0
0
0
Type
RO-0
RW
RW
RW
RW
RW
RW
RW
EEADR[14:8]
Bit
Name
15
N/A
Function
保留位，读 0
EEPROM/FLASH 读写地址寄存器
14:0
EEADR
在写周期（约 2ms）内，该寄存器不可写
注意：用该寄存器访问程序存储器时，地址范围必须位于 0~0x1FFF，否则无法完成读写访问
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- 74 -
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8.8.3. EECON1 寄存器，地址 0x195
Bit
7
6
5
4
3
2
1
0
Name
EEPGD
CFGS
—
FREE
WRERR
WREN
WR
RD
Reset
0
0
0
0
x
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW-1
RW-1
Bit
Name
Function
FLASH/数据 EEPROM 存储器选择位
7
EEPGD
1 = 访问 FLASH
0 = 访问数据 EEPROM 存储器
FLASH/数据 EEPROM 或配置寄存器选择位
6
CFGS
1 = 访问配置寄存器，读访问
0 = 访问 FLASH 或数据 EEPROM 存储器
5
Reserved
保留位，不要向该位写 1
FLASH 擦除使能位
当 CFGS=0 且 EEPGD=1（FLASH）
：
1 = 在下一条 WR 命令执行擦除操作（擦除完成后由硬件清零）
4
FREE
0 = 在下一条 WR 命令执行写操作
如果 EEPGD=0 且 CFGS=0（访问数据 EEPROM）
：
该位不起作用，下一条 WR 命令将启动一个擦除周期和一个写周期
EEPROM 错误标志位
1 = 此状态表示试图进行不当的编程或擦除序列
3
WRERR
或在写周期过程中被意外终止时，该位自动置 1
终止的事件可以是除 POR 之外的任何复位
0 = 编程或擦除操作正常完成
编程/擦除使能位
2
WREN
1 = 允许执行编程/擦除操作
0 = 禁止编程/擦除 FLASH 和数据 EEPROM
在写周期内，禁止对该寄存器位写
FLASH/EEPROM 写控制位
1 = 启动 FLASH 或数据 EEPROM 编程/擦除操作，软件写 1 后至少要等 1 个系统时钟才能回
1
WR
读
该操作是自定时的，且该位在操作完成时由硬件清零
用软件只能将 WR 位置 1，但不能清零
0 = 对闪存或数据 EEPROM 的编程/擦除操作已完成，当前不在进行中
FLASH/数据 EEPROM 读控制位
0
RD
1 = 启动对 FLASH 或数据 EEPROM 的读操作。读操作只占用一个周期
RD 由硬件清零，用软件只能将 RD 位置 1，但不能清零
0 = 不启动 FLASH 或数据 EEPROM 读操作
rev1.05
- 75 -
2020-5-29
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FT61F08X
8.8.4. EECON2 寄存器，地址 0x196
Bit
7
6
5
Name
4
3
2
1
0
EEPROM 控制寄存器 2
Reset
x
x
x
x
x
x
x
x
Type
WO
WO
WO
WO
WO
WO
WO
WO
Bit
Name
Function
FLASH/数据 EEPROM 写操作解锁控制寄存器
7:0
EECON2
要解锁写操作，在对 EECON1 寄存器的 WR 置位前，必须先写 55h，随后是 Aah。写入该寄
存器的值用于解锁写操作。对这些写操作有特殊的时序要求，必须是在连续的指令周期完成
8.8.5. EECON3 寄存器，地址 0x198
Bit
7
6
5
4
3
2
1
0
Name
—
—
—
—
—
—
—
DRDEN
Reset
—
—
—
—
—
—
—
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RW
Bit
Name
7:1
N/A
Function
保留位，读 0
数据 EEPROM 读使能
0
DRDEN
1：允许软件读数据 EEPROM(DROM)，置 1 后至少要等 0.2μs 才能发起 DROM 读
0：禁止软件读数据 EEPROM(DROM)
rev1.05
- 76 -
2020-5-29
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FT61F08X
8.8.6. EECON4 寄存器，地址 0x391
Bit
7
6
5
4
3
2
1
0
Name
—
PONLY
—
—
—
—
—
—
Reset
—
0
—
—
—
—
—
—
Type
RO-0
RW
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
Bit
Name
7, 5:0
N/A
Function
保留位，读 0
对于 I 版以上芯片，该位控制 DROM 只编程模式使能(A~H 版本无效)
6
PONLY
0:DROM 只编程模式未使能
1:DROM 只编程模式使能
rev1.05
- 77 -
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9. 12bit ADC 模块
模数转换器（Analog-to-digital Converter，ADC）可将模拟输入信号转换为相应的 12 位二进制表征值。
该系列器件采用多个模拟输入复用到一个采样保持电路。采样保持电路的输出与转换器的输入相连接。
转换器通过逐次逼近法产生 12 位二进制值，并将转换结果保存在 ADC 结果寄存器（ADRESL:ADRESH）
中。ADC 参考电压可用软件选择为 VDD、外部参考电压或内部产生的参考电压。ADC 可在转换完成时
产生中断。该中断可用于将器件从休眠唤醒。
INT_VREF
VDD
INT_VREF+EXT_CAP
EXT_VREF
PB7/AN0
0000
PC1/AN1
0001
PC0/AN2
0010
PA7/AN3
0011
PA6/AN4
0100
PA4/AN5
0101
PA3/AN6
0110
ADPREF=00
ADNREF=00
ADPREF=01
ADNREF=01
ADPREF=10
ADNREF=10
ADPREF=11
ADNREF=11
Vref+
INT_VREF+EXT_CAP
EXT_VREF
Vref-
A/D
12
ADON / ADCAL
ADFM
0111
PB1/AN7
INT_VREF
GND
左对齐/右对齐处理
1000
¼ VDD
16
GO/DONE
CHS
PWM0
000
PWM1
001
PWM2
010
PWM3
011
PWM4
100
PWM5
101
PWM6
110
ADC_ETR
111
ADRESH/L
[00]
[01]
ADDLY
ADEX
[10]
0.5V
00
2V
01
3V
10
float
11
INT_VREF
[11]
ADINTREF[1:0]
ETGSEL[2:0]
ETGTYP[1:0]
External Trigger
Int Vref
图 9.1 ADC 原理框图
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9.1 ADC 的配置
配置和使用 ADC 时，必须考虑以下功能：
校准 ADC
端口配置
通道选择
触发方式选择
触发源选择
触发类型选择
触发延时配置
ADC 参考电压的选择
ADC 转换时钟源
中断控制
转换结果的格式
阈值比较
注意：在进行各项配置更改的时候，需要确保 AD 转换并未正在进行或外部触发功能未开启。建议在
ADON 关闭时进行更改。
9.1.1校准 ADC
ADC 在启动转换之前建议至少进行一次校准。校准值会一直保存但不可见，任何复位都会导致其丢失。
ADCON0 寄存器的 ADCAL 设定为 1 可启动自动校准，不可以与 ADON 同时设定为 1。
自校准实现 ADC 偏移误差的自修正，实现原理是断开输入电压 Vin 选择的端口，将其与内部比较器的
负参考电压 Vref-端口连接，以保证输入电压为 Vref-时能够输出零点转换值。
更多信息请参见第 9.2 节“ADC 的工作原理”。
9.1.2端口配置
ADC 可用于转换模拟和数字信号。转换模拟信号时，应将相关的 TRIS 和 ANSEL 位置 1 将 I/O 引脚应
配置为模拟功能。更多信息请参见相应的端口章节。
注意：如果定义为数字输入的引脚上存在模拟电压，会导致输入缓冲器传导过大的电流。
9.1.3通道选择
ADCON0 寄存器的 CHS 位决定将哪个通道连接到采样保持电路。改变通道时，根据采样稳定的需要可
在启动转换前加入一定延时，硬件已固定有 1.5TAD 的采样延时。更多信息请参见第 9.2 节“ADC 的工作
原理”。
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9.1.4触发方式选择
ADCON0 寄存器的 ADEX 位决定是否使用外部触发信号。
若 ADEX=0 时，ADGO 可由程序置位，AD 转换完成自动清零。
若 ADEX=1 时，ADGO 将由外部硬件触发置位，AD 转换完成清零。
注意：若选择了前沿消隐触发 ADC，即 LEBADT 设为 1 时，需要先置位 ADEX 和 ADON。
9.1.5触发源选择
在设定 ADEX 后，ADCON2 寄存器的 ETGSEL 位决定使用哪个外部触发信号。其中可选 I/O 引脚触发，
需要配置相关寄存器。具体请参见相应的端口章节。
9.1.6触发类型选择
ADCON2 寄存器的 ETGTYP 位决定外部触发信号的触发类型。
其中选择 PWM 的中点或终点类型时，触发源将会默认选择 TIM1 中心对齐的 PWM 输出信号。具体请
参见相应的 TIM1 章节。
9.1.7触发延时配置
ADCON2 寄存器的 ADDLY.8 位和 ADDLY 寄存器组成 9 位延时计数器，共同决定外部触发信号的触发
延时时间。由于需要同步异步信号，实际延迟时间为：(ADDLY+6)/FADC。
注意：若选择了前沿消隐触发功能时，则实际延迟时间为：(ADDLY+3)/FTIM1 + 3/FADC。
9.1.8ADC 参考电压
ADCON1 寄存器的 ADPREF 位提供对正参考电压的控制，ADNREF 位提供对负参考电压的控制。正/
负参考电压可以是内部参考电压、VDD/GND、内部参考电压加外部电容、外部参考电压。正/负参考电
压可以有各种组合，但不可以同时选择内部参考电压。若发生则强制负参考电压选择 GND。
ADCON2 寄存器的 ADINTREF 位提供对内部参考电压的控制。内部参考电压可以选择 0.5V、2V、3V
或者悬空。
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9.1.9转换时钟
ADCS
3
FOSC
ADCLK
DIVIDER
ADC
FRC
图 9.2 ADC 的时钟配置原理
转换时钟源可通过 ADCON1 寄存器的 ADCS 位用软件选择。有以下 7 种时钟选项：
FOSC/2
FOSC /4
FOSC /8
FOSC /16
FOSC /32
FOSC /64
FRC（内部慢时钟振荡器）
完成一位（bit）的转换时间定义为 TAD。完成 12 位转换需要 15 个 TAD 周期（包括 1.5TAD 的采样时间
和 1TAD 的数据传输处理时间），如图 9.3 和 9.6 所示。
进行正确的转换必须满足相应的 TAD 规范。更多信息请参见第 21 节“电气特性”中的 A/D 转换要求。表
9.1 所示为正确选择 ADC 时钟的示例。
注意：
1. 除非使用的是 FRC，否则任何系统时钟频率的变化均会改变 ADC 时钟频率，这将对 ADC 结果产生
负面影响；
2. FRC 可以是 256kHz 或者是 32kHz，取决于 LFMOD 为何值；
3. 下表灰色部分表示不支持的时钟周期；
rev1.05
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ADC 时钟周期（TAD）
系统时钟频率（FOSC）
ADC
时钟源
ADCS
16MHz
8MHz
4MHz
1MHz
FOSC /2
000
125ns
250ns
500ns
2.0μs
FOSC /4
100
250ns
500ns
1.0μs
4.0μs
FOSC /8
001
0.5μs
1.0μs
2.0μs
8.0μs
FOSC /16
101
1.0μs
2.0μs
4.0μs
16.0μs
FOSC /32
010
2.0μs
4.0μs
8.0μs
32.0μs
FOSC /64
110
4.0μs
8.0μs
16.0μs
64.0μs
FRC
x11
4.0μs
4.0μs
4.0μs
4.0μs
表 9.1 ADC 时钟周期和器件工作频率
TCY to TAD
TAD1
TAD2
TAD3
TAD4
TAD5
TAD6
TAD7
TAD8
TAD9
TAD10
TAD11
TAD12
TAD13
TAD14
b11
b10
b9
b8
b7
b6
b5
b4
b3
b2
b1
b0
保持电容连接到模拟管脚
ADCMPO比较输出
转换开始
GO置1
TAD15
ADIF置1
GO位清0
装载ADRESH和ADRESL
保持电容从模拟输入断开
图 9.3 模数转换 TAD 周期
9.1.10
中断
ADC 模块可使中断在模数转换完成时产生。ADC 中断标志为 PIR1 寄存器中的 ADIF 位。ADC 中断使
能为 PIE1 寄存器中的 ADIE 位。ADIF 位必须用软件置 1 清零。
注意：
1、无论 ADC 中断是否被打开，ADIF 位在每次正常转换完成时均置 1。
2、自动校准完成、软件停止 AD 转换都不会置位 ADIF。
3、仅当在选择了 FRC 振荡器或打开 SYSON bit 时，ADC 才能在休眠期间工作。
器件工作或处于休眠状态时均可产生中断。如果器件处于休眠状态，中断可唤醒器件。从休眠唤醒时，
始终执行 SLEEP 指令后的那条指令。如果用户试图唤醒器件并恢复顺序执行代码，必须禁止全局中断。
如果允许全局中断，代码执行将转至中断服务程序。
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9.1.11
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转换结果的格式
12 位 A/D 转换结果有两种格式，即左对齐和右对齐。ADCON1 寄存器的 ADFM 位控制输出格式。
AD 自动校准值也受输出格式影响。
图 9.4 所示为两种输出格式。
ADRESH
ADFM=1
ADRESL
MSB
bit7
LSB
bit0
bit7
bit0
12位ADC结果
ADRESH
ADFM=0
ADRESL
MSB
LSB
bit7
bit0
bit7
bit0
12位ADC结果
图 9.4 ADC 转换结果格式示意
9.1.12
阈值比较
ADCMPH 寄存器为 ADC 结果比较阈值，ADCON3 寄存器的 ADCMPEN 位控制比较功能使能，
ADCMPOP 位控制比较极性，ADCMPO 指示比较结果。
ADC 可以在每次转换完成时进行比较。比较结果会一直保持，直到下次转换完成被更新。ADCMPEN
或 ADON 的清零可以关闭比较功能或 AD 模块，
同时可以清零 ADCMPO。进入睡眠不会清零 ADCMPO。
在每次比较完成时可以产生故障刹车事件，由 ADCON3 寄存器的 ADFBEN 控制。
ADC_DATA[11:4]
+
0
ADCMPH[7:0]
-
1
ADCMPOP
ADCMPO
ADCMPEN
ADC compare event
ADFBEN
图 9.5 ADC 阈值比较功能框图
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9.2 ADC 的工作原理
9.2.1启动自动校准
要启动 ADC 模块的自动校准功能，必须将 ADCON0 寄存器的 ADCAL 位置 1。
校准完成后会自动将 ADCAL 清零，并且将校准值更新到 ADRESH/L。
校准完成后 ADC 模块处于已校准状态，直到器件掉电或复位前均有效。
注意：ADCAL 不能跟 ADON 同时置 1。
校准步骤
1. 把 ADON 位置 1；
2. 配置正确的 VREFP 和 VREFN，这点尤其重要，因为校准结果直接影响后面的 ADC 转换；
3. 把 ADCAL 位置 1；
4. 等待 ADCAL 位清 0，至此，自动校准过程结束；
9.2.2启动转换
要使能 ADC 模块，必须将 ADCON0 寄存器的 ADON 位置 1。
若 ADEX=0 时，将 ADCON0 寄存器的 GO/DONE 位置 1 将启动 AD 转换,。
若 ADEX=1 时，需要外部触发信号才能启动，并且硬件置位 GO/DONE 位，程序置位 ADGO 无效。
注意：
1. 不应在打开 ADC 的那条指令中将 GO/DONE 位置 1。请参见第 9.2.7 节“A/D 转换步骤”
2. 不应在启动 ADC 转换后或等待外部触发时更改 AD 配置。
3. 置位 ADGO 后需要等待一个系统周期才可读回 ADGO 标志。
9.2.3转换完成
转换完成时，ADC 模块将：
将 GO/DONE 位清零
将 ADIF 标志位置 1
用新的转换结果更新 ADRESH:ADRESL 寄存器
若使能阈值比较功能，则更新 ADCMPO 比较结果
9.2.4终止转换
如果转换必须在完成前被终止，可用软件将 GO/DONE 清零。ADRESH:ADRESL 将使用部分完成的模
数转换结果进行更新。未完成位将用最后转换的一位填充。
终止转换需要处理时间，实际处理时间为 4/FAD ，即在这个时间后才会更新 AD 转换结果，若终止时 AD
还未开始转换，则不更新 AD 转换结果。
终止转换不会产生中断。
注意：器件复位将强制所有寄存器回到其复位状态。这样，ADC 模块就被关闭，并且任何待处理的转换
均被终止。
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9.2.5休眠模式下 ADC 的工作
ADC 模块可在休眠期间工作，这要求将 ADC 时钟源置于 FRC 选项或打开 SYSON 位。
ADC 需要等待 4*TAD 后才开始转换。这允许软件在设置 ADGO 后，执行一个 SLEEP 指令置 MCU 于
SLEEP 模式，从而降低 ADC 转换期间的系统噪声。通过配置 ADC 时钟为 FRC 和清零 SYSON，可进
一步降低系统噪声。
如果允许 ADC 中断，转换完成后器件将从休眠唤醒。如果禁止 ADC 中断，ADC 模块在转换完成后关
闭，尽管 ADON 位保持置 1 状态。
如果 ADC 时钟源不是 FRC 并且 SYSON 未打开，执行一条 SLEEP 指令将使当前转换强制中止，ADC
模块被直接关闭，尽管 ADON 位保持置 1 状态。
如果需要在休眠模式下搭配其它模块一起使用，具体请参见相应的功能配置章节，如 TIMER、GPIO、
CLK 管理模块。
9.2.6外部触发器
除了通过软件启动 AD 转换外，还可以通过硬件触发方式启动 AD 转换。在 ADEX 置 1 后，可选择 PWM
通道的边沿或周期、管脚边沿等触发信号自动触发启动 AD 转换（硬件自动置位 GO/DONE）。这允许在
没有软件介入的情况下，定期进行 AD 转换。
通过 ETGSEL (ADCON2[2:0]) 和 ETGTYP (ADCON2[5:4]) 设置来选择触发源和触发类型。同时，还
可以在外部触发信号与启动 AD 转换之间插入触发延时。
在 AD 模块转换过程中(GO/DONE = 1)，任何软件或硬件触发信号都是无效的。若这时停止转换，清零
ADGO 并不会停止触发延时计数。可清零 ADEX 停止触发延时计数。
只有配置 TIMER 为 PWM 输出模式并且使能 PWM 输出时，才会产生 AD 触发信号。更多信息请参见相
应的 TIMER 章节。
注意：
当 LEBEN=1 时，外部触发器被禁止。这种情况下，可以选择把 LEBADT 置 1，此时 ADON 和 ADEX
必须设置为 1。在消隐周期结束后会触发一次 AD 转换（硬件自动置位 GO/DONE）。
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9.2.7A/D 转换步骤
以下是使用 ADC 进行模数转换的步骤示例：
1. 配置端口：
禁止引脚输出驱动器（见 TRIS 寄存器）
将引脚配置为模拟
2. 配置 ADC 模块：
选择 ADC 转换时钟
配置参考电压
选择 ADC 输入通道
配置触发源、类型及延时
选择转换结果的格式
配置 ADC 结果阈值比较
3. 配置 ADC 中断（可选）：
将 ADC 中断标志清零
允许 ADC 中断
允许外设中断
允许全局中断
4. 进行 ADC 自校准（可选）
：
将 ADCAL 置 1 启动自校准
等待并查询 ADCAL 位，为 0 则校准结束
5. 打开 ADC 模块，并等待所需稳定时间 TST(1)；
6. 将 GO/DONE 置 1 启动转换或等待硬件触发；
7. 等待一个系统周期才可回读 GO/DONE；
8. 通过以下情况之一等待 ADC 转换完成：
查询 GO/DONE 位
等待 ADC 中断（允许中断时）
9. 读取 ADC 结果；
10. 将 ADC 中断标志清零（在允许了中断的情况下这一步是必需的）。
以下是一段示例代码：
BANKSEL TRISB
;
BSR
TRISB,7
;Set PB7 to input
BANKSEL ANSELA
;
BSR
ANSELA,0
;Set PB7 to analog
BANKSEL ADCON1
;
LDWI
B’11110101’
;Right justify, ADC Frc clock
STR
ADCON1
;Vref+ VDD , Vref- GND
BANKSEL ADCON0
;
LDWI
B’00000000’
;Select channel AN0,
STR
ADCON0
;
BSR
ADCON0,ADCAL
;Start ADC Self-Calibration
BTSC
ADCON0,ADCAL
;Is Self-Calibration done?
GOTO
$-1
;No, test again
BSR
ADCON0,ADON
;Turn ADC On
CALL
StableTime
;ADC stable time
BSR
ADCON0,ADGO
;Start conversion
NOP
;ADGO ReadBack WaitTime
BTSC
ADCON0,ADGO
;Is conversion done?
GOTO
$-1
;No, test again
BANKSEL ADRESH
;
LDR
ADRESH,W
;Read upper 4 bits
STR
RESULTHI
;store in GPR space
BANKSEL ADRESL
;
LDR
ADRESL,W
;Read lower 8 bits
STR
RESULTLO
;Store in GPR space
注意：
1. TST 时间是 ADC 的稳定时间，当使用内部参考时，ADC 首次启动还需要考虑参考电压的稳定时间
TVRINT，等待时间应取两者的较大者，即 max(TVRINT, TST);
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9.3 A/D 采集时间要求
ADCAL
6*TAD
ADC_CLK
1
2
3
108
109
110
3*TSYS
CALI_END
ADRES
Old Data
New Data
图 9.6 ADC 自校准时序图
ADON
TST
ADGO
3*TAD
ADC_CLK
1
2
3
13
14
15
CONV_END
ADIF
ADRES
Old Data
New Data
ADCMPO
ADCMPEVT
图 9.7 ADC 软件触发转换时序图
为了使 ADC 达到规定的精度，必须使充电保持电容（CHOLD）充满至输入通道的电平。模拟输入模型
请参见图 9.8。源阻抗（RS）和内部采样开关（RSS）阻抗直接影响电容 CHOLD 的充电时间。采样开
关（RSS）阻抗随器件电压（VDD）的变化而变化，参见图 9.8。建议模拟信号源的最大阻抗为 10kΩ。
采集时间随着源阻抗的降低而缩短。在选择（或改变）模拟输入通道后，必须在开始转换前完成采集。
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VDD
采样开关
Rs < 10K
+
VA
Ain
VT=0.6V
CPIN
5pF
-
Rss
SS
RIC
CHOLD
ILEAKAGE
±500 nA
VSS/VREF
VSS
图注：
CPIN
VT
ILEAKAGE
RIC
SS
CHOLD
= 输入电容
=门限电压
=结点漏电流
=互联电阻
=采样开关
=采样保持电容
图 9.8 模拟输入模型
9.4 与 ADC 相关寄存器汇总
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
名称
地址
ADRESL
0x09B
A/D 结果寄存器的低字节
0000 0000
ADRESH
0x09C
A/D 结果寄存器的高字节
0000 0000
ADCON0
0x09D
ADCON1
0x09E
ADCON2
0x09F
ADDLY
0x01F
ADCON3
0x41A
ADCMPH
0x41B
LEBCON
0x41C
CHS
ADFM
ADCAL
ADCS
ADINTREF
ADEX
ADNREF
ETGTYP
ADDLY.8
GO/DONE
ADON
ADPREF
ETGSEL
ADCMPOP
ADCMPEN
ADCMPO
LEBADT
LEBCH
EDGS
0000 0000
0000 0000
—
ELVDS
ADCMPH
LEBEN
0000 0000
0000 0000
ADDLY / LEBPRL
ADFBEN
复位值
0000 0-00
0000 0000
BKS2
BKS1
BKS0
0000 0000
注：ADCON2、ADDLY、ADCON3、LEBCON 即使在 PCKEN 的 ADCEN 位为 0 时也可以读写。
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FT61F08X
9.4.1ADRESL，地址 0x9B
Bit
7
6
5
Name
4
3
2
1
0
ADRESL
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
2
1
0
Bit
Name
Function
ADC 结果寄存器的低字节
7:0
ADRESL
ADFM=0 时，ADRESL[7:4]为 12 位转换结果的低 4 位，其余为 0。
ADFM=1 时，ADRESL[7:0]为 12 位转换结果的低 8 位。
9.4.2ADRESH，地址 0x9C
Bit
7
6
5
Name
4
3
ADRESH
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
ADC 结果寄存器的高字节
7:0
ADRESH
ADFM=0 时，ADRESH[7:0]为 12 位转换结果的高 8 位。
ADFM=1 时，ADRESH[3:0]为 12 位转换结果的高 4 位，其余为 0。
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FT61F08X
9.4.3ADCON0，地址 0x9D
Bit
7
6
Name
5
4
CHS
3
2
1
0
ADCAL
ADEX
GO/DONE
ADON
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
模拟通道选择位
0000 = AN0
0001 = AN1
0010 = AN2
0011 = AN3
7:4
CHS
0100 = AN4
0101 = AN5
0110 = AN6
0111 = AN7
1000 = 1/4 VDD
其余保留
ADC 自动校准使能位（ADON 为 0 时可设定）
3
ADCAL
该位由软件设置来启动 ADC 校准。当校准完成后，由硬件清零。
0 = 校准完成。
1 = 写 1 时校准 ADC，读为 1 时意味着校准仍在进行中。
ADC 触发信号类型选择
该位决定启动 ADC 的触发条件
2
ADEX
0 = 当软件设定 GO/DONE 位，启动 AD 转换
1 = 需要外部触发信号触发才可启动 AD 转换，触发事件置位 GO/DONE 位。
外部触发信号条件由寄存器 ETGSEL和 ETGTYP决定。
AD 转换状态位（硬件触发事件直接置位）
1
GO/DONE
将该位置 1 可启动 A/D 转换周期。当 A/D 转换完成以后，该位由硬件自动清零。
0 = A/D 转换完成/未进行。
1 = A/D 转换正在进行或硬件触发延时正在计数。
ADC 使能位
0
ADON
0 = ADC 被禁止且不消耗工作电流
1 = ADC 被使能
rev1.05
- 90 -
2020-5-29
Fremont Micro Devices
FT61F08X
9.4.4ADCON1，地址 0x9E
Bit
7
Name
ADFM
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
6
5
4
ADCS
3
2
ADNREF
Name
1
ADPREF
Function
ADC 结果格式选择位
7
ADFM
1 = 右对齐。装入转换结果时，ADRESH 的高 4 位被设置为 0。
0 = 左对齐。装入转换结果时，ADRESL 的低 4 位被设置为 0。
ADC 转换时钟选择位
000 = FOSC/2
001 = FOSC/8
010 = FOSC/32
6:4
ADCS
011 = FRC（由专用 RC 振荡器提供时钟）
100 = FOSC/4
101 = FOSC/16
110 = FOSC/64
111 = FRC（由专用 RC 振荡器提供时钟）
ADC 负参考电压配置位（使用 PB6 连接外部参考电压或外部电容）
00 = Int Vref（内部参考电压）
3:2
ADNREF
01 = GND
10 = Int Vref + Ext Cap（内部参考电压 + 外部电容）
11 = Ext Vref（外部参考电压）
ADC 正参考电压配置位（使用 PB5 连接外部参考电压或外部电容）
00 = Int Vref（内部参考电压）
1:0
ADPREF
01 = VDD
10 = Int Vref + Ext Cap（内部参考电压 + 外部电容）
11 = Ext Vref（外部参考电压）
rev1.05
- 91 -
0
2020-5-29
Fremont Micro Devices
FT61F08X
9.4.5ADCON2，地址 0x9F
Bit
7
6
5
4
ETGTYP
3
2
ADDLY.8
1
0
Name
ADINTREF
ETGSEL
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
ADC 内部参考电压配置位
00 = 0.5V
7:6
ADINTREF
01 = 2V
10 = 3V
11 = float（悬空）
外部触发信号类型选择
当 ADEX 置 1，该位决定响应外部触发的类型
00 = PWM 或 ADC_ETR 脚的下降沿
5:4
ETGTYP
01 = PWM 或 ADC_ETR 脚的上升沿
10 = 一个 PWM 周期的中点
11 = 一个 PWM 周期的终点
注：PWM 周期中点或终点触发仅适用于中心对齐模式的 PWM 输出
3
ADDLY.8
ADC 外部触发延时计数器阈值 第 8 位
/LEBPR9
详见 ADDLY 寄存器描述
外部触发源选择
当 ADEX 为 1，该位选择外部触发 ADC 的来源
选择 PWM 源时需要配置 TIMER 为 PWM 输出模式并使能输出。
000 = PWM0
001 = PWM1
2:0
ETGSEL
010 = PWM2
011 = PWM3
100 = PWM4
101 = PWM5
110 = PWM6
111 = ADC_ETR
rev1.05
- 92 -
2020-5-29
Fremont Micro Devices
FT61F08X
9.4.6ADDLY/LEBPRL，地址 0x1F
Bit
7
6
5
4
Name
3
2
1
0
ADDLY
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
ADC 外部触发启动延时计数器阈值低位
该 8 位寄存器与 ADCON2.7 组成 9 位计数器，用于在外部触发启动 ADC 之前加入一段延迟。延迟计数
7:0
ADDLY
器结束再开始 ADC 转换
外部延迟时间 = (ADDLY+6)/FADC
注，该延时仅当 ADEX 置 1 时有效。如果启用 PWM 输出触发 ADC 功能，在 PWM 运行过程中不得更改
ADDLY 计数值。同时复用为前沿消隐计数阈值
9.4.7ADCON3，地址 0x41A
Bit
7
6
5
4
3
2
Name
ADFBEN
ADCMPOP
ADCMPEN
ADCMPO
LEBADT
—
Reset
0
0
0
0
0
—
0
0
Type
RW
RW
RW
RO
RW
RO-0
RW
RW
Bit
Name
1
0
ELVDS
Function
ADC 比较结果响应故障刹车使能
7
ADFBEN
0 = 禁止
1 = ADC 触发故障刹车功能使能
ADC 比较器输出极性选择位
6
ADCMPOP
0 = 若 ADC 结果的高八位大于或等于 ADCMPH[7:0]，ADCMPO 为 1
1 = 若 ADC 结果的高八位小于 ADCMPH[7:0]，ADCMPO 为 1
ADC 结果比较使能位
5
ADCMPEN
0 = ADC 结果比较功能关闭
1 = ADC 结果比较功能打开
4
ADCMPO
ADC 比较结果输出位
该位输出 ADCMPOP 设定的比较输出结果。每次 AD 转换结束都会更新输出
前沿消隐周期结束后，ADC 触发使能
3
LEBADT
1 = 触发 ADC 转换
0 = 不触发 ADC 转换
2
N/A
保留：读为 0
外部 LVD 管脚输入选择，只有当 LVDM 为 1 时才有效
00 = ELVD0
1:0
ELVDS
01 = ELVD1
10 = ELVD2
11 = ELVD3
rev1.05
- 93 -
2020-5-29
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FT61F08X
9.4.8ADCMPH，地址 0x41B
Bit
7
6
5
Name
4
3
2
1
0
ADCMPH
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
7:0
ADCMPH
rev1.05
Function
ADC 比较阈值
仅 8 位，用于 ADC 结果高 8 位比较。
- 94 -
2020-5-29
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FT61F08X
10. 高级定时器 TIM1
10.1. 特性
16bit 的向上计数、向下计数或者上/下计数器，支持自动重载；
支持可编程预分频的计数时钟；
支持 4 个独立的捕捉比较通道，通道可支持：
输入捕捉
输出比较
边沿或中心对称 PWM
单脉冲输出
6 步 PWM
PWM 互补输出和可编程死区时间；
可编程的重复计数器；
刹车功能，使输出停止在一个复位态或者一个预设状态
中断事件：
更新事件：计数器溢出，计数器初始化
触发事件：触发计数开始与停止，计数器初始化或外部触发事件
输入捕捉事件
输出比较事件
刹车输入有效事件
外部时钟的触发计数
前沿消隐
10.2. 原理框图
fMASTER/DIV
CLOCK/TRIGGER
CONTROLLER
TRC
Clock/reset/enable
TIME BASE UNIT
Repetition
counter
CK_CNT
CK_PSC
UP-DOWN COUNTER
Prescaler
Auto-reload register
CAPTURE COMPARE ARRAY
CC1I UEV
TIM1_CH1
IC1
TI1
Prescaler
IC1PS
Capture/Compare 1 Register
OC1
OC1REF
OC1N
TIM1_CH1
TIM1_CH1N
CC2I UEV
TIM1_CH2
IC2
TI2
Prescaler
INPUT
STAGE
TIM1_CH3
TI3
IC2PS
Capture/Compare 2 Register
OC2REF
CC3I UEV
IC3
Prescaler
IC3PS
Capture/Compare 3 Register
OC3REF
TI4
IC4
Prescaler
IC4PS
OC2N
OC3
OC3N
CC4I UEV
TIM1_CH4
OC2
OUTPUT
STAGE
Capture/Compare 4 Register
OC4REF
OC4
TIM1_CH2
TIM1_CH2N
TIM1_CH3
TIM1_CH3N
TIM1_CH4
TIM1_BKIN
图 10.1 TIM1 原理框图
rev1.05
- 95 -
2020-5-29
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FT61F08X
10.3. 功能描述
整个 TIM1 可以分为三个大的功能部分：计数基本单元、计数控制和捕捉比较通道。计数基本单元分为向
上/向下计数器、自动加载寄存器、重复计数器和预分频器；计数控制器又分为计数触发源，模式控制；
捕捉比较通道分为捕捉输入通道，输出比较通道，死区产生和输出控制。
10.3.1.
计数基本单元
UEV
TIM1_ARRH,ARRL
Auto-reload register
CK_CNT
CK_PSC
Prescaler
TIM1_PSCRH,PSCRL
16-bit Counter
TIM1_RCR
Repetition counter register
Repetition
counter
UIF
UEV
TIM1_CNTRH,CNTRL
图 10.2 计数基本单元
16 位计数器，预分频器，自动重载寄存器和重复计数寄存器都能由软件进行读写。
10.3.1.1. 计数基本单元组成
10.3.1.1.1.
16 位计数器
16 位计数器的读写：
TIM1CNTRH/L 能在任何时候进行写操作；但是建议为了避免出现不正确的中间状态，不要在计数器
运行的时候进行写操作
TIM1CNTRH/L 的写操作是没有顺序限制的；可以先写高位也可以先写低位
TIM1CNTRH/L 能在任何时候进行读操作；但是因为此设计是异步设计，所以在计数器运行期间进行
读操作可能读出不正确的数值，需要读两次，比较两次数值是否一致；如果一致，则读出的数值是正
确的数值；否则，读出数值是错误的。
rev1.05
- 96 -
2020-5-29
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10.3.1.1.2.
FT61F08X
预分频器
计数时钟可以进行 16bit 的时钟预分频，分频系数为 1~65536。
下列是计算计数器时钟分频的公式：
fCK_CNT = fCK_PSC/(PSCR[15:0]+1)；PSCR 为实际装入预分频器影子寄存器的值
预分频支持分频自动更新，即在更新事件发生后，能够自动改变预分频值。当 T1CEN 为 0 时，写入预分
频寄存器的值也能直接加载实际应用的预分频寄存器中。
配置步骤示例：
1. 使能 TIM1 模块时钟并选择 TIM1 时钟源
2. 配置计数周期
3. 配置占空比
4. 配置预分频
5. 使能计数器
示例对应时序图：
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
SFR CLK
TIMER CLK
COUNTER
0
1
2
3
SFR_CEN
CNT_CEN
T1ARR[15:0]
T1CCRx[15:0]
T1PSC[15:0]
FF
35
0
1F
0
1
图 10.3 预分频为 1 时的计数器计数图
注意：
在配置的时候，需要先将周期，占空比，模式等寄存器配置完成后并且在 T1CEN 使能之前配置预分频寄
存器。
rev1.05
- 97 -
2020-5-29
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10.3.1.1.3.
FT61F08X
自动重载寄存器
自动重载寄存器由一个预加载寄存器和一个影子寄存器组成。
写自动重载寄存器的三种方式：
方式 1：计数器使能位打开并且周期预加载使能(T1ARPE=1)。在这种模式下，写入自动重载寄存器
的值保存在预加载寄存器中，并在下一个更新事件到来时传送到影子寄存器中进行使用。如下图所示：
1
2
3
4
5
6
7
8
9
10
11
SFR CLK
TIMER CLK
CNT_EN
COUNTER
FB
FC
FE
FD
FF
0
1
2
3
UEV
TIM1_ARRH/L
FF
35
Write a new value in TIM1_ARR
ARR_SHADH/L
FF
35
New value transferred in shadow
register on counter overflow
图 10.4 T1CEN=1 且 T1ARPE=1，周期寄存器(T1ARR)加载图
方式 2：计数器使能位打开并且周期预加载关闭(T1ARPE=0)。在这种模式下，写入自动重载寄存器
的数值直接传送到影子寄存器中进行使用。如下图所示：
1
2
3
4
5
6
7
8
9
10
11
SFR CLK
TIMER CLK
CNT_EN
COUNTER
32
33
34
35
0
1
2
3
UEV
TIM1_ARRH/L
FF
35
write a new value in TIM1_ARR
ARR_SHADH/L
FF
35
New value immediately in shadow reg
图 10.5 T1CEN=1 且 T1ARPE=0，周期寄存器(T1ARR)加载图
rev1.05
- 98 -
2020-5-29
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FT61F08X
方式 3：当计数器使能位(T1CEN)关闭时，不管周期预加载(T1ARPE)使能还是关闭，写入自动重载
寄存器的数值直接传送到影子寄存器中进行使用。如下图所示：
1
2
3
4
5
6
7
8
9
10
11
SFR CLK
TIMER CLK
CNT_EN
COUNTER
3
TIM1_ARRH/L
FF
4
5
6
35
Write a new value in TIM1_ARR
ARR_SHADH/L
FF
35
New value immediately in shadow reg
图 10.6 T1CEN=0，周期寄存器(T1ARR)加载图
10.3.1.1.4.
更新事件
更新事件的产生：
计数器上溢或下溢
配置为复位模式(必须在输入捕捉模式下才能配置为复位模式)时，触发事件的到来
更新事件的影响：
影响 1：某些预加载的寄存器(具体寄存器可查看寄存器表格)在预加载使能的情况下都能被更新为最
新值。各类预加载寄存器的总结如下表所示：
在更新事件下，可进行预
加载的寄存器
TIMARRH/L
TIM1PSCRH/L
TIM1CCRxH/L
相应的预加载使能位
T1ARPE
没有使能位，预加载在计数
器使能(T1CEN=1)时一直
有效
T1OCxPE
表 10.1 更新事件相关的预加载寄存器 vs 预加载使能位
rev1.05
- 99 -
2020-5-29
Fremont Micro Devices
1
2
FT61F08X
3
4
5
6
7
8
9
10
11
SFR CLK
TIMER CLK
CNT_EN
COUNTER
32
34
33
35
0
1
UEV
T1ARR[15:0]
FF
ARR_SHAD
FF
35
35
T1CCRx[15:0]
8
CCRx_SHAD
8
1F
1F
T1PSC[15:0]
0
PSC_SHAD
0
1
1
图 10.7 更新事件下，预加载寄存器的更新图
影响 2：若 T1UDIS=0，当产生更新事件时，更新标志位(T1UIF)被置位；反之，T1UDIS=1 时，不产
生更新事件，更新标志位(T1UIF)也不会被置位。如下图所示：
1
2
3
4
5
6
7
8
9
10
11
SFR CLK
TIMER CLK
CNT_EN
COUNTER
32
33
34
35
0
1
2
UEV
T1UDIS
T1UIF
图 10.8 更新事件下且 T1UDIS=0，更新标志位变化图
影响 3：单次脉冲模式下，更新事件的到来会使计数器使能位(T1CEN)关闭，计数器停止计数。关于
单次脉冲模式的详细说明可查看 10.3.3.3 章节内容。
影响 4：故障事件撤消后，如果 T1AOE=1，PWM 将在更新事件后恢复正常输出。关于故障刹车事件
的详细说明可查看 10.3.5 章节内容。
rev1.05
- 100 -
2020-5-29
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10.3.1.2.
FT61F08X
向上计数模式
TIMx_ARR
0
Overflow
Overflow
Overflow
Overflow
Time
图 10.9 向上计数模式
在向上计数模式中，计数器从 0 开始计数向上计数，计到 TIM1_ARR 寄存器所设数值。然后重新从 0 开
始计数并产生一个计数器上溢事件；如果 T1UDIS 设为 0，那么还会产生一个更新事件 UEV。
10.3.1.3.
向下计数模式
TIMx_ARR
0
Underflow
Underflow
Underflow
Underflow
Time
图 10.10 向下计数模式
在向下计数模式中，计数器从 TIM1_ARR 寄存器设置的自动重载值开始向下计数，直到计到 0。然后重
新从自动重载值开始计数并产生一个计数器下溢事件；如果 T1UDIS 设为 0，那么还会产生一个更新事件
UEV。
10.3.1.4. 中心对齐模式
TIMx_ARR
0
Overflow
Underflow
Overflow
Underflow
Time
Underflow
Time
图 10.11 中心对齐模式，T1DIR 初始化为 0
TIMx_ARR
0
Overflow
Underflow
Overflow
图 10.12 中心对齐模式，T1DIR 初始化为 1
rev1.05
- 101 -
2020-5-29
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FT61F08X
在中心对齐模式中，计数器从 0 开始向上计数，计到自动重载值。这时会产生一个计数器上溢事件。然后
计数器开始向下计数计到 0，产生一个下溢事件。计数器不断地重复上述的计数过程。
在这个模式下，方向位(T1DIR)不能进行写操作。方向位会由硬件设置成当前计数器的计数方向。
中心对齐模式所需注意事项：
当在中心对齐模式下开始计数时，当前的配置会被使用 – 计数开始值为写入 TIM1CNTRH/L 中的值，
计数开始方向决定于写入 TIM1CR1 寄存器中的 T1DIR 位。注意 T1DIR 位和 T1CMS 值不能被软件
同时改写。
T1DIR 位在 T1CMS 不等于 00 时，为只读寄存器，无法进行写操作；所以如果想要配置计数器的初
始计数方向，需要先配置计数方向(T1DIR)，再配置计数模式(TICMS)。
运行在中心对齐模式下时，不建议写计数器值(TIM1CNTRH/L)，因为可能会产生意想不到的结果。
如果写入计数器的值大于自动加载值(TIM1_CNT > T1ARR)，计数方向可能不会进行更新。
如果写入计数器的值为 0 或为 T1ARR，计数方向会进行更新但更新事件(UEV)不会产生。
配置步骤示例：
1. 使能 TIM1 模块时钟并选择 TIM1 时钟源
2. 配置计数周期预加载使能(T1ARPE=1)
3. 配置计数周期(T1ARR=06H)，占空比
4. 配置初始计数方向为向上计数(T1DIR=0)
5. 配置计数模式为中央对齐模式 1(T1CMS=01)
6. 配置预分频(T1PSC=0)
7. 使能计数器
示例对应时序图：
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
CLK_PSC
TIMER CLK
CNT_EN
COUNTER
4
3
2
1
0
2
1
3
4
5
6
5
4
3
UEV
T1ARR[15:0]
FF
ARR_SHAD
FF
6
6
图 10.12 中心对齐模式下，计数时序图
rev1.05
- 102 -
2020-5-29
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FT61F08X
10.3.1.5. 重复向下计数器
重复计数器是 8bit 的向下计数器，会在每次 TIMER 上溢或下溢时-1；只有当重复向下计数器减到 0 时，
计数器上溢或下溢才会产生更新事件(UEV)；使用重复计数器能够设定更新事件的频率，这在产生特定数
量 PWM 信号时非常有用，如图 10.14 所示。
重复向下计数器自减事件：
计数器向上计数模式下，每个计数上溢事件都会使重复计数器减 1。
计数器向下计数模式下，每个计数下溢事件都会使重复计数器减 1。
计数器中心对齐模式下，每个计数上溢或下溢事件都会使重复计数器减 1。
重复向下计数器是自动重载的，当发生了更新事件(UEV)时，会将 TIM1RCR 寄存器中的值自动重载到重
复向下计数器中。如下图所示：
0
RCR
2
1
0
2
1
UEV
TIM_CNT
0
OVERFLOW
OVERFLOW
OVERFLOW
OVERFLOW
OVERFLOW
TIME
图 10.13 T1REP=2，重复计数器计数时序图
配置产生特定个数 PWM 信号的步骤示例：
1. 使能 TIM1 模块时钟并选择 TIM1 时钟源
2. 配置 TIM1 通道相对应的端口为输出端口
3. 开启更新事件中断
4. 配置计数周期(T1ARR)，占空比(T1CCRx)
5. 需要开启周期预加载(T1ARPE)和占空比预加载功能(T1OCxPE)
6. 配置计数方向为向上计数(T1DIR=0)
7. 配置输出比较模式(T1OCxM=3’b111)为 PWM2 输出模式，并配置通道使能
8. 打开自动主输出使能(T1AOE=1)位
9. 使能计数器
10. 在更新事件中断中，重新更改计数周期，占空比等配置
rev1.05
- 103 -
2020-5-29
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FT61F08X
以下是一段示例代码：
BANKSEL
PCKEN
BSR
PCKEN,0
BANKSEL
INTCON
LDWI
H’C0’
STR
INTCON
BANKSEL
TCKSRC
LDWI
H’01’
STR
TCKSRC
BANKSEL
TRISA
LDWI
H’FE’
STR
TRISA
BANKSEL
TIM1ARRL
LDWI
H’1F’
STR
TIM1ARRL
LDWI
H’10’
STR
TIM1CCR1L
LDWI
H’02’
STR
TIM1RCR
BSR
TIM1BKR,6
BANKSEL
TIM1CCMR1
LDWI
H’70’
STR
TIM1CCMR1
BSR
TIM1IER,0
LDWI
H’01’
STR
TIM1CCER1
BANKSEL
TIM1CR1
LDWI
H’81’
STR
TIM1CR1
INT:
BANKSEL
TIM1ARRL
LDWI
H’14’
STR
TIM1ARRL
上述示例对应示意图：
0
RCR
2
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
使能 TIM1 模块时钟
开启全局中断使能和外设中断使能
选择 TIM1 时钟源为 HIRC
配置 PA0 为通道 1 的输出通道
将输出波形周期配置为 32
将输出波形占空比配置为 16
将重复计数器配置为 2
打开自动主输出使能位
配置通道 1 为 PWM2 模式输出
开启更新事件中断
使能通道 1
开启计数器计数使能位
开启计数器计数使能位和周期预加载使能位
;
;
; 将输出波形周期配置为 20
1
0
2
1
UEV
T1ARR
New T1ARR
T1CCRx
0
TIME
Overflow
MOE
PWM
图 10.14 利用重复计数器输出 3 个特定的 PWM 的时序图
注意：
由于重复计数器只有在周期更新事件(UEV)发生时才重载 T1REP 值，对 TIM1_RCR 寄存器写入的新值只
在下次周期更新事件发生时才起作用，所以建议当配置 T1REP 不为 0 时，在第一个更新事件(计数器上溢
或下溢)之后再打开更新事件中断。
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10.3.2. 计数控制器
Trigger
Controller
fMASTER
0
0
TGI
ITR
TRC
TRGI
From input stage
TI1F_ED
Clock/Trigger
Mode
Controller
Reset, Enable,
Up/Down, Count
CK_CNT
To Time Base Unit
TI1FP1
From input stage
Encoder
Interface
TI2FP2
图 10.15 时钟/触发控制器框图
时钟/触发控制器允许配置各种计数器时钟源，输入触发和输出触发。
10.3.2.1. 计数器时钟源
计数器的计数时钟(CK_CNT)可由 TCKSRC 寄存器进行选择，总共有以下 8 种时钟源：
系统时钟/主时钟
HIRC
XT 时钟/外部时钟
HIRC 的 2 倍频
XT 时钟/外部时钟的 2 倍频
LIRC
LP 时钟/外部时钟
LP 时钟/外部时钟的 2 位频
CK_CNT
CK_PSC
CNT_EN
Counter
0
1
2
3
4
图 10.16 预分频为 1 时，计数器计数时序图
rev1.05
- 105 -
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10.3.2.2. 计数触发源
本章节所述的触发源是计数触发源，而非捕捉源；计数触发源只能来自通道 1/2 对应的输入端口，来源与
通道 1/2 的捕捉源的来源一致；计数触发源不能来自通道 3/4，通道 3/4 的输入只能作为对应的通道捕捉
源。关于捕捉源的详细描述可查看 10.3.3.1 章节内容。
当 T1SMS=000 时，计数由内部时钟驱动，使能 T1CEN 即可触发计数，但是在 slave 模式(T1SMS=101/110)
下，需要触发源，这些触发源由 TIM1CR1 寄存器中的 T1TS[2:0]位进行选择，总共有以下 3 种计数触发
源：
（1） 输入源 T1 的边沿检测(TI1F_ED)；
（2） 滤波后的通道 1 输入(TI1FP1)；
（3） 滤波后的通道 2 输入(FI2FP2)；
注意：
只有当 T1SMS=101/110 时，计数触发源才有意义；否则，不管端口是否有触发信号输入都是没有意义的。
10.3.2.3. 计数控制模式选择
TIM1 除了有向上计数、向下计数、中央对齐计数方式之外，还有 4 种计数控制模式，需要计数触发源的
配合使用；计数模式的选择由 TIM1SMCR 寄存器中的 T1SMS[2:0]去控制，下列是 4 种计数模式：
（1） 内部时钟模式：
计数由内部时钟(CK_CNT)驱动。
（2） 复位模式(必须在输入捕捉模式下才能配置为此模式)：
在选中的触发输入(TRGI)的上升沿时重新初始化计数器，并且产生一个更新寄存器的信号。
（3） 门控模式(T1SMS=3’b101)：
当触发输入(TRGI)为高时，计数器的时钟开启。一旦触发输入变为低，则计数器停止(但不复位)。
计数器的启动和停止都是受控的。
（4） 触发模式(T1SMS=3’b110)：
计数器在触发输入 TRGI 的上升沿启动(但不复位)，只有计数器的启动是受控的。
内部时钟模式：
内部时钟(CK_CNT)模式下，在软件配置计数器使能(T1CEN)之后，计数器开始由内部时钟(CK_CNT)驱
动下进行计数；如图 10.16 所示。
复位模式：
当触发输入事件到来时，计数器和计数器预分频都会被初始化。如果此时 T1URS 为 0 且 T1UDIS 也为 0，
则会产生一个更新事件，同时所有的预加载寄存器都会被更新。
复位模式的步骤示例：
1. 配置输入捕捉寄存器的值 – 配置输入捕捉滤波器 T1IC1F=000；配置捕捉预分频器 T1IC1PSC=0
2. 将通道配置为输入捕捉通道 T1CC1S=01，并将 IC1 映射在 TI1FP1 上
3. 写 T1CC1P=0，选择检测触发上升沿的到来
4. 通过写 T1SMS=100，将 TIM1 配置为复位模式。同时写 T1TS=101，选择 TI1 为输入触发源
5. 置位 T1CEN，启动计数器
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以下是一段示例代码：
BANKSEL
PCKEN
BSR
PCKEN,0
BANKSEL
TCKSRC
LDWI
H’01’
STR
TCKSRC
BANKSEL
TRISA
LDWI
H’FF’
STR
TRISA
BANKSEL
TIM1CCMR1
LDWI
H’01’
STR
TIM1CCMR1
LDWI
H’54’
STR
TIM1SMCR
LDWI
H’01’
STR
TIM1CCER1
BANKSEL
TIM1CR1
BSR
TIM1CR1,0
;
; 使能 TIM1 模块时钟
;
;
; 选择 TIM1 时钟源为 HIRC
;
;
; PA0 为通道 1 的输入通道
;
;
; 配置通道 1 的 IC1 映射在 TI1FP1 上
;
; 配置 TIM1 为复位模式，触发源为 TI1FP1
;
; 使能通道 1 并且为上升沿触发
;
; 开启计数器计数使能位
当 TI1 的上升沿到来时，计数器被清 0 并从 0 开始重新计数。与此同时与此同时，触发标志位(TIF)会被
置位，在触发中断使能的情况下还会产生一个中断请求。如下列示例对应时序图所示：
Capture edge
TI1
IC1
COUNTER
CCR1_SHAD
T1CCR1[15:0]
30
31
32
33
10
0
1
2
3
4
5
6
33
33
10
图 10.17 复位模式下，计数器计数时序图
门控模式：
依据选择的触发输入的电平值，计数器会被使能。此模式下，计数器的运行和停止都是受控的。
门控模式的步骤示例：
1. 使能 TIM1 模块时钟并选择 TIM1 时钟源
2. 配置输入捕捉寄存器的值 – 配置输入捕捉滤波器 T1IC1F=000；配置捕捉预分频器 T1IC1PSC=0
3. 将通道配置为输入捕捉通道 T1CC1S=01，并将 IC1 映射在 TI1FP1 上
4. 写 T1CC1P=1，选择检测输入低电平的到来
5. 通过写 T1SMS=101，将 TIM1 配置为门控模式。同时写 T1TS=101，选择 TI1 为输入源
6. 置位 T1CEN，使能计数器(在门控模式下，需要开启 T1CEN；在此基础上，才能由输入源控制计数器
的运行与停止)
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以下是一段示例代码：
BANKSEL
PCKEN
BSR
PCKEN,0
BANKSEL
TCKSRC
LDWI
H’01’
STR
TCKSRC
BANKSEL
TRISA
LDWI
H’FF’
STR
TRISA
BANKSEL
TIM1CCMR1
LDWI
H’01’
STR
TIM1CCMR1
LDWI
H’55’
STR
TIM1SMCR
LDWI
H’03’
STR
TIM1CCER1
BANKSEL
TIM1CR1
BSR
TIM1CR1,0
BTSS
TIM1SR1,6
LJUMP
$-1
BCR
TIM1SR1,6
FT61F08X
;
; 使能 TIM1 模块时钟
;
;
; 选择 TIM1 时钟源为 HIRC
;
;
; PA0 为通道 1 的输入通道
;
;
; 配置通道 1 的 IC1 映射在 TI1FP1 上
;
; 配置 TIM1 为门控模式，触发源为 TI1FP1
;
; 使能通道 1 并且低电平输入为有效电平
;
; 开启计数器计数使能位
; 判断触发中断标志位是否为高
;
; 将触发中断标志位清零
当 TI1 为低电平时，计数器在内部时钟的驱动下进行计数；当 TI1 变为高电平时，计数器停止计数。触发
标志位(T1TIF)会在计数器启动或停止时被置位。如下列示例对应时序图所示：
TI1
同步时间
T1CEN
同步时间
CNT_EN
CK_CNT
COUNTER
30
31
32
33
34
35
36
37
38
39
T1TIF
write T1TIF=0
图 10.18 门控模式下，计数器计数时序图
触发模式：
依据选择的触发输入的电平值，计数器会被启动(T1CEN 被置位)。
触发模式的步骤示例：
1. 使能 TIM1 模块时钟并选择 TIM1 时钟源
2. 配置输入捕捉寄存器的值 – 配置输入捕捉滤波器 T1IC2F=000；配置捕捉预分频器 T1IC2PSC=0
3. 将通道配置为输入捕捉通道 T1CC2S=01，并将 IC2 映射在 TI2FP2 上
4. 写 T1CC2P=0，选择检测触发上升沿的到来
5. 通过写 T1SMS=110，将 TIM1 配置为触发模式。同时写 T1TS=110，选择 TI2 为输入触发源
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以下是一段示例代码：
BANKSEL
PCKEN
BSR
PCKEN,0
BANKSEL
TCKSRC
LDWI
H’01’
STR
TCKSRC
BANKSEL
TRISA
LDWI
H’FF’
STR
TRISA
BANKSEL
TIM1CCMR2
LDWI
H’01’
STR
TIM1CCMR2
LDWI
H’66’
STR
TIM1SMCR
LDWI
H’10’
STR
TIM1CCER1
BANKSEL
TIM1CR1
BSR
TIM1CR1,0
FT61F08X
;
; 使能 TIM1 模块时钟
;
;
; 选择 TIM1 时钟源为 HIRC
;
;
; PA1 为通道 2 的输入通道
;
;
; 配置通道 2 的 IC2 映射在 TI2FP2 上
;
; 配置 TIM1 为触发控制模式，触发源为 TI2FP2
;
; 使能通道 2 并且为上升沿触发
;
; 开启计数器计数使能位
当 TI2 的上升沿到来时，计数器在内部时钟的驱动下启动计数，并且触发标志位(T1TIF)被置位。如下列
示例对应时序图所示：
TI2
同步时间
T1CEN
CNT_EN
CK_CNT
COUNTER
35
34
36
37
T1TIF
图 10.19 触发模式下，计数器计数时序图
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10.3.3. 捕捉比较通道
S write CCR1H
R write CCR1L
CC1S[1]
output
CC1S[0]
mode
OC1PE OC1PE
UEV
TIMx_CCMR1
write_in_progress
Read CCR1H S
Read CCR1L R
read_in_progress
Capture/Compare Preload Register
compare_transfer
capture_transfer
CC1S[1]
CC1S[0]
Capture/Compare Shadow Register
capture
ic1ps
CC1E
CNT>CCR1
Counter
CC1G
from time
base unit
CNT=CCR1
TIMx_EGR
图 10.20 捕捉/比较通道 1 框图
TIMER 的 I/O 口能被配置为输入捕捉或输出比较功能。这个配置由 T1CCxS 通道选择位进行设定；对单
个通道而言，输入捕捉功能和输出比较功能是互斥的两个功能。但每个通道都有独立的配置寄存器，所以
可以将某些通道配置为输入捕捉功能，另一些通道配置为输出比较功能；例如：配置 T1CC1S=2’b00，
T1CC2S=2’b00，T1CC3S=2’b01，T1CC3S=2’b10，这样通道 1 和通道 2 为输出比较通道，可在输出波
形，而通道 3 和通道 4 为输入捕捉通道，可进行捕捉功能。
TIM1CCRxH/L 寄存器的读写：
TIM1CCRxH/L 寄存器由一个预加载寄存器和一个影子寄存器组成。
TIM1CCRxH/L 寄存器在输出比较模式和输入捕捉模式下的读写有所不同；在输出比较模式下，为可读可
写寄存器；而在输入捕捉模式下，为只读寄存器。
在输出比较模式下：
TIM1CCRxH/L 寄存器的访问没有任何限制，可读可写。
读 TIM1CCRxH/L： 读出的值来自 CCRx 预加载寄存器的值，跟先前写入 TIM1CCRxH/L 寄存器的
值保持一致。
写 TIM1CCRxH/L：有预加载使能位(T1OCxPE)；如果预加载使能(T1OCxPE=0)关闭，则写入
TIM1CCRxH/L 寄存器的值直接由 CCRx 预加载寄存器传递到 CCRx 影子寄存
器。反之，写入 TIM1CCRxH/L 寄存器的值在下一次更新事件发生时才会从
CCRx 预加载寄存器传递到 CCRx 影子寄存器。
在输入捕捉模式下：
TIM1CCRxH/L 寄存器为只读寄存器。在捕捉事件发生时，计数器值会被写入到 CCRx 影子寄存器中，
而后再写回到 CCRx 预加载寄存器中。
读 TIM1CCRxH/L 寄存器时，必须先读高 8 位，再读低 8 位。读高 8 位时，CCRx 预加载寄存器被冻
结，此时计数器值无法写回到 CCRx 预加载寄存器中；只有按顺序读完低 8 位后，CCRx 预加载寄存
器才能更新为最新一次捕捉值。
注意：
TIM1CCMRx 寄存器是复用寄存器。
当作为输出比较通道时，TIM1CCMRx 寄存器作为输出配置寄存器，并且第 7 位和第 2 位禁止配置，保持
为默认值；下表为 TIM1CCMRx 作为输出配置寄存器时的具体意义：
Bit
7
6
Name
reserved
Rese
－
0
Type
RO-0
RW
5
4
T1OCxM[2:0]
3
2
1
0
T1OCxPE
reserved
0
0
0
－
0
T1CCxS[1:0]
0
RW
RW
RW
RO-0
RW
RW
表 10.2 TIM1CCMRx 作为输出配置寄存器
rev1.05
- 110 -
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当作为输入捕捉通道时，TIM1CCMRx 寄存器作为输入配置寄存器；下表为 TIM1CCMRx 作为输出配置
寄存器时的具体意义：
Bit
7
6
Name
5
4
T1ICxF[3:0]
Rese
0
0
Type
RO
RO
3
2
1
T1ICxPSC[1:0]
0
T1CCxS[1:0]
0
0
0
0
0
0
RO
RO
RO
RO
RO
RO
表 10.3 TIM1CCMRx 作为输入配置寄存器
10.3.3.1. 捕捉输入通道
TI1F_ED
TRC
to clock/trigger
TIM1_CH1
TI1
TIM1_CH2
TI2
TI1FP1
Input Filter & TI1FP2
EdgeDetector
TRC
IC1
Input Filter & TI2FP1
EdgeDetector TI2FP2
IC2
TRC
TIM1_CH3
TI3
TIM1_CH4
TI4
TI3FP3
Input Filter & TI3FP4
EdgeDetector
IC3
Input Filter & TI4FP3
EdgeDetector TI4FP4
IC4
to capture/
compare channel
图 10.21 通道输入框图
rev1.05
- 111 -
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信号名称
TIM1_CH1/2/3/4
IC1/2/3/4
TI1FP1
TI1FP2
TI2FP2
TI2FP1
TI3FP3
TI3FP4
TI4FP4
TI4FP3
TRC
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详细说明
通道 1/2/3/4 对应 I/O 口的输入
通过选择后的真正的通道捕捉源
来自通道 1 对应 I/O 的输入捕捉信号，作为通道 1 的捕捉源之一
来自通道 1 对应 I/O 的输入捕捉信号，作为通道 2 的捕捉源之一
来自通道 2 对应 I/O 的输入捕捉信号，作为通道 2 的捕捉源之一
来自通道 2 对应 I/O 的输入捕捉信号，作为通道 1 的捕捉源之一
来自通道 3 对应 I/O 的输入捕捉信号，作为通道 3 的捕捉源之一
来自通道 3 对应 I/O 的输入捕捉信号，作为通道 4 的捕捉源之一
来自通道 4 对应 I/O 的输入捕捉信号，作为通道 4 的捕捉源之一
来自通道 4 对应 I/O 的输入捕捉信号，作为通道 3 的捕捉源之一
来自通道 1 对应 I/O 的输入双沿捕捉信号，作为通道 1 和通道 2 的捕捉源之一
表 10.4 对应图 10.9 中信号说明列表
当一个通道被配置成输入捕捉通道并且输入捕捉事件有效时，可以将当前的计数值保存在 TIM1CCRx 寄
存器。每个通道都有一个数字滤波单元，可配置采样频率(T1ICxF[3:0])，捕捉预分频(T1IC1PSC[1:0])，
捕捉极性选择(T1CCxP)和捕捉触发源(T1CCxS)。每个通道都有各自的捕捉源，如下表所示：
T1CCxS
(捕捉源选择)
2’b00
2’b01
2’b10
通道 1
通道 2
通道 3
通道 4
TI1FP1
TI2FP1
TRC
TI2FP2
TI1FP2
TRC
TI3FP3
TI4FP3
－
TI4FP4
TI3FP4
－
表 10.5 各通道输入捕捉源列表
当一个输入捕捉发生时：
TIM1CCR1H/L 寄存器得到捕捉发生时计数器的值。
输入捕捉标志位(T1CCxIF)被置位。如果当 T1CCxIF 保持为 1 时，又一次发生了输入捕捉事件，那
么溢出捕捉标志位(T1CCxOF)也会被置位。
如果 T1CCxIE 为 1，那么捕捉将产生一个中断事件。
配置为输入捕捉通道的示例步骤：
1. 使能 TIM1 模块时钟并选择 TIM1 时钟源
2. 将通道相应的端口配置为输入端口
3. 选择输入触发源(T1CCxS)
4. 配置采样频率(T1ICxF[3:0])，捕捉预分频(T1IC1PSC[1:0])
5. 配置捕捉源的捕捉极性(T1CCxP)
6. 使能捕捉通道(T1CCxE)
7. 使能计数器(T1CEN)
rev1.05
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IC1 Capture
TI1
COUNTER
30
CCR1_SHAD
31
32
33
34
10
T1CCR1[15:0]
35
36
37
38
39
40
41
33
33
10
图 10.22 简单输入捕捉时序图
PWM 输入信号测量的应用：
利用捕捉输入模式和复位模式，并且将两个通道的输入捕捉源都选择为同一个通道的 PWM 信号输入；这
样就可以测量从通道输入的 PWM 信号的周期以及占空比。
PWM
input signal
T1ARR
0
IC1:
PWM周期测量
复位计数器
TIME
IC1
IC2
IC1
IC2
IC2:
PWM占空比测量
图 10.23 测量 PWM 信号的示意图
具体测量 PWM 的配置步骤如下：
1. 使能 TIM1 模块时钟并选择 TIM1 时钟源
2. 将通道 1/2 相应的端口配置为输入端口
3. 通道 1 配置将 IC1 映射在 TI1FP1 上；通道 2 配置将 IC2 映射在 TI2FP1 上
4. 配置通道 1 为上升沿捕捉(T1CC1P=0)；通道 2 为下降沿捕捉(T1CC2P=1)
5. 配置采样频率(T1ICxF[3:0]=4’b0000)，捕捉预分频(T1IC1PSC[1:0]=2’b00)
6. 将计数控制模式配置为复位模式(T1SMS=101)，计数触发源配置为 TI1FP1(T1TS=101)
7. 使能计数器(T1CEN)
8. 开启通道 1 和通道 2 的输入捕捉功能(T1CC1E=1 且 T1CC2E=1)
rev1.05
- 113 -
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注意：
因为捕捉沿先于复位触发源两个计数时钟周期，所以需要软件进行一下操作才能等到准确测量值：
当预分频为 0 时，PWM 周期等于 T1CCR1H/L+2，PWM 占空比等于 T1CCR2H/L+2
当预分频为 1 时，PWM 周期等于 T1CCR1H/L+1，PWM 占空比等于 T1CCR2H/L+1
当预分频大于 1 时，PWM 周期等于 T1CCR1H/L，PWM 占空比等于 T1CCR2H/L
以下是一段示例代码：
BANKSEL
PCKEN
BSR
PCKEN,0
BANKSEL
TCKSRC
LDWI
H’01’
STR
TCKSRC
BANKSEL
TRISA
LDWI
H’FF’
STR
TRISA
BANKSEL
TIM1CCMR1
LDWI
H’01’
STR
TIM1CCMR1
LDWI
H’02’
STR
TIM1CCMR2
LDWI
H’54’
STR
TIM1SMCR
LDWI
H’31’
STR
TIM1CCER1
BANKSEL
TIM1CR1
BSR
TIM1CR1,0
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
使能 TIM1 模块时钟
选择 TIM1 时钟源为 HIRC
配置 PA0 为通道 1 的输入通道，PA1 为通道 2 的输入通道
配置通道 1 为 IC1 映射在 TI1FP1 上
配置通道 2 的 IC2 映射在 TI1FP2 上
配置 TIM1 为复位控制模式，触发源为 TI1FP1
使能通道 1/2，通道 1 为上升沿捕捉，通道 2 为下降沿捕捉
开启计数器计数使能位
上述示例代码对应波形图：
TI1
IC1/IC2
COUNTER
5
0
1
2
3
T1CCR1
5
T1CCR2
3
IC1:
周期测量
复位计数器
4
5
0
IC2:
脉冲宽度测量
图 10.24 测量 PWM 信号的时序图
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10.3.3.2. 输出比较通道
Deadtime generation
DTG registers
OC1
OC1REF
OC2REF
From capture/
compare channels
OC3REF
DTG
output
control OC1N
DTG
output
control OC2N
DTG
output
control OC3N
OC2
OC3
output
control
OC4REF
OC4
TIM1_CH1
TIM1_CH1N
TIM1_CH2
TIM1_CH2N
TIM1_CH3
TIM1_CH3N
TIM1_CH4
BI
TIM1_BKIN
Polarity Selection
Enable
图 10.25 通道输出框图
输出阶段产生立即响应的波形，用来作为参考波形，叫做 OCxREF 信号(高有效)。刹车功能，极性选择和
其他输出控制位都在参考波形之后去做控制。
输出比较通道根据计数值与比较值 CCRx，产生 OCxREF 输出并送到死区产生模块，经过死区产生模块
后再经过其他输出控制位的控制将波形输出到端口。
具体的输出控制位以及可达到的输出效果可以查看 10.3.3.5 章节内容。
输出比较模式下，可选择不同的输出模式去输出 PWM 波形；输出模式由 T1OCxM[3:0]选择，总共有以下
8 种不同的输出模式(最终的输出还需要取决于极性选择(T1CCxP))：
（1） 冻结模式：输出冻结，输出实际比较值(CCRx_SHAD)与计数器 TIM1_CNT 间的比较对 OC1REF
不起作用
（2） 匹配有效：当计数值 CNT 与实际比较值(CCRx_SHAD)匹配时，OCxREF 为高电平；
（3） 匹配无效：当计数值 CNT 与实际比较值(CCRx_SHAD)匹配时，OCxREF 为低电平；
（4） 翻转：当计数值 CNT 与实际比较值(CCRx_SHAD)匹配时，输出翻转；
（5） 强制无效：OCxREF 强制为低电平；
（6） 强制有效：OCxREF 强制为高电平；
（7） PWM1：向上计数时，当 CNT实际比较值(CCRx_SHAD)时，OCxREF 无效；
（8） PWM2：向上计数时，当 CNT实际比较值(CCRx_SHAD)时，OCxREF 有效；
rev1.05
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配置为输出比较通道的示例步骤：
1. 使能 TIM1 模块时钟并选择 TIM1 时钟源
2. 将通道相应的端口配置为输出端口
3. 配置输出波形的周期(T1ARR)和占空比(T1CCRx)
4. 配置输出比较模式(T1OCxM)和输出极性(T1CCxP)
5. 使能比较输出通道(T1CCxE)
6. 打开主输出自动使能位(T1AOE)，在更新事件发生时硬件会自动使能主输出(T1MOE)
7. 使能计数器(T1CEN)
以下是一段示例代码：
BANKSEL
PCKEN
BSR
PCKEN,0
BANKSEL
TCKSRC
LDWI
H’01’
STR
TCKSRC
BANKSEL
TRISA
LDWI
H’FE’
STR
TRISA
BANKSEL
TIM1ARRL
LDWI
H’05’
STR
TIM1ARRL
LDWI
H’03’
STR
TIM1CCR1L
BANKSEL
TIM1CCMR1
LDWI
H’10’
STR
TIM1CCMR1
LDWI
H’01’
STR
TIM1CCER1
BANKSEL
TIM1BKR
BSR
TIM1BKR,6
BANKSEL
TIM1CR1
BSR
TIM1CR1,0
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
使能 TIM1 模块时钟
选择 TIM1 时钟源为 HIRC
配置 PA0 为通道 1 的输出通道
将输出波形周期配置为 6
将输出波形占空比配置为 3
配置通道 1 为匹配有效模式输出
使能通道 1
打开主输出自动使能位 T1AOE
开启计数器计数使能位
上述示例代码对应波形图：
CK_CNT
CNT_CEN
COUNTER
0
1
2
3
4
5
T1ARR
5
T1CCRx
3
0
1
2
3
4
5
OCxREF
T1AOE
T1MOE
OCx
图 10.26 T1OCxM 为匹配有效模式下的输出时序图
rev1.05
- 116 -
2020-5-29
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FT61F08X
以下是一段示例代码：
BANKSEL
PCKEN
BSR
PCKEN,0
BANKSEL
TCKSRC
LDWI
H’01’
STR
TCKSRC
BANKSEL
TRISA
LDWI
H’FE’
STR
TRISA
BANKSEL
TIM1ARRL
LDWI
H’05’
STR
TIM1ARRL
LDWI
H’03’
STR
TIM1CCR1L
BANKSEL
TIM1CCMR1
LDWI
H’30’
STR
TIM1CCMR1
LDWI
H’01’
STR
TIM1CCER1
BANKSEL
TIM1BKR
BSR
TIM1BKR,6
BANKSEL
TIM1CR1
BSR
TIM1CR1,0
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
使能 TIM1 模块时钟
选择 TIM1 时钟源为 HIRC
配置 PA0 为通道 1 的输出通道
将输出波形周期配置为 6
将输出波形占空比配置为 3
配置通道 1 为翻转模式输出
使能通道 1
打开主输出自动使能位 T1AOE
开启计数器计数使能位
上述示例代码对应波形图：
CK_CNT
CNT_CEN
COUNTER
0
1
2
3
4
5
T1ARR
5
T1CCRx
3
0
1
2
3
4
5
OCxREF
T1AOE
T1MOE
OCx
图 10.27 T1OCxM 为翻转模式下的输出时序图
rev1.05
- 117 -
2020-5-29
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FT61F08X
以下是一段示例代码：
BANKSEL
PCKEN
BSR
PCKEN,0
BANKSEL
TCKSRC
LDWI
H’01’
STR
TCKSRC
BANKSEL
TRISA
LDWI
H’FE’
STR
TRISA
BANKSEL
TIM1ARRL
LDWI
H’05’
STR
TIM1ARRL
LDWI
H’03’
STR
TIM1CCR1L
BANKSEL
TIM1CCMR1
LDWI
H’70’
STR
TIM1CCMR1
LDWI
H’01’
STR
TIM1CCER1
BANKSEL
TIM1BKR
BSR
TIM1BKR,6
BANKSEL
TIM1CR1
BSR
TIM1CR1,0
上述示例代码对应波形图：
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
使能 TIM1 模块时钟
选择 TIM1 时钟源为 HIRC
配置 PA0 为通道 1 的输出通道
将输出波形周期配置为 6
将输出波形占空比配置为 3
配置通道 1 为 PWM2 模式输出
使能通道 1
打开主输出自动使能位 T1AOE
开启计数器计数使能位
CK_CNT
CNT_CEN
COUNTER
0
1
2
3
4
5
T1ARR
5
T1CCRx
3
0
1
2
3
4
5
1
0
OCxREF
T1AOE
T1MOE
OCx
图 10.28 T1OCxM 为 PWM2 模式下的输出时序图
注意：
刹车事件的到来只会影响输出，并不影响 TIMER 本身的计数。
为了避免在计数器还未开启时，就开始输出脉冲；
需要在计数器使能之后再开启 T1CCxE 和 T1CCxNE
rev1.05
- 118 -
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10.3.3.3. 单次脉冲模式
开启单次脉冲模式和不开单次脉冲模式的区别在于：开启单次脉冲模式(T1OPM=1)并且下一次更新事件
到来时，硬件会自动关闭计数器使能位(T1CEN)，计数器停止计数。
想要产生一个正确的脉冲，比较值(T1CCRx)必须与计数器初始值(T1ARR)不同；所以在开始计数之前必
须满足以下配置：
在向上计数模式下：COUNTER < T1CCRx < T1ARR
在向下计数模式下：COUNTER > T1CCRx
想要产生一个正确的脉冲，还必须满足以下配置：
在输出模式为 PWM1 模式(T1OCxM=110)下：T1CCxP 必须为 1
如果输出模式为 PWM1 模式并且 T1CCxP 为 0，更新事件之后 PWM 输出会一直为有效值
在输出模式为 PWM2 模式(T1OCxM=111)下：T1CCxP 必须为 0
如果输出模式为 PWM2 模式并且 T1CCxP 为 1，更新事件之后 PWM 输出会一直为有效值
单次脉冲模式可以配合触发模式在特定的时间点产生单个特定的 PWM 输出；配置步骤如下所示：
1. 使能 TIM1 模块时钟并选择 TIM1 时钟源
2. 将通道 2 相应的端口配置为输入端口，通道 1 相应的端口配置为输出端口
3. 通道 2 配置 T1CC2S 为 01，IC2 映射在 TI2FP2 上；并配置通道 2 为上升沿捕捉(T1CC2P=0)
4. 将计数控制模式配置为触发模式(T1SMS=110)，计数触发源配置为 TI2FP2(T1TS=110)
5. 通道 1 配置为输出通道(T1CC1S=00)
6. 通道 1 的比较输出模式配置为 PWM2 模式(T1OC1M=111)，输出极性配置为高电平有效(T1CC1P=0)
7. 打开主输出使能(T1MOE)并且使能计数器(T1CEN)
8. 开启通道 2 的输入捕捉功能 T1CC2E=1)和通道 1 的输出比较功能(T1CC1E)
以下是一段示例代码：
BANKSEL
PCKEN
BSR
PCKEN,0
BANKSEL
TCKSRC
LDWI
H’01’
STR
TCKSRC
BANKSEL
TRISA
LDWI
H’FE’
STR
TRISA
BANKSEL
TIM1CCMR1
LDWI
H’70’
STR
TIM1CCMR1
LDWI
H’01’
STR
TIM1CCMR2
LDWI
H’66’
STR
TIM1SMCR
LDWI
H’11’
STR
TIM1CCER1
BANKSEL
TIM1BKR
BSR
TIM1BKR,7
BANKSEL
TIM1CR1
BSR
TIM1CR1,0
rev1.05
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
;
使能 TIM1 模块时钟
选择 TIM1 时钟源为 HIRC
配置 PA0 为通道 1 的输出通道，PA1 为通道 2 的输入通道
配置通道 1 为 PWM2 模式输出
配置通道 2 的 IC2 映射在 TI2FP2 上
配置 TIM1 为触发控制模式，触发源为 TI2FP2
使能通道 1 和通道 2
打开主输出使能 T1MOE
开启计数器计数使能位
- 119 -
2020-5-29
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上述示例代码对应示意图：
TI2
OC1REF
OC1
T1ARR
T1CCR1
0
TIME
图 10.29 单次脉冲应用示意图
10.3.3.4. 死区产生
当把通道的互补输出使能时，就自动使能死区功能。每当一个输出信号(正向输出信号或互补输出信号)出
现下降沿时，就会将另一个信号的上升沿后延一个死区时间长度。如图 10.26 和图 10.27 所示：
OCxREF
OCx
delay
OCxN
delay
图 10.30 正向输出插入死区时序图
rev1.05
- 120 -
2020-5-29
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FT61F08X
OCxREF
delay
OCx
OCxN
delay
图 10.31 互补输出插入死区时序图
死区时间可以编程:根据寄存器位 T1DTG[7:0]，可以配置死区时间长度，具体参考寄存器描述 TIM1DTR
的 T1DTG[7:0]。
有的 OCXREF 输出的脉冲时间很短（小于死区时间），有可能某一脉冲信号(正向输出信号或反向输出信
号)会被死区覆盖，导致输出不变化。如图 10.28 和图 10.29 所示：
OCxREF
delay
OCx
OCxN
图 10.32 正向输出被死区覆盖时序图
OCxREF
OCx
delay
OCxN
图 10.33 互补输出被死区覆盖时序图
rev1.05
- 121 -
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10.3.3.5. 输出控制
参考波形 OCxREF 产生后不是直接输出到端口，会先经过死区控制模块和通过极性选择，最后再由以下
5 位控制信号进行组合控制之后才送到端口上。具体的组合控制内容如下表所示：
控制位
输出状态
T1MOE T1OSSI T1OSSR T1CCxE T1CCxNE OCx 输出状态
OCxN 输出状态
1
0
0
0
0
输出关闭(不由 TIMER 驱动)
OCx=0, OCx_EN=0
0
0
1
输出关闭(不由 TIMER 驱动)
OCx=0, OCx_EN=0
0
1
0
OCxREF + 极性选择
OCx=OCxREF ^ T1CCxNP
OCx_EN=1
0
1
1
OCxREF + 极性选择 +
死区时间
OCx_EN=1
1
0
0
输出关闭(不由 TIMER 驱动)
OCx=T1CCxP, OCx_EN=0
1
0
1
关闭状态(运行模式下输出使
能)
OCx=T1CCxP, OCx_EN=1
1
1
0
OCxREF + 极性选择
OCx=OCxREF ^ T1CCxNP
OCx_EN=1
1
1
1
OCxREF + 极性选择 +
死区时间
OCx_EN=1
0
0
0
输出关闭(不由 TIMER 驱动)
OCx=T1CCxP, OCx_EN=0
0
0
0
1
1
0
1
1
1
0
0
1
1
0
1
1
0
1
1
1
X
0
X
输出关闭(不由 TIMER 驱动)
OCxN=0, OCxN_EN=0
OCxREF + 极性选择
OCxN=OCxREF ^
T1CCxNP
OCxN_EN=1
输出关闭(不由 TIMER 驱动)
OCxN=0, OCxN_EN=0
OCREF 的互补信号 + 极性
选择 + 死区时间
OCxN_EN=1
输出关闭(不由 TIMER 驱动)
OCxN=T1CCxNP,OCxN_E
N=0
OCxREF + 极性选择
OCxN=OCxREF ^
T1CCxNP
OCxN_EN=1
关闭状态(运行模式下输出使
能)
OCxN=T1CCxNP,
OCx_EN=1
OCREF 的互补信号 + 极性
选择 + 死区时间
OCxN_EN=1
输出关闭(不由 TIMER 驱动)
OCxN=T1CCxNP,OCxN_E
N=0
输出关闭(不由 TIMER 驱动)
一开始
OCx=T1CCxP,OCx_EN=0,OCxN=T1CCxNP,OCxN_EN=0
在死区时间之后 OCx=T1OISx,OCxN=T1OISxN
输出关闭(不由 TIMER 驱动)
输出关闭(不由 TIMER 驱动)
OCxN=T1CCxNP,OCxN_EN
OCx=T1CCxP, OCx_EN=0
=0
关闭状态(空闲模式下输出使能)
一开始
OCx=T1CCxP,OCx_EN=1,OCxN=T1CCxNP,OCxN_EN=1
在死区时间之后 OCx=T1OISx,OCxN=T1OISxN
表 10.6 输出控制与输出状态
可以根据 T1MOE、T1OSSI、T1OSSR、T1CCxNE 和 CCxE 进行输出的控制。
注意：
输出的状态转换实际是刹车事件异步将 T1MOE 清零实现的，T1MOE 异步清零，但要注意刹车事件撤销
时需要同步 2 个 CK_CNT 时钟（如果有时钟的情况下）。
rev1.05
- 122 -
2020-5-29
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10.3.4. TIM1 中断
TIM1 有以下 7 个中断请求源：
刹车中断
触发中断
捕捉/比较 4 中断
捕捉/比较 3 中断
捕捉/比较 2 中断
捕捉/比较 1 中断
更新中断(例如：上溢、下溢、计数初始化)
在用这些中断之前需要提前打开 TIM1IER 寄存器中的中断使能位(T1BIE、T1TIE、T1CCxIE 和 T1UIE)。
不同的中断源还可以配置通过 TIM1EGR 寄存器来产生(软件产生中断)。
10.3.5. 故障刹车源
Timer1 有以下 3 种刹车事件：
BKIN 管脚事件
LVD 事件
ADC 比较事件
当故障事件有效且被选择为刹车源（由 BKS0~2 决定），如果 BKE 位为 1，PWM 输出管脚将被置于预设
的状态，预设状态由寄存器 TIM1OISR 决定。
当一个刹车事件发生时：
T1MOE 位会被异步清 0，强制输出进入无效状态，空闲状态或复位状态。甚至在 MCU 振荡器关闭
的情况下，T1MOE 也会被刹车事件清 0。
在 T1MOE=0 之后，每个输出通道都会先将输出值置为无效值，等死区时间到之后变成提前设置好的
T1OISx 位的值。如果 T1OSSI=0，TIMER 会将输出关闭。
当互补输出使能时：
输出首先会设置为无效值(根据极性选择位)。此操作是异步清 0 的，所以即使 TIM1 没有时钟驱动也
能进行。
如果 TIM1 是有时钟进行驱动的，那么死区时间到来之后就会进入由 T1OISx 和 T1OISxN 提前设定
的预设状态。(由于 T1MOE 的同步，所以此情况下真正的死区时间会比死区设置值长 2 个 CK_CNT
时钟)
刹车状态标志位(T1BIF)被置位。如果 T1BIE 位为 1，那么将会产生一个中断事件。
如果 T1AOE 位配置为 1，那么 T1MOE 位在下次更新事件(UEV)到来时，将会由硬件自动置位。如
果 T1AOE 位为 0，那么只能由软件将 T1MOE 位重新置位。
当故障事件有效时，T1MOE 清 0，PWM 输出将一直置于预设状态；
故障事件撤消后，如果 T1AOE=1，PWM 将在下一次更新事件后恢复正常输出，否则，软件需要自动打
开 T1MOE。如图 10.30 和图 10.31 所示。
rev1.05
- 123 -
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TIM1_REF
TIM1_CHx
BKIN
BIF
AOE
自动重启
MOE
图 10.34 PWM 的自动重启
TIM1_REF
TIM1_CHx
PWM恢复输出
BKIN
BIF
AOE
软件重启
MOE
图 10.35 PWM 的软件重启
rev1.05
- 124 -
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10.3.6. 前沿消隐
BKIN
BKS0
LVDW
BKS1
to TIM1 break
logic
T1BKE
ADCMP
BKS2
EDGS
edge
detect
TIM1_CHx
to ADC trig
LEBCNT
9bit
LEBCH
T1CK
ADCLK
1
0
LEBADT
LEBEN
图 10.36 前沿消隐原理框图
在高速开关应用中，开关通常会产生极大的瞬变，这些瞬变可能会导致测量误差。利用前沿消隐（LEB）
功能，应用程序可以忽略 PWM 输出边沿附近发生的瞬变。
TIM1_CHx(PWM)
TIM1_BKIN
LEBEN
LEBCNT
0
1
2
0
在此期间故障被屏蔽
BKDIS
图 10.37 前沿消隐时序示意图
LEBCH 用于选择被消隐 TIM1 的 PWM 通道，EDGS 选择边沿类型。当 LEBEN 为 1，PWM 边沿将触发
LEB 定时器计数，时钟源为 TIM1 时钟，直到计数值等于 LEBPR，LEB 定时器停止计数，这段时间为消
隐周期，期间所发生的刹车事件将被忽略；在消隐周期内如果再次发生有效的 PWM 边沿，则 LEB 定时
器将清 0，重新开始计数。
注意：
(1) LEB 定时器和 ADC 延时定时器复用了同一个 9bit 计数器，当 LEBEN 为 1 时，原 ADC 的延时触发功能被
禁止，但如果 LEBADT 为 1，LEB 定时器溢出将触发一次 AD 转换。
(2) 寄存器 ADCON3 中 ADCMPEN 位的关闭能将 ADCMP 产生的刹车事件清除。
rev1.05
- 125 -
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10.4. 与 TIM1 相关寄存器汇总
名称
地址
bit7
TIM1CR1
0x211
T1ARPE
TIM1SMCR
0x213
－
TIM1IER
0x215
T1BIE
T1TIE
TIM1SR1
0x216
T1BIF
TIM1SR2
0x217
TIM1EGR
0x218
TIM1CCMR1
(output mode)
TIM1CCMR1
(input mode)
TIM1 CCMR2
(output mode)
TIM1CCMR2
(input mode)
TIM1CCMR3
(output mode)
TIM1CCMR3
(input mode)
TIM1CCMR4
(output mode)
TIM1CCMR4
(input mode)
bit6
bit5
bit4
bit3
bit2
bit1
bit0
复位值
T1DIR
T1OPM
T1URS
T1UDIS
T1CEN
0000 0000
－
T1CC4IE
T1CC3IE
T1CC2IE
T1CC1IE
T1UIE
00-0 0000
T1TIF
－
T1CC4IF
T1CC3IF
T1CC2IF
T1CC1IF
T1UIF
00-0 0000
－
－
－
T1CC4OF
T1CC3OF
T1CC2OF
T1CC1OF
－
---0 000-
T1BG
－
－
T1CC4G
T1CC3G
T1CC2G
T1CC1G
－
0--0 000-
T1OC1PE
－
T1CC1S[1:0]
-000 0-00
T1IC1PSC[1:0]
T1CC1S[1:0]
0000 0000
－
T1CC2S[1:0]
-000 0-00
T1IC2PSC[1:0]
T1CC2S[1:0]
0000 0000
－
T1CC3S[1:0]
-000 0-00
T1IC3PSC[1:0]
T1CC3S[1:0]
0000 0000
－
T1CC4S[1:0]
-000 0-00
T1IC4PSC[1:0]
T1CC4S[1:0]
0000 0000
T1CMS[1:0]
T1TS[2:0]
T1OC1M[2:0]
－
T1SMS[2:0]
－
-000 -000
0x219
T1IC1F[3:0]
T1OC2M[2:0]
－
T1OC2PE
0x21A
T1IC2F[3:0]
T1OC3M[2:0]
－
T1OC3PE
0x21B
T1IC3F[3:0]
T1OC4M[2:0]
－
T1OC4PE
0x21C
T1IC4F[3:0]
TIM1CCER1
0x21D
T1CC2NP
T1CC2NE
T1CC2P
T1CC2E
T1CC1NP
T1CC1NE
T1CC1P
T1CC1E
0000 0000
TIM1CCER2
0x21E
－
－
T1CC4P
T1CC4E
T1CC3NP
T1CC3NE
T1CC3P
T1CC3E
--00 0000
TIM1CNTRH
0x28C
T1CNT[15:8]
0000 0000
TIM1CNTRL
0x28D
T1CNT[7:0]
0000 0000
TIM1PSCRH
0x28E
T1PSC[15:8]
0000 0000
TIM1PSCRL
0x28F
T1PSC[7:0]
0000 0000
TIM1ARRH
0x290
T1ARR[15:8]
1111 1111
TIM1ARRL
0x291
T1ARR[7:0]
1111 1111
TIM1RCR
0x292
T1REP[7:0]
0000 0000
TIM1CCR1H
0x293
T1CCR1[15:8]
0000 0000
TIM1CCR1L
0x294
T1CCR1[7:0]
0000 0000
TIM1CCR2H
0x295
T1CCR2[15:8]
0000 0000
TIM1CCR2L
0x296
T1CCR2[7:0]
0000 0000
TIM1CCR3H
0x297
T1CCR3[15:8]
0000 0000
TIM1CCR3L
0x298
T1CCR3[7:0]
0000 0000
TIM1CCR4H
0x299
T1CCR4[15:8]
0000 0000
TIM1CCR4L
0x29A
T1CCR4[7:0]
0000 0000
TIM1BKR
0x29B
T1MOE
T1AOE
T1BKP
T1BKE
T1OIS4
T1OIS3N
T1OIS3
T1OIS2N
－
EDGS
TIM1DTR
0x29C
TIM1OISR
0x29D
－
LEBCON
0x41C
LEBEN
T1OSSR
T1OSSI
T1LOCK[1:0]
T1DTG[7:0]
LEBCH[1:0]
0000 0000
T1OIS2
T1OIS1N
T1OIS1
BKS[2:0]
- 126 -
-000 0000
000- 0000
注意：
TIM1 寄存器中的保留位必须保持为复位值，不能更改，否则可能出现预想不到的情况。
rev1.05
0000 0000
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.1. TIM1CR1，地址：0x211
Bit
7
Name
T1ARPE
6
5
T1CMS[1:0]
4
3
2
1
0
T1DIR
T1OPM
T1URS
T1UDIS
T1CEN
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T1ARPE：自动预装载允许位
7
0：TIM1ARRH/L寄存器没有缓冲，它可以被直接写入；
1：TIM1ARRH/L 寄存器由预装载缓冲器缓冲。
T1CMS[1:0]：选择中央对齐模式
00：边沿对齐模式。计数器依据方向位(T1DIR)向上或向下计数。
01：中央对齐模式1。计数器交替地向上和向下计数。配置为输出的通道(TIM1CCMRx寄存器中CCxS=00)的输出比较中断
标志位，只在计数器向下计数时被置1。
6:5
10：中央对齐模式2。计数器交替地向上和向下计数。配置为输出的通道(TIM1CCMRx寄存器中CCxS=00)的输出比较中断
标志位，只在计数器向上计数时被置1。
11：中央对齐模式3。计数器交替地向上和向下计数。配置为输出的通道(TIM1CCMRx寄存器中CCxS=00)的输出比较中断
标志位，在计数器向上和向下计数时均被置1。
注1：在计数器开启时(T1CEN=1)，不允许从边沿对齐模式转换到中央对齐模式。
T1DIR：方向
4
0：计数器向上计数；
1：计数器向下计数。
注：当计数器配置为中央对齐模式或编码器模式时，该位为只读。
T1OPM：单脉冲模式
3
0：在发生更新事件时，计数器不停止；
1：在发生下一次更新事件(清除T1CEN位)时，计数器停止。
T1URS：更新请求源
0：如果T1UDIS允许产生更新事件，则下述任一事件产生一个更新中断：
2
寄存器被更新(计数器上溢/下溢)
复位触发事件产生的更新
1：如果T1UDIS允许产生更新事件，则只有当下列事件发生时才产生更新中断，并T1UIF置1：
计数器上溢/下溢
T1UDIS：禁止更新
0：一旦下列事件发生，产生更新(UEV)事件：
1
计数器溢出/下溢
时钟/触发模式控制器产生的硬件复位被缓存的寄存器被装入它们的预装载值
1：不产生更新事件，影子寄存器(ARR_SHAD、PSC_SHAD、CCRx_SHAD)保持它们的值。如果触发复位模式下触发事
件到来时，计数器和预分频器会被重新初始化。
T1CEN：允许计数器
0
0：禁止计数器；
1：使能计数器。
注：在软件设置了T1CEN位后，门控模式才能工作。
rev1.05
- 127 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.2. TIM1SMCR，地址：0x213
Bit
7
Name
reserved
Reset
－
0
0
0
－
0
0
0
Type
RO-0
RW
RW
RW
RO-0
RW
RW
RW
7
6
5
4
T1TS[2:0]
3
2
reserved
1
0
T1SMS[2:0]
保留位
T1TS[2:0]：触发选择
这3位选择用于选择同步计数器的触发输入。
000：内部触发ITR0连接到TIM6 TRGO (此设计没有TIM6，所以固定接0)
001：保留
010：内部触发ITR2连接到TIM5 TRGO(此设计没有TIM5，所以固定接0)
6:4
011：保留
100：TI1的边沿检测器(TI1F_ED)
101：滤波后的定时器输入1(TI1FP1)
110：滤波后的定时器输入2(TI2FP2)
111：禁止配置
注：这些位只能在SMS=3’b000时被改变，以避免在改变时产生错误的边沿检测。
3
保留位
T1SMS：时钟/触发/从模式选择
当选择了外部信号，触发信号(TRGI)的有效边沿与选中的外部输入极性相关(见输入控制寄存器和控制寄存器的说明)
000：时钟/触发控制器禁止 – 如果T1CEN=1，则预分频器直接由内部时钟驱动。
100：复位模式 – 在选中的触发输入(TRGI)的上升沿时重新初始化计数器，并且产生一个更新寄存器的信号。
2:0
101：门控模式 – 当触发输入(TRGI)为高时，计数器的时钟开启。一旦触发输入变为低，则计数器停止(但不复位)。计数
器的启动和停止都是受控的。
110：触发模式 – 计数器在触发输入TRGI的上升沿启动(但不复位)，只有计数器的启动是受控的。
注：(1)其他值禁止配置
(2)只有在输入捕捉模式下才能配置为复位模式；在输出比较模式下，禁止配置为复位模式
(3)配置成门控模式/触发模式时，捕捉功能可正常使用
rev1.05
- 128 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.3. TIM1IER，地址：0x215
Bit
7
6
5
4
3
2
1
0
Name
T1BIE
T1TIE
reserved
T1CC4IE
T1CC3IE
T1CC2IE
T1CC1IE
T1UIE
Reset
0
0
－
0
0
0
0
0
Type
RW
RW
RO-0
RW
RW
RW
RW
RW
T1BIE：允许刹车中断
7
0：禁止刹车中断；
1：允许刹车中断。
T1TIE：触发中断使能
6
0：禁止触发中断；
1：使能触发中断。
5
保留位
T1CC4IE：允许捕获/比较4中断
4
0：禁止捕获/比较4中断；
1：允许捕获/比较4中断。
T1CC3IE：允许捕获/比较3中断
3
0：禁止捕获/比较3中断；
1：允许捕获/比较3中断。
T1CC2IE：允许捕获/比较2中断
2
0：禁止捕获/比较2中断；
1：允许捕获/比较2中断。
T1CC1IE：允许捕获/比较1中断
1
0：禁止捕获/比较1中断；
1：允许捕获/比较1中断。
T1UIE：允许更新中断
0
0：禁止更新中断；
1：允许更新中断。
rev1.05
- 129 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.4. TIM1SR1，地址：0x216
Bit
7
6
5
4
3
2
1
0
Type
T1BIF
T1TIF
reserved
T1CC4IF
T1CC3IF
T1CC2IF
T1CC1IF
T1UIF
Reset
0
0
－
0
0
0
0
0
Type
R-W0
R-W0
RO-0
R-W0
R-W0
R-W0
R-W0
R-W0
T1BIF：刹车中断标记(写1清0，写0无效)
7
一旦刹车输入有效，由硬件对该位置1。如果刹车输入无效，则该位可由软件清0。
0：无刹车事件产生；
1：刹车输入上检测到有效电平。
T1TIF：触发器中断标记(写1清0，写0无效)
当发生触发事件(当从模式控制器处于除门控模式外的其它模式时，在TRGI输入端检测到有效边沿，或门控模式下的任一
6
边沿)时由硬件对该位置1。它由软件清0。
0：无触发器事件产生；
1：触发中断等待响应。
5
4
3
2
保留位
T1CC4IF：捕获/比较4中断标记(写1清0，写0无效)
参考CC1IF描述。
T1CC3IF：捕获/比较3中断标记(写1清0，写0无效)
参考CC1IF描述。
T1CC2IF：捕获/比较2中断标记(写1清0，写0无效)
参考CC1IF描述。
T1CC1IF：捕获/比较1中断标记
如果通道1配置为输出模式：(写1清0，写0无效)
当计数器值与比较值匹配时该位由硬件置1，但在中心对称模式下除外(参考TIM1_CR1寄存器的T1CMS位)。它由软件清0。
0：无匹配发生；
1：CNT的值与T1CCR1值匹配。
1
注：在中心对称模式下，当计数器值为0时，向上计数，当计数器值为T1ARR时，向下计数（它从0向上计数到T1ARR-1，
再由T1ARR向下计数到1）。因此，对所有的T1SMS位值，这两个值都不置标记。但是，如果T1CCR1>T1ARR，则当CNT
达到T1ARR值时，T1CC1IF置1。
如果通道1配置为输入模式：当捕获事件发生时该位由硬件置1，它由软件清0或通过读TIM1CCR1L清0。
0：无输入捕获产生；
1：计数器值已被捕获(拷贝)至TIM1CCR1H/L(在IC1上检测到与所选极性相同的边沿)。
T1UIF：更新中断标记(写1清0，写0无效)
0
当产生更新事件时该位由硬件置1。它由软件清0。
0：无更新事件产生；
1：更新事件等待响应。
rev1.05
- 130 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.5. TIM1SR2，地址：0x217
Bit
7
Name
6
5
reserved
4
3
2
1
0
T1CC4OF
T1CC3OF
T1CC2OF
T1CC1OF
reserved
Reset
－
－
－
0
0
0
0
－
Type
RO-0
RO-0
RO-0
RW
RW
RW
RW
RO-0
7:5
4
3
2
保留位
T1CC4OF：捕获/比较4重复捕获标记(写1清0，写0无效)
参见CC1OF描述。
T1CC3OF：捕获/比较3重复捕获标记(写1清0，写0无效)
参见CC1OF描述。
T1CC2OF：捕获/比较2重复捕获标记(写1清0，写0无效)
参见CC1OF描述。
T1CC1OF：捕获/比较1重复捕获标记(写1清0，写0无效)
1
仅当相应的通道被配置为输入捕获时，该标记可由硬件置1。写0可清除该位。
0：无重复捕获产生；
1：计数器的值被捕获到TIM1CCR1H/L寄存器时，T1CC1IF的状态已经为1。
0
保留位
10.4.6. TIM1EGR，地址：0x218
Bit
7
6
5
4
3
2
1
0
Name
T1BG
reserved
reserved
T1CC4G
T1CC3G
T1CC2G
T1CC1G
reserved
Reset
0
－
－
0
0
0
0
－
R0-W
RO-0
RO-0
R0-W
R0-W
R0-W
R0-W
RO-0
Type
T1BG：产生刹车事件
7
该位由软件置1，用于产生一个刹车事件，由硬件自动清0。
0：无动作；
1：产生一个刹车事件。此时T1MOE=0、T1BIF=1，若开启对应的中断(T1BIE=1)，则产生相应的中断。
6:5
4
3
2
保留位
T1CC4G：产生捕获/比较4事件
参考CC1G描述。
T1CC3G：产生捕获/比较3事件
参考CC1G描述。
T1CC2G：产生捕获/比较2事件
参考CC1G描述。
T1CC1G：产生捕获/比较1事件
该位由软件置1，用于产生一个捕获/比较事件，由硬件自动清0。
0：无动作；
1
1：在通道1上产生一个捕获/比较事件： 若通道1配置为输出：
设置T1CC1IF=1，若开启对应的中断，则产生相应的中断。若通道1配置为输入：
当前的计数器值被捕获至TIM1CCR1H/L寄存器，设置T1CC1IF=1，若开启对应的中断，则产生相应的中断。若T1CC1IF
已经为1，则设置T1CC1OF=1。
0
保留位
rev1.05
- 131 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.7. TIM1CCMR1，地址：0x219
配置为输出比较模式：
Bit
7
Name
reserved
Rese
－
0
0
RO-0
RW
RW
Type
7
6
5
4
3
2
T1OC1PE
reserved
0
0
－
0
0
RW
RW
RO-0
RW
RW
T1OC1M[2:0]
1
0
T1CC1S[1:0]
保留位
T10C1M[2:0]：输出比较1模式
该3位定义了输出参考信号OC1REF的动作，而OC1REF决定了OC1的值。OC1REF是高电平有效，而OC1的有效电平取
决于CC1P位。
000：冻结。输出实际比较值(CCRx_SHAD)与计数器TIM1_CNT间的比较对OC1REF不起作用；
001：匹配时设置通道1的输出为有效电平。当计数器TIM1_CNT的值与捕获/比较寄存器1(TIM1_CCR1)相同时，强制
OC1REF为高。
010：匹配时设置通道1的输出为无效电平。当计数器TIM1_CNT的值与捕获/比较寄存器1(TIM1_CCR1)相同时，强制
OC1REF为低。
6:4
011：翻转。当TIM1_CCR1=TIM1_CNT时，翻转OC1REF的电平。
100：强制为无效电平。强制OC1REF为低。
101：强制为有效电平。强制OC1REF为高。
110：PWM模式1－ 在向上计数时，一旦TIM1_CNT实际比较值(CCRx_SHAD)时，OC1REF为无效电平，否则为有效电平。
111：PWM模式2－ 在向上计数时，一旦TIM1_CNT实际比较值(CCRx_SHAD)时，OC1REF为有效电平，否则为无效电平。
注1：一旦LOCK级别设为3(TIM1_BKR寄存器中的LOCK位)并且T1CC1S=00(该通道配置成输出) 则该位不能被修改。
注2：在PWM模式1或PWM模式2中，只有当比较结果改变了或在输出比较模式中从冻结模式切换到PWM模式时，OC1REF
电平才改变。(参考17.5.7PWM模式)
T1OC1PE：输出比较1预装载使能
0：禁止TIM1CCR1H/L寄存器的预装载功能，可随时写入T1CCR1预加载寄存器，并且新写入的数值立即起作用。
1：开启TIM1CCR1H/L寄存器的预装载功能，读写操作仅对预装载寄存器操作，TIM1CCR1H/L的预装载值在更新事件到
3
来时被加载至当前寄存器中。
注1：一旦LOCK级别设为3(TIM1BKR寄存器中的T1LOCK位)并且T1CC1S=00(该通道配置成输出) 则该位不能被修改。
注2：为了操作正确，在PWM模式下必须使能预装载功能。但在单脉冲模式下(TIM1CR1寄存器的T1OPM=1)，它不是必须
的。
2
保留位
T1CC1S[1:0]：捕获/比较1 选择。
这2位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道1被配置为输出；
1:0
01：通道1被配置为输入，IC1映射在TI1FP1上；
10：通道1被配置为输入，IC1映射在TI2FP1上；
11：通道1被配置为输入，IC1映射在TRC上。此模式仅工作在内部触发器输入被选中时(由
TIM1SMCR寄存器的T1TS位选择)。
注：T1CC1S仅在通道关闭时(TIM1CCER1寄存器的T1CC1E=0，T1CC1NE=0且已被更新)才是可写的。
rev1.05
- 132 -
2020-5-29
Fremont Micro Devices
FT61F08X
配置为输入捕捉模式：
Name
Type
T1IC1F[3:0]
RO
RO
RO
T1IC1PSC[1:0]
RO
RO
RO
T1CC1S[1:0]
RO
RO
T1IC1F[3:0]：输入捕获1滤波器
这几位定义了TI1输入的采样频率及数字滤波器长度。数字滤波器由一个事件计数器组成，只有发生了N个事件后输出的
跳变才被认为有效。
7:4
0000：无滤波器，fSAMPLING=fMASTER
1000：采样频率fSAMPLING=fMASTER/8，N=6
0001：采样频率fSAMPLING=fMASTER，N=2
1001：采样频率fSAMPLING=fMASTER/8，N=8
0010：采样频率fSAMPLING=fMASTER，N=4
1010：采样频率fSAMPLING=fMASTER/16，N=5
0011：采样频率fSAMPLING=fMASTER，N=8
1011：采样频率fSAMPLING=fMASTER/16，N=6
0100：采样频率fSAMPLING=fMASTER/2，N=6
1100：采样频率fSAMPLING=fMASTER/16，N=8
0101：采样频率fSAMPLING=fMASTER/2，N=8
1101：采样频率fSAMPLING=fMASTER/32，N=5
0110：采样频率fSAMPLING=fMASTER/4，N=6
1110：采样频率fSAMPLING=fMASTER/32，N=6
0111：采样频率fSAMPLING=fMASTER/4，N=8
1111：采样频率fSAMPLING=fMASTER/32，N=8
T1IC1PSC[1:0]：输入/捕获1预分频器
这2位定义了通道1输入(IC1)的预分频系数。
一旦T1CC1E=0(TIM1CCER寄存器中)，则预分频器复位。
3:2
00：无预分频器，捕获输入口上检测到的每一个边沿都触发一次捕获；
01：每2个事件触发一次捕获；
10：每4个事件触发一次捕获；
11：每8个事件触发一次捕获。
T1CC1S[1:0]：捕获/比较1 选择。
这2位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道1被配置为输出；
1:0
01：通道1被配置为输入，IC1映射在TI1FP1上；
10：通道1被配置为输入，IC1映射在TI2FP1上；
11：通道1被配置为输入，IC1映射在TRC上。此模式仅工作在内部触发器输入被选中时(由
TIM1SMCR寄存器的T1TS位选择)。
注：T1CC1S仅在通道关闭时(TIM1CCER1寄存器的T1CC1E=0，T1CC1NE=0且已被更新)才是可写的。
rev1.05
- 133 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.8. TIM1CCMR2，地址：0x21A
配置为输出比较模式：
Bit
7
Name
reserved
6
5
4
T1OC2M[2:0]
3
2
T1OC2PE
reserved
1
0
T1CC2S[1:0]
Reset
－
0
0
0
0
－
0
0
Type
RO-0
RW
RW
RW
RW
RO-0
RW
RW
7
保留位
6:4
T1OC2M[2:0]：输出比较2模式
3
T1OC2PE：输出比较2预装载使能
2
保留位
T1CC2S[1:0]：捕获/比较2选择。
该位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道2被配置为输出；
1:0
01：通道2被配置为输入，IC2映射在TI2FP2上；
10：通道2被配置为输入，IC2映射在TI1FP2上；
11：预留
注：T1CC2S仅在通道关闭时(TIM1CCER1寄存器的T1CC2E=0，T1CC2NE=0且已被更新)才是可写的。
配置为输入捕捉模式：
Name
T1IC2F[3:0]
Type
RO
RO
T1IC2PSC[1:0]
RO
7:4
T1IC2F[3:0]：输入捕获2滤波器
3:2
T1IC2PSC[1:0]：输入/捕获2预分频器
RO
RO
RO
T1CC2S[1:0]
RO
RO
T1CC2S[1:0]：捕获/比较2选择。
这2位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道2被配置为输出；
1:0
01：通道2被配置为输入，IC2映射在TI2FP2上；
10：通道2被配置为输入，IC2映射在TI1FP2上；
11：通道2被配置为输入，IC2映射在TRC上。此模式仅工作在内部触发器输入被选中时(由
TIM1SMCR寄存器的T1TS位选择)。
注：T1CC2S仅在通道关闭时(TIM1CCER1寄存器的T1CC2E=0，T1CC2NE=0且已被更新)才是可写的。
rev1.05
- 134 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.9. TIM1CCMR3，地址：0x21B
配置为输出比较模式：
Bit
7
Type
6
5
reserved
4
T1OC3M[2:0]
3
2
T1OC3PE
reserved
1
0
T1CC3S[1:0]
Reset
－
0
0
0
0
－
0
0
Type
RO-0
RW
RW
RO-0
RW
RO-0
RW
RW
7
保留位
6:4
T1OC3M[2:0]：输出比较3模式
3
T1OC3PE：输出比较3预装载使能
2
保留位
T1CC3S[1:0]：捕获/比较3选择。
该位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道3被配置为输出；
1:0
01：通道3被配置为输入，IC3映射在TI3FP3上；
10：通道3被配置为输入，IC3映射在TI4FP3上；
11：预留
注：T1CC3S仅在通道关闭时(TIM1CCER2寄存器的T1CC3E=0，T1CC3NE=0且已被更新)才是可写的。
配置为输入捕捉模式：
Name
T1IC3F[3:0]
Type
RO
RO
T1IC3PSC[1:0]
RO
7:4
T1IC3F[3:0]：输入捕获3滤波器
3:2
T1IC3PSC[1:0]：输入/捕获3预分频器
RO
RO
RO
T1CC3S[1:0]
RO
RO
T1CC3S[1:0]：捕获/比较3选择。
这2位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道3被配置为输出；
1:0
01：通道3被配置为输入，IC3映射在TI3FP3上；
10：通道3被配置为输入，IC3映射在TI4FP3上；
11：预留
注：T1CC3S仅在通道关闭时(TIM1CCER2寄存器的T1CC3E=0，T1CC3NE=0且已被更新)才是可写的。
rev1.05
- 135 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.10. TIM1CCMR4，地址：0x21C
配置为输出比较模式：
Bit
7
Name
reserved
6
5
4
T1OC4M[2:0]
3
2
T1OC4PE
reserved
1
0
T1CC4S[1:0]
Reset
－
0
0
0
0
－
0
0
Type
RO-0
RW
RW
RO-0
RW
RO-0
RW
RW
7
保留位
6:4
T1OC4M[2:0]：输出比较4模式
3
T1OC4PE：输出比较4预装载使能
2
保留位
T1CC4S[1:0]：捕获/比较4选择。
该位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道4被配置为输出；
1:0
01：通道4被配置为输入，IC4映射在TI3FP4上；
10：通道4被配置为输入，IC4映射在TI4FP4上；
11：预留
注：T1CC4S仅在通道关闭时(TIM1CCER2寄存器的T1CC4E=0)才是可写的。
配置为输入捕捉模式：
Name
T1IC4F[3:0]
Type
RO
RO
T1IC4PSC[1:0]
RO
7:4
T1IC4F[3:0]：输入捕获4滤波器
3:2
T1IC4PSC[1:0]：输入/捕获4预分频器
RO
RO
RO
T1CC4S[1:0]
RO
RO
T1CC4S[1:0]：捕获/比较4选择。
这2位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道4被配置为输出；
1:0
01：通道4被配置为输入，IC4映射在TI3FP4上；
10：通道4被配置为输入，IC4映射在TI4FP4上；
11：预留
注：T1CC4S仅在通道关闭时(TIM1CCER2寄存器的T1CC4E=0)才是可写的。
rev1.05
- 136 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.11. TIM1CCER1，地址：0x21D
Bit
7
6
5
4
3
2
1
0
Name
T1CC2NP
T1CC2NE
T1CC2P
T1CC2E
T1CC1NP
T1CC1NE
T1CC1P
T1CC1E
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
7
T1CC2NP：输入捕获/比较2互补输出极性。参考T1CC1NP的描述。
6
T1CC2NE：输入捕获/比较2互补输出使能。参考T1CC1NE的描述。
5
T1CC2P：输入捕获/比较2输出极性。参考T1CC1P的描述。
4
T1CC2E：输入捕获/比较2输出使能。参考T1CC1E的描述。
T1CC1NP：输入捕获/比较1互补输出极性
3
0：OC1N高电平有效；
1：OC1N低电平有效。
注1：一旦LOCK级别(TIM1BKR寄存器中的T1LOCK位)设为3或2且T1CC1S=00(通道配置为输出) 则该位不能被修改。
T1CC1NE：输入捕获/比较1互补输出使能
0：关闭－ OC1N禁止输出，因此OC1N的输出电平依赖于T1MOE、T1OSSI、T1OSSR、T1OIS1、
2
T1OIS1N和T1CC1E位的值。
1：开启－ OC1N信号输出到对应的输出引脚，其输出电平依赖于T1MOE、T1OSSI、T1OSSR、
T1OIS1、T1OIS1N和T1CC1E位的值。
T1CC1P：输入捕获/比较1输出极性选择
通道1配置为输出：
0：OC1高电平有效；
1：OC1低电平有效。
通道1配置为触发输入：
1
0：触发发生在TI1F的高电平或上升沿；
1：触发发生在TI1F的低电平或下降沿。
CC1通道配置为捕捉输入：
0：捕捉发生在TI1F的高电平或上升沿；
1：捕捉发生在TI1F的低电平或下降沿。
注1：一旦LOCK级别(TIM1BKR寄存器中的T1LOCK位)设为3或2，则该位不能被修改。
T1CC1E：输入捕获/比较1输出使能
CC1通道配置为输出：
0： 关闭－ OC1禁止输出，因此OC1的输出电平依赖于T1MOE、T1OSSI、T1OSSR、T1OIS1、T1OIS1N和T1CC1NE位的
值。
0
1： 开启－ OC1信号输出到对应的输出引脚，其输出电平依赖于T1MOE、T1OSSI、T1OSSR、T1OIS1 、 T1OIS1N 和
T1CC1NE 位 的 值 。
通道1配置为输入：
该位决定了计数器的值是否能被捕获到TIM1CCR1寄存器中。
0：捕获禁止；
1：捕获使能。
rev1.05
- 137 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.12. TIM1CCER2，地址：0x21E
Bit
7
6
5
4
3
2
1
0
Name
reserved
reserved
T1CC4P
T1CC4E
T1CC3NP
T1CC3NE
T1CC3P
T1CC3E
Reset
－
－
0
0
0
0
0
0
Type
RO-0
RO-0
RW
RW
RW
RW
RW
RW
3
2
1
0
7:6
保留位
5
T1CC4P：输入捕获/比较4输出极性。参考T1CC1P的描述。
4
T1CC4E：输入捕获/比较4输出使能。参考T1CC1E 的描述。
3
T1CC3NP：输入捕获/比较3互补输出极性。参考T1CC1NP的描述。
2
T1CC3NE：输入捕获/比较3互补输出使能。参考T1CC1NE的描述。
1
T1CC3P：输入捕获/比较3输出极性。参考T1CC1P的描述。
0
T1CC3E：输入捕获/比较3输出使能。参考T1CC1E 的描述。
10.4.13. TIM1CNTRH，地址：0x28C
Bit
7
6
5
4
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
Name
7:0
T1CNT[15:8]
T1CNT[15:8]：计数器的高8位值
10.4.14. TIM1CNTRL，地址：0x28D
Bit
7
6
5
4
Name
T1CNT[7:0]
Reset
Type
7:0
0
0
0
0
0
0
0
0
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
T1CNT[7:0]：计数器的低8位值
10.4.15. TIM1PSCRH，地址：0x28E
Bit
7
6
5
4
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Name
T1PSC[15:8]
T1PSC[15:7]：预分频器的高8位值
7:0
预分频器用于对CK_PSC进行分频。
计数器的时钟频率(fCK_CNT)等于fCK_PSC/( PSCR[15:0]+1)。
PSCR为实际装入预分频器影子寄存器的值。这意味着为了使新的值起作用，必须产生一个更新事件或者T1CEN=0。
rev1.05
- 138 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.16. TIM1PSCRL，地址：0x28F
Bit
7
6
5
4
Name
3
2
1
0
T1PSC[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T1PSC[7:0]：预分频器的低8位值
预分频器用于对CK_PSC进行分频。
7:0
计数器的时钟频率(fCK_CNT)等于fCK_PSC/( PSCR[15:0]+1)。
PSCR为实际装入预分频器影子寄存器的值。这意味着为了使新的值起作用，必须产生一个更新事件或者T1CEN=0。
注：在配置的时候，需要先将周期，占空比，模式等寄存器配置完成后并且在T1CEN使能之前配置预分频寄存器。
10.4.17. TIM1ARRH，地址：0x290
Bit
7
6
5
4
Name
3
2
1
0
T1ARR[15:8]
Reset
1
1
1
1
1
1
1
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
T1ARR[15:8]: 自动重装载的高8位值
7:0
T1ARR为将要装载入实际的自动重装载寄存器的值。
当自动重装载的值为空时，计数器不工作。
10.4.18. TIM1ARRL，地址：0x291
Bit
7
6
5
4
Reset
1
1
1
1
1
1
1
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
Name
T1ARR[7:0]
T1ARR[7：0]: 自动重装载的低8位值
7:0
T1ARR为将要装载入实际的自动重装载寄存器的值。
当自动重装载的值为空时，计数器不工作。
rev1.05
- 139 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.19. TIM1RCR，地址：0x292
Bit
7
6
5
4
Name
3
2
1
0
T1REP[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T1REP[7:0]: 重复计数器的值
开启了预装载功能后，这些位允许用户设置比较寄存器的更新速率(即周期性地从预装载寄存器传输到当前寄存器)；如果
允许产生更新中断，则会同时影响产生更新中断的速率。
7:0
每次向下重复计数器达到0，会产生一个更新事件并且重复计数器重新从T1REP值开始计数。由于重复计数器只有在周期
更新事件(UEV)发生时才重载T1REP值，因此对TIM1RCR寄存器写入的新值只在下次周期更新事件发生时才起作用。
这意味着在PWM模式中，(T1REP+1)对应着：
--- 在边沿对齐模式下，PWM周期的数目；
--- 在中心对称模式下，PWM半周期的数目；
10.4.20. TIM1CCR1H，地址：0x293
Bit
7
6
5
4
Name
3
2
1
0
T1CCR1[15:8]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T1CCR1[15:8]: 捕获/比较1的高8位值
若通道1配置为输出(TIM1CCMR1的T1CC1S=00)：
T1CCR1H/L为装入当前捕获/比较1寄存器的值(预装载值)。
7:0
如果在TIM1CCMR1寄存器(T1OC1PE位)中未选择预装载功能，写入的数值会立即传输至当前寄存器中。否则只有当更新
事件发生时，此预装载值才传输至当前捕获/比较1寄存器中。
当前捕获/比较寄存器的值同计数器TIM1_CNT的值相比较，并在OC1端口上产生输出信号。
若通道1配置为输入：
T1CCR1H/L包含了上一次输入捕获1事件(IC1)发生时的计数器值（此时该寄存器为只读）。
10.4.21. TIM1CCR1L，地址：0x294
Bit
7
6
5
Name
Reset
7:0
4
3
2
1
0
RW
RW
RW
T1CCR1[7:0]
RW
RW
RW
RW
RW
T1CCR1[7:0]: 捕获/比较1的低8位值
rev1.05
- 140 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.22. TIM1CCR2H，地址：0x295
Bit
7
6
5
4
Name
3
2
1
0
T1CCR2[15:8]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T1CCR2[15:8]: 捕获/比较2的高8位值
若通道2配置为输出(TIM1CCMR2的T1CC2S=00)：
T1CCR2H/L包含了装入当前捕获/比较2寄存器的值(预装载值)。
7:0
如果在TIM1CCMR2寄存器(T1OC2PE位)中未选择预装载功能，写入的数值会立即传输至当前寄存器中。否则只有当更新
事件发生时，此预装载值才传输至当前捕获/比较1寄存器中。
当前捕获/比较寄存器的值同计数器TIM1_CNT的值相比较，并在OC2端口上产生输出信号。
若通道2配置为输入：
T1CCR2H/L包含了由上一次输入捕获2事件(IC2)传输的计数器值(此时该寄存器为只读)。
10.4.23. TIM1CCR2L，地址：0x296
Bit
7
6
5
4
Name
3
2
1
0
T1CCR2[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
7:0
T1CCR2[7:0]: 捕获/比较2的低8位值
10.4.24. TIM1CCR3H，地址：0x297
Bit
7
6
5
4
Name
T1CCR3[15:8]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T1CCR3[15:8]: 捕获/比较3的高8位值
若通道2配置为输出(TIM1CCMR3的T1CC3S=00)：
T1CCR3H/L包含了装入当前捕获/比较3寄存器的值(预装载值)。
7:0
如果在TIM1CCMR3寄存器(T1OC3PE位)中未选择预装载功能，写入的数值会立即传输至当前寄存器中。否则只有当更新
事件发生时，此预装载值才传输至当前捕获/比较1寄存器中。
当前捕获/比较寄存器的值同计数器TIM1_CNT的值相比较，并在OC3端口上产生输出信号。
若通道3配置为输入：
T1CCR3H/L包含了由上一次输入捕获3事件(IC3)传输的计数器值(此时该寄存器为只读)。
rev1.05
- 141 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.25. TIM1CCR3L，地址：0x298
Bit
7
6
5
4
Name
3
2
1
0
T1CCR3[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
7:0
T1CCR3[7:0]: 捕获/比较3的低8位值
10.4.26. TIM1CCR4H，地址：0x299
Bit
7
6
5
4
Name
T1CCR4[15:8]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T1CCR4[15:8]: 捕获/比较4的高8位值
若通道2配置为输出(TIM1CCMR4的T1CC4S=00)：
T1CCR4H/L包含了装入当前捕获/比较4寄存器的值(预装载值)。
7:0
如果在TIM1CCMR4寄存器(T1OC4PE位)中未选择预装载功能，写入的数值会立即传输至当前寄存器中。否则只有当更新
事件发生时，此预装载值才传输至当前捕获/比较1寄存器中。
当前捕获/比较寄存器的值同计数器TIM1_CNT的值相比较，并在OC4端口上产生输出信号。
若通道4配置为输入：
T1CCR4H/L包含了由上一次输入捕获4事件(IC4)传输的计数器值(此时该寄存器为只读)。
10.4.27. TIM1CCR4L，地址：0x29A
Bit
7
6
5
4
Name
3
2
1
0
T1CCR4[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
7:0
T1CCR4[7:0]: 捕获/比较4的低8位值
rev1.05
- 142 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.28. TIM1BKR，地址：0x29B
Bit
7
6
5
4
3
2
Name
T1MOE
T1AOE
T1BKP
T1BKE
T1OSSR
T1OSSI
1
0
T1LOCK[1:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T1MOE: 主输出使能
一旦刹车输入有效，该位被硬件异步清0。根据T1AOE位的设置值，该位可以由软件置1或被自动置1。它仅对配置为输
7
出的通道有效。
0：禁止OC和OCN输出或强制为空闲状态；
1：如果设置了相应的使能位(TIM1CCERx寄存器的T1CCxE位)，则使能OC和OCN输出。
T1AOE: 自动输出使能
6
0：T1MOE只能被软件置1；
1：T1MOE能被软件置1或在下一个更新事件被自动置1(如果刹车输入无效)。
注：一旦LOCK级别(TIM1BKR寄存器中的T1LOCK位)设为1，则该位不能被修改。
T1BKP: 刹车输入极性（只对故障源TIM1_BKIN有效）
5
0：刹车输入低电平有效；
1：刹车输入高电平有效。
注：一旦LOCK级别(TIM1BKR寄存器中的T1LOCK位)设为1，则该位不能被修改。
T1BKE: 刹车功能使能
4
0：禁止刹车输入(BRK)；
1：开启刹车输入(BRK)。
注：一旦LOCK级别(TIM1BKR寄存器中的T1LOCK位)设为1，则该位不能被修改。
T1OSSR: 运行模式下“关闭状态”选择
该位用于当T1MOE=1且通道为互补输出时。
3
0：当定时器不工作时，禁止OC/OCN输出(OC/OCN使能输出信号=0)；
1：当定时器不工作时，一旦CCxE=1或CCxNE=1，首先开启OC/OCN并输出无效电平，然后置
OC/OCN使能输出信号=1。
注：一旦LOCK级别(TIM1BKR寄存器中的T1LOCK位)设为2，则该位不能被修改。
2
T1OSSI:空闲模式下“关闭状态”选择 该位用于当T1MOE=0且通道设为输出时。
0：当定时器不工作时，禁止OC/OCN输出(OC/OCN使能输出信号=0)；
1：当定时器不工作时，一旦CCxE=1或CCxNE=1，OC/OCN首先输出其空闲电平，然后
OC/OCN使能输出信号=1。
注：一旦LOCK级别(TIM1BKR寄存器中的T1LOCK位)设为2，则该位不能被修改。
T1LOCK[1:0]: 锁定设置
该位为防止软件错误而提供写保护。
00：锁定关闭，寄存器无写保护；
01：锁定级别1，不能写入TIM1BKR寄存器的T1BKE、T1BKP、T1AOE位和TIM1OISR寄存器的
1:0
T1OISI位；
10：锁定级别2，不能写入锁定级别1中的各位，也不能写入输出极性位(一旦相关通道通过T1CCxS
位设为输出，输出极性位是TIM1CCERx寄存器的T1CCxP位)以及T1OSSR/T1OSSI位；
11：锁定级别3，不能写入锁定级别2中的各位，也不能写入输出控制位(一旦相关通道通过T1CCxS
位设为输出，输出控制位是TIM1CCMRx寄存器的T1OCIM/T1OCIPE位)；
注：在系统复位后，只能写一次LOCK位，一旦写入TIM1BDR寄存器，则其内容保持不变直至复位。
rev1.05
- 143 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.29. TIM1DTR，地址：0x29C
Bit
7
6
5
4
Name
3
2
1
0
T1DTG[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T1DTG[7:0]: 死区发生器设置
这些位定义了插入互补输出之间的死区持续时间。假设DT表示其持续时间，tCK_PSC为TIM1的时钟脉冲：
7:0
T1DTG[7:5]=0xx
=>
DT=DTG[7:0]x tdtg，其中：tdtg =tCK_PSC.
(f1)
T1DTG[7:5]=10x
=>
DT=(64+DTG[5:0])x tdtg，其中：tdtg = tCK_PSC.
(f2)
T1DTG[7:5]=110
=>
DT=(32+DTG[4:0])x tdtg， 其 中 ：tdtg=8x tCK_PSC.
T1DTG[7:5]=111
=>
DT=(32+DTG[4:0])x tdtg， 其 中 ：tdtg=16x tCK_PSC.
(f3)
(f4)
举列:
如果tCK_PSC =125 ns (8 MHz), 可能的死区时间为：
T1DTG[7:0]
=
0到7Fh，
0到15875 ns，
步长时间为125 ns
T1DTG[7:0]
=
80h到BFh ，16μs到31750ns， 步长时间为250 ns
T1DTG[7:0]
=
C0h到DFh， 32μs到63μs，
步长时间为1μs
T1DTG[7:0]
=
E0h到FFh， 64μs到126μs，
步长时间为2 μs
(参考f1)
(参考f2)
(参考f3)
(参考f4)
注：一旦LOCK级别(TIM1BKR寄存器中的T1LOCK位)设为1、2或3，则不能修改这些位。
10.4.30. TIM1OISR，地址：0x29D
Bit
7
6
5
4
3
2
1
0
Name
reserved
T1OIS4
T1OIS3N
T1OIS3
T1OIS2N
T1OIS2
T1OIS1N
T1OIS1
Reset
－
0
0
0
0
0
0
0
Type
RO-0
RW
RW
RW
RW
RW
RW
RW
7
保留位
6
T1OIS4：输出空闲状态4(OC4输出)。参见T1OIS1位。
5
T1OIS3N：输出空闲状态3(OC3N输出)。参见T1OIS1N位。
4
T1OIS3：输出空闲状态3(OC3输出)。参见T1OIS1位。
3
T1OIS2N：输出空闲状态2(OC2N输出)。参见T1OIS1N位。
2
T1OIS2：输出空闲状态2(OC2输出)。参见T1OIS1位。
T1OIS1N：输出空闲状态1(OC1N输出)。
1
0：当T1MOE=0时，则在一个死区时间后，OC1N=0；
1：当T1MOE=0时，则在一个死区时间后，OC1N=1。
注：已经设置了LOCK(TIM1BKR寄存器)级别1、2或3后，该位不能被修改。
T1OIS1：输出空闲状态1(OC1输出)。
0
0：当T1MOE=0时，如果OC1N使能，则在一个死区后，OC1=0；
1：当T1MOE=0时，如果OC1N使能，则在一个死区后，OC1=1。
注：已经设置了LOCK(TIM1BKR寄存器)级别1、2或3后，该位不能被修改。
rev1.05
- 144 -
2020-5-29
Fremont Micro Devices
FT61F08X
10.4.31. LEBCON 寄存器，地址 0x41C
Bit
7
Name
LEBEN
Reset
0
0
Type
RW
RW
Bit
Name
7
LEBEN
6:5
LEBCH[1:0]
4
N/A
3
EDGS
6
5
4
3
reserved
EDGS
0
－
0
0
0
0
RW
RO-0
RW
RW
RW
RW
LEBCH[1:0]
2
1
0
BKS[2:0]
Function
前沿消隐使能位（仅当 ADGO=0 时可进行切换，否则 ADC 工作异常）
1 = 使能
0 = 禁止
前沿消隐通道选择
00 = TIM1_CH1
01 = TIM1_CH2
10 = TIM1_CH3
11 = TIM1_CH4
保留位，读 0
PWM 消隐沿选择
0 = PWM 上升沿
1 = PWM 下降沿
2
1
BKS[2:0]
BKS[2:0]，TIM1 的故障源使能，高有效
BKS2：选择 ADC 阈值比较
BKS1：选择 LVD 检测
BKS0：选择 BKIN 管脚
0
rev1.05
- 145 -
2020-5-29
Fremont Micro Devices
FT61F08X
11. 通用定时器 TIM2
11.1. 特性
tiemr2 的功能除捕捉比较通道数量不同以外，其他相同：
16bit 的向上计数，支持自动重载；
计数时钟预分频；
支持 1/2 个独立的捕捉比较通道，通道可支持：
输入捕捉
输出比较
PWM 产生
中断事件：
更新事件：计数器溢出，计数器初始化
输入捕捉事件
输出比较事件
11.2. 原理框图
TIME BASE UNIT
CK_CNT
fMASTER
CK_PSC
UP-DOWN COUNTER
Prescaler
Auto-reload register
CAPTURE COMPARE ARRAY
CC1I UEV
TIM2_CH1
IC1
TI1
Prescaler
IC1PS
Capture/Compare 1 Register
OC1REF
OC1
TIM2_CH1
OC2
TIM2_CH2
OC3
TIM2_CH3
CC2I UEV
TIM2_CH2
TI2
INPUT
STAGE
IC2
Prescaler
IC2PS
Capture/Compare 2 Register
OC2REF
OUTPUT
STAGE
CC3I UEV
TIM2_CH3
TI3
IC3
Prescaler
IC3PS
Capture/Compare 3 Register
OC3REF
图 11.1 TIM2 原理框图
rev1.05
- 146 -
2020-5-29
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FT61F08X
11.3. 功能描述
整个 TIM2 可以分为两个大的功能部分：计数基本单元和捕捉比较通道。计数基本单元分为向上计数器、自
动加载寄存器、预分频器；捕捉比较通道分为捕捉输入通道，输出比较通道和输出控制。
11.3.1. 计数基本单元
TIM2_ARRH,ARRL
Auto-reload register
UEV
CK_PSC
UIF
CK_CNT
Prescaler
TIM2_PSCR
16-bit Counter
TIM2_CNTRH,CNTRL
UEV
图 11.2 计数基本单元框图
计数基本单元包括：
16 位向上计数器
16 位自动重加载寄存器
4 位可编程预分频器
TIM2 没有重复计数器
11.3.1.1. 时钟源选择
时钟源可由 TCKSRC 寄存器进行配置：
T2CKSRC[2:0]=000 时，系统时钟/主时钟为 TIM2 时钟
T2CKSRC[2:0]=001 时，HIRC 为 TIM2 时钟
T2CKSRC[2:0]=010 时，XT 时钟/外部时钟为 TIM2 时钟
T2CKSRC[2:0]=011 时，HIRC 的 2 倍频为 TIM2 时钟
T2CKSRC[2:0]=100 时，XT 时钟/外部时钟的 2 倍频为 TIM2 时钟
T2CKSRC[2:0]=101 时，LIRC 为 TIM2 时钟
T2CKSRC[2:0]=110 时，LP 时钟/外部时钟为 TIM2 时钟
T2CKSRC[2:0]=111 时，LP 时钟/外部时钟的 2 倍频为 TIM2 时钟
rev1.05
- 147 -
2020-5-29
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FT61F08X
11.3.1.2. 向上计数器
TIMx_ARR
0
Overflow
Overflow
Overflow
Overflow
Time
图 11.3 向上计数器
TIM2 计数器只能向上计数。计数器从 0 开始计数向上计数，计到 TIM1_ARR 寄存器所设数值。然后重新从
0 开始计数并产生一个计数器上溢事件；如果 T2UDIS 设为 0，那么还会产生一个更新事件 UEV。
11.3.1.3. 预分频器
计数时钟可以进行 4bit 的时钟预分频：
fCK_CNT = fCK_PSC/
预分频支持分频自动更新，即在更新事件发生后，能够自动改变预分频值。当 T2CEN 为 0 时，写入预分频
寄存器的值也能直接加载实际应用的预分频寄存器中。
11.3.2. 捕捉比较通道
TIM2CCMRx 寄存器是复用寄存器。
当作为输出比较通道时，TIM2CCMRx 寄存器作为输出配置寄存器，并且第 7 位和第 2 位禁止配置，保持为
默认值；下表为 TIM2CCMRx 作为输出配置寄存器时的具体意义：
Bit
7
6
5
4
Name
reserved
Rese
－
0
0
0
Type
RO-0
RW
RW
RW
T2OCxM[2:0]
3
2
1
0
T2OCxPE
reserved
0
－
0
0
RW
RO-0
RW
RW
T2CCxS[1:0]
表 11.1 TIM2CCMRx 作为输出配置寄存器
当作为输入捕捉通道时，TIM2CCMRx 寄存器作为输入配置寄存器；下表为 TIM2CCMRx 作为输出配置寄存
器时的具体意义：
Bit
7
6
5
4
3
Rese
0
0
0
0
0
0
0
0
Type
RO
RO
RO
RO
RO
RO
RO
RO
Name
T2ICxF[3:0]
2
1
T2ICxPSC[1:0]
0
T2CCxS[1:0]
表 10.2 TIM2CCMRx 作为输入配置寄存器
rev1.05
- 148 -
2020-5-29
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11.3.2.1. 捕捉输入通道
TI1F_ED
TRC
to clock/trigger
TIM2_CH1
TI1
TIM2_CH2
TI2
TI1FP1
Input Filter & TI1FP2
EdgeDetector
TRC
IC1
Input Filter & TI2FP1
EdgeDetector TI2FP2
IC2
TRC
TIM2_CH3
TI3
to capture/
compare channel
Input Filter & TI3FP3
EdgeDetector
IC3
图 11.4 输入通道框图
11.3.2.2. 输出比较通道
OC1REF
output
control
OC1
OC2REF
output
control
OC2
OC3REF
output
control
OC3
From capture/
compare channels
TIM2_CH1
TIM2_CH2
TIM2_CH3
图 11.5 输出通道框图
TIM2 的输出没有死区功能，没有互补输出功能，也没有刹车功能。
rev1.05
- 149 -
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11.3.3. TIM2 中断
TIM2 有以下 4 个中断请求源：
捕捉/比较 3 中断
捕捉/比较 2 中断
捕捉/比较 1 中断
更新中断
在用这些中断之前需要提前打开 TIM2IER 寄存器中的中断使能位(T2CCxIE 和 T2UIE)。
不同的中断源还可以配置通过 TIM2EGR 寄存器来产生(软件产生中断)。
11.4. 与 TIM2 相关寄存器汇总
名称
地址
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
复位值
TIM2CR1
0x30C
T2ARPE
－
－
－
T2OPM
T2URS
T2UDIS
T2CEN
0--- 0000
TIM2IER
0x30D
－
－
－
－
T2CC3IE
T2CC2IE
T2CC1IE
T2UIE
---- 0000
TIM2SR1
0x30E
－
－
－
－
T2CC3IF
T2CC2IF
T2CC1IF
T2UIF
---- 0000
TIM2SR2
0x30F
－
－
－
－
T2CC3OF
T2CC2OF
T2CC1OF
－
- - - - 0 0 0-
TIM2EGR
0x310
－
－
－
－
T2CC3G
T2CC2G
T2CC1G
T2UG
---- 0000
T2OC1PE
－
T2CC1S[1:0]
-000 0-00
T2IC1PSC[1:0]
T2CC1S[1:0]
0000 0000
－
T2CC2S[1:0]
-000 0-00
T2IC2PSC[1:0]
T2CC2S[1:0]
0000 0000
－
T2CC3S[1:0]
-000 0-00
T2IC3PSC[1:0]
T2CC3S[1:0]
0000 0000
TIM2CCMR1
(output mode)
TIM2CCMR1
(input mode)
TIM2CCMR2
(output mode)
TIM2CCMR2
(input mode)
TIM2CCMR3
(output mode)
TIM2_CCMR3
(input mode)
T2OC1M[2:0]
－
0x311
T2IC1F[3:0]
T2OC2M[2:0]
－
T2OC2PE
0x312
T2IC2F[3:0]
T2OC2M[2:0]
－
OC3PE
0x313
T2IC3F[3:0]
TIM2CCER1
0x314
－
－
T2CC2P
T2CC2E
－
－
T2CC1P
T2CC1E
--00 --00
TIM2CCER2
0x315
－
－
－
－
－
－
T2CC3P
T2CC3E
---- --00
TIM2CNTRH
0x316
T2CNT[15:8]
0000 0000
TIM2CNTRL
0x317
T2CNT[7:0]
0000 0000
TIM2PSCR
0x318
TIM2ARRH
0x319
T2ARR[15:8]
1111 1111
TIM2ARRL
0x31A
T2ARR[7:0]
1111 1111
TIM2CCR1H
0x31B
T2CCR1[15:8]
0000 0000
TIM2CCR1L
0x31C
T2CCR1[7:0]
0000 0000
TIM2CCR2H
0x31D
T2CCR2[15:8]
0000 0000
TIM2CCR2L
0x31E
T2CCR2[7:0]
0000 0000
TIM2CCR3H
0x29E
T2CCR3[15:8]
0000 0000
TIM2CCR3L
0x29F
T2CCR3[7:0]
0000 0000
rev1.05
－
－
－
－
- 150 -
T2PSC[3:0]
---- 0000
2020-5-29
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FT61F08X
11.4.1. TIM2CR1，地址 0x30C
Bit
7
Name
T2ARPE
6
5
4
reversed
3
2
1
0
T2OPM
T2URS
T2UDIS
T2CEN
Reset
0
－
－
－
0
0
0
0
Type
RW
RO-0
RO-0
RO-0
RW
RW
RW
RW
7
6:4
3
2
1
0
T2ARPE：自动预装载允许位
0：TIM2ARRH/L寄存器没有缓冲，它可以被直接写入；
1：TIM2ARRH/L 寄存器由预装载缓冲器缓冲。
保留位
T2OPM：单脉冲模式
0：在发生更新事件时，计数器不停止；
1：在发生下一次更新事件(清除T2CEN位)时，计数器停止。
T2URS：更新请求源
0：如果T2UDIS允许产生更新事件，则下述任一事件产生一个更新中断：
寄存器被更新(计数器上溢/下溢)
1：如果T2UDIS允许产生更新事件，则只有当下列事件发生时才产生更新中断，并UIF置1：
寄存器被更新(计数器上溢/下溢)
T2UDIS：禁止更新
0：一旦下列事件发生，产生更新(UEV)事件：
计数器溢出/下溢
产生软件更新事件
1：不产生更新事件，影子寄存器(ARR_SHAD、PSC_SHAD、CCRx_SHAD)保持它们的值。
T2CEN：允许计数器
0：禁止计数器；
1：使能计数器。
11.4.2. TIM2IER，地址 0x30D
Bit
7
6
5
4
Reset
－
－
－
－
Type
RO-0
RO-0
RO-0
RO-0
7:4
保留位
Name
reserved
3
2
1
0
T2CC3IE
T2CC2IE
T2CC1IE
T2UIE
0
0
0
0
R-W0
R-W0
R-W0
R-W0
T2CC3IE：允许捕获/比较3中断
3
0：禁止捕获/比较3中断；
1：允许捕获/比较3中断。
T2CC2IE：允许捕获/比较2中断
2
0：禁止捕获/比较2中断；
1：允许捕获/比较2中断。
T2CC1IE：允许捕获/比较1中断
1
0：禁止捕获/比较1中断；
1：允许捕获/比较1中断。
T2UIE：允许更新中断
0
0：禁止更新中断；
1：允许更新中断。
rev1.05
- 151 -
2020-5-29
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FT61F08X
11.4.3. TIM2SR1，地址 0x30E
Bit
7
6
5
4
Reset
－
－
－
－
Type
RO-0
RO-0
RO-0
RO-0
Name
7:4
3
2
reserved
3
2
1
0
T2CC3IF
T2CC2IF
T2CC1IF
T2UIF
0
0
0
0
R-W0
R-W0
R-W0
R-W0
保留位
T2CC3IF：捕获/比较3中断标记(写1清0，写0无效)
参考T2CC1IF描述。
T2CC2IF：捕获/比较2中断标记(写1清0，写0无效)
参考T2CC1IF描述。
T2CC1IF：捕获/比较1中断标记
如果通道1配置为输出模式：(写1清0，写0无效)
如果通道1配置为输出比较模式：当计数器值与比较值匹配时该位由硬件置1；它由软件清0。
0：无匹配发生；
1
1：TIM2_CNT的值与TIM2CCR1H/L的值匹配。
如果通道1配置为输入捕捉模式：当捕获事件发生时该位由硬件置1，它由软件清0或通过读TIM2CCR1L清0。
0：无输入捕获产生；
1：计数器值已被捕获(拷贝)至TIM2CCR1H/L(在IC1上检测到与所选极性相同的边沿)。
T2UIF：更新中断标记(写1清0，写0无效)
0
当产生更新事件时该位由硬件置1。它由软件清0。
0：无更新事件产生；
1：更新事件等待响应。
11.4.4. TIM2SR2，地址 0x30F
Bit
7
6
Name
Reset
Type
7:4
3
2
5
4
reserved
3
2
1
0
T2CC3OF
T2CC2OF
T2CC1OF
reserved
－
－
－
－
0
0
0
－
RO-0
RO-0
RO-0
RO-0
R-W0
R-W0
R-W0
RO-0
保留位
T2CC3OF：捕获/比较3重复捕获标记(写1清0，写0无效)
参见T2CC1OF描述。
T2CC2OF：捕获/比较2重复捕获标记(写1清0，写0无效)
参见T2CC1OF描述。
T2CC1OF：捕获/比较1重复捕获标记(写1清0，写0无效)
1
仅当相应的通道被配置为输入捕获时，该标记可由硬件置1。写0可清除该位。
0：无重复捕获产生；
1：计数器的值被捕获到TIM2CCR1H/L寄存器时，T2CC1IF的状态已经为1。
0
保留位
rev1.05
- 152 -
2020-5-29
Fremont Micro Devices
FT61F08X
11.4.5. TIM2EGR，地址 0x310
Bit
7
6
Name
5
4
reserved
3
2
1
0
T2CC3G
T2CC2G
T2CC1G
T2UG
Reset
－
－
－
－
0
0
0
0
Type
RO-0
RO-0
RO-0
RO-0
RW
RW
RW
RW
7:4
保留位
3
2
T2CC3G：产生捕获/比较3事件
参考T2CC1G描述。
T2CC2G：产生捕获/比较2事件
参考T2CC1G描述。
T2CC1G：产生捕获/比较1事件
该位由软件置1，用于产生一个捕获/比较事件，由硬件自动清0。
0：无动作；
1：在通道1上产生一个捕获/比较事件。
1
若通道1配置为输出：
设置T2CC1IF=1，若开启对应的中断，则产生相应的中断。
若通道1配置为输入：
当前的计数器值被捕获至TIM2CCR1H/L寄存器，设置T2CC1IF=1，若开启对应的中断，则产生相应的中断。
若T2CC1IF已经为1，则设置T2CC1OF=1。
T2UG：产生更新事件
该位由软件置1，由硬件自动清0。
0：无动作；
0
1：重新初始化计数器，并产生一个更新事件。
注意：
预分频器的计数器也被清0(但是预分频系数不变)。若在T2DIR=0(向上计数)则计数器被清0；若T2DIR=1(向下计数)则计
数器初始化为TIM1ARRH/L的值。
rev1.05
- 153 -
2020-5-29
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FT61F08X
11.4.6. TIM2CCMR1，地址 0x311
配置为输出比较模式：
Bit
7
Name
reserved
6
5
4
T2OC1M[2:0]
3
2
T2OC1PE
reserved
1
0
T2CC1S[1:0]
Reset
－
0
0
0
0
－
0
0
Type
RO-0
RW
RW
RO-0
RW
RO-0
RW
RW
7
保留位
T2OC1M[2:0]：输出比较1模式
该3位定义了输出参考信号OC1REF的动作，而OC1REF决定了OC1的值。OC1REF是高电平有效，而OC1的有效电平取
决于T2CC1P位。
000：冻结。输出实际比较值(CCRx_SHAD)与计数器TIM2_CNT间的比较对OC1REF不起作用；
001：匹配时设置通道1的输出为有效电平。当计数器TIM2_CNT的值与实际比较值(CCRx_SHAD)相同时，强制OC1REF
为高。
010：匹配时设置通道1的输出为无效电平。当计数器TIM2_CNT的值与实际比较值(CCRx_SHAD)相同时，强制OC1REF
为低。
6:4
011：翻转。当TIM2_CCR1=TIM2_CNT时，翻转OC1REF的电平。
100：强制为无效电平。强制OC1REF为低。
101：强制为有效电平。强制OC1REF为高。
110：PWM模式1－ 在向上计数时，一旦TIM2_CNT实际比较值(CCRx_SHAD)时OC1REF为无效电平， 否则为有效电平。
111：PWM模式2－ 在向上计数时，一旦TIM2_CNT实际比较值(CCRx_SHAD)时OC1REF为有效电平，否则为无效电平。
注1：在PWM模式1或PWM模式2中，只有当比较结果改变了或在输出比较模式中从冻结模式切换到PWM模式时，OC1REF
电平才改变。
T2OC1PE：输出比较1预装载使能
3
0：禁止TIM2CCR1H/L寄存器的预装载功能，可随时写入T2CCR1预加载寄存器，并且新写入的数值立即起作用。
1：开启TIM2CCR1H/L寄存器的预装载功能，读写操作仅对预装载寄存器操作，TIM2CCR1H/L的预装载值在更新事件到
来时被加载至当前寄存器中。
2
保留位
T2CC1S[1:0]：捕获/比较1 选择。
这2位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道1被配置为输出；
1:0
01：通道1被配置为输入，IC1映射在TI1FP1上；
10：通道1被配置为输入，IC1映射在TI2FP1上；
11：预留
注：T2CC1S仅在通道关闭时(TIM2CCER1寄存器的T2CC1E=0)才是可写的。
rev1.05
- 154 -
2020-5-29
Fremont Micro Devices
FT61F08X
配置为输入捕捉模式：
Name
T2IC1F[3:0]
T2IC1PSC[1:0]
T2CC1S[1:0]
Reset
0
0
0
0
0
0
0
0
Type
RO
RO
RO
RO
RO
RO
RO
RO
T2IC1F[3:0]：输入捕获1滤波器
这几位定义了TI1输入的采样频率及数字滤波器长度。数字滤波器由一个事件计数器组成，只有发生了N个事件后输出的跳
变才被认为有效。
7:4
0000：无滤波器，fSAMPLING=fMASTER
1000：采样频率fSAMPLING=fMASTER/8，N=6
0001：采样频率fSAMPLING=fMASTER，N=2
1001：采样频率fSAMPLING=fMASTER/8，N=8
0010：采样频率fSAMPLING=fMASTER，N=4
1010：采样频率fSAMPLING=fMASTER/16，N=5
0011：采样频率fSAMPLING=fMASTER，N=8
1011：采样频率fSAMPLING=fMASTER/16，N=6
0100：采样频率fSAMPLING=fMASTER/2，N=6
1100：采样频率fSAMPLING=fMASTER/16，N=8
0101：采样频率fSAMPLING=fMASTER/2，N=8
1101：采样频率fSAMPLING=fMASTER/32，N=5
0110：采样频率fSAMPLING=fMASTER/4，N=6
1110：采样频率fSAMPLING=fMASTER/32，N=6
0111：采样频率fSAMPLING=fMASTER/4，N=8
1111：采样频率fSAMPLING=fMASTER/32，N=8
T2IC1PSC[1:0]：输入/捕获1预分频器
这2位定义了通道1输入(IC1)的预分频系数。
一旦T2CC1E=0(TIM2CCER1寄存器中)，则预分频器复位。
3:2
00：无预分频器，捕获输入口上检测到的每一个边沿都触发一次捕获；
01：每2个事件触发一次捕获；
10：每4个事件触发一次捕获；
11：每8个事件触发一次捕获。
T2CC1S[1:0]：捕获/比较1 选择。
这2位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道1被配置为输出；
1:0
01：通道1被配置为输入，IC1映射在TI1FP1上；
10：通道1被配置为输入，IC1映射在TI2FP1上；
11：预留
注：T2CC1S仅在通道关闭时(TIM2CCER1寄存器的T2CC1E=0)才是可写的。
rev1.05
- 155 -
2020-5-29
Fremont Micro Devices
FT61F08X
11.4.7. TIM2CCMR2，地址 0x312
配置为输出比较模式：
Bit
7
Name
reserved
6
5
4
T2OC2M[2:0]
3
2
T2OC2PE
reserved
1
0
T2CC2S[1:0]
Reset
－
0
0
0
0
－
0
0
Type
RO-0
RW
RW
RW
RW
RO-0
RW
RW
7
6:4
保留位
T2OC2M[2:0]：输出比较2模式
3
T2OC2PE：输出比较2预装载使能
2
保留位
T2CC2S[1:0]：捕获/比较2选择。
该位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道2被配置为输出；
1:0
01：通道2被配置为输入，IC2映射在TI2FP2上；
10：通道2被配置为输入，IC2映射在TI1FP2上；
11：预留
注：T2CC2S仅在通道关闭时(TIM2CCER1寄存器的T2CC2E=0，T2CC2NE=0且已被更新)才是可写的。
配置为输入捕捉模式：
Name
T2IC2F[3:0]
T2IC2PSC[1:0]
T2CC2S[1:0]
Reset
0
0
0
0
0
0
0
0
Type
RO
RO
RO
RO
RO
RO
RO
RO
7:4
T2IC2F[3:0]：输入捕获2滤波器
3:2
T2IC2PSC[1:0]：输入/捕获2预分频器
T2CC2S[1:0]：捕获/比较2选择。
这2位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道2被配置为输出；
1:0
01：通道2被配置为输入，IC2映射在TI2FP2上；
10：通道2被配置为输入，IC2映射在TI1FP2上；
11：预留
注：T2CC2S仅在通道关闭时(TIM2CCER1寄存器的T2CC2E=0，T2CC2NE=0且已被更新)才是可写的。
rev1.05
- 156 -
2020-5-29
Fremont Micro Devices
FT61F08X
11.4.8. TIM2CCMR3，地址 0x313
配置为输出比较模式：
Bit
7
Name
reserved
6
5
4
T2OC3M[2:0]
3
2
T2OC3PE
reserved
1
0
T2CC3S[1:0]
Reset
－
0
0
0
0
－
0
0
Type
RO-0
RW
RW
RW
RW
RO-0
RW
RW
7
6:4
保留位
T2OC3M[2:0]：输出比较3模式
3
T2OC3PE：输出比较3预装载使能
2
保留位
T2CC3S[1:0]：捕获/比较3选择。
该位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道3被配置为输出；
1:0
01：通道3被配置为输入，IC3映射在TI3FP3上；
10：通道3被配置为输入，IC3映射在TI4FP3上；
11：预留
注：T2CC3S仅在通道关闭时(TIM2CCER2寄存器的T2CC3E=0，T2CC3NE=0且已被更新)才是可写的。
配置为输入捕捉模式：
Name
T2IC3F[3:0]
T2IC3PSC[1:0]
T2CC3S[1:0]
Reset
0
0
0
0
0
0
0
0
Type
RO
RO
RO
RO
RO
RO
RO
RO
7:4
T2IC3F[3:0]：输入捕获3滤波器
3:2
T2IC3PSC[1:0]：输入/捕获3预分频器
T2CC3S[1:0]：捕获/比较3选择。
这2位定义通道的方向(输入/输出)，及输入脚的选择：
00：通道3被配置为输出；
1:0
01：通道3被配置为输入，IC3映射在TI3FP3上；
10：通道3被配置为输入，IC3映射在TI4FP3上；
11：预留
注：T2CC3S仅在通道关闭时(TIM2CCER2寄存器的T2CC3E=0，T2CC3NE=0且已被更新)才是可写的。
rev1.05
- 157 -
2020-5-29
Fremont Micro Devices
FT61F08X
11.4.9. TIM2CCER1，地址 0x314
Bit
7
Name
6
reserved
5
4
T2CC2P
T2CC2E
3
2
reserved
1
0
T2CC1P
T2CC1E
Reset
－
－
0
0
－
－
0
0
Type
RO-0
RO-0
RW
RW
RO-0
RO-0
RW
RW
3
2
1
0
T2CC3P
T2CC3E
7:6
保留位
5
T2CC2P：输入捕获/比较2输出极性。参考T2CC1P的描述。
4
T2CC2E：输入捕获/比较2输出使能。参考T2CC1E的描述。
3:2
保留位
T2CC1P：输入捕获/比较1输出极性
通道1配置为输出：
0：OC1高电平有效；
1：OC1低电平有效。
1
通道1配置为触发输入：
0：触发发生在TI1F的高电平或上升沿；
1：触发发生在TI1F的低电平或下降沿。
通道1配置为捕捉输入：
0：捕捉发生在TI1F的高电平或上升沿；
1：捕捉发生在TI1F的低电平或下降沿。
T2CC1E：输入捕获/比较1输出使能
CC1通道配置为输出：
0： 关闭－ OC1禁止输出。
0
1： 开启－ OC1信号输出到对应的输出引脚。
CC1通道配置为输入：
该位决定了计数器的值是否能捕获入TIM2CCR1寄存器。
0：捕获禁止；
1：捕获使能。
11.4.10. TIM2CCER2，地址 0x315
Bit
7
6
5
Name
4
reserved
Reset
－
－
－
－
－
－
0
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RW
RW
7:2
保留位
1
T2CC3P：输入捕获/比较3输出极性。参考T2CC1P的描述。
0
T2CC3E：输入捕获/比较3输出使能。参考T2CC1E 的描述。
rev1.05
- 158 -
2020-5-29
Fremont Micro Devices
FT61F08X
11.4.11. TIM2CNTRH，地址 0x316
Bit
7
6
5
4
Name
3
2
1
0
T2CNT[15:8]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
7:0
T2CNT[15:8]：计数器的高8位值
11.4.12. TIM2CNTRL，地址 0x317
Bit
7
6
5
4
Name
T2CNT[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
7:0
T2CNT[7:0]：计数器的低8位值
11.4.13. TIM2PSCR，地址 0x318
Bit
7
6
Name
5
4
reserved
T2PSC[3:0]
Reset
－
－
－
－
0
0
0
0
Type
RO-0
RO-0
RO-0
RO-0
RW
RW
RW
RW
7:4
保留位
T2PSC[3:0]：预分频器的值
预分频器对输入的CK_PSC时钟进行分频。
3:0
计数器的时钟频率fCK_CNT等于fCK_PSC/2
(PSCR[3:0])
。
PSCR为实际装入预分频器影子寄存器的值(包括由于清除TIM2EGR寄存器的UG位产生的计数器清除事件)。这意味着如
要新的预分频值生效，必须产生更新事件或者T2CEN=0。
11.4.14. TIM2ARRH，地址 0x319
Bit
7
6
5
4
Name
3
2
1
0
T2ARR[15:8]
Reset
1
1
1
1
1
1
1
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
T2ARR[15:8]: 自动重装载的高8位值
7:0
T2ARR为将要装载入实际的自动重装载寄存器的值。
当自动重装载的值为空时，计数器不工作。
rev1.05
- 159 -
2020-5-29
Fremont Micro Devices
FT61F08X
11.4.15. TIM2ARRL，地址 0x31A
Bit
7
6
5
4
Name
3
2
1
0
T2ARR[7:0]
Reset
1
1
1
1
1
1
1
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
T2ARR[7：0]: 自动重装载的低8位值
7:0
T2ARR为将要装载入实际的自动重装载寄存器的值。
当自动重装载的值为空时，计数器不工作。
11.4.16. TIM2CCR1H，地址 0x31B
Bit
7
6
5
4
Name
T2CCR1[15:8]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T2CCR1[15:8]: 捕获/比较1的高8位值
若通道1配置为输出(TIM2CCMR1的T2CC1S=00)：
T2CCR1H/L为装入当前捕获/比较1寄存器的值(预装载值)。
7:0
如果在TIM2CCMR1寄存器(T2OC1PE位)中未选择预装载功能，写入的数值会立即传输至当前寄存器中。否则只有当更新
事件发生时，此预装载值才传输至当前捕获/比较1寄存器中。
当前捕获/比较寄存器的值同计数器TIM2_CNT的值相比较，并在OC1端口上产生输出信号。
若CC1通道配置为输入：
T2CCR1H/L包含了上一次输入捕获1事件(IC1)发生时的计数器值（此时该寄存器为只读）。
11.4.17. TIM2CCR1L，地址 0x31C
Bit
7
6
5
4
Name
3
2
1
0
T2CCR1[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
7:0
T2CCR1[7:0]: 捕获/比较1的低8位值
rev1.05
- 160 -
2020-5-29
Fremont Micro Devices
FT61F08X
11.4.18. TIM2CCR2H，地址 0x31D
Bit
7
6
5
4
Name
3
2
1
0
T2CCR2[15:8]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T2CCR2[15:8]: 捕获/比较2的高8位值
若通道2配置为输出(TIM2CCMR2的T2CC2S=00)：
T2CCR2H/L为装入当前捕获/比较2寄存器的值(预装载值)。
7:0
如果在TIM2CCMR2寄存器(T2OC2PE位)中未选择预装载功能，写入的数值会立即传输至当前寄存器中。否则只有当更新
事件发生时，此预装载值才传输至当前捕获/比较2寄存器中。
当前捕获/比较寄存器的值同计数器TIM2_CNT的值相比较，并在OC2端口上产生输出信号。
若通道2配置为输入：
T2CCR2H/L包含了上一次输入捕获2事件(IC2)发生时的计数器值（此时该寄存器为只读）。
11.4.19. TIM2CCR2L，地址 0x31E
Bit
7
6
5
4
Name
3
2
1
0
T2CCR2[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
7:0
T2CCR2[7:0]: 捕获/比较2的低8位值
11.4.20. TIM2CCR3H，地址 0x29E
Bit
7
6
5
4
Name
T2CCR3[15:8]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
T2CCR3[15:8]: 捕获/比较3的高8位值
若通道3配置为输出(TIM2CCMR3的T2CC3S=00)：
T2CCR3H/L为装入当前捕获/比较3寄存器的值(预装载值)。
7:0
如果在TIM2CCMR3寄存器(T2OC3PE位)中未选择预装载功能，写入的数值会立即传输至当前寄存器中。否则只有当更新
事件发生时，此预装载值才传输至当前捕获/比较3寄存器中。
当前捕获/比较寄存器的值同计数器TIM2_CNT的值相比较，并在OC3端口上产生输出信号。
若通道3配置为输入：
T2CCR3H/L包含了上一次输入捕获3事件(IC3)发生时的计数器值（此时该寄存器为只读）。
11.4.21. TIM2CCR3L，地址 0x29F
Bit
7
6
5
4
Name
3
2
1
0
T2CCR3[7:0]
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
7:0
T2CCR3[7:0]: 捕获/比较3的低8位值
rev1.05
- 161 -
2020-5-29
Fremont Micro Devices
FT61F08X
12. 基本定时器 TIM4
12.1. 特性
8bit 自动重载向上计数器
计数时钟可编程预分频
中断
计数器溢出
12.2. 原理框图
TIME BASE UNIT
UEV
Auto-reload register
UEV
CK_CNT
fMASTER
CK_PSC
UIF
UP-COUNTER
Prescaler
图 12.1 TIM4 原理框图
12.3. TIM4 时钟源
TIM4 有 4 种时钟源可选，由寄存器位 T4CKS 设置。在 TIM4 的被使能（PCKEN.TIM4EN=1）的情况下，
所选择的时钟源被自动使能。
注意：
1. 如果要选择 LP 晶体时钟，系统时钟配置寄存器位 FOSC 必须选择 LP 模式，否则对应的时钟源将不被
使能；
2.
同理，如果要选择 XT 晶体时钟，系统时钟配置寄存器位 FOSC 必须选择 XT 模式，否则对应的时钟源
将不被使能；
SLEEP 模式下，如果 SYSON 为 1，且 TIM4EN=1，则所选择的时钟源将保持振荡，TIM4 将继续工作；否
则，所选的时钟源取决于其他模块的设置情况。
12.4. 预分频器
计数时钟可以进行 3bit 的时钟预分频：
fCK_CNT = fCK_PSC/
预分频支持分频自动更新，即在更新事件发生后，能够自动改变预分频值。当 T4CEN 为 0 时，写入预分频
寄存器的值也能直接加载实际应用的预分频寄存器中。
rev1.05
- 162 -
2020-5-29
Fremont Micro Devices
FT61F08X
12.5. TIM4 中断
TIM4 只有一个中断请求源：
更新中断(计数器上溢或计数器初始化)
在用这些中断之前需要提前打开 TIM4IER 寄存器中的中断使能位(T4UIE)。
不同的中断源还可以配置通过 TIM4EGR 寄存器来产生(软件产生中断 T4UG)。
12.6. TIM4 寄存器表
bit7
bit6
bit5
名称
地址
TIM4CR1
0x111
T4ARPE
－
TIM4IER
0x112
－
－
－
TIM4SR
0x113
－
－
TIM4EGR
0x114
－
－
TIM4CNTR
0x115
TIM4PSCR
0x116
TIM4ARR
0x117
rev1.05
bit4
bit3
bit2
bit1
－
复位值
T4OPM
T4URS
T4UDIS
T4CEN
0-00 0000
－
－
－
－
T4UIE
---- ---0
－
－
－
－
－
T4UIF
---- ---0
－
－
－
－
－
T4UG
---- ---0
T4CKS[1:0]
T4CNT[7:0]
－
bit0
－
－
－
T4ARR[7:0]
- 163 -
0000 0000
T4PSC[2:0]
---- -000
1111 1111
2020-5-29
Fremont Micro Devices
FT61F08X
12.6.1. TIM4CR1，地址 0x111
Bit
7
6
5
4
Name
T4ARPE
reserved
Reset
0
－
0
Type
RW
RO-0
RW
3
2
1
0
T4OPM
T4URS
T4UDIS
T4CEN
0
0
0
0
0
RW
RW
RW
RW
RW
T4CKS[1:0]
T4ARPE：自动预装载允许位
0：TIM4ARRH/L寄存器没有缓冲，它可以被直接写入；
7
1：TIM4ARRH/L 寄存器由预装载缓冲器缓冲。
6
保留位
T4CKS：TIM4时钟选择位
00：系统时钟/主时钟
5:4
01：内部快时钟HIRC
10：LP时钟，只有当FOSC选择LP模式时才有意义
11：XT时钟，只有当FOSC选择XT模式时才有意义
T4OPM：单脉冲模式
3
0：在发生更新事件时，计数器不停止；
1：在发生下一次更新事件(清除T4CEN位)时，计数器停止。
T4URS：更新请求源
0：如果T4UDIS允许产生更新事件，则下述任一事件产生一个更新中断：
寄存器被更新(计数器上溢)
2
软件设置T4UG位
1：如果T4UDIS允许产生更新事件，则只有当下列事件发生时才产生更新中断，并T4UIF置1：
寄存器被更新(计数器上溢)
T4UDIS：禁止更新
0：一旦下列事件发生，产生更新(UEV)事件：
计数器溢出
1
产生软件更新事件
1：不产生更新事件，影子寄存器(ARR_SHAD、PSC_SHAD)保持它们的值。如果设置了T4UG位，则计数器和预分频器
被重新初始化。
T4CEN：允许计数器
0
0：禁止计数器；
1：使能计数器。
12.6.2. TIM4IER，地址 0x112
Bit
7
6
5
Name
4
3
2
1
reserved
0
T4UIE
Reset
－
－
－
－
－
－
－
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RW
7:1
保留位
T4UIE：允许更新中断
0：禁止更新中断；
0
1：允许更新中断。
rev1.05
- 164 -
2020-5-29
Fremont Micro Devices
FT61F08X
12.6.3. TIM4SR，地址 0x113
Bit
7
6
5
Name
4
3
2
1
reserved
0
T4UIF
Reset
－
－
－
－
－
－
－
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RW-0
3
2
1
0
7:1
保留位
T4UIF：更新中断标记
当产生更新事件时该位由硬件置1。它由软件清0。
0
0：无更新事件产生；
1：更新事件等待响应。
12.6.4. TIM4EGR，地址 0x114
Bit
7
6
5
Name
reserved
Reset
Type
7:1
4
T4UG
－
－
－
－
－
－
－
0
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RW
3
2
1
0
保留位
T4UG：产生更新事件
该位由软件置1，由硬件自动清0。
0
0：无动作；
1：重新初始化计数器，并产生一个更新事件。
12.6.5. TIM4CNTR，地址 0x115
Bit
7
6
5
4
Name
T4CNT[7:0]
Reset
Type
7:0
0
0
0
0
0
0
0
0
RW
RW
RW
RW
RW
RW
RW
RW
T4CNT[7:0]：计数器的8位值
rev1.05
- 165 -
2020-5-29
Fremont Micro Devices
FT61F08X
12.6.6. TIM4PSCR，地址 0x116
Bit
7
6
5
4
3
2
reserved
Name
1
0
T4PSC[2:0]
Reset
－
－
－
－
－
0
0
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RW
RW
RW
7:3
保留位
T4PSC[2:0]：预分频器的值
预分频器对输入的CK_PSC时钟进行分频。
2:0
计数器的时钟频率fCK_CNT等于fCK_PSC/2
(PSCR[2:0])
。
PSCR为实际装入预分频器影子寄存器的值(包括由于清除TIMxEGR寄存器的T4UG位产生的计数器清除事件)。这意味着
如要新的预分频值生效，必须产生更新事件或者T4CEN=0。
12.6.7. TIM4ARR，地址 0x117
Bit
7
6
5
4
Name
3
2
1
0
T4ARR[7:0]
Reset
1
1
1
1
1
1
1
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
T4ARR[7：0]: 自动重装载的8位值
7:0
T4ARR为将要装载入实际的自动重装载寄存器的值。
当自动重装载的值为空时，计数器不工作。
rev1.05
- 166 -
2020-5-29
Fremont Micro Devices
FT61F08X
13. SPI 接口
13.1. 功能特性
3 线全双工同步传输
2 线半双工同步传输，或单向传输
主机模式或从机模式操作
nss pin 软件或硬件管理
可编程的同步时钟极性和相位控制
可编程的 LSB first 或 MSB first
配置模式错误和 overrun 标志
硬件 CRC 校验支持
Wakeup 唤醒支持
13.2. 功能描述
13.2.1. 一般描述
Address and data bus
rxovr
miso
crcerr
modf
wkflag
rxbuf
mosi
Shift register
master control
txbuf
ssm
nss
ctrl
ssi1
lsbfirst
slave control
bdm
bdoe
rxonly
crcen
0
sck
braud generate
scr
master
cpha
cpol
crcnxt
图 13.1 SPI 结构框图
rev1.05
- 167 -
2020-5-29
Fremont Micro Devices
FT61F08X
SPI 接口总共有四个引脚：
NSS:从机选择引脚低电平有效，在 NSS 引脚采用硬件管理用作输入时，如果 NSS 引脚为零则表示
选择该从机，如果该接口配置为主机模式，则会产生 MODF 标志位，表示配置错误，这时该接口自
动进入从机模式，这种特性用于兼容多主机通信；
MOSI:主机数据输出/从机数据输入；
MISO:主机数据输出/从机数据输入；
SCK:主机串行时钟输出/从机串行时钟输入；
SPI 接口引脚通常的接法是采用三线全双工和四线全双工，如下图所示的引脚接法，NSS 引脚可以根据
NSSM 的值选择作为输入，或者是输出；当 NSS 引脚用作输入时，输入的值取决于 SSM 的值，当 SSM
置 1 时，NSS 引脚的值无效，SSI 的值会被传输到通信控制单元。SPI 模块支持双线半双工模式，主机
模式时采用的数据通信引脚是 MOSI，从机模式时采用的数据通信引脚是 MISO。
miso
mosi
sck
nss
miso
mosi
Master
sck
nss
miso
mosi
sck
nss
miso
mosi
sck
nss
Slave1
Slave2
Slave3
二线半双工
四线全双工
三线全双工
图 13.2 SPI 模块连接示意图
SPI 通信的时钟相位和极性设置如下图所示，时钟和相位的控制总共有四种情况，可以通过 CPHA 和
CPOL 设定相应配置，其中 CPOL 是控制模块空闲时的 SCK 的电平，当 CPOL 为 1 时，SCK 空闲时的
电平为高电平，相反为低电平，图中所示箭头的位置是接收数据采样点；当使用了 NSS 引脚时，NSS
为低电平时才会接收数据；发送方串行数据的发送格式可以根据 LSBFIRST 来控制，默认情况下是先发
送的八位数据的高位，最后发送的是八位数据的低位。
rev1.05
- 168 -
2020-5-29
Fremont Micro Devices
1
2
FT61F08X
3
4
5
6
7
8
9
10
SCK CPOL=1 CPHA=0
SCK CPOL=0 CPHA=0
SCK CPOL=1 CPHA=1
SCK CPOL=0 CPHA=1
MOSI
1
2
3
4
5
6
7
8
MISO
1
2
3
4
5
6
7
8
NSS
图 13.3 时钟极性和相位时序图
CRC 校验模块用来增强数据传输的可靠性，计算模块初始化的值采用的是零，默认多项式 CRCPOL 是
0x07，每次 CRCEN 从零到置位的时候都会对 CRC 模块进行初始化（该初始化不会影响 CRCPOL 的值），
模块内部中间运算的值会丢失（RXCRC 和 TXCRC 的值会被置为零）。当 CRCEN 使能的时候，每次正
常写入到 TXBUF 的值都会被送到 CRC 模块用来生成 TXCRC 的值，同样的在接收数据时每次正常写入
到 RXBUF 的值也会被送到 CRC 模块，用来生产 RXCRC 的值；当需要传输 CRC 字节的时候，可以置
位 CRCNXT，在正常数据传输完成后，下一次传输就会自动把 TXCRC 的值写入到 TXBUF(本次写入到
TXBUF 中的值不会送到 CRC 模块进行计算)，同时 CRCNXT 的值自动清零，在传输最后的 CRC 检验
码的同时，也会接收对方的 CRC 检验码（本次接收到的数据不会写入 RXBUF）
，在接收完成时会比较
RXCRC 与接收到的校验码值，如果不匹配就会产生 CRCERR 标志位。
1
2
3
4
5
6
7
8
9
10
11
12
13
14
CRCEN
TXBUF
TXCRC
0
RXCRC
xx
0
xx
CRCNXT
RXBUF
SPIF
CLR SPIF
CLR SPIF
图 13.4 CRC 模块的工作时序图
rev1.05
- 169 -
2020-5-29
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FT61F08X
13.2.2. 配置 SPI
主机模式的 SCK 是由主机产生的，从机的 SCK 是从机输入的，下面是 SPI 配置流程:
1.
2.
3.
4.
5.
6.
7.
8.
9.
根据主从机的需求配置 SPICFG 寄存器中的 MSTEN 位，置 0 是用作从机，置 1 是用作主机
如果用作主机需要配置 SCR 寄存器，来配置通信的速率，通信的比特率=Fmater/(2*(SCR+1)),
该位对从机没有作用，只是在要求从机接收速率较快时，要提高 Fmaster 的频率，以便从机模块可
以采样到 SCK 的上升沿或下降沿
配置 NSSM 来设定如何使用 NSS 引脚，如果是用作四线主机模式则 NSS 引脚应配置为输出模式；
如果用作从机模式，则可以配置成输入模式。如果只是用三线通信则可以设置禁用 NSS 引脚；另外
NSS 引脚在配置为输入模式时，可以置位 SSM 来启用软件管理 NSS 引脚的输入值，屏蔽掉实际的
NSS 引脚的值
配置 SPICFG 中的 CPOL 和 CPHA 来配置 SCK 的相位和极性
配置 SPICTRL2 中的 LSBFIRST 来设置数据的传输格式
配置 CRCPOL 寄存器和 CRCEN，使能 CRC 校验
置位 SPICTRL2 中的 RXONLY 只允许接收或者置位 BDM 来启用半双工通信
置位 SPICFG 中的 SPIEN 来启用 SPI 通信接口，这时相应的 GPIO 接口会用作 SPI 通信接口，同
时 SPIEN 从低电平到高电平的变化会导致清零 RXOVER，CRCERR，MODF，SPIF，WCF 标志
位，置位 TXBMT，RXBMT 标志位
如果使用中断模式进行通信则需配置 SPIIER 寄存器来使能相应的中断
13.2.3. 数据处理流程
数据通信的流程大致分为阻塞模式通信和非阻塞式模式通信，大致的处理方式是一样的，只是非阻
模式是在中断中进行的：
1. 阻塞通信时向 DATA 寄存器写入数据后需要查询 TXBMT，在查询到 TXBMT 为 1 时可以写入下一
个数据；在 TXE 中断使能允许的时候，TXBMT 置 1 会直接进入中断
2. 阻塞模式接收数据时，需要一直查询 RXMBT，在查询到该位为 1 时，则可以读取 DATA 寄存器的
值；在 RXNE 中断允许时，RXMBT 置 1 时则会进入中断
3. 阻塞模式接收的过程中需要查询 RXOVRN 和 CRCERR 位，在查询到相应的位置 1 后则需要写零清
理相应的错误标志位；在 RXERR 中断使能时，发生相应的错误标志位会直接进入中断
4. 非阻塞模式中，进入中断后查询一次状态信息，然后根据相应的状态信息处理发送接收流程，处理
完成以后退出中断子程序，继续处理其他的事情
无论是阻塞模式还是非阻塞模式，通信模块中的相关标识位变化如下图所示，在数据写入到发送数据寄
存器后，TXBMT 从 1 变为 0，然后数据寄存器中的数据会传送到内部的移位寄存器，移位寄存器标志位
从 1 变为 0，直到数据从移位寄存器中完全移出后变为 1；在发送的过程中，BUSY 状态位一直为 1；发
送完成标志位在当前字节传输完成后会变为 1，同时 RXBMT 的值会从 1 变为 0。
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1
2
3
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4
5
6
7
8
9
10
11
SCK
MOSI
0
1
2
3
4
5
MISO
0
1
2
3
4
5
6
7
7
6
TXBMT
SRMT
BUSY
SPIF
RXBMT
图 13.5 数据处理时序图
13.2.4. 睡眠模式唤醒
当系统进入睡眠模式，外设时钟存在时，SPI 模块有能力唤醒 MCU；如图所示，SPI 模块作为从机
模块使用，开启了 WAKUP 中断使能，从机在接收到第一比特的数据时就会产生 WAKEUP 中断信号，
在中断控制模块中如果使能了外设接口中断，就会直接唤醒 MCU；
1
2
3
4
5
6
7
8
9
10
11
SCK
MOSI
0
1
2
3
4
5
6
7
WKF
SPI_INT
spi 模 块 中 断 信 号 （ 需 要 使 能 wakeup中 断 ）
MCU SLEEP
MCU 睡 眠 信 号
图 13.6 睡眠唤醒时序图
rev1.05
- 171 -
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13.2.5. CRC 处理流程
阻塞模式传输数据时，在传输完成最后一个数据时，查询 TXBMT 的状态，在 TXBMT 位 1 时，则
置位 CRCNXT，这时 TXCRC 的值就会自动传输到 DATA 寄存器，然后 CRCNXT 就会自动清零， 查询
CRCNXT，查询到为 0 则清零 SPIF 状态位，然后再查询 SPIF 位，如果状态位置 1，则表示 CRC 校验
码发送完成，接着查询 CRCERR 状态位，如果该状态位为 1，表示 CRC 校验码不匹配，写零清零相应
的状态位；采用非阻塞模式通信时，TXBMT 为 1 进入中断时，若数据已经发送完整，则置位 CRCNXT，
CRC 发送完成后如果产生了 CRCERR，则会直接进入中断，查询相关的标志位，然后写零清零。
1
2
3
4
5
6
7
8
9
10
TXBMT
CRCNXT
SPIF
CRCERR
SCK
图 13.7 CRC 模块标志位时序图
13.3. 与 SPI 相关寄存器汇总
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
名称
地址
SPIDATA
015h
SPICTRL
016h
SPIF
WCOL
MODF
RXOVRN
SPICFG
017h
BUSY
MSTEN
CPHA
CPOL
SPISCR
018h
SCR[7:0]
0000 0000
SPICRCPOL
019h
CRCPOL[7:0]
0000 0111
SPIRXCRC
01Ah
RXCRC[7:0]
0000 0000
SPITXCRC
01Bh
TXCRC[7:0]
0000 0000
SPIIER
01Ch
SPICTRL2
01Dh
BDM
BDOE
RXONLY
SPISTAT
01Eh
—
SMODF
SRXOVRN
rev1.05
DATA[7:0]
—
复位值
0000 0000
NSSM
SLAS
NSSVAL
TXBMT
SPIEN
0000 0110
SRMT
RXBMT
0000 0000
WAKUP
RXERR
RXNE
TXE
---- 0000
SSI
SSM
CRCNXT
CRCEN
LSBFIRST
0000 0000
SBUSY
SRXBMT
STXBMT
WKF
CRCERR
-000 1100
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FT61F08X
13.3.1. SPIDATA 寄存器，地址 0x015
Bit
7:0
Name
DATA
Reset
0x00
Type
RW
Bit
Name
7:0
DATA
Function
数据发送/接收寄存器（BUF）
13.3.2. SPICTRL 寄存器，地址 0x016
Bit
7
6
5
4
3:2
1
0
Name
SPIF
WCOL
MODF
RXOVRN
NSSM
TXBMT
SPIEN
Reset
0x0
0x0
0x0
0x0
0x01
0x1
0x0
Type
RW
RW
RW
RW
RW
RO
RW
Bit
Name
Function
7
SPIF
6
WCOL
BUF 写入失败标识，
0：BUF 写入正常
1：BUF 为非空时，进行写入会置位该位，写零清理，写 1 无效
5
MODF
工作模式错误标识,
0：工作模式正常
1：当 SPI 配置为主机模式，并且 NSS 用作输入引脚时，若 NSS 引进为低电平就会产生置位该
位
写零清零，写 1 无效
4
RXOVRN
传输完成标志
0：表示没有传输完成或者已经清零
1：传输完成标志位，写零清理，写 1 无效
接收溢出标志
0：接收正常
1：接收溢出，写零清理，写 1 无效
3:2
NSSM
NSS 引脚模式选择，当用作输出模式时，相应的 IO 脚会被用作 NSS 输出
00:禁用 NSS 引脚
01:NSS 引脚用作输入
1x:NSS 引脚用作输出，输出的值等于 NSSM[0]的值
注：NSS 引脚配置为输入状态时，可以被 SSM 的软件管理模式屏蔽掉
1
TXBMT
发送 BUFF 为空状态
0：发送 BUF 非空
1：发送 BUF 位空
SPIEN
SPI 接口使能
0：禁用 SPI 模块
1：启用 SPI 模块，相应的 IO 会被用作 SPI 的功能
注：在使用完 SPI 以后，禁用 SPI 不会对已经产生的标志位进行复位，只有再次打开 SPI 时会
对标志位进行复位操作；SPIEN 从低电平到高电平的变化会导致复位标志位
0
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- 173 -
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FT61F08X
13.3.3. SPICFG 寄存器，地址 0x017
Bit
7
6
5
4
3
2
1
0
Name
BUSY
MSTEN
CPHA
CPOL
SLAS
NSSVAL
SRMT
RXBMT
Reset
0x00
0x0
0x0
0x0
0x0
0x1
0x1
0x1
Type
RO
RW
RW
RW
RO
RO
RO
RO
Bit
Name
Function
SPI
7
BUSY
BUSY 状态
0：SPI 模块空闲
1：表示 SPI 模块忙绿中
MASTER 使能位
6
MSTEN
0：工作在 SLAVE 模式
1：工作在 MSATER 模式
SCK 相位选择
5
CPHA
0：第一个时钟转换的沿是数据采样点
1：第二个时钟转换的沿是数据采样点
SCK 极性选择
4
CPOL
0：SPI 空闲时，SCK 的时钟是处于低电平状态
1：SPI 空闲时，SCK 的时钟是处于高电平状态
SLAVE 选择标志
0：该模块未被选中
3
SLAS
1：该模块被选中
注：当 NSS 用作输入时，该值可以被 SSM 软件管理，当 SSM 为 1 时，这里的值表示的是 SSI
的值取反
NSS 引脚的输入值状态
2
NSSVAL
注：当 NSS 用作输入时，该值可以被 SSM 软件管理，当 SSM 为 1 时，这里的值表示的是 SSI
的值
移位寄存器为空状态
1
SRMT
0：内部串行移位寄存器非空
1：内部串行移位寄存器为空
接受 BUFFER 为空状态
0
RXBMT
0：表示接收 BUF 非空
1：接收 BUF 为空状态
rev1.05
- 174 -
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FT61F08X
13.3.4. SPISCR 寄存器，地址 0x018
Bit
7:0
Name
SCR
Reset
0x00
Type
RW
Bit
Name
7:0
SCR
Function
波特率设置寄存器,波特率=Fmaster/(2*(SCR+1))
注：Fmaster 指的是外设时钟
13.3.5. SPICRCPOL 寄存器，地址 0x019
Bit
7:0
Name
CRCPOL
Reset
0x07
Type
RW
Bit
Name
7:0
CRCPOL
Function
CRC 计算多项式,默认值为 0x07
13.3.6. SPIRXCRC 寄存器，地址 0x01A
Bit
7:0
Name
RXCRC
Reset
0x00
Type
RO
Bit
Name
7:0
RXCRC
rev1.05
Function
接收数据的 CRC 计算结果
注：该寄存器在 CRCEN 发生从零到 1 的变化时会清零
- 175 -
2020-5-29
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FT61F08X
13.3.7. SPITXCRC 寄存器，地址 0x01B
Bit
7:0
Name
TXCRC
Reset
0x00
Type
RO
Bit
Name
7:0
TXCRC
Function
发送数据的 CRC 计算结果
注：该寄存器在 CRCEN 发生从零到一的变化时会清零
13.3.8. SPIIER 寄存器，地址 0x01C
Bit
7:4
3
2
1
0
Name
—
WAKUP
RXERR
RXNE
TXE
Reset
—
0x0
0x0
0x0
0x0
Type
RO-0
RW
RW
RW
RW
Bit
Name
7:4
N/A
Function
保留位，读 0
唤醒中断使能
3
WAKUP
0：禁用唤醒中断
1：启用中断唤醒
接收错误中断使能，包括 CRC 错误,接收溢出错误，模式错误
2
RXERR
0：禁用接收数据出现 CRC 错误，溢出错误和模式错误中断
1：允许接收数据出现 CRC 错误，溢出错误和模式错误中断
接收 BUF 不为空中断使能
1
RXNE
0：禁用接收 BUF 不为空中断
1：允许接收 BUF 不为空中断
发送 BUF 为空中断使
0
TXE
0：禁用发送 BUF 为空中断
1：使能发送 BUF 为空中断
rev1.05
- 176 -
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FT61F08X
13.3.9. SPICTRL2 寄存器，地址 0x01D
Bit
7
6
5
4
3
2
1
0
Name
BDM
BDOE
RXONLY
SSI
SSM
CRCNXT
CRCEN
LSBFIRST
Reset
0x0
0x0
0x0
0x0
0x0
0x0
0x0
0x0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
半双工使能
7
BDM
0：禁用半双工模式
1：使能半双工模式
半双工模式的接收使能
6
BDOE
0：半双工模式接收使能
1：半双工模式发送使能
全双工模式只允许接收使能
5
RXONLY
0：全双工模式允许发送和接收
1：全双工模式只允许接收
NSS 输入管脚的值，仅当 SSM 置 1 时有效
4
SSI
0：输入到 NSS 引脚的值是 0
1：输入发哦 NSS 引脚的值是 1
软件 SLAVE 模式管理，使能后 NSS 引脚的值由 SSI 替代
3
SSM
0：禁用 NSS 引脚的软件管理模式
1：启用 NSS 引脚的关键管理模式，如果 NSS 引脚用作输入，则 NSS 引脚实际的值有 SSI 取
代
置位后在 TXBUFF 为空时会把 TXCRC 的值写入 TXBUFF
2
CECNXT
0：不传送 TXCRC 的值到 TXBUF
1：等待 TXBMT 为 1 时，传送 TXCRC 的值到 TXBUF，写入完成后改位自动清零
CRC 模块计算使能
1
CRCEN
0：禁用 CRC 校验模块
1：启用 CRC 校验模块
发送低比特位使能
0
LSBFIRST
0：高比特位优先发送
1：低比特位优先发送
rev1.05
- 177 -
2020-5-29
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FT61F08X
13.3.10. SPISTAT 寄存器，地址 0x01E
Bit
7
6
5
4
3
2
1
0
Name
—
SMODF
SRXOVRN
SBUSY
SRXBMT
STXBMT
WKF
CRCERR
Reset
—
0x0
0x0
0x0
0x1
0x1
0x0
0x0
Type
RO-0
RO
RO
RO
RO
RO
RW
RW
Bit
Name
7
N/A
Function
保留位，读 0
6
SMODF
同 SPICTRL[5]
5
SRXOVRN
同 SPICTRL[4]
4
SBUSY
同 SPICFG[7]
3
SRXBMT
同 SPICFG[0]
2
STXBMT
同 CTRL[1]
睡眠模式下，从机在接收数据时，会产生 WAKEUP 唤醒标志，写 0 清零，写 1 无效
1
WKF
0：没有发生 WAKEUP 唤醒或者已被清零
1：发生了 WAKEUP 唤醒事件
CRC 错误标志，写 0 清零，写 1 无效
0
CRCERR
0：传输过程中没有发生 CRC 校验错误或者已被清零
1：传输过程中发生了 CRC 校验错误
rev1.05
- 178 -
2020-5-29
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FT61F08X
14. I2C 接口
SDA_oe
SDA_in
SCL_in
SCL_oe
I2C 模块通过 SDA 和 SCL 管脚与外部 I2C 器件进行通信，数据以字节格式按照先传高位的原则进行传
输。
sclk_gen
i2c_rst_n
RX_FIFO
rx_shift
master_
fsm
slave_
fsm
TX_FIFO
tx_shift
i2c_clk
registers
int_ctrl
ic_int
I2C
SFR总线
图 14.1 I2C 原理框图
I2C 模块包含以下功能：
主机模式和从机模式
多主机支持
标准模式（100kHz）和快速模式（400kHz）
7 位和 10 位地址模式
General call 支持
Clock stretching
发送 NACK（从机模式）
14.1. I2C 的工作原理
I2C 模块主要有四种工作模式，即主机接收、主机发送、从机发送、从机接收。每种模式下又包含了 7
位地址模式和 10 位地址格式。
rev1.05
- 179 -
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FT61F08X
14.1.1. 主机发送
主机发送模式下，输出串行数据到 SDA，输出时钟到 SCL。主机发送的第一个字节包括从机地址和读写
位，此模式下读写位为 0。然后主机发送 8 位的串行数据，每个数据字节后会接收到 ACK。同时，主机
也会产生 Start 和 Stop。
当 I2CCR1 寄存器中 MST10B 位为 0 时，主机发送 7 位地址格式：
S
Address
A
E1
Data1
E3
A
Data2
. . .
A
E1
DataN
A
E1
图 14.2 7 比特地址模式主机发送流程图
其中：
E1：IICTXE=1，写 DR 和 CMD 寄存器清零 IICTXE；
E3：ADDF=1，写零到 ADDF 清零 ADDF；
S：表示 START 信号；
A：表示 ACK 信号；
P：表示 STOP 信号；
当 I2CCR1 寄存器中 MST10B 位为 1 时，主机发送 10 位地址格式：
S
Header
E1
A
Address
E2
Data2
E1
A
A
Data1
A
E3
. . .
DataN
A
P
E1
图 14.3 10 比特地址模式主机发送流程图
其中：
E1：IICTXE=1，写 DR 和 CMD 寄存器清零 IICTXE；
E2：ADD10F=1，写零到 ADD10F 清零 ADD10F；
E3：ADDF=1，写零到 ADDF 清零 ADD；
注意：主机发送模式下，软件可以不处理 SBF/ADDF/ADD10F 标志位，只关心 IICTXE。
rev1.05
- 180 -
2020-5-29
P
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14.1.2. 主机接收
主机接收模式下，从 SDA 线上接收串行数据，输出时钟到 SCL。主机首先发送从机地址和读写位，此模
式下读写位为 1。然后主机接收 8 位的串行数据，每个数据字节后主机需要发送 ACK。同时，主机也会
产生 Start 和 Stop。
当 I2CCR1 寄存器中 MST10B 位为 0 时，主机发送 7 位地址格式：
S
Address
A
E1
Data1
E3
A
Data2
. . .
A
E2
DataN
NA
P
E2
图 14.4 7 比特地址模式主机接收流程图
其中：
E1：IICTXE=1，写 DR 和 CMD 寄存器清零 IICTXE；
E3：ADDF=1，写零到 ADDF 清零 ADDF；
E2：IICRXNE=1，读 DR 寄存器清零 IICRXNE，然后写 CMD=0x1，继续读数据，或者写 0x20，再接
收完成一个数据后停止；
当 I2CCR1 寄存器中 MST10B 位为 1 时，主机发送 10 位地址格式：
S
Header
E1
A
Address
E2
Data2
E4
A
A
Data1
A
E3
. . .
DataN
NA
P
E4
图 14.5 10 比特地址模式主机接收流程图
其中：
E1：IICTXE=1，写 DR 和 CMD 寄存器清零 IICTXE；
E2：ADD10F=1，写 1 到 ADD10F 清零 ADD10F；
E3：ADDF=1，写零到 ADDF 清零 ADDF；
E4：IICRXNE=1，读 DR 寄存器清零 IICRXNE，然后写 CMD=0x1，继续读数据，或者写 0x20，再接
收完成一个数据后停止；
注意：主机接收模式下，软件可以不处理 SBF/ADDF/ADD10F 标志位
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- 181 -
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14.1.3. 从机发送
从机发送模式下，发送串行数据到 SDA。从机在检测到 Start 条件后，首先接收地址字节和读写位，此
模式下读写位应为 1。然后发送 8 位的数据字节，每个数据字节后会接收 ACK。同时如果检测到 Stop
条件，从机会结束通信，等待下一次 Start。
当 I2CCR1 寄存器中 SLV10B 位为 0 时，从机响应 7 位地址格式：
S
Address
A
Data1
E1
Data2. . .
A
E2
DataN
NA
E2
P
E3
图 14.6 7 比特地址模式从机发送流程图
E1：ADDR=1,拉低 SCL 线，写零到 ADDR 清零 ADDF；
E2：IICTXE=1，拉低 SCL 线，读 SR3 寄存器 rd_req 位为 1，需向 DR 寄存器中写数据清零 IICTXE；
E3：AF=1，写 I2CSR2 寄存器中 AF 位为 0 清零；
当 I2CCR1 寄存器中 SLV10B 位为 1 时，从机响应 10 位地址格式：
S
Header
A
Address
A
Sr
Header
DataN
NA
A
E1
Data1
E1
E2
Data2. . .
A
E2
P
E3
图 14.7 10 比特地址模式从机发送流程图
E1：ADDF=1，拉低 SCL 线，写零到 ADDF 清零；
E2：IICTXE=1，拉低 SCL 线，读 SR3 寄存器 rd_req 位为 1，需向 DR 寄存器中写数据清零 IICTXE；
E3：AF=1，写 SR2 寄存器中 AF 位为 0 清零；
rev1.05
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14.1.4. 从机接收
从机接收模式下，从 SDA 线接收串行数据。从机在检测到 Start 条件后，首先接收地址字节和读写位，
此模式下读写位应为 0。然后接收 8 位的数据字节，每个数据字节后需要发送 ACK。同时如果检测到 Stop
条件，从机会结束通信，等待下一次 Start。
当 I2CCR1 寄存器中 SLV10B 位为 0 时，从机响应 7 位地址格式：
S
Address
A
Data1
A
E1
Data2 . . .
DataN
A
E2
P
E2
E3
图 14.7 7 比特地址模式从机接收流程图
E1：ADDF=1，写零到 ADDF 清零；
E2：IICRXNE=1，读取 DR 寄存器中数据清零 IICRXNE；
E3：STOPF=1，写零到 STOPF 清零；
当 I2CCR1 寄存器中 SLV10B 位为 1 时，从机响应 10 位地址格式：
S
Address
A
Address
Data1
E1
A
A
Data2 . . .
E2
DataN
A
P
E2
E3
图 14.8 10 比特地址模式从机接收流程图
E1：ADDF=1，写零到 ADDF 清零；
E2：IICRXNE=1，读取 DR 寄存器中数据清零 IICRXNE；
E3：STOPF=1，写零到 STOPF 清零 STOPF；
14.1.5. General Call
General Call 模式在主机置位了 AGCALL 以后，就会向地址为 0x00 的地址发送数据，这种模式下主机
只允许进行写数据，不允许读数据；从机模式下在置位了 AGCALL 以后，就会响应主机发来的 General
Call；通信的过程跟主机发送，从机接收模式相同。
rev1.05
- 183 -
2020-5-29
Fremont Micro Devices
FT61F08X
14.2. 与 I2C 相关寄存器汇总
名称
地址
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
复位值
I2CCR1
0x40C
—
—
—
MST10B
SLV10B
—
SPEED
MASTER
---0 0-00
I2CCR2
0x40D
—
SOFTRST
AGCALL
SNACK
—
—
RXHLD
—
-000 --0-
I2CCR3
0x40E
EVSTRE
—
ENABLE
---- -000
I2COARL
0x40F
I2COARH
0x410
—
—
I2CFREQ
0x411
—
—
I2CDR
0x412
I2CCMD
0x413
I2CCCRL
0x414
I2CCCRH
0x415
I2CITR
0x416
I2CSR1
0x417
IICTXE
IICRXNE
—
STOPF
I2CSR2
0x418
—
—
—
I2CSR3
0x419
—
—
GCALL
—
ADD[7:0]
—
—
0000 0000
—
—
ADD[9:8]
FREQ[5:0]
--00 0000
DR[7:0]
—
—
—
—
0000 0000
—
RESTART
STOP
MSTDIR
CCR[7:0]
—
DUTY
—
---- --00
---- -000
0000 0000
—
CCR[11:8]
—
-0-- 0000
ITBUFEN
ITEVEN
ITERREN
---- -000
ADD10F
—
ADDF
SBF
00-0 0-00
TXABRT
OVR
AF
ARLO
BERR
---0 0000
—
—
RDREQ
ACTIVE
RXHOLD
--0- -000
14.2.1. I2CCR1 寄存器，地址 0x40C
Bit
7
6
5
4
3
2
1
0
Name
—
—
—
MST10B
SLV10B
—
SPEED
MASTER
Reset
—
—
—
0
0
—
0
0
Type
RO-0
RO-0
RO-0
RW
RW
RO-0
RW
RW
Bit
Name
7:5
N/A
Function
保留位，读 0
主机模式下地址格式，该位只有在 I2C 模块禁用时才能进行写操作
4
MST10B
0：发送 7 位地址格式；
1：发送 10 位地址格式；
从机模式下地址格式，该位只有在 I2C 模块禁用时才能进行写操作
3
SLV10B
0：响应 7 位地址格式；
1：响应 10 位地址格式；
2
N/A
保留位，读 0
I2C 通信速度模式，该位只有在 I2C 模块禁用时才能进行写操作
1
SPEED
0：标准模式（100kHz）
；
1：快速模式（400kHz）
；
主从机模式，该位只有在 I2C 模块禁用时才能进行写操作
0
MASTER
0：从机模式；
1：主机模式；
rev1.05
- 184 -
2020-5-29
Fremont Micro Devices
FT61F08X
14.2.2. I2CCR2 寄存器，地址 0x40D
Bit
7
6
5
4
3
2
1
0
Name
—
SOFTRST
AGCALL
SNACK
—
—
RXHLD
—
Reset
—
0
0
0
—
—
0
—
Type
RO-0
RW
RW
RW
RO-0
RO-0
RW
RO-0
Bit
Name
7
N/A
Function
保留位，读 0
软件复位，对 I2C 模块进行复位；该位只有在 ACTIVE 为 1 时才能进行写 1 操作
0：没有影响；
6
SOFTRST
1：复位 I2C 控制模块；
注意：该复位不会复位寄存器的值；由于一些异常原因导致 I2C 模块一直处于活动状态时，可以置
位该位对发送和接收模块进行复位
从机时，应答 General call 使能，该位只有在 I2C 模块禁用时才能进行写操作
0：不响应 General call；
5
AGCALL
1：响应 General call（在使能了 SNACK 时才会有效）
主机时，发送 General call 使能
0：发送正常的从机地址；
1：发送 General call 地址(0x00)；
从机接收是否发送 NACK，该位只有在 I2C 模块禁用时才能进行写操作
4
SNACK
0：字节接收后发送 ACK（地址匹配或数据字节）
；
1：发送 NACK；
3:2
N/A
保留位，读 0
RX-FIFO 满控制位，该位只有在 I2C 模块禁用时才能进行写操作
1
RXHLD
0：RX-FIFO 满时不拉低 SCL，新接收的数据将会丢失；
1：RX-FIFO 满时拉低 SCL；
0
N/A
rev1.05
保留位，读 0
- 185 -
2020-5-29
Fremont Micro Devices
FT61F08X
14.2.3. I2CCR3 寄存器，地址 0x40E
Bit
7
6
5
4
3
2
1
0
Name
—
—
—
—
—
EVSTRE
—
ENABLE
Reset
—
—
—
—
—
0
—
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RW
RO-0
RW
2
1
0
Bit
Name
7:1
N/A
2
EVSTRE
1
N/A
0
ENABLE
Function
保留位，读 0
SBF/ADD/ADD10 拉低 SCL 使能
0：SBF/ADD/ADD10 不拉低 SCL
1：SBF/ADD/ADD10 拉低 SCL
保留位，读 0
I2C 模块使能
0：禁用 I2C 模块；
1：使能 I2C 模块，相应的 IO 管脚会用作 I2C 的功能；
14.2.4. I2COARL 寄存器，地址 0x40F
Bit
7
6
5
4
3
Name
ADD[7:0]
Reset
0x00
Type
RW
Bit
7:0
Name
Function
ADD[7:0]
从机地址，
，该位只有在 I2C 模块禁用时才能进行写操作
7 位地址格式时：bit[7] 不关心；
10 位地址格式时：10 位地址的低 8 位；
注：如果模块用作主机，则该寄存器存储的是目标从机的地址，而在用作从机时表示的是本机的地
址
14.2.5. I2COARH 寄存器，地址 0x410
Bit
7
6
5
4
3
2
Name
—
—
—
—
—
—
ADD[9:8]
Reset
—
—
—
—
—
—
2’b00
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RW
Bit
Name
7:2
N/A
1:0
ADD[9:8]
rev1.05
1
0
Function
保留位，读 0
从机地址：10 位地址的高 2 位，该位只有在 I2C 模块禁用时才能进行写操作
注：如果模块用作主机，则该寄存器存储的是目标从机的地址，而在用作从机时表示的是本机的地
址
- 186 -
2020-5-29
Fremont Micro Devices
FT61F08X
14.2.6. I2CFREQ 寄存器，地址 0x411
Bit
7
6
Name
—
—
FREQ[5:0]
Reset
—
—
6’h0
Type
RO-0
RO-0
RW
Bit
Name
7:6
N/A
5
4
3
2
1
0
Function
保留位，读 0
外设时钟频率，请根据实际的外设时钟频率来设定该位的值；该位只有在 I2C 模块禁用时才能进行
写操作
6’b000000：不允许；
5:0
6’b000001：1MHz；
FREQ[5:0]
6’b000010：2MHz；
…
6’b011000：24MHz；
Higher values：不允许；
14.2.7. I2CDR 寄存器，地址 0x412
Bit
7
6
5
4
3
Name
DR[7:0]
Reset
0x00
Type
RW
Bit
Name
2
1
0
Function
数据寄存器
写时：将该数据 push 到 TX-FIFO 中；
7:0
DR[7:0]
读时：读出 RX-FIFO 中数据；
注意： 主机模式下写数据时，push 动作是在写完 I2CCMD 寄存器之后，因此需要先写 I2CDR 寄存
器，再写 I2CCMD 寄存器；发送和接收的 FIFO 深度都为 1
rev1.05
- 187 -
2020-5-29
Fremont Micro Devices
FT61F08X
14.2.8. I2CCMD 寄存器，地址 0x413
Bit
7
6
5
4
3
2
1
0
Name
—
—
—
—
—
RESTART
STOP
MSTDIR
Reset
—
—
—
—
—
0
0
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
W
W
W
Bit
Name
7:3
N/A
Function
保留位，读 0
发送 Restart，读到的值没有意义
2
RESTART
0：字节传输后不发送 Restart；
1：字节传输后发送 Restart；
发送 Stop，读到的值没有意义
1
STOP
0：字节传输之后不发送 Stop；
1：字节传输之后发送 Stop；
主机模式时的传输方向，读到的值没有意义
0：发送数据；
0
1：读取数据；
MSTDIR
注意：请不要对该寄存器进行单比特操作，建议使用字节传输的指令对该寄存器进行
操作，因为任何对该寄存器的写操作（无论是单比特还是字节操作）都会立即把这个数据写到 FIFO
中
14.2.9. I2CCCRL 寄存器，地址 0x414
Bit
7
6
5
4
3
Name
CCR[7:0]
Reset
0x00
Type
RW
Bit
Name
7:0
CCR[7:0]
rev1.05
2
1
Function
主机模式时 SCL 时钟周期的低 8 位；该位只有在 I2C 模块禁用时才能进行写操作
- 188 -
2020-5-29
0
Fremont Micro Devices
FT61F08X
14.2.10. I2CCCRH 寄存器，地址 0x415
Bit
7
6
5
4
Name
—
DUTY
—
—
CCR[11:8]
Reset
—
0
—
—
4’h0
Type
RO-0
RW
RO-0
RO-0
RW
Bit
Name
7
N/A
3
2
1
Function
保留位，读 0
快速模式下占空比选择，该位只有在 I2C 模块禁用时才能进行写操作
6
DUTY
0： Tlow/Thigh = 2；
1： Tlow/Thigh = 16/9；
注意：标准模式下 Tlow/Thigh = 1；
5:4
N/A
保留位，读 0
主机模式时 SCL 时钟周期的高 4 位，该位只有在 I2C 模块禁用时才能进行写操作
下表为具体的 SCL 时钟周期公式：
3:0
CCR[11:8]
周期
SCLH
SCLL
标准模式
2*CCR*Fmaster
CCR*Fmaster
CCR*Fmaster
快速模式（DUTY=0）
3*CCR*Fmaster
CCR*Fmaster
2*CCR*Fmaster
16*CCR*Fmaster
9*CCR*Fmaster
快速模式（DUTY=1） 25*CCR*Fmaster
其中，Fmaster 为外设时钟频率；
rev1.05
- 189 -
2020-5-29
0
Fremont Micro Devices
FT61F08X
14.2.11. I2CITR 寄存器，地址 0x416
Bit
7
6
5
4
3
2
1
0
Name
—
—
—
—
—
ITBUFEN
ITEVEN
ITERREN
Reset
—
—
—
—
—
0
0
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RW
RW
RW
Bit
Name
7:3
N/A
Function
保留位，读 0
FIFO 状态中断使能
2
ITBUFEN
0：IICTXE=1 或 IICRXNE=1 不产生中断；
1：IICTXE=1 或 IICRXNE=1 产生中断；
事件中断使能
0：Disabled 事件中断使能；
1：使能事件中断；
1
ITEVEN
事件中断产生条件：
SB=1（master）
ADDR=1（master/slave）
ADD10=1（master）
STOPF=1（slave）
错误中断使能
0：Disable 错误中断；
1：使能错误中断；
0
ITERREN
错误中断产生条件：
BERR=1
ARLO=1
AF=1
OVR=1
rev1.05
- 190 -
2020-5-29
Fremont Micro Devices
FT61F08X
14.2.12. I2CSR1 寄存器，地址 0x417
Bit
7
6
5
4
3
2
1
0
Name
IICTXE
IICRXNE
—
STOPF
ADD10F
—
ADDF
SBF
Reset
0
0
—
0
0
—
0
0
Type
RO
RO
RO-0
RO
RO
RO-0
RO
RO
Bit
7
Name
Function
IICTXE
TX-FIFO 空
0：TX-FIFO 非空；
1：TX-FIFO 空；
--发送条件下 TX-FIFO 空时置位；
--软件写 I2CDR 寄存器，或者 disable I2C 时硬件清零；
注意：该寄存器位在数据传输过程中一直是 0，在当前数据传输完成后会置 1，因为 FIFO 的深度为
1，则推荐在该标志位为 1 时在向 FIFO 中写入数据，否则会导致数据写入失败，置位 OVR 标志位
6
IICRXNE
5
N/A
RX-FIFO 非空
0：RX-FIFO 为空；
1：RX-FIFO 非空；
--接收条件下 RX-FIFO 非空时置位；
--软件读 I2CDR 寄存器，或者 disable I2C 时硬件清零；
保留位，读 0
STOPF
从机模式下 Stop 检测
0：没有检测到 Stop；
1：检测到 Stop；
--从机模式时 ACK 之后检测到 Stop 时置位；
--软件读 I2CSR1 寄存器，或者 disable I2C 时硬件清零；
3
ADD10F
主机模式下发送 10 位地址 Header；
0：没有发送 10 位地址 Header；
1：主机发送 10 位地址 Header；
--主机发送 10 位地址 Header 时置位（ACK 之后）
；
--软件读 I2CSR1 寄存器，或者 disable I2C 时硬件清零；
2
N/A
4
1
0
rev1.05
保留位，读 0
ADDF
地址发送（主机）/地址匹配（从机）
：
软件读 I2CSR1 寄存器，或者 disable I2C 时硬件清零；
--地址匹配（从机）
0：接收地址不匹配；
1：接收地址匹配；
--接收地址匹配或者识别 General Call 后置位；
--地址发送（主机）
：
0：地址传输没有完成；
1：地址传输完成；
--对于 10 位地址：第二个地址字节之后置位（ACK 后）；
--对于 7 位地址：地址字节之后置位（ACK 后）；
注意：NACK 后不会置位 ADDF；
SBF
主机模式下 Start 产生
0：没有发送 Start；
1：发送 Start；
--主机模式时发送 Start 置位；
--软件读 I2CSR1 寄存器，或者 disable I2C 时硬件清零；
- 191 -
2020-5-29
Fremont Micro Devices
FT61F08X
14.2.13. I2CSR2 寄存器，地址 0x418
Bit
7
6
5
4
3
2
1
0
Name
—
TXARBT
OVR
AF
ARLO
BERR
Reset
—
0
0
0
0
0
Type
RO-0
RW0
RW0
RW0
RW0
RW0
RW0：只能写 0，不能写 1
Bit
Name
7:3
N/A
Function
保留位，读 0
发送过程中由于出错或异常原因导致发送终止，写零清零或者 disable I2C 时硬件清零；
4
TXABRT
0：传输未发生终止
1：传输发生终止
Overrun 产生
0：没有 Overrun；
1：产生 Overrun；
3
OVR
--以下条件时置位：
tx-over：当 TX-FIFO 中有数据时仍写 I2CDR 寄存器；
rx_over：RX-FIFO 中有数据时仍接收数据；
rx_under：RX-FIFO 空时进行读操作；
--软件该位写 0，或者 disable I2C 时硬件清零；
无 ACK：
0：ACK 正常；
2
AF
1：NACK 产生；
--当产生 NACK 时硬件置位；
--软件该位写 0，或者 disable I2C 时硬件清零；
主机仲裁失败
0：无仲裁失败产生；
1
ARLO
1：产生仲裁失败；
--主机仲裁失败时置位；
--软件该位写 0，或者 disable I2C 时硬件清零；
总线错误
0：没有检测到错位的 Start/Stop；
0
BERR
1：检测到错位的 Start/Stop；
--字节传输阶段检测到 Start/Stop 时置位；
--软件该位写 0，或者 disable I2C 时硬件清零；
rev1.05
- 192 -
2020-5-29
Fremont Micro Devices
FT61F08X
14.2.14. I2CSR3 寄存器，地址 0x419
Bit
7
6
5
4
3
2
1
0
Name
—
—
GCALL
—
—
RDREQ
ACTIVE
RXHOLD
Reset
—
—
0
—
—
0
0
0
Type
RO-0
RO-0
RO
RO-0
RO-0
RO
RO
RO
Bit
Name
7:6
N/A
Function
保留位，读 0
从机模式接收到 General call
5
GCALL
--从机模式接收并且 ACK General call 时置位；
--检测到 Start/Stop，或者 disable I2C 时硬件清零；
4:3
N/A
保留位，读 0
从机模式读请求
0：从机接收数据；
2
RDREQ
1：从机发送数据；
--从机接收地址字节的读写位为 1 时置位；
--检测到 Start/Stop，或者 disable I2C 时硬件清零；
主从状态机状态
0：主从状态机处于 IDLE 状态，总线处于空闲状态；
1
ACTIVE
1：主从状态机处于 Busy 状态；
--主从状态机处于 IDLE 状态时置位；
--主从状态机处于 Busy 状态时清零；
接收满保持状态，此时 SCL 被拉低，在读取数据寄存器后释放
0
RXHOLD
0：接收未满，未出现 SCL 被拉低的状态
1：接收 FIFO 满，SCL 被拉低状态
rev1.05
- 193 -
2020-5-29
Fremont Micro Devices
FT61F08X
15. USART 接口
15.1. 功能特性
同步模式
产生同步时钟输出
多芯片通信模式
哑模式唤醒之后，才可以接收数据
可以通过地址匹配和 IDLE 帧唤醒哑模式
异步模式
可编程的 7, 8, 9 比特数据模式
支持 1, 2, 1.5 bit 停止位
支持红外 1.0 模式
单线半双工
发送接收使能控制
16bit 波特率设置
RXNE 中断，TXE 中断，IDLE 帧中断，break 帧中断，奇偶校验错误，overrun 中断，发
送完成中断
智能卡模式
1.5 bit 停止位
时钟输出
guard time
LIN 主机模式
支持断开帧的发送与检测
自动波特率检测
rev1.05
- 194 -
2020-5-29
Fremont Micro Devices
FT61F08X
15.2. 功能描述
15.2.1. 一般描述
Data and address bus
txbuf
shift register
uart_tx
braud gen
regsiters
tx module
rxbuf
uart_ck
shift register
ctrl
uart_rx
rx module
SYNEN
SDEN
HDSEL
TXEN
RXEN
SIREN
LINEN
图 15.1 USART 原理框图
串口模块总共有三只引脚：
1. uart_rx：用作串口数据的输入引脚
2. uart_tx：用作串口数据的输出引脚，在用作半双工模式时也用作串行数据的输入引脚
3. uart_ck：在同步模式时用作同步时钟输出，在智能卡模式时用系统作分频时钟输出
该模块支持同步模式，异步模式，半双工模式，LIN Master 模式，红外模式和智能卡模式，默认的状态
是工作于异步全双工模式，在确定使用一种模式后，请确保其他模式的相关使能位已关闭。
rev1.05
- 195 -
2020-5-29
Fremont Micro Devices
FT61F08X
15.2.2. 异步工作模式
异步工作模式的串口采用异步的方式进行通信，配置的步骤如下：
1. 配置 DLH/DLL 产生相应的波特率进行通信，DLH 和 DLL 共同组成 16 位的波特率分频器，通信的
波特率=fmaster/(16*(DL*))，其中 fmaster 为系统时钟，16 位的波特率分频器的值最小位 1，DL*表
示的是 DLL 和 DLH 的组合，设置为零时串口不工作；
2. 配置 LCR 寄存器中的 LTH 位和 LCREXT 寄存器中的 EXTEN 来设置通信的数据长度，配置 LCR 寄
存器中的 STOP 位来配置停止位的长度，配置 LCR 寄存器中的 PEN 和 EVEN 来配置奇偶校验位，
配置 IER 寄存器中的中断使能位来允许中断；
3. 配置 MCR 寄存器中的 TXEN 和 RXEN 来使能允许发送和接收；
异步模式通信的数据格式是先发送低位数据位，最后发送高比特位，如下图所示的 8 比特数据格式不带
奇偶校验和带奇偶校验的帧格式。
1
2
uart_tx PEN=0 LTH=1
3
start bit
uart_tx PEN=1 LTH=1
start bit
4
5
6
7
8
9
10
11
12
13
0
1
2
3
4
5
6
7
1 stop
start bit
0
1
2
3
4
5
6
7
parity
1 stop
14
15
start bit
bit rate
图 15.2 异步模式时序图
异步模式的数据处理流程包括阻塞模式处理和非阻塞模式处理，大致的处理流程如下：
1.
2.
3.
配置完波特率和相关控制位以后，发送端可以向 DATAL/H 发送 buf 寄存器写入数据，在阻塞模式下
可以查询 TXEF 标志位，如果查询到 TXEF 为 1，则可以继续向 DATAL/H 写入需要发送的数据；在
非阻塞模式下，使能发送为空中断，则在 TXEF 为 1 时，就会自动进入中断，向 DATAL/H 写入数据
就可清除 TXEF 标志位，当在向 txbuf 写入最后一个要发送的数据时，禁用发送为空中断；
接收端在阻塞模式下可以查询 RXNEF 标志位，在查询到该标志位为 1 时，表示接收到了数据，通
过读取 DATAL/H 来清零 RXNEF 标志位；采用非阻塞模式接收数据时，需要使能 RXNE 中断，在串
口接收到数据后，直接进入中断，读取 rxbuf 后清零 RXNEF 标志位；在采用非阻塞模式接收数据时，
建议打开 RXSE 中断使能，在接收数据的过程中如遇到接收错误就会直接进入中断进行相关的处理；
在串口发送数据的时候也可以使用 TCF 标志位来处理，在 TCF 标志位为 1 时，表示当前的数据发
送已经完成，可以向 txbuf 写入下一个要发送的数据，这时 TCF 标志位会自动清零；
1
uart_rx
2
3
4
5
6
7
8
9
10
11
start bit
0
1
2
3
4
5
6
7
1 stop
start bit
0
1
2
3
4
5
6
7
1 stop
12
13
14
15
start bit
RXNEF
uart_tx
TXEF
TCF
图 15.3 异步模式标志位时序图
rev1.05
- 196 -
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15.2.3. 同步工作模式
同步工作模式用于串口模拟 SPI 通信的功能，在串口数据输出的同时，输出一个与数据相关的同步时钟，
同步时钟的极性和相位可以通过 URSYNCR 寄存器中的 CPOL 和 CPHA 来配置；URSYNCR 寄存器中
的 LBCL 控制的是最后一比特数据的时钟是否输出，该位为零时，只输出数据长度减一个有效同步时钟，
最后一个有效时钟不会输出；SYNEN 就是同步时钟输出使能位，在该位为 1 时相应的 IO 会用作同步时
钟输出；该模块只能模拟 SPI 主机模式，数据输出是先发送低位数据，然后发送的高位数据，并且时钟
引脚只能输出同步时钟，并不能用作时钟输入；
1
2
3
4
5
6
7
8
9
10
ck cpol=0 cpha=1
*
ck cpol=1 cpha=1
*
ck cpol=0 cpha=0
* *
ck cpol=1 cpha=0
* *
start
tx
rx
0
1
2
3
4
5
6
7
0
1
2
3
4
5
6
7
11
12
MSB
LSB
* lbcl control this pulse
图 15.4 同步模式时序图
如图所示八比特数据格式的同步时钟输出，同步模式中如果没有使能 TXEN 也会产生同步脉冲输出，这
时候同步模式只用于接收数据，写入到 DATAL/H 寄存器中的数据会发送到内部的移位寄存器中，用于产
生同步脉冲输出，tx 引脚的值一直保持为 1，在同步发送的同时如果使能了 RXEN 接收位，则可以同步
接收数据。
15.2.4. 半双工模式
半双工模式属于异步工作方式的一种，只是在通信时只用到了 tx 引脚，tx 引脚 IO 的应该配置成开漏模
式，发送与接收的处理由软件控制 RXEN 和 TXEN 来实现；需要注意的是如果在发送过程中同时使能了
接收，则发送的数据也会被本机接收到；置位 HDSEL 即可启用半双工模式。
rev1.05
- 197 -
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15.2.5. 红外工作模式
红外模式用于红外通信，置位 SIREN 位可以使能红外模式，同时 LTH 位置位为 1，启用八比特数据格式；
通信的波特率设置跟异步串口的配置方法相同。
1
2
3
4
5
6
7
8
9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30
tx sir
start bit 0
rx sir
3/16 braudrate
tx
0
1
1
0
图 15.5 红外模式时序图
如图所示红外模块发送的脉冲宽度是比特周期的 3/16，当发送的数据为零时会产生一个高脉冲；接收时
的低脉冲会被解释成零；接收与发送的总线极性是相反的，发送空闲时总线保持低电平，接收空闲时总
线保持为高电平。
红外模式可以工作在低功耗模式，红外模式通常工作在系统的时钟频率下，红外的通信波特率
=fmaster/(16*DL*)；当使能了 SIRLP 以后，红外的通信波特率= fmaster/(PSC*16*DL*)；这里的 DL*表
示 DLL 和 DLH 的组合，在 psc 设置为 0 或 1 时，psc 分频模块无效，波特产生模块直接使用 Fmaster，
如下图所示。
Fmaster
Psc 分频=fmaster/psc
usart braud gen
图 15.6 红外低功耗模式原理框图
rev1.05
- 198 -
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15.2.6. 智能卡模式
智能卡模式属于半双工模式，支持 ISO7816-3 标准，置位 SDEN 来启用智能卡模式，除此之外根据协议
要求需要使能 1.5 比特停止位 STOP 和奇偶校验位 PEN，同时需要配置相应的 IO 为开漏模式。
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
nack
uart_tx
start bit
0
1
2
3
4
5
6
7
bit rate
P
1.5 stop
guard time
TCF
图 15.7 智能卡模式时序图
在使能了 NACK 位以后，接收方在检测到奇偶校验出错以后，会在 0.5 个停止位之后拉低总线一个比特
周期，同时发送方会在停止位处检测总线是否被拉低，若检测到总线被拉低，则会产生帧错误标志 FEF，
发送方根据要求可以选择重发当前的数据，发送次数由用户决定。在没有使能 NACK 位时，接收方在检
测到奇偶校验错误时，不会拉低总线而是会产生一个奇偶检验错误标志位 PEF。
智能卡模式的发送方发送完成数据后，TCF 标志位会在经过 GT 个波特周期后置位；发送与接收的处理
由软件控制 TXEN 和 RXEN 来处理。
智能卡模式中，可以通过使能 CKOE 来输出一个时钟供给使能卡使用，输出的时钟频率详见 URSDCR2
寄存器说明；需要注意的是在置位 CKOE 后，请配置 PSC 的值为有效值，否则不应该置位 CKOE。
rev1.05
- 199 -
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15.2.7. LIN Master 模式
串口模块支持 LIN Master 模式，使能 LINEN 后进入 LIN Master 模式，在发送断开帧之前请先配置一下
断开帧的长度 BLTH；如图所示，在置位 BKREQ 后，tx 引脚会发送 BLTH 个连续的低电平，发送完成后
自动清零，在使能该位后，可以查询 BKREQ 的状态，等到 BKREQ 为 0 时则表示断开帧发送完成；在
发送断开帧的过程中请勿手动清零 BKREQ。
接收端在接收到大于起始位+数据长度+停止位个数的连续低电平以后，会被认为接收到了断开帧，BKF
会被置 1。
1
2
3
4
5
6
7
8
9
10
BKREQ
tx
BLTH BIT LENGTH
rx
> start bit + data bit + stop bit
BKF
图 15.8 LIN Master 模式时序图
需要注意的是断开帧的接收与发送并不局限于 LIN mode，其他异步模式，红外模式等也是可以应用。
rev1.05
- 200 -
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15.2.8. 多芯片通信模式
多处理器通信用于一个芯片用作主机模式，其他芯片用作从机模式，从机的发送引脚通过逻辑与的方式
连接到主机的 RX 引脚，这种模式中主机希望接收特定的消息，只有在特定的条件触发后才会接收数据。
置位 RWU 后即可进入哑模式，屏蔽一切接收，根据 WAKE 的配置，可以唤醒接收主机接收数据：
1. WAKE 置零，在接收到起始位+数据位+停止位总个数波特周期后唤醒；
2. WAKE 置一，在接收到匹配的地址后唤醒；
地址空闲唤醒，在置位 RWU 后，如果总线数据一致繁忙，则不唤醒接收，在检测到连续的一帧空
闲时间（起始位+数据位+停止位）后唤醒开始接收数据。
1
2
RWU
3
4
5
6
7
RX
DATA1
DATA2
8
9
10
Normal Mode
Mute Mode
DATA3
IDLE
DATA4
DATA5
RXNEF
图 15.9 哑模式空闲唤醒时序图
地址匹配唤醒，在置位 RWU 后，每次接收到数据后都会判断数据的高位是否为 1，若为 1 则把数据
的低四位与 URRAR 的值进行比较，若相等则退出哑模式开始接收之后的数据，后续如果再次接收
到地址数据（该模式下数据的高位为 1 则表示接收到的数据为地址数据），则还是会与本机的地址
URRAR 进行比较，若不同立即进入哑模式；该模式下每次匹配到地址后 ADDF 会被置 1，反之没
有匹配到地址时一直为零。
1
2
RWU
3
4
5
6
7
RX
addr=1
DATA2
8
9
Normal Mode
Mute Mode
DATA3
IDLE
addr=2
DATA4
DATA5
10
11
Mute Mode
addr=3
DATA6
RXNEF
ADDRF
图 15.10 哑模式地址匹配唤醒时序图
rev1.05
- 201 -
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15.2.9. 自动波特率检测
自动波特率检测功能用于接收端校准通信波特率，保持与发送端波特率相同，串口模块实现的波特率检
测模块有两种模式：
1. 检测起始位的长度（model0）；这种模式要求数据的第一比特为一，例如数据 0x03、0x55 等；
2. 检测起始比特和第一比特的长度（model1）；这种模式要求第一比特的数据为 1，第二比特的数据为
0，例如数据 0x55，0x01 等；
1
2
3
4
5
6
7
8
9
10
11
12
13
14
data = 0x55
start bit
rx
model 0
model 1
abrf model0
abrf model1
abre
图 15.11 自动波特率检测时序图
使用波特率检测功能，首先使能 ABREN，然后根据自己使用的检测模式配置 ABRM，读取 ABRF 是否
为 1（上次使用过后未清零），如果为 1，则写零清零；然后开始接收数据，波特率检测完成后 ABRF 就
会置 1，在 ABRF 置 1 后，不要立即清零 ABRF，因为清理 ABRF 会立即在当前传输的位置（可能已经
不是起始比特的位置）进行波特率检测，这样会导致错误的结果；当前数据接收完成后会产生 RXNEF
标志位，然后可以清零 ABRF，开始下一次波特率的检测，假如不清零 ABRF 标志位，则下次接收数据
时不会启动波特率检测；如果波特率检测超出了范围则会产生 ABRE 标志位 ，表示波特率检测出错。
波特率检测完成后，如果后续还需要检测波特率则不需要立即清零 ABRF，只有在需要再次检测的时候
清零 ABRF 即可。
需要注意的是波特率检测的数据是用来配置 DLL/DLH 寄存器用的，如果发送方波特率数据不靠近
Fbraudrate=Fmaster/(16*{DLH,DLL})，则波特率检测模块会自动配置本机为靠近支持的波特率，串口模
块并不支持小数波特率，因此该模块的波特率检测存在误差。
rev1.05
- 202 -
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15.3. 与 USART 相关寄存器汇总
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
名称
地址
URDATAL
0x48C
URDATAH
0x48D
URIER
0x48E
URLCR
0x48F
URLCREXT
0x490
URMCR
0x491
URLSR
0x492
URRAR
0x493
URDLL
0x494
DLL[7:0]
0000 0000
URDLH
0x495
DLH[7:0]
0000 0000
URABCR
0x496
—
ABRE
ABRM
ABRF
ABREN
---- 0000
URSYNCR
0x497
—
LBCL
URCPHA
URCPOL
SYNEN
---- 0000
URLINCR
0x498
URSDCR0
0x499
URSDCR1
0x49A
GT[7:0]
0000 0000
URSDCR2
0x49B
PSC[7:0]
0000 0000
URTC
0x49C
DATAL[7:0]
0000 0000
—
—
—
BKREQ
ADDRF
IDLEF
IDELE
RXSE
URTE
URRXNE
--0- 0000
—
EVEN
PEN
URSTOP
—
LTH
-0-0 00-0
RWU
EXTEN
---- --00
SIRLP
TXEN
RXEN
WAKE
HDSEL
SIREN
---0 0000
TXEF
BKF
FEF
PEF
OVERF
RXNEF
0000 0000
RAR[3:0]
—
NACK
---- ---0
—
—
—
DATAH
TCEN
—
—
复位值
CKOE
---- 0000
LINEN
BLTH[3:0]
---0 0000
SDEN
—
-000 ----
—
TCF
---- ---1
15.3.1. URDATAL 寄存器，地址 0x48C
Bit
7:0
Name
DATAL
Reset
0x00
Type
RW
Bit
Name
7:0
DATAL
Function
数据发送/接收寄存器低八位，请使用字节传输指令对该寄存器进行操作
15.3.2. URDATAH 寄存器，地址 0x48D
Bit
Name
Reset
Type
7:1
0
DATAH
0x0
RW
—
—
RO-0
Bit
Name
7:1
N/A
0
DATAH
rev1.05
Function
保留位，读 0
数据发送/接受寄存器高八位，这一位只有启用 9 比特数据格式才有用，这种模式下，一定要先
写低八位再写高 1 位。
1：表示 DATAL 是地址
0：表示 DATAL 是数据
- 203 -
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FT61F08X
15.3.3. URIER 寄存器，地址 0x48E
Bit
7:6
5
4
3
2
1
0
Name
—
TCEN
—
IDELE
RXSE
URTE
URRXNE
Reset
—
0x0
—
0x0
0x0
0x0
0x0
Type
RO-0
RW
RO-0
RW
RW
RW
RW
Bit
Name
7:6
N/A
Function
保留位，读 0
发送完成中断使能
5
TCEN
1：使能发送完成中断
0：禁用发送完成中断
4
N/A
-保留位，读 0
空闲帧中断使能
3
IDELE
1：使能空闲帧中断
0：禁用空闲帧中断
接收状态使能，包括帧断开，帧错误，奇偶校验错误，接收溢出错误
2
RXSE
1：使能接收到断开帧/帧错误/奇偶校验错误/接收溢出错误状态中断
0：禁用状态信息中断
发送 buf 为空中断使能
1
URTE
1：使能发送为空中断
0：禁用发送为空中断
接受到数据中断使能
0
URRXNE
1：使能接收到数据中断
2：禁用接收到数据中断
rev1.05
- 204 -
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FT61F08X
15.3.4. URLCR 寄存器，地址 0x48F
Bit
7
6
5
4
3
2
1
0
Name
—
BKREQ
—
EVEN
PEN
URSTOP
—
LTH
Reset
—
0x0
—
0x0
0x0
0x0
—
0x0
Type
RO-0
RW
RO-0
RW
RW
RW
RO-0
RW
Bit
Name
7
N/A
Function
保留位，读 0
发送断开帧使能，发送完成后改位自动清零，断开帧发送过程中不应该写零该位；发送断开帧
6
之前请先设置断开帧的长度，在 lincr 寄存器的 lth 字段
BKREQ
1：请求发送断开帧/断开帧发送中
0：未请求发送断开帧/断开帧发送完成
5
N/A
保留位，读 0
置 1 表示偶检验使能，置零表示奇校验使能
4
EVEN
1：表示使用偶检验
0：表示使用奇校验
校验位使能
3
PEN
1：使能校验位
0：禁用校验位
停止位长度设定
2
URSTOP
0：表示 1 个停止位
1：智能卡模式启用时表示 1.5 个停止位，否则表示两个停止位
1
N/A
0
LTH
保留位，读 0
通信数据长度设定
0：表示数据长度是 7 位，此位不包含检验位长度
1：表示数据长度是 8 位，此位不包含检验位长度
15.3.5. URLCREXT 寄存器，地址 0x490
Bit
7:2
1
0
Name
—
RWU
EXTEN
Reset
—
0x0
0x0
Type
RO-0
RW
RW
Bit
Name
7:2
N/A
Function
保留位，读 0
多处理器模式接收唤醒
1
RWU
1：设置进入哑模式
0：未设置进入哑模式或者已经退出哑模式
发送的数据是否时 9 比特长度
0
EXTEN
1：发送的数据长度是 9 比特长度
0：发送的数据不是 9 比特长度
rev1.05
- 205 -
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FT61F08X
15.3.6. URMCR 寄存器，地址 0x491
Bit
7:6
5
4
3
2
1
0
Name
—
SIRLP
TXEN
RXEN
WAKE
HDSEL
SIREN
Reset
—
0x0
0x0
0x0
0x0
0x0
0x0
Type
RO-0
RW
RW
RW
RW
RW
RW
Bit
Name
7:6
N/A
Function
保留位，读 0
红外低功耗模式使能
5
SIRLP
1：使能红外低功耗模式
0：禁用红外低功耗模式
发送使能
4
TXEN
1：使能接口的发送，相应的 IO 会被用作 TX 引脚
0：禁用接口的发送
接收使能
3
RXEN
1：允许接口接收，相应的 IO 会被用作 RX 引脚
0：禁用接口接收
哑模式唤醒方式选择
2
WAKE
1：选择地址匹配
0：选择 IDLE 帧
半双工使能
1
HDSEL
1：使能半双工模式
0：禁用半双工模式
红外模式使能
0
SIREN
1：使能红外模式
0：禁用红外模式
rev1.05
- 206 -
2020-5-29
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FT61F08X
15.3.7. URLSR 寄存器，地址 0x492
Bit
7
6
5
4
3
2
1
0
Name
ADDRF
IDLEF
TXEF
BKF
FEF
PEF
OVERF
RXNEF
Reset
0x0
0x0
0x1
0x0
0x0
0x0
0x0
0x0
Type
RO
W0
RO
W0
W0
W0
W0
RO
Bit
Name
Function
哑模式地址匹配标志位，指示位，软件不可清
7
ADDRF
1：哑模式地址匹配唤醒模式中，匹配到了地址
0：哑模式地址匹配唤醒模式中，未匹配到地址
空闲帧标志，写 0 清 0，写 1 无效
6
IDLEF
1：检测到空闲帧
0：未检测到空闲帧
发送寄存器的状态，在启用了 9 比特数据格式时，写 DATAH 寄存器清零，否则写取 DATAL 寄
5
TXEF
存器清零
1：发送寄存器为空
0：发送寄存器不为空
断开帧标志，写 0 清 0，写 1 无效
4
BKF
1：接收到了断开帧
0：未接收到断开帧或已清零
帧错误标志，写 0 清 0，写 1 无效
3
FEF
1：接收出现了帧错误
0：未接收到帧错误会已清零
奇偶校验错误标识，写 0 清 0，写 1 无效零
2
PEF
1：接收到了奇偶校验错误
0：未接收到奇偶校验错误或已清零
溢出错误标志，写 0 清 0，写 1 无效
1
OVERF
1：接收寄存器出现溢出
0：接收未出现溢出或已清零
在启用 9 比特数据格式时，读取 DATAH 寄存器清零，否则读取 DATAL 寄存器清零
0
RXNEF
1：接收寄存器非空
0：接收寄存器为空或已清零
rev1.05
- 207 -
2020-5-29
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FT61F08X
15.3.8. URRAR 寄存器，地址 0x493
Bit
7:4
3:0
Name
—
Receive address
Reset
—
0x0
Type
RO-0
RW
Bit
Name
7:4
N/A
3:0
Receive address
Function
保留位，读 0
多处理器模式中的本机地址
15.3.9. URDLL 寄存器，地址 0x494
Bit
7:0
Name
DLL
Reset
0x0
Type
RW
Bit
Name
7:0
DLL
Function
波特率分频计数器低八位
15.3.10. URDLH 寄存器，地址 0x495
Bit
7:0
Name
DLH
Reset
0x0
Type
RW
Bit
Name
Function
波特率分频计数器高八位
7:0
DLH
波特率=Fmaster/(16*{DLH,DLL})，默认值{DLH，DLL}为 0x0000 时，串口不工作；
{DLH，DLL}最小值为 0x0001
rev1.05
- 208 -
2020-5-29
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FT61F08X
15.3.11. URABCR 寄存器，地址 0x496
Bit
ABCR
3
2
1
0
Name
—
ABRE
ABRM
ABRF
ABREN
Reset
—
0x0
0x0
0x0
0x0
Type
RO-0
RW
RW
RW
RW
Bit
Name
Function
7:4
N/A
3
ABRE
波特率检测溢出
1：波特率检测超出范围
0：波特率检测未超出范围
2
ABRM
波特率检测模式
0：只检测起始位长度；这种模式要求第一比特为 1
1：检测起始位和数据第一位的长度，然后除以 2；这种模式要求第一比特为 1，第二比特为零
1
ABRF
检测到波特率标识，写零清零；该位在清零后，会立即再次进入波特率检测，为了保证每次检
测的都是起始位，可以在 RXNEF 置位后，再清零
1：检测到波特率
0：未检测到波特率
0
ABREN
保留位，读 0
自动波特率检测使能
1：使能波特率检测功能
0：禁用波特率检测功能
15.3.12. URSYNCR 寄存器，地址 0x497
Bit
7:4
3
2
1
0
Name
—
LBCL
URCPHA
URCPOL
SYNEN
Reset
—
0x0
0x0
0x0
0x0
Type
RO-0
RW
RW
RW
RW
Bit
Name
7:4
N/A
3
LBCL
2
URCPHA
同步模式时钟相位设置
1：主机在时钟变化的第二个沿开始采样第一个数据
0：主机在时钟变化的第一个沿开始采样第一个数据
1
URCPOL
同步模式时钟极性设置
1：同步模式中时钟空闲时为高电平
0：同步模式中时钟空闲时为低电平
0
SYNEN
rev1.05
Function
保留位，读 0
同步模式最后一个比特时钟使能
1：同步模式中最后一比特的时钟输出
0：同步模式中最后一比特的时钟不输出
同步模式使能
1：使能同步传输模式，相应的 IO 会用作同步时钟输出
0：禁用时钟同步模式
- 209 -
2020-5-29
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FT61F08X
15.3.13. URLINCR 寄存器，地址 0x498
Bit
7:5
4
3:0
Name
—
LINEN
BLTH
Reset
—
0x0
0x0
Type
RO-0
RW
RW
Bit
Name
7:5
N/A
Function
保留位，读 0
Lin 模式使能
4
LINEN
1：使能 LIN Master 模式
0：禁用 LIN Master 模式
3:0
BLTH
断开帧比特长度，大于零有效，一般设置为 12/13 比特长度，设置太短会被认为接收到的是正
常的帧
15.3.14. URSDCR0 寄存器，地址 0x499
Bit
7
6
5
4
3:0
Name
—
NACK
CKOE
SDEN
—
Reset
—
0x0
0x0
0x0
—
Type
RO-0
RW
RW
RW
RO-0
Bit
Name
Function
智能卡回复 Nack 使能
6
NACK
1：使能检测到奇偶校验出错时，发送 NACK
0：检测到奇偶校验位错误时不发送 NACK
给智能卡提供时钟时的使能
5
CKOE
1：使能时钟输出，请配置 PSC 寄存器的值为有效值
0：禁止时钟输出
智能卡模式使能，启用智能卡模式必须设定停止位为 1.5 位
4
SDEN
1：使能智能卡模式
0：禁用智能卡模式
3:0
N/A
rev1.05
保留位，读 0
- 210 -
2020-5-29
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FT61F08X
15.3.15. URSDCR1 寄存器，地址 0x49A
Bit
7:0
Name
GT
Reset
0x0
Type
RW
Bit
Name
7:0
GT
Function
智能卡模式:两字符之间波特间隔，最小为 1，即使设置为 0，也有一个间隔
15.3.16. URSDCR2 寄存器，地址 0x49B
Bit
7:0
Name
PSC
Reset
0x0
Type
RW
Bit
Name
7:0
PSC
Function
-给智能卡提供时钟时的时钟分频系数
0：无效
1：2 分频
2：3 分频
3：4 分频
……
-红外低功耗模式系统时钟分频
0:无效
1：1 分频
2：2 分频
3：3 分频
……
15.3.17. URTC 寄存器，地址 0x49C
Bit
7:1
0
Name
—
TCF
Reset
—
0x1
Type
RO-0
RW
Bit
Name
7:1
N/A
保留位，读 0
TCF
发送完成状态标志
1：数据发送完成
0：数据发送未完成，写 1 清零或写 DATAL/DATAH 寄存器后清零（在使能了 9 比特数据格式时，
写 DATAH 寄存器后清零，否则写 DATAL 寄存器后清零）
0
rev1.05
Function
- 211 -
2020-5-29
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FT61F08X
16. GPIO
本芯片共包含 30 个 GPIO。这些 IO 除了作为普通输入/输出端口以外还通常具备一些与内核周边电路通
讯的功能。
每个端口有 8 个标准寄存器供其操作使用。这些寄存包括：
TRISx 寄存器（数据方向寄存器）
PORTx 寄存器（用于读器件引脚上的电平）
LATx 寄存器（输出锁存器）
WPUx 寄存器（上拉控制）
WPDx 寄存器（下拉控制）
PSRCx 寄存器（源电流选择）
PSINKx 寄存器（灌电流选择）
ITYPEx 寄存器（中断类型选择）
VDD
ANSEL
weak
pullup
TRIS
PDRV
xxxOD
LAT
weak
pulldown
NDRV
xxxOD
PUENB
WPU
PORTx
TRIS
ANSEL
PDEN
WPD
GPIO控制
ANSEL
图 16.1 I/O 的结构原理
某些端口可能有以下额外寄存器：
ANSELx（模拟选择寄存器）
通常情况下，当某个端口上的外设使能时，其相关引可能不能用作通用输出引脚，但可读取该引脚。
数据锁存器（LATx 寄存器）用于对 I/O 引脚所驱动的值进行“读-修改-写”操作。对 LATx 寄存器的写操作
与对相应 PORTx 寄存器的写操作具有相同的效果。读 LATx 寄存器将读取保存在 I/O 端口锁存器中的值，
而读 PORTx 寄存器将读取实际的 I/O 引脚值。
支持模拟输入的端口具有相关的 ANSELx 寄存器。当 ANSEL 位置 1 时，禁止与该位相关的数字输入缓
冲器。禁止输入缓冲器可防止逻辑输入电路产生短路电流。
rev1.05
- 212 -
2020-5-29
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FT61F08X
16.1. 端口和 TRIS 寄存器
所有的管脚 PORTx.y 都是双向端口，其方向控制寄存器就是 TRISx.y。将 TRISx.y 设置为“0”会将该对应
PORTx.y 端口设置为输出端口。在置为输出端口时，输出驱动电路会被打开，输出寄存器里的数据会被
放置到输出端口。当 IO 处于输入状态时（TRISA=1），对 PORTx 进行读反映的是输入端口的状态。在
PORTx 上进行写动作时，PORTx 内容会被写入输出寄存器。所有的写操作都是“读-更改-写”这样一个微
流程，即数据被读，然后更改，再写入输出寄存器的过程。
当 MCLRE 为 1 时，PORTC[0]读的值为 0，此时它是作为外部复位管脚。
16.2. 弱上拉
每个端口都有一个可以单独设置的内部弱上拉功能。控制 WPUx 寄存器里的位就可使能或关断这些弱上
拉电路。当 GPIO 被设置为输出时，这些弱上拉电路会被自动关断。弱上拉电路在上电复位期间被置为
关断状态，因为 WPUx 寄存器复位为无效状态。
当 PORTC[0]配置为复位脚时，内部上拉是自动打开的，此时 WPUC[0]不起作用。
16.3. 弱下拉
跟弱上拉功能类似，每个管脚处于数字输入时具有内部弱下拉功能，由寄存器 WPDx 控制。需要注意的
是，弱上拉和弱下拉不是互斥的，即它们可以同时打开。
另外，PORTC[0]作为复位脚时，弱上拉自动打开，但它不反映到 WPUC[0]上，同时弱下拉自动关闭，
WPDC[0]不起作用。
16.4. 开漏输出
以下 3 种功能管脚支持开漏输出：
SPI_MISO, SPI_MOSI
I2C_SCL, I2C_SDA
UART_TX
开漏输出由寄存器 ODCON0 相关位控制，当相关位为 1 时，该功能所在的管脚即配置为开漏。
注意：
1. 管脚的开漏功能和内部上拉功能可以同时打开；
2. 对于拥有重映射功能的 I2C，开漏设置只应用在对应的被映射的管脚上；
rev1.05
- 213 -
2020-5-29
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FT61F08X
16.5. ANSELA 寄存器
ANSELA 寄存器用于控制 IO 的数模输入，当 ANSELA.x 为 1 时，对应的 IO 口为模拟引脚，IO 的输入
上拉、下拉被自动禁止，软件读该 IO 返回的是 0。
ANSELA 寄存器位对数字输出驱动没有影响，换言之，TRIS 位的优先级更高，即当 TRIS 为 0 时，不管
相关的 ANSELA.x 是 0 还是 1，对应的 IO 为数字输出 IO。要想配置真正的模拟管脚，TRIS 要置 1，把
数字输出驱动关闭。
16.6. 源电流选择
每个 I/O 口都支持不同的源电流驱动能力。通过配置相应的选择寄存器 PSRCx，指定的 I/O 端口可支持 4
种级别的源电流驱动能力。仅当对应的引脚被设为输出时，其源电流选择位才有效。否则，这些选择位
无效。用户可参考 I/O 电气特性章节为不同应用选择所需的源电流。
16.7. 灌电流选择
每个 I/O 都支持 2 种不同的灌电流驱动能力，设置寄存器为 PSINKx，当 I/O 设置为输出管脚时，其灌电
流设置位才有效。
16.8. 管脚输出的优先级
每个 I/O 管脚均复用了多个功能，当某管脚复用的功能模块都使能输出的情况下，就存在优先级的问题。
因为输入是连到各个功能模块的，故输入不存在优先级问题，例如 PB0 作为 GPIO 输入功能时，同时也
作为 TIM2 的捕捉输入。
rev1.05
- 214 -
2020-5-29
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FT61F08X
16.9. PORTx 功能及优先级
管脚名称
功能优先级（由高到低排序）
管脚名称
PA0
TIM1_CH1
SPI_MISO
PA0
PB0
PA1
PA2
PA3
PA4
PA5
TIM1_CH2
SPI_MOSI
PA1
ISPCK（处于调试模式）
I2C_SCL
UART_RX
PA2
TIM1_CH2N
PA3
TIM2_CH2
PA4
TIM2_CH1
UART_CK
PA5
PB1
PB2
PB3
PB4
PB5
功能优先级（由高到低排序）
TIM1_CH3N
TIM2_CH1
SPI_SCK
PB0
CLKO
TIM1_CH4
PB1
I2C_SCL
PB2
I2C_SDA
PB3
TIM1_CH3
PB4
TIM2_CH3
SPI_NSS
PB5
ISPDAT（处于调试模式）
I2C_SDA
UART_TX
PB6
OSC2（XT 模式）
SPI_MOSI
PB7
PA6
UART_TX
PA6
PB6
PA7
PA7
PB7
管脚名称
功能优先级（由高到低排序）
管脚名称
功能优先级（由高到低排序）
PC0
MCLRB（复位脚）
TIM1_CH1N
PC0
PD0
SPI_NSS
PD0
PC1
OSC1（XT 模式）
SPI_MISO
PC1
PD1
TIM1_CH1
UART_CK
PD1
PC2
PC2
PD2
TIM1_CH2
PD2
PC3
PC3
PD3
TIM1_CH3
SPI_SCK
PD3
PC4
PC4
PD4
CLKO
PD4
PC5
TIM1_CH3N
PC5
PD5
TIM1_CH4
PD5
PC6
TIM1_CH2N
PC6
PC7
TIM1_CH1N
PC7
rev1.05
- 215 -
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16.10.
FT61F08X
管脚功能重映射
为提高应用的灵活性，有部分功能输入/输出支持重映射功能，即可以在两个管脚之间选择输入或输出，
由寄存器 AFP0，AFP1 和 AFP2 设置。
16.11.
外部中断
所有 I/O 都可被选择为外部中断源，但同一时刻最多只有 8 个 IO 可以作为外部中断管脚，它们具备以下
特性：
上升沿中断
下降沿中断
双边沿中断
低电平中断
ITYPE0
EPS0
EPIE0.0
PA0
PB0
PC0
PD0
EPIF0.0
to INT ctrl
...
ITYPE1
...
EPS1
EPIE0.7
PA7
PB7
PC7
保留
EPIF0.7
图 16.2 外部中断结构框图
中断类型的选择通过寄存器 ITYPE0、1 设置。
ITYPEx[1:0]/[3:2]值
中断触发类型
00
低电平
01
上升沿
10
下降沿
11
双边沿
外部中断源的选择通过 EPS0，EPS1 设置。
rev1.05
- 216 -
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16.12.
FT61F08X
关于读端口 PORTx
D
SET
CLR
Q
Q
TRISx.y
写PORTx或
写LATx
D
SET
CLR
ENB
Q
Q
Px.y(x=PORTA/B/C/D)
LATx.y
端口数据寄存器
到内部总线
LATx
读
PORTx_sync
Q
SET
D
到内部总线
Q
读
CLR
PORTx
同步
图 16.3 端口读操作原理框图
在 FT61F08x 系列芯片中，操作 GPIO 有两种方式：访问 PORTx 寄存器或者 LATx 寄存器，它们有不同
的 SFR 地址。
对于读操作，“读 PORTx”返回的是管脚经过同步寄存器后的值，而“读 LATx”返回的是端口数据寄存器的
值；换言之，软件对端口数据寄存器写操作之后，至少要经过一个系统时钟之后，才能通过“读 PORTx”
的方式得到新值，而“读 LATx”则无需等待；
对于写操作，无论是写 PORTx 还是 LATx，都是对端口数据寄存器进行写；
由于以上特性，当软件使用“读-修改-写”（可参阅 19.1 小节）指令对 PORTx 进行写操作时，需要特别注
意以下情形：
BSR PORTx, n; 对 PORTx 第 n 位置 1
BSR PORTx, m; 对 PORTx 第 m 位置 1
…
软件期望的波形如下：
rev1.05
- 217 -
2020-5-29
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FT61F08X
MCLK
PORTx(n)
BSF PORT x, n
PORTx(m)
BSF PORT x, n
图 16.4 连续使用 RMW 指令对 PORTx 写操作的期望时序
实际输出波形如下：
MCLK
PORT x(n)只输出了一个脉冲
PORTx(n)
PORTx(m)
指令
BSF PORT x, n
PORTx_sync
BSF PORT x, m
在执行BSF PORT x, m 时，
PORT x_sync还未置1
图 16.5 连续使用 RMW 指令对 PORTx 写操作的输出时序
出现这个现象的原因是在执行“BSR PORTx, m”（回顾一下 RMW 指令的执行流程：先读取 PORTx，修
改数据，写 PORTx（LATx））时，由于同步的原因，PORTx_sync 还保持为 0，那么写回 PORTx 时刻，
这一位的“0”又被写回到 LATx，导致管脚 PORTx.n 只有一个高脉冲。
有以下两种方式解决这一问题：
a) 在 PORTx 连续写操作中间插入一个 NOP；
BSR PORTx, n; 对 PORTx 第 n 位置 1
NOP
; 插入 NOP 等待
BSR PORTx, m; 对 PORTx 第 m 位置 1
b) 或者，写操作用 LATx 寄存器而不是 PORTx；
BSR LATx, n ;
直接操作端口数据寄存器 LATx
BSR LATx, m;
直接操作端口数据寄存器 LATx
注意：只有 1T 速度模式下才有该现象，不存在于其它 2T/4T 模式，原因是处于 2T/4T 模式下，执行后
续指令时，PORTx_sync 已经同步到最新的值。
rev1.05
- 218 -
2020-5-29
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16.13.
FT61F08X
与端口相关寄存器汇总
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
名称
地址
PSRC0
0x11A
管脚的源电流设置 0
1111 1111
PSRC1
0x11B
管脚的源电流设置 1
1111 1111
PSINK0
0x19A
管脚的灌电流设置 0
0000 0000
PSINK1
0x19B
管脚的灌电流设置 1
0000 0000
PSINK2
0x19C
管脚的灌电流设置 2
0000 0000
PSINK3
0x19D
ITYPE0
0x11E
管脚中断类型设置 0
0000 0000
ITYPE1
0x11F
管脚中断类型设置 1
0000 0000
AFP0
0x19E
管脚重映射寄存器 0
0000 0000
AFP1
0x19F
—
AFP2
0x11D
—
EPS0
0x118
外部中断管脚选择 0
0000 0000
EPS1
0x119
外部中断管脚选择 1
0000 0000
EPIF0
0x14
外部管脚中断标志位
0000 0000
EPIE0
0x94
外部管脚中断使能位
0000 0000
ODCON0
0x21F
PORTA
0x0C
端口 A 读管脚寄存器
xxxx xxxx
PORTB
0x0D
端口 B 读管脚寄存器
xxxx xxxx
PORTC
0x0E
端口 C 读管脚寄存器
xxxx xxxx
PORTD
0x0F
TRISA
0x8C
端口 A 方向控制
1111 1111
TRISB
0x8D
端口 B 方向控制
1111 1111
TRISC
0x8E
端口 C 方向控制
1111 1111
TRISD
0x8F
LATA
0x10C
端口 A 数据锁存器
xxxx xxxx
LATB
0x10D
端口 B 数据锁存器
xxxx xxxx
LATC
0x10E
端口 C 数据锁存器
xxxx xxxx
LATD
0x10F
ANSELA
0x197
rev1.05
—
—
—
—
—
—
管脚的灌电流设置 3
--00 0000
管脚重映射寄存器 1
—
—
—
—
-000 0000
管脚重映射寄存器 2
—
—
—
SPIOD
端口 D 读管脚寄存器
—
端口 D 方向控制
—
端口 D 数据锁存器
模拟管脚设置
- 219 -
复位值
I2COD
---0 0000
UROD
---- -000
--xx xxxx
--11 1111
--xx xxxx
0000 0000
2020-5-29
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FT61F08X
16.13.1. PSRC0，地址 0x11A
Bit
7
6
Name
5
4
3
2
PSRCB
1
0
PSRCA
Reset
1
1
1
1
1
1
1
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
2
1
0
Bit
Name
7:4
PSRCB
3:0
PSRCA
Function
PSRCB[3:2]，控制 PORTB[7:4]源电流能力
PSRCB[1:0]，控制 PORTB[3:0]源电流能力
PSRCA[3:2]，控制 PORTA[7:4]源电流能力
PSRCA[1:0]，控制 PORTA[3:0]源电流能力
16.13.2. PSRC1，地址 0x11B
Bit
7
6
Name
5
4
3
PSRCD
PSRCC
Reset
1
1
1
1
1
1
1
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
7:4
PSRCD
3:0
PSRCC
Function
PSRCD[3:2]，控制 PORTD[5:4]源电流能力
PSRCD[1:0]，控制 PORTD[3:0]源电流能力
PSRCC[3:2]，控制 PORTC[7:4]源电流能力
PSRCC[1:0]，控制 PORTC[3:0]源电流能力
PSRCx[1:0]/[3:2]值
源电流能力
00
L0（最小）
01
L1
10
L2
11
L3（最大）
16.13.3. PSINK0，地址 0x19A
Bit
7
6
5
4
Name
3
2
1
0
PSINK0
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
PORTA 的灌电流能力设置
7:0
PSINK0
0: L0, 53mA
1: L1, 62mA
rev1.05
- 220 -
2020-5-29
Fremont Micro Devices
FT61F08X
16.13.4. PSINK1，地址 0x19B
Bit
7
6
5
4
Name
3
2
1
0
PSINK1
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
Bit
Name
Function
PORTB 的灌电流能力设置
7:0
PSINK1
0: L0, 53mA
1: L1, 62mA
16.13.5. PSINK2，地址 0x19C
Bit
7
6
5
4
Name
PSINK2
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
Bit
Name
Function
PORTC 的灌电流能力设置
7:0
PSINK2
0: L0, 53mA
1: L1, 62mA
16.13.6. PSINK3，地址 0x19D
Bit
7
6
5
4
Name
PSINK3
Reset
—
—
0
0
0
0
0
0
Type
RO-0
RO-0
RW
RW
RW
RW
RW
RW
Bit
Name
7:6
NA
Function
保留位
PORTD 的灌电流能力设置
5:0
PSINK3
0: L0, 53mA
1: L1, 62mA
rev1.05
- 221 -
2020-5-29
Fremont Micro Devices
FT61F08X
16.13.7. ITYPE0，地址 0x11E
Bit
7
6
5
4
Name
3
2
1
0
ITYPE0
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
Bit
Name
7:4
ITYPE0[7:4]
3:0
ITYPE0[3:0]
Function
ITYPE0[7:6]，控制 PORTx.3 中断类型
ITYPE0[5:4]，控制 PORTx.2 中断类型
ITYPE0[3:2]，控制 PORTx.1 中断类型
ITYPE0[1:0]，控制 PORTx.0 中断类型
16.13.8. ITYPE1，地址 0x11F
Bit
7
6
5
4
Name
ITYPE1
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
7:4
ITYPE1[7:4]
3:0
ITYPE1[3:0]
rev1.05
Function
ITYPE1[7:6]，控制 PORTx.7 中断类型（仅 PORTA/B/C）
ITYPE1[5:4]，控制 PORTx.6 中断类型（仅 PORTA/B/C）
ITYPE1[3:2]，控制 PORTx.5 中断类型
ITYPE1[1:0]，控制 PORTx.4 中断类型
- 222 -
2020-5-29
Fremont Micro Devices
FT61F08X
16.13.9. AFP0，地址 0x19E
Bit
Name
Reset
Type
7
6
5
4
0
RW
Bit
0
RW
0
RW
0
RW
Name
bit0
bit1
bit2
7:0
bit3
AFP0
bit4
bit5
bit6
bit7
16.13.10.
Bit
7
7
6
值
0
0
RW
0
RW
0
RW
0
RW
受控功能
0
0
1
0
1
0
1
PB3
PB6
PA4
ADC_ETR
1
0
复用管脚
I2C_SDA
1
PB2
PB0
TIM1_CH3N
PC5
PA3
TIM1_CH2N
PC6
PC0
TIM1_CH1N
0
PC7
PB5
SPI_NSS
1
0
PD0
PA0
TIM1_CH1
1
0
PD1
PA5
UART_CK
1
5
PD1
4
3
2
1
0
0
RW
0
RW
0
RW
0
RW
AFP1
—
RO-0
0
RW
0
RW
Function
bit0
bit1
bit2
AFP1
0
RW
保留位
位
bit3
bit4
bit5
bit6
rev1.05
1
AFP1，地址 0x19F
Name
NA
6:0
2
Function
位
Bit
Name
Reset
Type
3
AFP0
值
0
1
0
1
0
1
0
1
0
1
0
1
0
1
受控功能
TIM1_CH2
TIM1_CH3
TIM2_CH1
TIM1_BKIN
I2C_SCL
TIM1_CH4
CLKO
- 223 -
复用管脚
PA1
PD2
PB4
PD3
PA5
PB0
PB3
PD4
PB2
PA2
PB1
PD5
PB1
PD4
2020-5-29
Fremont Micro Devices
16.13.11.
Bit
FT61F08X
AFP2，地址 0x11D
7
6
5
4
Name
3
2
1
0
AFP2
Reset
—
—
—
0
0
0
0
0
Type
RO-0
RO-0
RO-0
RW
RW
RW
RW
RW
Bit
Name
7:5
NA
Function
保留位，读 0
位
值
0
bit0
AFP2
0
0
0
16.13.12.
Bit
PA7
PA2
PA1
PC1
PA0
SPI_MOSI
1
0
bit4
PB6
SPI_MISO
1
bit3
PA6
UART_RX
1
bit2
复用管脚
UART_TX
1
bit1
4:0
受控功能
PB7
PB0
SPI_SCK
1
PD3
EPS0，地址 0x118
7
6
5
4
Name
3
2
1
0
EPS0
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
外部中断 EINT3~0 的管脚选择
7:0
EPS0
rev1.05
EPS0[1:0]值
EINT0 管脚
EPS0[3:2]值
EINT1 管脚
00
PA0
00
PA1
01
PB0
01
PB1
10
PC0
10
PC1
11
PD0
11
PD1
EPS0[5:4]值
EINT2 管脚
EPS0[7:6]值
EINT3 管脚
00
PA2
00
PA3
01
PB2
01
PB3
10
PC2
10
PC3
11
PD2
11
PD3
- 224 -
2020-5-29
Fremont Micro Devices
16.13.13.
Bit
FT61F08X
EPS1，地址 0x119
7
6
5
4
Name
3
2
1
0
EPS1
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
外部中断 EINT7~4 的管脚选择
7:0
EPS1
16.13.14.
Bit
EPS1[1:0]值
EINT4 管脚
EPS1[3:2]值
EINT5 管脚
00
PA4
00
PA5
01
PB4
01
PB5
10
PC4
10
PC5
11
PD4
11
PD5
EPS1[5:4]值
EINT6 管脚
EPS1[7:6]值
EINT7 管脚
00
PA6
00
PA7
01
PB6
01
PB7
10
PC6
10
PC7
11
保留（接 PC6）
11
保留（接 PC7）
EPIF0，地址 0x14
7
6
5
4
Name
3
2
1
0
EPIF0
Reset
0
0
0
0
0
0
0
0
Type
RW-0
RW-0
RW-0
RW-0
RW-0
RW-0
RW-0
RW-0
Bit
Name
Function
外部中断 x 标志位
0：外部管脚 x 没触发中断，或已由软件清 0
Bit[7:0]
EPIF0
1：外部管脚 x 触发了中断
写操作：
写 1 清 0，建议只使用 STR, MOVWI 指令，而不是 BSR 位操作（该寄存器不能由软件方式置 1）
rev1.05
- 225 -
2020-5-29
Fremont Micro Devices
16.13.15.
Bit
FT61F08X
EPIE0，地址 0x94
7
6
5
4
Name
3
2
1
0
EPIE0
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
外部中断 x 允许位
Bit[7:0]
EPIE0
0：禁止外部中断 x
1：允许外部中断 x，当相关标志位 EPIF0.x 为 1 且 GIE 为 1 时，CPU 将执行中断程序
16.13.16.
ODCON0，地址 0x21F
Bit
7
6
5
4
3
2
1
0
Name
—
—
—
—
—
SPIOD
I2COD
UROD
Reset
—
—
—
—
—
0
0
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RW
RW
RW
2
1
0
Bit
Name
7:3
N/A
2
SPIOD
SPI_MISO, SPI_MOSI 管脚的开漏输出设置，高有效
1
I2COD
I2C_SCL, I2C_SDA 管脚的开漏输出设置，高有效
0
UROD
UART_TX 管脚的开漏输出设置，高有效
16.13.17.
Bit
Function
保留位，读 0
PORTx，地址 0x0C, 0D, 0E, 0F
7
6
5
Name
4
3
PORTA/B/C/D
Reset
x
x
x
x
x
x
x
x
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
7:0
PORTx
rev1.05
Function
PORTx 管脚寄存器
读返回的是管脚上的电平，写是写到相应的 LATx 寄存器
- 226 -
2020-5-29
Fremont Micro Devices
16.13.18.
Bit
FT61F08X
TRISx，地址 0x8C, 8D, 8E, 8F
7
6
5
4
Name
3
2
1
0
TRISA/B/C/D
Reset
1
1
1
1
1
1
1
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
3
2
1
0
Bit
Name
Function
PORTx 方向控制寄存器
7:0
TRISx
1 = 输入
0 = 输出
16.13.19.
Bit
LATx，地址 0x10C, 10D, 10E, 10F
7
6
5
4
Name
LATA/B/C/D
Reset
x
x
x
x
x
x
x
x
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
7:0
LATx
16.13.20.
Bit
Function
PORTx 数据寄存器
WPUx，地址 0x18C, 18D, 18E, 18F
7
6
5
4
Name
3
2
1
0
WPUA/B/C/D
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
PORTx 弱上拉控制寄存器
7:0
WPUx
1 = 使能弱上拉
0 = 关闭弱上拉
rev1.05
- 227 -
2020-5-29
Fremont Micro Devices
16.13.21.
Bit
FT61F08X
WPDx，地址 0x20C, 20D, 20E, 20F
7
6
5
4
Name
3
2
1
0
WPDA/B/C/D
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
2
1
0
Bit
Name
Function
PORTx 弱下拉控制寄存器
7:0
WPDx
1 = 使能弱下拉
0 = 关闭弱下拉
16.13.22.
Bit
ANSELA，地址 0x197
7
6
5
Name
4
3
模拟管脚设置寄存器
Reset
0
0
0
0
0
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
模拟选择寄存器 A，控制 Anx 相关的管脚
7:0
ANSELA
1 = Anx 为模拟管脚
0 = Anx 为数字管脚
rev1.05
- 228 -
2020-5-29
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FT61F08X
17. 看门狗定时器
...
LIRC
HIRC
LPCLK
XTCLK
...
7-bit
prescaler
WDT
Time-out
16-bit
timer
WDTPS
WCKSEL
WDTPRE
WDTPS
WTDE
SWDTEN
图 17.1 看门狗结构框图
看门狗的时钟源为内部慢时钟（32kHz），它是一个带 7 位预分频的 16 位计数器，其中预分频和周期可
编程，分别由 WDTPRE 和 WDTPS 设置。
WDT 的硬件使能位位于配置寄存器 UCFG0 的第 3 位，WDTEN，软件使能位位于 WDTCON 寄存器的
第 0 位，为 1 时表示使能看门狗，为 0 时禁止。
指令 CLRWDT、SLEEP 会清除看门狗计数器。
在使能了看门狗的情况下，处于睡眠时看门狗溢出事件可以作为一个唤醒源，而 MCU 正常工作时 WDT
则是作为一个复位源。
条件
看门狗状态
WDTEN 和 SWDTEN 同时为 0
CLRWDT 指令
清零
进入 SLEEP、退出 SLEEP 时刻
写 WDTCON
写 WCKSEL
注意：
1. 如果内部慢时钟从 32k 切换到 256k 模式（或反之从 256k 切换到 32k 模式，由 LFMOD 位控制），
都不影响看门狗计时，因为 WDT 固定使用 32k 时钟源，见 5.1 小节的时钟框图；
2. PWRT 和 OST 复用了 WDT 定时器，故 PWRT 或 OST 工作时，看门狗的复位功能是暂时屏蔽的；
rev1.05
- 229 -
2020-5-29
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FT61F08X
17.1. 看门狗时钟源
WDT 有 4 种时钟源可选，由寄存器 MISC0 的 WCKSEL 位设置。在 WDT 使能的情况下，所选择的时钟
源被自动使能，并在 SLEEP 模式下保持。
注意：
1. 如果要选择 LP 晶体时钟，系统时钟配置寄存器位 FOSC 必须选择 LP 模式，否则对应的时钟源将不
被使能；
2.
同理，如果要选择 XT 晶体时钟，系统时钟配置寄存器位 FOSC 必须选择 XT 模式，否则对应的时
钟源将不被使能；
17.2. 与看门狗相关寄存器汇总
bit7
bit6
bit5
bit4
bit3
bit2
名称
地址
WDTCON
0x97
UCFG0
0x2000
—
CPB
MCLRE
PWRTEB
WDTE
FOSC2
MISC0
0x11C
—
—
—
—
—
—
rev1.05
WDTPRE[2:0]
bit1
WDTPS[3:0]
- 230 -
FOSC1
bit0
复位值
SWDTEN
1110 1000
FOSC0
qqqq qqqq
WCKSEL
---- --00
2020-5-29
Fremont Micro Devices
FT61F08X
17.2.1. WDTCON 寄存器，地址 0x97
Bit
7
6
Name
5
4
3
WDTPRE[2:0]
2
1
0
WDTPS[3:0]
SWDTEN
Reset
1
1
1
0
1
0
0
0
Type
RW
RW
RW
RW
RW
RW
RW
RW
Bit
Name
Function
看门狗预分频设置位
000：1:1
001：1:2
010：1:4
7:5
WDTPRE
011：1:8
100：1:16
101：1:32
110：1:64
111：1:128（复位值）
看门狗定时器周期选择：
0000 = 1:32
0001 = 1:64
0010 = 1:128
0011 = 1:256
0100 = 1:512（复位值）
0101 = 1:1024
0110 = 1:2048
4:1
WDTPS
0111 = 1:4096
1000 = 1:8192
1001 = 1:16384
1010 = 1:32768
1011 = 1:65536
1100 = 1:65536
1101 = 1:65536
1110 = 1:65536
1111 = 1:65536
看门狗软件使能位
0
SWDTEN
1 = 使能
0 = 禁止
rev1.05
- 231 -
2020-5-29
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FT61F08X
17.2.2. MISC0 寄存器，地址 0x11C
Bit
7
6
5
4
3
2
Name
—
—
—
—
—
—
Reset
—
—
—
—
—
—
0
0
Type
RO-0
RO-0
RO-0
RO-0
RO-0
RO-0
RW
RW
Bit
Name
7:2
N/A
1
0
WCKSEL
Function
保留位，读 0
WDT 时钟源选择
00 = LIRC
1:0
WCKSEL
01 = HIRC
10 = LP，只有当 FOSC 选择 LP 模式时才有效
11 = XT，只有当 FOSC 选择 XT 模式时才有效
rev1.05
- 232 -
2020-5-29
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FT61F08X
18. 慢时钟测量
芯片集成了两个内部 RC 振荡器，一个是经过出厂校准的高速高精度的 16M 快时钟 HIRC，一个是低速
低功耗的 32k 时钟 LIRC，利用慢时钟测量功能可以把 LIRC 的周期用系统时钟计算出来。此功能可以比
较精准的测量内部慢时钟周期。
18.1. 测量原理
慢时钟测量类似于定时器的捕捉模式，处于这种模式下，被测量时钟 LIRC 的边沿（任意沿）将会触发
定时器，在另一高速时钟（如 HIRC）的作用下开始计数，在此后的第 2 个（或第 8 个，平均模式时）
LIRC 边沿到来时，定时器停止计数，同时把定时器的值锁存到 SOSCPRL/H 寄存器。
注意：慢时钟测量使用的定时器是 TIM2。
MSCKCON
CKMAVG
CKCNTI
CLKRST
CKMCNT
AVGSEL
CLK & RST
CKMEND
TRGGEN
CKMTRG
TIMER2
CKM
SOSCPRH/L
T2CNT
图 18.1 慢时钟测量模式原理框图
注意：
1. 在慢时钟测量过程中软件不要写 SOSCPRH/L；
2. 不要在单步调试下做慢时钟测量，因为暂停模式下 TIM2 被停止，这样会导致测量结果不正确；
3. 若 SYSON bit 为 0 时，慢时钟测量无法在 SLEEP 模式下进行，不要在测量运行时进入 SLEEP 模
式。
rev1.05
- 233 -
2020-5-29
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FT61F08X
18.2. 上电自动测量
在上电后慢时钟测量将会自动启动，此时 CKCNTI 置 1，CKMAVG 为 0，打开 LIRC 和 HIRC。TIM2 的
时钟被自动配置为 16M 的内部高速时钟，即类似设置 T2CKSRC 为 001、TIM2EN=1 的功能，但未配置
这些位。TIM2 使用默认配置，无需置位 CEN 使能 TIM2 计数，此时不能配置 TIM2。
在测量过程中，实际应用程序已在运行，若要使用 TIM2 则需要查询 CKCNTI。若 CKCNTI 为 0 即可使
用 TIM2，此时 SOSCPR 寄存器的值为有效值，其单位为 FHSI 时钟的个数。
注意：
1. 上电自动测量不会置位 CKM 中断标志；
CKCNTI
CKMAVG
CPU_RSTN
T2CEN
T2CLK
16M(HIRC)
DEFAULT
LSI_CLK
CKMTRG
CKMEND
CKMCNT
0
1
2
0
T2CNT
Valid
3*Tsys
SOSCPR
Valid
CKMIF
图 18.2 上电慢时钟自动测量时序图
rev1.05
- 234 -
2020-5-29
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FT61F08X
18.3. 操作步骤
1.
2.
3.
4.
5.
6.
7.
8.
为提高计量精度，建议设置 T2CKSRC 为 001，TIM2EN=1，选择 16M 的内部高速时钟；
关闭 TIM2 的相关中断使能，设置 TIM2ARRH/L 为最大值，设置 TIM2PSC 为 0000；
设置 TIM2CR1 为复位值，再将 CEN 置 1，使能 TIM2；
如果选择 4 次平均，则把 MSCKCON.1 置 1，否则把它清 0；
置位 MSCKCON.0，开始测量；
测量结束后 MSCKCON.0 自动清 0，中断标志置 1；
可以用查询或中断的方式等待结束；
当查询到中断标志为 1 时读取得到的 SOSCPR 即为最终结果。
CKCNTI
CKMAVG
CPU_RSTN
T2CEN
T2CLK
16M(HIRC)(User Config)
LSI_CLK
CKMTRG
CKMEND
CKMCNT
0
1
2
3
4
5
6
7
0
T2CNT
Valid
3*Tsys
SOSCPR
Valid
CKMIF
图 18.3 慢时钟测量模式时序图
18.4. 与慢时钟测量相关寄存器汇总
名称
地址
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
复位值
MSCKCON
0x41D
—
—
—
—
—
—
CKMAVG
CKCNTI
---- --01
SOSCPRL
0x41E
SOSCPRH
0x41F
rev1.05
SOSCPR[7:0]
—
1111 1111
SOSCPR[11:8]
- 235 -
---- 1111
2020-5-29
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FT61F08X
18.4.1. MSCKCON 寄存器，地址 0x41D
Bit
7
6
5
4
3
2
1
0
Name
—
—
—
—
—
—
CKMAVG
CKCNTI
Reset
—
—
—
—
—
—
0
1
Type
RW
RW
RW
RW
RO-0
RW
RW
RW
3
2
1
0
3
2
1
0
Bit
Name
7:2
N/A
Function
保留位，读 0
快时钟测量慢时钟周期的测量平均模式
1
CKMAVG
1 = 打开平均模式（自动测量并累加 4 次）
0 = 关闭平均模式
Clock Count Init –使能快时钟测量慢时钟周期
0
1 = 使能快时钟测量慢时钟周期
CKCNTI
0 = 关闭快时钟测量慢时钟周期
注：这一位在测量完毕后会自动归零
18.4.2. SOSCPR 寄存器，地址 0x41E，41F
SOSCPRL，地址 0x41E
Bit
7
6
5
4
Name
SOSCPR[7:0]
Reset
8’hFF
Type
RW
SOSCPRH，地址 0x41F
Bit
7
6
5
4
Name
—
—
—
—
SOSCPR[11:8]
Reset
—
—
—
—
4’hF
Type
RO-0
RO-0
RO-0
RO-0
RW
Bit
Name
0x41E：7:0
0x41F：3:0
rev1.05
SOSCPR[11:0]
Function
低速振荡器周期（单位：TIM2 时钟周期数）
用于慢时钟测量功能，TLSI = SOSCPR * TTIM2
- 236 -
2020-5-29
Fremont Micro Devices
FT61F08X
19. 指令集汇总
一共 49 条指令，大部分指令为单周期。
助记符
STR
NOP
MOVLB
CLRWDT
RETI
RET
BRW
CALLW
RESET
MOVIW
MOVWI
SLEEP
CLRR
CLRW
SUBWR
DECR
IORWR
ANDWR
XORWR
ADDWR
LDR
COMR
INCR
DECRSZ
RRR
RLR
SWAPR
INCRSZ
BCR
BSR
BTSC
BTSS
LCALL
LJUMP
LDWI
MOVLP
ADDFSR
BRA
RETW
LSLF
LSRF
ASRF
IORWI
ANDWI
XORWI
SUBWFB
SUBWI
ADDWFC
ADDWI
MOVIW
MOVWI
f
–
k
–
–
–
–
–
–
n mm
n mm
–
f
–
f, d
f, d
f, d
f, d
f, d
f, d
f, d
f, d
f, d
f, d
f, d
f, d
f, d
f, d
f, b
f, b
f, b
f, b
k
k
k
k
n, k
k
k
f, d
f, d
f, d
k
k
k
f, d
k
f, d
k
k[n]
k[n]
说明
将 W 送至 f
空操作
将立即数传送到 BSREG
清零看门狗定时器
中断返回
从子程序返回
将 W 寄存器的内容作为偏移量进行相对跳转
调用地址由 W 寄存器指定的子程序
软件器件复位
将间接 FSRn 的内容传送到 W 寄存器，带预/后增/减修改符，mm
将 W 寄存器的内容传送到间接 FSRn，带预/后增/减修改符，mm
进入待机模式
将 f 清零
将 W 清零
f减W
f 减 1 操作
W 与 f 同或
W 与 f 相与
W 与 f 异或
W 与 f 相加
传送 f
求 f 的补码
f 加 1 操作
f 减 1 操作，若为 0 则跳过
f 寄存器带进位位右循环
f 寄存器带进位位左循环
f 半字节交换
f 加 1 操作，若为 0 则跳过
将 f 位清零
将 f 位置 1
测试 f 位，若为 0 则跳过
测试 f 位，若为 1 则跳过
调用子程序
转移
立即数移至 W
将立即数传送到 PCLATH
立即数 k 与 FSRn 相加
相对跳转
立即数送到 W 中返回
逻辑左移
逻辑右移
算术右移
立即数与 W 同或
立即数与 W 相与
立即数与 W 异或
f 减去 W（带借位）
立即数减 W
W 和 f 进行带进位的相加
立即数与 W 相加
将 INDFn 的内容传送到 W 寄存器，采用变址间接寻址模式
将 W 寄存器的内容传送到 INDFn，采用变址间接寻址模式
周期
1
1
1
1
2
2
2
2
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
2
2
1
1
1
2
2
1
1
1
1
1
1
1
1
1
1
1
1
影响标志
TO, PD
Z
TO, PD
Z
Z
C, DC, Z
Z
Z
Z
Z
C, DC, Z
Z
Z
Z
C
C
C和Z
C和Z
C和Z
Z
Z
Z
C, DC, Z
C, DC, Z
C, DC, Z
C, DC, Z
Z
表 29.1 指令集
rev1.05
- 237 -
2020-5-29
Fremont Micro Devices
FT61F08X
操作码字段说明
字段
f
说明
文件寄存器地址（0x00 到 0x7F）
W
工作寄存器（累加器）
b
8 位文件寄存器内的位地址
k
立即数字段、常数或标号
x
忽略（或 0 或 1），汇编器将生成 x = 0 的代码。
d
目标寄存器选择，d = 0：结果保存至 W；d = 1：结果保存至文件寄存器 f。默认值为 d = 1。
n
FSR 或 INDF 编号（0-1）
mm
预/后增/减模式选择
缩写说明
字段
说明
PC
程序计数器
TO
WDT 超时位
C
进位位
DC
半进位位
Z
全零标志位
PD
掉电位（睡眠）
19.1. 读-修改-写（RMW）指令
所有需要使用文件寄存器（表格 20.1 中助记符带 f 的指令）的指令都会执行读-修改-写（RMW）操作，
即先把目标寄存器内容取出，根据指令修改数据，再把数据写回到目标寄存器或 W（取决于 d 和具体指
令）。
举例说明：
BSR FSR0L, 0;
上述指令在 CPU 的执行过程如下：
1）把 FSR0L 读出到临时寄存器 T；
2）把寄存器 T 或上”0000 0001”形成新数据；
3）再把新数据写回 FSR0L；
rev1.05
- 238 -
2020-5-29
Fremont Micro Devices
FT61F08X
19.1. 指令详细描述
ADDFSR
立即数与FSRn 相加
ANDWI
立即数和W作逻辑与运算
[标号] ADDFSR FSRn, k
-32≤k≤31
n∈[0,1]
操作：
FSR(n)+k → FSR(n)
受影响的状态位：无
说明：
将有符号6 位立即数k与
FSRnH:FSRnL寄存器对的内
容相加。
FSRn 地址范围限制为
0000h-FFFFh。传送地址超出该
边界时，FSR会发生折回。
语法：
[标号] ANDWI k
操作数：
0≤k≤255
操作：
(W).AND.(k) → (W)
受影响的状态位：Z
说明：
将W寄存器的内容与8 位立即
数k进行逻辑与运算。结果存入
W寄存器。
ADDWI
ANDWR
语法：
操作数：
立即数与W相加
W和f作逻辑与运算
语法：
[标号] ADDWI k
操作数：
0≤k≤255
操作：
(W)+k → (W)
受影响的状态位：C、DC和Z
说明：
将W寄存器的内容与8位立即数
k相加，结果存入W寄存器。
语法：
操作数：
ADDWR
ASRF
算术右移
语法：
操作数：
[标号] ASRF
0≤f≤127
d∈[0,1]
操作：
(f)→目标寄存器
W与f相加
[标号]ADDWR f,d
0≤f≤127
d∈[0,1]
操作：
(W)+(f)→(目标寄存器)
受影响的状态位：C、DC 和Z
说明：
将W寄存器的内容与寄存器f的
内容相加。如果d为0，结果存入
W寄存器。如果d为1，结果存回
寄存器f。
语法：
操作数：
[标号] ANDWR f,d
0≤f≤127
d∈[0,1]
操作：
(W).AND.(f) →(目标寄存器)
受影响的状态位：Z
说明：
将W 寄存器的内容与寄存器f
的内容进行逻辑与运算。如果d
为0，结果存入W寄存器。如果d
为1，结果存回寄存器f。
(f)→目标寄存器，
(f)→C
受影响的状态位： C和Z
说明：
将寄存器f的内容连同进位标志
位一起右移1位。MSb保持不变。
如果d为0，结果存入W寄存器。
如果d为1,结果存回寄存器f。
寄存器f
rev1.05
f {,d}
- 239 -
C
2020-5-29
Fremont Micro Devices
FT61F08X
BRW
ADDWFC
W与f相加（带进位）
将W寄存器的内容作为偏移量
进行相对跳转
[标号] ADDWFC f {,d}
0≤f≤127
d∈[0,1]
操作：
(W)+(f)+(C)→目标寄存器
受影响的状态位：C、DC 和Z
说明：
将W的内容、进位标志位与数据
存储单元f的内容相加。如果d为
0，结果存入W。如果d为1，结
果存入数据存储单元f。
语法：
[标号] BRW
操作数：
无
操作：
(PC)+(W)→PC
受影响的状态位：无
说明：
将W的内容（无符号）与PC相
加。由于PC将递增1以取出下一
条指令，所以新地址将为
PC+1+(W)。该指令为一条双周
期指令。
BCR
BSR
语法：
操作数：
将f寄存器中的某位清零
[标号] BCR f, b
0≤f≤127
0≤b≤7
操作：
0→(f)
受影响的状态位：无
说明：
将寄存器f中的位b清零。
语法：
操作数：
BRA
BTSC
语法：
操作数：
相对跳转
[标号] BRA 标号
[标号] BRA $+k
操作数：
-256≤标号 - PC+1≤255
-256≤k≤255
操作：
(PC)+1+k→PC
受影响的状态位：无
说明：
将有符号9位立即数k与PC相
加。由于PC 将递增1以便取下
一条指令，所以新地址将为
PC+1+k。该指令为一条双周期
指令。该跳转的地址范围存在限
制。
语法：
rev1.05
将f中的某位置1
[标号] BSR f,b
0≤f≤127
0≤b≤7
操作：
1→(f)
受影响的状态位：无
说明：
将寄存器f的位b置1。
测试f中某位，为0则跳过
[标号] BTSC f,b
0≤f≤127
0≤b≤7
操作：
如果(f)=0，则跳过
受影响的状态位：无
说明：
如果寄存器f的位b为1，则执行
下一条指令。如果寄存器f的位b
为0，则丢弃下一条指令，转而
执行一条NOP指令，从而使该
指令成为双周期指令。
语法：
操作数：
- 240 -
2020-5-29
Fremont Micro Devices
BTSS
测试f中某位,为1则跳过
FT61F08X
CLRW
[标号] BTSS f,b
0≤f≤127
0≤b≤7
操作：
如果(f)=1，则跳过
受影响的状态位：无
说明：
如果寄存器f的位b为0，则执行
下一条指令。如果位b为1，则丢
弃下一条指令，转而执行一条
NOP指令，从而使该指令成为
双周期指令。
语法：
操作数：
操作：
LCALL
CALLW
语法：
操作数：
调用子程序
[标号] CLRW
无
00h→(W)
1→Z
受影响的状态位：Z
说明：
W寄存器被清零。全零位（Z）
被置1。
[标号] LCALL k
0≤k≤2047
(PC)+1→TOS，
k→PC，
(PCLATH)→PC
受影响的状态位：无
说明：
调用子程序。首先，将返回地址
（PC+1）压入堆栈。将11位立
即数地址装入PC的位。
将PCLATH的内容装入PC的高
位。LCALL是双周期指令。
语法：
操作数：
操作：
CLRR
CLRWDT
语法：
操作数：
操作：
将f清零
[标号] CLRR f
0≤f≤127
00h→(f)
1→Z
受影响的状态位：Z
说明：
寄存器f的内容被清零，并且Z位
被置1。
语法：
操作数：
操作：
rev1.05
将W寄存器清零
调用地址由W寄存器指定的子
程序
[标号] CALLW
无
(PC)+1→TOS，
(W)→PC，
(PCLATH)→PC
受影响的状态位：无
说明：
调用地址由W寄存器指定的子程
序。首先，将返回地址（PC+1）
压入返回堆栈。然后，W的内容
被装入PC，将PCLATH的
内容装入PC。CALLW是
双周期指令。
将看门狗定时器清零
[标号] CLRWDT
无
00h→WDT
0→WDT 预分频器
1→/TO
1→/PD
受影响的状态位：/TO和/PD
说明：
CLRWDT指令复位看门狗定时
器及其预分频器。
状态位/TO和/PD均被置1。
语法：
操作数：
操作：
- 241 -
2020-5-29
Fremont Micro Devices
FT61F08X
COMR
f取反
LJUMP
语法：
操作数：
[标号] COMR
0≤f≤127
d∈[0,1]
操作：
(f )→(目标寄存器)
f,d
—
受影响的状态位：Z
说明：
将寄存器f的内容取反。如果d为
0，结果存入W寄存器。如果d
为1，结果存回寄存器f。
DECR
f递减1
[标号] LJUMP k
0≤k≤2047
k→PC
PCLATH→PC
受影响的状态位：无
说明：
LJUMP是无条件跳转指令。将
11位立即数值装入PC 的
位。PC的高位从
PCLATH装入。LJUMP是
双周期指令。
语法：
操作数：
操作：
INCR
[标号] DECR f,d
0≤f≤127
d∈[0,1]
操作：
(f)-1→(目标寄存器)
受影响的状态位：Z
说明：
将寄存器f的内容递减1。如果d
为0，结果存入W寄存器。如果d
为1，结果存回寄存器f。
语法：
操作数：
DECRSZ
INCRSZ
语法：
操作数：
f递减1，为0则跳过
[标号]DECRSZ f,d
0≤f≤127
d∈[0,1]
操作：
(f)-1→(目标寄存器)；
结果=0则跳过
受影响的状态位：无
说明：
将寄存器f的内容递减1。如果d
为0，结果存入W寄存器。如果d
为1，结果存回寄存器f。如果结
果为1，则执行下一条指令。如
果结果为0，则转而执行一条
NOP指令，从而使该指令成为
双周期指令。
语法：
操作数：
rev1.05
无条件跳转
f递增1
[标号] INCR f,d
0≤f≤127
d∈[0,1]
操作：
(f)+1→(目标寄存器)
受影响的状态位：Z
说明：
将寄存器f的内容递增1。如果d
为0，结果存入W寄存器。如果d
为1，结果存回寄存器f。
f递增1，为0则跳过
[标号] INCRSZ f,d
0≤f≤127
d∈[0,1]
操作：
(f)+1→(目标寄存器)，
结果=0则跳过
受影响的状态位：无
说明：
将寄存器f的内容递增1。如果d
为0，结果存入W寄存器。如果d
为1，结果存回寄存器f。如果结
果为1，则执行下一条指令。如
果结果为0，则转而执行NOP指
令，从而使该指令成为双周期指
令。
语法：
操作数：
- 242 -
2020-5-29
Fremont Micro Devices
IORWI
FT61F08X
LSRF
立即数和W作逻辑或运算
语法：
[标号] IORWI k
操作数：
0≤k≤255
操作：
(W).OR.k→(W)
受影响的状态位：Z
说明：
将W寄存器的内容与8位立即数
k进行逻辑或运算。结果存入W
寄存器。
IORWR
W和f作逻辑或运算
[标号] IORWR f,d
0≤f≤127
d∈[0,1]
操作：
(W).OR.(f)→(目标寄存器)
受影响的状态位：Z
说明：
将W寄存器的内容与寄存器f的
内容进行逻辑或运算。如果d为
0，结果存入W寄存器。如果d
为1，结果存回寄存器f。
语法：
操作数：
[标号] LSRF f {,d}
0≤f≤127
d∈[0,1]
操作：
0→目标寄存器
(f)→目标寄存器
(f)→C
受影响的状态位：C和Z
说明：
将寄存器f的内容连同进位标志
位一起右移1位。0 移入MSb。
如果d为0，结果存入W。如果d
为1，结果存回寄存器f。
语法：
操作数：
0
LSLF
逻辑左移
LDR
语法：
操作数：
[标号] LSLF f {,d}
0≤f≤127
d∈[0,1]
(f)→C
语法：
操作数：
操作：
(f)→目标寄存器
0→目标寄存器
受影响的状态位：C和Z
说明：
将寄存器f的内容连同进位标志
位一起左移1位。0 移入LSb。
如果d为0，结果存入W。如果d
为1，结果存回寄存器f。
C
寄存器f
0
寄存器f
C
传送f
[标号] LDR f,d
0≤f≤127
d∈[0,1]
操作：
(f)→(目标寄存器)
受影响的状态位：Z
说明：
根据d的状态，将寄存器f的内容
传送到目标寄存器。如果d=0，
目标寄存器为W寄存器。如果
d=1，目标寄存器为文件寄存器
f。由于状态标志位Z要受影响，
可用d=1 检测文件寄存器。
指令字数：
1
指令周期数：
1
示例：
rev1.05
逻辑右移
- 243 -
LDR
FSR, 0
执行指令后
W=FSR寄存器的值
Z=1
2020-5-29
Fremont Micro Devices
MOVIW
FT61F08X
将INDFn的内容传送到W
[标号] MOVIW ++FSRn
[标号] MOVIW --FSRn
[标号] MOVIW FSRn++
[标号] MOVIW FSRn-[标号] MOVIW k[FSRn]
操作数：
n∈[0,1]
mm∈[00,01,10,11]
-32≤k≤31
操作：
INDFn→W
有效地址通过以下方式确定：
•FSR+1（预递增1）
•FSR-1（预递减1）
•FSR+k（相对偏移）
执行传送指令后，FSR值为以下
任一项：
•FSR+1（所有值都加1）
•FSR-1（所有值都减1）
•不变
受影响的状态位：Z
语法：
MOVWI
将W 的内容传送到INDFn
[标号] MOVWI ++FSRn
[标号] MOVWI --FSRn
[标号] MOVWI FSRn++
[标号] MOVWI FSRn-[标号] MOVWI k[FSRn]
操作数：
n∈[0,1]
mm∈[00,01,10,11]
-32≤k≤31
操作：
W→INDFn
有效的地址由以下项决定:
•FSR+1（预递增1）
•FSR-1（预递减1）
•FSR+k（相对偏移）
执行传送指令后，FSR值为以下
任一项：
•FSR+1（所有值都加1）
•FSR-1（所有值都减1）
不变
受影响的状态位：无
语法：
模式
语法
mm
模式
语法
mm
预递增
++FSRn
00
预递增
++FSRn
00
与递减
--FSRn
01
与递减
--FSRn
01
后递增
FSRn++
10
后递增
FSRn++
10
后递减
FSRn--
11
后递减
FSRn--
11
说明：
该指令用于在W寄存器和任一
间接寄存器（INDFn）之间传送
数据。执行该传送指令之前/之
后，将通过预/后增/减来更新指
针（FSRn）。
说明：
该指令用于在W寄存器和任一
个间接寄存器（INDFn）之间传
送数据。执行该传送指令之前/
之后，将通过预/后增/减来更新
指针（FSRn）。
注：INDFn 寄存器不是物理寄存器。访问INDFn
寄存器的指令实际上访问的是由FSRn指定的地址
处的寄存器。
注：INDFn寄存器不是物理寄存器。访问INDFn寄
存器的指令实际上访问的是由FSRn指定的地址处
的寄存器。
FSRn地址范围限制为0000h-FFFFh。地址递增/
递减到超出边界时，将导致它发生折回。
FSRn地址范围限制为0000h-FFFFh。地址递增/
递减到超出边界时，将导致它发生折回。
对于FSRn的递增/递减操作不会影响任
何状态位。
rev1.05
- 244 -
2020-5-29
Fremont Micro Devices
MOVLB
将立即数传送到BSR
语法：
[标号] MOVLB k
操作数：
0≤k≤15
操作：
k→BSR
受影响的状态位：无
说明：
将5位立即数k装入存储区选择
寄存器（BSR）。
FT61F08X
STR
将W的内容传送到f
语法：
[标号] MOVLP k
操作数：
0≤k≤127
操作：
k→PCLATH
受影响的状态位：无
说明：
将7位立即数k装入PCLATH寄
存器。
语法：
[标号] STR f
操作数：
0≤f≤127
操作：
(W) →(f)
受影响的状态位：无
说明：
将W寄存器的数据传送到寄存
器f。
指令字数：
1
指令周期数：
1
示例：
STR OPTION
执行指令前
OPTION = 0xFF
W = 0x4F
执行指令后
OPTION = 0x4F
W = 0x4F
LDWI
RESET
MOVLP
将立即数传送到PCLATH
将立即数传送到W
[标号] RESET
无
执行器件复位。复位PCON 寄
存器的nRI标志。
受影响的状态位：无
说明：
此指令可实现用软件执行硬件
复位。
语法：
[标号] MOVLW k
操作数：
0≤k≤255
操作：
k→(W)
受影响的状态位：无
说明：
将8位立即数k装入W寄存器。其
余无关位均汇编为0。
指令字数：
1
指令周期数：
1
示例：
LDWI
0x5A
执行指令后
W = 0x5A
语法：
操作数：
操作：
NOP
RET
空操作
语法：
[标号] NOP
操作数：
无
操作：
空操作
受影响的状态位：无
说明：
不执行任何操作。
指令字数：
1
指令周期数：
1
示例：
NOP
rev1.05
软件复位
从子程序返回
语法：
[标号] RET
操作数：
无
操作：
TOS→PC
受影响的状态位：无
说明：
从子程序返回。执行出栈操作，
将栈顶（TOS）内容装入程序计
数器。这是一条双周期指令。
- 245 -
2020-5-29
Fremont Micro Devices
RETI
FT61F08X
RETW
从中断返回
[标号] RETI
无
TOS→PC，
1→GIE
受影响的状态位：无
说明：
从中断返回。执行出栈操作，将
栈顶（Top-of-Stack，TOS）的
内容装入PC。通过将全局中断
允许位GIE（INTCON）置1，
来允许中断。这是一条双周期指
令。
指令字数：
1
指令周期数：
2
示例：
RETI
中断后
PC = TOS
GIE = 1
语法：
操作数：
操作：
RLR
对f执行带进位的循环左移
[标号] RLR f,d
0≤f≤127
d∈[0,1]
操作：
参见如下说明
受影响的状态位：C
说明：
将寄存器f 的内容连同进位标
志位一起循环左移1位。如果d
为0，结果存入W寄存器。如果d
为1，结果存回寄存器f。
指令字数：
1
指令周期数：
1
示例：
RLF
REG1,0
执行指令前:
REG1 = 1110 0110
C=0
执行指令后:
REG1 = 1110 0110
W = 1100 1100
C=1
语法：
操作数：
C
寄存器f
返回并将立即数送入W
[标号] RETW k
0≤k≤255
k→(W)；
TOS→PC
受影响的状态位：无
说明：
将8位立即数k装入W寄存器。将
栈顶内容（返回地址）装入程序
计数器。这是一条双周期指令。
指令字数：
1
指令周期数：
2
示例：
LCALL TABLE;W contains
;table offset value
• ;W now has table value
•
TABLE
•
ADDWR PC ;W = offset
RETW
k1 ;Begin table
RETW
k2 ;
•
•
•
RETW
kn ;End of table
执行指令前
W = 0x07
执行指令后
W = k8的值
语法：
操作数：
操作：
RRR
对f执行带进位的循环右移
[标号] RRR f,d
0≤f≤127
d∈[0,1]
操作：
参见如下说明
受影响的状态位：C
说明：
将寄存器f的内容连同进位标志
位一起循环右移1位。如果d为
0，结果存入W寄存器。如果d
为1，结果存回寄存器f
语法：
操作数：
C
rev1.05
- 246 -
寄存器f
2020-5-29
Fremont Micro Devices
SLEEP
FT61F08X
进入休眠模式
SWAPR
[标号] SLEEP
无
00h→WDT，
0→WDT 预分频器，
1→/TO，
0→/PD
受影响的状态位：/TO和/PD
说明：
掉电状态位/PD被清零。超时状
态位/TO被置1。看门狗定时器
及其预分频器被清零。振荡器停
振，处理器进入休眠模式。
语法：
操作数：
SUBWI
SUBWR
语法：
操作数：
操作：
从立即数中减去W
语法：
[标号] SUBWI k
操作数：
0≤k≤255
操作：
k-(W)→(W)
受影响的状态位：C、DC和Z
说明：
用8位立即数k减去W寄存器的
内容（通过二进制补码方式进行
运算）。结果存入W寄存器。
C= 0
W＞k
C= 1
W≤k
DC=0
W > k
DC=1
W ≤ k
SUBWFB
f减去W（带借位）
SUBWFB f {,d}
0≤f≤127
d∈[0,1]
操作：
(f)–(W)–(/B)→目标寄存器
受影响的状态位：C、DC和Z
说明：
用f寄存器的内容减去W的内容
和借位标志（进位）（通过二进
制补码方式进行运算）。如果d
为0，结果存入W。如果d为1，
结果存回寄存器f。
语法：
操作数：
rev1.05
将f中的两个半字节交换
[标号] SWAPR f,d
0≤f≤127
d∈[0,1]
操作：
(f)→(目标寄存器)，
(f)→(目标寄存器)
受影响的状态位：无
说明：
寄存器f的高半字节和低半字节
相互交换。如果d为0，结果存入
W 寄存器。如果d为1，结果存
回寄存器f。
f减去W
[标号] SUBWR f,d
0≤f≤127
d∈[0,1]
操作：
(f)-(W)→(目标寄存器)
受影响的状态位：C、DC和Z
说明：
用寄存器f的内容减去W寄存器
的内容（通过二进制补码方式进
行运算）。如果d为0，结果存入
W寄存器。如果d为1，结果存回
寄存器f。
语法：
操作数：
XORWR
C= 0
W＞f
C= 1
W≤f
DC=0
W > f
DC=1
W ≤ f
W和f作逻辑异或运算
[标号] XORWR f,d
0≤f≤127
d∈[0,1]
操作：
(W).XOR.(f)→(目标寄存器)
受影响的状态位：Z
说明：
将W寄存器的内容与寄存器f的
内容进行逻辑异或运算。如果d
为0，结果存入W寄存器。如果d
为1，结果存回寄存器f。
语法：
操作数：
- 247 -
2020-5-29
Fremont Micro Devices
XORWI
FT61F08X
立即数和W作逻辑异或运算
语法：
[标号] XORWI k
操作数：
0≤k≤255
操作：
(W).XOR.k→(W)
受影响的状态位：Z
说明：
将W寄存器的内容与8位立即数
k进行逻辑异或运算。结果存入
W寄存器。
rev1.05
- 248 -
2020-5-29
Fremont Micro Devices
FT61F08X
20. 芯片的电气特性
20.1. 极限参数
工 作 温 度 … … … … … … … … … … … … … … … … … … … … … … … … … … … … … … - 4 0 ~ + 8 5 °C
存 储 温 度 … … … … … … … … … … … … … … … … … … … … … … … … … … … … … - 4 0 ~ + 1 2 5 °C
电源电压……………………………………………………………………VSS-0.3V~VSS+6.0V
端口输入电压………………………………………………………………VSS-0.3V~VDD+0.3V
注：上述值为芯片工作条件的极限参数值，超过极限参数所规定的范围，可能会对芯片造成永久性损坏。若芯
片长时间工作在极限参数范围外的条件下，其可靠性可能受到影响。
20.2. 内置高频振荡器（HIRC）
电气参数
最小值(1)
典型值(1)
最大值(1)
单位
条件/备注
校准范围
15.84
16
16.16
MHz
25°C, VDD = 2.5V
随温度变化范围
-2.0%
—
2.0%
—
-40~85°C, VDD = 2.5V
随电源电压变化范围
-0.5%
—
0.5%
—
25°C, VDD = 1.9~5.5V
IHIRC 工作电流
—
40
—
μA
25°C, VDD = 3.0V
启动时间
—
2.5
—
μs
25°C, VDD = 3.0V
(1) 数据基于特性值，并未生产测试。
20.3. 内置低频振荡器（LIRC）
低频振荡器有双模模式，一种模式下振动频率为 32kHz，另一种模式下振动频率为 256kHz。振荡频率模
式由 OSCCON 寄存器中的 LFMOD 位控制，0 为 32kHz 模式，1 为 256kHz 模式。
电气参数
最小值(1)
典型值(1)
最大值(1)
单位
条件/备注
振荡频率
30.4
32
33.6
kHz
25°C, VDD = 2.5V
随温度变化范围
-2.0%
—
2.0%
—
-40~85°C, VDD = 2.5V
随电源电压变化范围
-4.5%
—
1.0%
—
25°C, VDD = 1.9~5.5V
ILIRC 工作电流
—
1.3
—
μA
25°C, VDD = 3.0V
启动时间
—
4.6
—
μs
25°C, VDD = 3.0V
(1) 数据基于特性值，并未生产测试。
rev1.05
- 249 -
2020-5-29
Fremont Micro Devices
FT61F08X
20.4. 低电压复位电路（LVR）
电气参数
ILVR 工作电流
VLVR，LVR 阈值
LVR delay
最小值(1)
典型值(1)
最大值(1)
单位
—
15.18
—
μA
25°C, VDD = 3.3V
1.94
2.0
2.06
2.13
2.2
2.27
2.42
2.5
2.58
2.72
2.8
2.88
V
25°C
3.01
3.1
3.19
3.49
3.6
3.71
3.98
4.1
4.22
—
125
157
μs
25°C, VDD = 1.9~5.5V
条件/备注
(1) 数据基于特性值，并未生产测试。
20.5. 低电压侦测电路（LVD）
电气参数
ILVD 工作电流
VLVD，LVD 阈值
LVD delay
最小值(1)
典型值(1)
最大值(1)
单位
—
21.54
—
μA
25°C, VDD = 3.3V
1.94
2.0
2.06
2.33
2.4
2.47
2.72
2.8
2.88
2.91
3.0
3.09
V
25°C
3.49
3.6
3.71
3.88
4.0
4.12
—
125
157
μs
25°C, VDD = 1.9~5.5V
条件/备注
(1) 数据基于特性值，并未生产测试。
20.6. 上电复位电路（POR）
最小值
典型值(1)
最大值
单位
IPOR 工作电流
—
140
—
nA
25°C, VDD = 3.3V
VPOR
—
1.65
—
V
25°C
电气参数
条件/备注
(1) 数据基于特性值，并未生产测试。
rev1.05
- 250 -
2020-5-29
Fremont Micro Devices
FT61F08X
20.7. I/O PAD 电路
最小值(1)
典型值(1)
最大值(1)
单位
VIL
0
—
0.3*VDD
V
VIH
0.7*VDD
—
VDD
V
-1
—
1
μA
VDD = 5V
L0
—
-2
—
L1
—
-4
—
L2
—
-14
—
mA
25°C, VDD = 5V, VOH = 4.5V
L3
—
-26
—
L0
—
53
—
L1
—
62
—
mA
25°C, VDD = 5V, VOL= 0.5V
上拉电阻
—
21
—
kΩ
下拉电阻
—
21
—
kΩ
电气参数
漏电流
源电流(source)
灌电流(sink)
条件/备注
(1) 数据基于特性值，并未生产测试。
20.8. 总体工作电流（IDD）
电气参数
典型值@VDD(1)
Sysclk
2.0V
3.0V
5.5V
16MHz
—
4.143
4.402
8MHz
1.897
2.648
2.808
4MHz
1.293
1.887
1.981
2MHz
0.871
1.130
1.183
1MHz
0.561
0.727
0.755
32kHz
0.036
0.051
0.054
16MHz
2.170
3.000
3.181
8MHz
1.435
2.074
2.169
4MHz
0.947
1.224
1.284
2MHz
0.596
0.778
0.810
1MHz
0.420
0.560
0.581
32kHz
0.032
0.046
0.048
休眠模式（Sleep, WDT OFF, LVR OFF）, ISB
—
0.087
0.136
0.240
休眠模式（Sleep, WDT ON, LVR OFF）
—
1.294
2.420
2.854
休眠模式（Sleep, WDT OFF, LVR ON）
—
11.257
15.318
20.777
休眠模式（Sleep, WDT ON, LVR ON）
—
12.457
17.551
23.240
休眠模式（Sleep, WDT OFF, LVR OFF, LVD ON）
—
17.793
21.672
27.133
正常模式(1T)，IDD
正常模式(2T)，IDD
单位
mA
mA
μA
(1) 数据基于特性值，并未生产测试。
注：
1.
测试环境温度为 25°C；
2.
睡眠电流的测试条件为 I/O 处于输入模式并外部下拉到 0；
rev1.05
- 251 -
2020-5-29
Fremont Micro Devices
FT61F08X
20.9. AC 电气参数
最小值(1)
典型值(1)
最大值(1)
单位
条件/备注
1T/ 2T
—
—
8
MHz
-40~85°C , VDD = 1.9~5.5V
/4T
—
—
16
MHz
-40~85°C , VDD = 2.7~5.5V
1T
—
62.5
—
ns
2T
—
125
—
ns
4T
—
250
—
ns
1T
—
30.5
—
μs
2T
—
61
—
μs
4T
—
122
—
μs
—
4.2
—
ms
25°C, PWRT disable
2000
—
—
ns
25°C
—
1
—
ms
无预分频, WDTPS=0000
电气参数
Fsys(系统时钟频率)
指令周期（Tins）
上电复位保持时间（TDRH）
外部复位脉冲宽度（TMCLRB）
WDT 周期（TWDT）
系统时钟 HIRC
系统时钟 LIRC
(1) 数据基于特性值，并未生产测试。
注：除特殊说明，特性测试条件为：T=25°C，VDD=1.9~5.5V。
rev1.05
- 252 -
2020-5-29
Fremont Micro Devices
20.10.
FT61F08X
12bit ADC 特性
ADC 特性参数
最小值(1)
典型值(1)
最大值(1)
单位
2.7
—
5.5
V
—
630
—
μA
—
750
—
μA
—
1350
—
μA
模拟输入电压 VAIN
VREFN
—
VREFP
V
外部参考电压 VREF
—
—
VDD
V
分辨率
—
—
12
位
积分误差 EIL
—
±2
—
LSB
电气参数
ADC 工作电压 VDD
ADC 工作电流 IVDD
条件/备注
25°C, VREFP = VDD = 2.7V,
ADC 转换时钟频率为 250kHz
25°C, VREFP = VDD = 3.0V,
ADC 转换时钟频率为 250kHz
25°C, VREFP = VDD = 5.5V,
ADC 转换时钟频率为 250kHz
25°C, VREFP = VDD = 5.0V,
VREFN = GND, ADC 转换时钟
微分误差 EDL
—
±2
—
LSB
频率为 250kHz
偏移误差 EOFF
—
±1
—
LSB
25°C, VREFP = VDD = 5.0V,
增益误差 EGN
—
±1.5
—
LSB
VREFN = GND
转换时钟周期 TAD
—
1
—
μs
转换时钟数
—
15
—
TAD
稳定时间(TST)
—
15
—
μs
采样时间(TACQ)
—
1.5
—
TAD
建议的模拟电压源阻抗（ZAI）
—
—
10
kΩ
最小值(1)
典型值(1)
最大值(1)
单位
0.492
0.5
0.508
V
25°C, VDD =5V
1.992
2.0
2.008
V
25°C, VDD =5V
2.988
3.0
3.012
V
25°C, VDD =5V
内置参考电压 0.5V
—
400
—
μs
25°C, VDD =5V
稳定时间 TVRINT
—
600
—
μs
25°C, VDD =5V, 1μF
内置参考电压 2.0V
—
450
—
μs
25°C, VDD =5V
稳定时间 TVRINT
—
800
—
μs
25°C, VDD =5V, 1μF
内置参考电压 3.0V
—
450
—
μs
25°C, VDD =5V
稳定时间 TVRINT
—
1200
—
μs
25°C, VDD =5V, 1μF
VREFP > 3.0V, VDD > 3.0V
(1) 数据基于特性值，并未生产测试。
ADC Vref 特性参数
电气参数
内置参考电压 ADCVref
条件/备注
(1) 数据基于特性值，并未生产测试。
注：除非另外说明，否则“典型值”一栏的数据都是在 25°C ，5.0V 的条件下给出。
rev1.05
- 253 -
2020-5-29
Fremont Micro Devices
20.11.
FT61F08X
存储器编程特性
电气参数
最小值
(1)
(1)
(1)
典型值
最大值
单位
FLASH 编程电压，VPRW_FL
2.7
—
5.5
V
EEPROM 编程电压，VPRW_EE
1.9
—
5.5
V
条件/备注
(1) 数据基于特性值，并未生产测试。
20.12.
直流和交流特性曲线图
注意：本节提供的图表基于特性值，仅用作设计参考，未经生产测试。
20.12.1. HIRC vs VDD ( TA=25°C )
rev1.05
- 254 -
2020-5-29
Fremont Micro Devices
FT61F08X
20.12.2. LIRC vs VDD ( TA=25°C )
20.12.3. 不同 VDD 下， IDD vs Freq ( 1T, TA=25°C )
rev1.05
- 255 -
2020-5-29
Fremont Micro Devices
FT61F08X
20.12.4. 不同 VDD 下， IDD vs Freq ( 2T, TA=25°C )
20.12.5. 不同 VDD 下，ISB (睡眠电流) 随温度变化曲线
rev1.05
- 256 -
2020-5-29
Fremont Micro Devices
FT61F08X
20.12.6. 不同温度下，IOH ( level -2mA ) vs VOH @VDD=5V
20.12.7. 不同温度下，IOH ( level -4mA ) vs VOH @VDD=5V
rev1.05
- 257 -
2020-5-29
Fremont Micro Devices
FT61F08X
20.12.8. 不同温度下，IOH ( level -14mA ) vs VOH @VDD=5V
20.12.9. 不同温度下，IOH ( level -26mA ) vs VOH @VDD=5V
rev1.05
- 258 -
2020-5-29
Fremont Micro Devices
FT61F08X
20.12.10.
不同温度下，IOL ( L0 ) vs VOL @VDD=5V
20.12.11.
不同温度下，IOL ( L1) vs VOL @VDD=5V
rev1.05
- 259 -
2020-5-29
Fremont Micro Devices
FT61F08X
21. 芯片封装信息
SOP24 封装尺寸如下：
Symbol
Dimensions In Millimeters
Min
Nom
Max
A
2.36
2.54
2.64
A1
0.10
0.20
0.30
A2
2.26
2.30
2.35
A3
0.97
1.02
1.07
b
0.39
—
0.47
b1
0.38
0.41
0.44
c
0.25
—
0.29
c1
0.24
0.25
0.26
D
15.30
15.40
15.50
E
10.10
10.30
10.50
E1
7.40
7.50
7.60
e
L
1.27BSC
0.70
L1
—
1.00
1.40REF
h
0.25
—
0.75
θ
0
—
8°
rev1.05
- 260 -
2020-5-29
Fremont Micro Devices
FT61F08X
SSOP24 封装尺寸如下：
Symbol
Dimensions In Millimeters
Min
Nom
Max
A
—
—
1.700
A1（站高）
0.100
0.150
0.200
A2（厚度）
1.300
1.400
1.500
A3
0.600
0.650
0.700
b
0.229
—
0.279
e（脚间距）
0.605
0.635
0.665
D（长度）
8.500
8.600
8.700
E（跨度）
5.800
6.000
6.200
E1（宽度）
3.800
3.900
4.000
L（脚长）
0.500
0.600
0.700
L1
—
0.25BSC
—
rev1.05
- 261 -
2020-5-29
Fremont Micro Devices
FT61F08X
TSSOP24 封装尺寸如下：
Symbol
Dimensions In Millimeters
Min
Nom
Max
A
—
—
1.20
A1
0.05
—
0.15
A2
0.80
1.00
1.05
A3
0.39
0.44
0.49
b
0.20
—
0.29
b1
0.19
0.22
0.25
c
0.13
—
0.18
c1
0.12
0.13
0.14
D
7.70
7.80
7.90
E
6.20
6.40
6.60
E1
4.30
4.40
4.50
e
L
0.65BSC
0.45
L1
θ
rev1.05
0.60
0.75
1.00BSC
0
—
- 262 -
8°
2020-5-29
Fremont Micro Devices
FT61F08X
SOP28 封装尺寸如下：
Symbol
Dimensions In Millimeters
Dimensions In Inches
Min
Max
Min
Max
A
-
2.65
-
0.104
A1
0.10
0.30
0.004
0.012
A2
2.25
2.35
0.089
0.093
A3
0.97
1.07
0.038
0.042
b
0.39
0.47
0.015
0.019
b1
0.38
0.44
0.015
0.017
c
0.25
0.29
0.010
0.011
c1
0.24
0.26
0.009
0.010
D
17.90
18.10
0.704
0.712
E
10.10
10.50
0.397
0.413
E1
7.40
7.60
0.290
0.299
e
L
1.27(BSC)
0.70
L1
θ
rev1.05
0.05(BSC)
1.00
0.027
1.40REF
0
0.039
0.055REF
8°
0
- 263 -
8°
2020-5-29
Fremont Micro Devices
FT61F08X
SSOP28 封装尺寸如下：
Symbol
Dimensions In Millimeters
Min
Nom
Max
A
—
—
2.00
A1
0.05
—
0.25
A2
1.65
1.75
1.85
A3
0.75
0.80
0.85
b
0.28
—
0.36
b1
0.27
0.30
0.33
c
0.15
—
0.19
c1
0.14
0.15
0.16
D
10.10
10.20
10.30
E
7.60
7.80
8.00
E1
5.20
5.30
5.40
e
L
0.65BSC
0.75
L1
θ
rev1.05
—
1.05
1.25REF
0
—
- 264 -
8°
2020-5-29
Fremont Micro Devices
FT61F08X
LQFP32 封装尺寸如下：
Symbol
Dimensions In Millimeters
Dimensions In Inches
Min
Max
Min
Max
A
-
1.60
-
0.630
A1
0.05
0.15
0.020
0.059
A2
1.35
1.45
0.531
0.571
A3
0.59
0.69
0.232
0.272
b
0.33
0.41
0.130
0.161
b1
0.32
0.38
0.126
0.150
c
0.13
0.17
0.051
0.067
c1
0.12
0.14
0.047
0.055
D
8.80
9.20
3.465
3.622
D1
6.90
7.10
2.717
2.795
E
8.80
9.20
3.465
3.622
E1
6.90
7.10
2.717
2.795
eB
8.10
8.25
3.189
3.248
e
L
0.80(BSC)
0.45
L1
θ
rev1.05
0.315(BSC)
0.75
0.177
1.00REF
0
0.295
0.394REF
7°
0
- 265 -
7°
2020-5-29
Fremont Micro Devices
FT61F08X
附录 1，文档更改历史
日期
版本
2019-4-24
1.00
内容
初版
更正笔误“CLRF STATUS”
修改 11.3 章节的标题级别
修改 I2C 章节的笔误：
ADDRF 改名为 ADDF
TXE 改名 IICTXE，RXNE 改名 II2CRXNE
添加 BANK11 到 3.2.5 小节
删除 TSSOP20 脚位，添加 SOP24/SOP28 脚位图
更新管脚描述中的 HS output
添加“校准步骤”到 9.2.1 小节
2019-6-5
1.01
更新图 3.2 的地址笔误
更正 TIM2CCR2L，TIM2CCR3H 寄存器描述笔误
SPICFG2 改为 SPICTRL2
添加 SOP24 脚位
开放 1T
更新电气特性
更新若干格式问题
添加注意事项到 8.2.2 小节，“写数据 EEPROM 存储器”
2019-9-3
2019-11-18
2020-04-23
rev1.05
1.02
删除表格多余寄存器
删除脚位图中多余的字符
TIM1BRK 改名为 TIM1BKR
T1UTG 更正为 T1DTG
URLCR.2 改名为 URSTOP
1.03
更改电气特性
6.3 小节睡眠下的中断小节最后添加注意
PSINKx 寄存器描述中，把 L0（最小）L1（最大）改为：L0, xxmA, L1, xxmA
时钟框图中的“=12pF”删掉
TIM4CR1 的 T4CKS 改为可读写
更新 14.1.2 主机接收小节
添加指令详细描述
1.04
添加 FT61F087-ERB（SSOP28）脚位
更新电气特性表格
添加 EECON4 寄存器
UCFG2 的第四位增加 I2CRMAP 控制位
增加 EECON4 寄存器，用于控制 DROM 只编程模式，详见 8.8.6 小节
- 266 -
2020-5-29
Fremont Micro Devices
日期
2020-5-28
rev1.05
FT61F08X
版本
1.05
内容
添加以下型号：
FT61F087E-RB
FT61F086E-RB （脚位同 FT61F086A-RB ）
FT61F086E-ERB（脚位同 FT61F086-ERB ）
FT61F086E-TRB（脚位同 FT61F086-TRB ）
FT61F088E-LRB（脚位同 FT61F088-LRB ）
- 267 -
2020-5-29
工商网监
湘ICP备2023018690号
