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XD74LS194

XD74LS194

  • 厂商:

    XINLUDA(信路达)

  • 封装:

    DIP16

  • 描述:

    移位寄存器 DIP-16

  • 详情介绍
  • 数据手册
  • 价格&库存
XD74LS194 数据手册
1 2 3 4 5 6 7 DIP 78
XD74LS194
物料型号:XD74LS194

器件简介: XD74LS194是一款双向移位寄存器,设计用于满足系统设计师对移位寄存器几乎所有功能的需求。该电路包含46个等效门,具有并行输入、并行输出、右移和左移串行输入、操作模式控制输入以及直接覆盖清除线。寄存器有四种不同的操作模式:抑制时钟(无操作)、右移(Qa向Qd方向)、左移(Qd向Qa方向)、并行(侧向)加载。

引脚分配: - 1: CLR(清除)- 16: U16(未使用) - 2: SR(串行输入)- 15: Vcc(电源) - 3: A(数据输入)- 14: QB(输出) - 4: B(数据输入)- 13: QD(输出) - 5: SL(串行输入)- 12: Qc(输出) - 6: SERD(串行数据输入)- 11: CLK(时钟输入) - 7: GND(地)- 10: S1(模式控制输入) - 8: SO(模式控制输入)- 9: CLR(清除)

参数特性: - 典型最大时钟频率:36 MHz - 典型功耗:75mW - 电源电压范围:4.75V至5.25V - 时钟频率:0至25 MHz - 时钟或清除脉冲宽度:20 ns - 模式控制输入设置时间:30 ns - 串行和并行数据输入设置时间:20 ns - 清除无效状态:25 ns - 任何输入保持时间:0 ns - 操作环境温度:0°C至70°C

功能详解: - 同步并行加载:通过应用四位数据并使两个模式控制输入SO和SI高电平来完成。 - 右移:在时钟上升沿同步进行,当SO高电平且S1低电平时。 - 左移:当SO低电平且S1高电平时,数据向左同步移动。 - 抑制时钟:当两个模式控制输入都为低电平时,移位寄存器的时钟被抑制。

应用信息: XD74LS194适用于需要数据移动或数据存储的系统设计中,例如数据采集、信号处理和通信协议。

封装信息: XD74LS194采用DIP-16封装,引脚间距为0.1英寸。
XD74LS194 价格&库存

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XD74LS194
  •  国内价格
  • 5+2.20180
  • 50+1.68578
  • 150+1.50023
  • 500+1.26879

库存:598