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CA-IS2082B

CA-IS2082B

  • 厂商:

    CHIPANALOG(川土微)

  • 封装:

    SSOP16_150MIL

  • 描述:

    RS485收发器 2.375V~5.5V 5Mbps SSOP16_150MIL

  • 数据手册
  • 价格&库存
CA-IS2082B 数据手册
CA-IS2082B 上海川土微电子有限公司 Version 1.0 CA-IS2082B 隔离 2.5kV 半双工 RS485 收发器 • • • • • • • • • • 应用 符合 TIA/EIA-485-A 标准 信号传输速率:高达 5Mbps 失效防护接收器(总线开路、 短路) 支持多达 256 个总线节点 总线引脚 ESD 能力 –总线引脚对 GNDB ±8kV HBM –总线侧其他引脚对 GNDB ±6kV HBM –信号侧引脚对 GNDA ±6kV HBM – ±12 kV IEC 61000-4-2 Contact Discharge 2.5 V 至 5.5 V 逻辑侧电源 (VDDA) 4.5 V 至 5.5 V 总线侧电源(VDDB) 在接收状态时,总线输入端开路或短路接收器 输出高电平 宽温度范围: -40 °C 至 125 °C 引脚兼容大多数隔离式 RS-485 收发器 高 CMTI:±100 kV/µs (典型值) 高达 3000 VRMS 隔离耐压 隔离栅寿命: >40 年 SSOP16 封装,符合 RoHS 标准 安全相关认证: –符合 DIN VDE V 0884-11:2017-0 – 已通过 UL 1577 认证, 1 分钟 3 kVRMS –已通过 IEC 60950-1,IEC 62368-1 和 IEC61010-1 认 证. – 已通过 CQC,TUV 和 CSA 认证 • • • • • 隔离 RS-485 通信 光伏逆变器 工厂自动化 电机驱动器 防电磁干扰(EMI)的收发器 概述 CA-IS2082B 是具有高可靠性的隔离式半双工 RS-485 收发 器系列产品,同时具有高电磁抗扰度和低辐射特性。 该产品具有失效保护功能,在接收状态时,如果输入端 开路或短路则接收器输出高电平。 CA-IS2082B 系列产品具有高绝缘能力,有助于防止数据 总线或其他电路上的噪声和浪涌进入本地接地端,从而 干扰或损坏敏感电路。高 CMTI 能力可以保证数字信号 的正确传输。CA-IS2082B 器件采用 SSOP16 封装,支持 绝缘耐压高达 3 kVRMS。 器件信息 零件号 封装 CA-IS2082B 4.9 mm × 3.9 mm CA-IS2082B 功能框图 VDDA DE DI RO RE GNDA Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 封装尺寸(标称值) SSOP16(B) GALVANIC ISOLATION • • • • • 产品特性 VDDB B A GNDB 1 CA-IS2082B 上海川土微电子有限公司 Version 1.0 订购指南 表 4-1 有效订购零件编号 2 型号 VCC1(V) VCC2(V) 全/半双工 传输速度(Mbps) 额定耐压(V) 封装 CA-IS2082B 2.5~5.5 4.5~5.5 半双工 10 3000 SSOP16 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 上海川土微电子有限公司 Version 1.0 目录 产品特性 ............................................................1 7.8. 供电电流 ............................................................ 8 应用 ...................................................................1 7.9. 时序特性 ............................................................ 9 概述 ...................................................................1 订购指南 ............................................................2 修订历史 ............................................................3 引脚功能描述 ....................................................4 产品规格 ............................................................5 7.1. 绝对最大额定值 1 ..............................................5 7.2. ESD 额定值 .........................................................5 7.3. 建议工作条件.....................................................5 7.4. 热量信息.............................................................5 7.5. 隔离特性.............................................................6 7.6. 安全相关认证.....................................................7 7.7. 电气特性.............................................................8 7.9.1. 驱动时序特性 ................................................... 9 7.9.2. 接收时序特性 ................................................... 9 输入等效电路 ....................................................9 功能描述 .......................................................... 10 9.1. 简述 .................................................................. 10 9.2. 失效安全 .......................................................... 10 9.3. 总线上挂接 256 个收发器............................... 10 9.4. 驱动器输出保护 .............................................. 10 产品测试电路 .................................................. 11 功能模式 .......................................................... 15 封装信息 .......................................................... 17 焊接信息 .......................................................... 18 7.7.1. 驱动特性 ............................................................8 编带信息 .......................................................... 19 7.7.2. 接收特性 ............................................................8 重要声明 .......................................................... 20 修订历史 Version 1.0 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 3 CA-IS2082B 上海川土微电子有限公司 Version 1.0 引脚功能描述 VDDA 1 16 VDDB GNDA 2 15 GNDB RO 3 14 NC RE 4 13 B DE 5 12 A DI 6 11 NC NC 7 10 VDDB GNDA 8 9 GNDB CA-IS2082B 图 6-1 CA-IS2082B 顶部视图 表 6-1 CA-IS2082B 引脚功能描述 引脚名称 VDDA GNDA RO 4 引脚编号 类型 RE 1 2 3 4 电源 地 逻辑输出 逻辑输入 DE 5 逻辑输入 DI 6 逻辑输入 NC GNDA GNDB VDDB NC A B NC GNDB VDDB 7 8 9 10 11 12 13 14 15 16 地 地 地 无 逻辑输入/输出 逻辑输入/输出 无 地 电源 描述 A 侧电源电压。 A 侧接地基准点。 接收输出端。 接收使能端:低电平有效。 发送使能端:高电平有效,DE 为低时,发送输出为高阻。 DE 为高电平 时芯片工作在发送状态,DE 为低电平且RE为低电平时芯片工作在接收状 态。 发送数据输入端: DI 为高时,A 输出高电平, B 输出低电平。DI 为低时 正好相反。 无内部连接。 A 侧接地基准点。 B 侧接地基准点。 B 侧电源电压。 无内部连接。 总线正接收输入端和总线正发送输出端。 总线负接收输入端和总线负发送输出端。 无内部连接。 B 侧接地基准点。 B 侧电源电压。 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 上海川土微电子有限公司 Version 1.0 产品规格 7.1. 绝对最大额定值 1 参数 最小值 最大值 单位 -0.5 6.0 V VDDA, VDDB 电源电压 2 3 -0.5 VDDA+0.5 V Vin 输入电压 -20 20 mA IO 输出电流 150 °C TJ 结温 TSTG 存储温度范围 -65 150 °C 备注: 1. 等于或超出上述绝对最大额定值可能会导致产品永久性损坏。这只是额定最值,并不能以这些条件或者在任何其它超出本技术规 范操作章节中所示规格的条件下,推断产品能否正常工作。长期在超出最大额定值条件下工作会影响产品的可靠性。 2. 除差分 I / O 总线电压以外的所有电压值,均相对于本地接地端子(GNDA 或 GNDB) ,并且是峰值电压值。 3. 最大电压不得超过 6 V。 7.2. ESD 额定值 总线引脚到 GNDA 总线引脚到 GNDB 所有引脚 人体模型 (HBM), 根据 ANSI/ESDA/JEDEC JS-001,所有引脚 1 VESD 静电放电 接触放电,根据 IEC 61000-4-2,总线引脚 到 GNDB 组件充电模式(CDM), 根据 JEDEC Specification JESD22-C101, 所有引脚 2 数值 ±6000 ±8000 ±6000 ±12000 ±2000 单位 V 备注: 1. JEDEC 文件 JEP155 规定 500V HBM 可通过标准 ESD 控制过程实现安全制造。 2. JEDEC 文件 JEP157 规定 250V CDM 允许使用标准 ESD 控制过程进行安全制造。 7.3. 建议工作条件 参数 VDDA VDDB VOC VID VIH VIL DR TA 7.4. 最小值 2.375 4.5 -7 -12 2.0 电源电压 电源电压 A,B 引脚电压 A,B 差分输入电压 输入阈值逻辑高电平 输入阈值逻辑低电平 信号传输速率 环境温度 1 -40 27 最大值 5.5 5.5 12 12 0.8 5 125 单位 V V V V V V Mbps °C 热量信息 热量表 RθJA 典型值 3.3/5.0 5.0 IC 结至环境的热阻 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 115 单位 °C/W 5 CA-IS2082B 上海川土微电子有限公司 Version 1.0 隔离特性 7.5. CLR CPG DTI CTI 参数 外部气隙(间隙)1 外部爬电距离 1 隔离距离 相对漏电指数 材料组 IEC 60664-1 过压类别 DIN V VDE V 0884-11:2017-012 VIORM 最大重复峰值隔离电压 VIOWM 最大工作隔离电压 VIOTM 最大瞬态隔离电压 VIOSM 最大浪涌隔离电压 3 表征电荷 4 qpd CIO 栅电容, 输入到输出 5 RIO 绝缘电阻 5 测试条件 测量输入端至输出端,隔空最短距离 测量输入端至输出端,沿壳体最短距离 最小内部间隙(内部距离) DIN EN 60112 (VDE 0303-11);IEC 60112 依据 IEC 60664-1 额定市电电压≤ 300 VRMS 额定市电电压≤ 400 VRMS 额定市电电压 ≤ 600 VRMS 数值 >3.7 >3.7 32 >600 I I-IV I-IV I-III 单位 mm mm μm V 交流电压(双极) 交流电压; 时间相关的介质击穿 (TDDB) 测试 直流电压 VTEST = VIOTM, t = 60 s (认证); VTEST = 1.2 × VIOTM, t= 1 s (100% 产品测试) 测试方法 依据 IEC 60065, 1.2/50 μs 波形, VTEST = 1.6 × VIOSM (生产测试) 方法 ,输入/输出安全测试子类 2/3 后, Vini = VIOTM, tini = 60 s; Vpd(m) = 1.2 × VIORM, tm = 10 s 方法 ,环境测试子类 1 后, Vini = VIOTM, tini = 60 s; Vpd(m) = 1.6 × VIORM, tm = 10 s 方法 b, 常规测试 (100% 生产测试) 和前期 预处理(抽样测试) Vini = 1.2 × VIOTM, tini = 1 s; Vpd(m) = 1.875 × VIORM, tm = 1 s VIO = 0.4 × sin (2πft), f = 1 MHz VIO = 500 V, TA = 25°C VIO = 500 V, 100°C ≤ TA ≤ 125°C VIO = 500 V at TS = 150°C 566 400 556 VPK VRMS VDC 4242 VPK 4000 VPK 污染度 ≤5 ≤5 pC ≤5 ~0.5 >1012 >1011 >109 2 pF 3000 VRMS Ω UL 1577 最大隔离电压 VISO VTEST = VISO , t = 60 s (认证), VTEST = 1.2 × VISO , t = 1 s (100%生产测试) 备注: 1. 根据应用的特定设备隔离标准应用爬电距离和间隙要求。 注意保持电路板设计的爬电距离和间隙距离,以确保印刷电路板上隔离 器的安装焊盘不会缩短该距离。 在某些情况下印刷电路板上的爬电距离和间隙相等。 在印刷电路板上插入凹槽的技术有助于提 高这些指标。 2. 该标准仅适用于安全等级内的安全电气绝缘。 应通过适当的保护电路确保符合安全等级。 3. 测试在空气或油中进行,以确定隔离屏障的固有浪涌抗扰度。 4. 表征电荷是由局部放电引起的放电电荷(pd)。 5. 栅两侧的所有引脚连接在一起,形成双端子器件。 6 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 上海川土微电子有限公司 7.6. 安全相关认证 VDE(申请中) 根据 DIN V VDE V 0884-11:2017-01 认证 Version 1.0 UL UL1577 器件程序认证 SOP16-W: 5000 VRMS CQC 根据 GB4943.1-2011 和 GB 8898-2011 认证 加强绝缘 最大工作电压 600 VRMS (仅适用于海拔 5000 米及以下) 证书编号:E511334 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 证书编号:CQC20001257126 TUV 根据 EN/IEC 61010-1:2010 (3rd Ed)和 EN/IEC 62368-1:2014+A11:2017 认证 5000 VRMS 根据加强绝缘 EN/IEC 610101:2010 (3rd Ed) 和 EN/IEC 623681:2014+A11:2017,最大工作电压 600 VRMS CB 证书编号: JPTUV-112094; DE 2-028138 AK 证书编号: AK 50476734 0001; AK 50476735 0001 7 CA-IS2082B 上海川土微电子有限公司 Version 1.0 7.7. 电气特性 7.7.1. 驱动特性 除非有额外说明,本表格数据均为建议工作条件下的测试结果。 参数 测试条件 |VOD1| 差分输出(无负载)电压 |VOD2| 差分输出(带负载) 电压 ∆|VOD| 差分输出电压增量 RL=54Ω 图 10-1 VOC 稳态 共模输出电压 ∆VOC 两个状态共模输出电压增量 IIL 输入漏电流 DI,DE, RE=0 OR 1 最小值 4.5 1.5 -0.2 1 典型值 5.0 2.3 -20 最大值 5.5 3.18 0.2 3 0.2 20 单位 V V µA Ios1 驱动短路电流(VO=HIGH) DE= RE=1, DI=1, VA=-7 V, VB=12 V 48 78 108 mA Ios2 驱动短路电流(VO=LOW) 共模瞬变抗扰度 输入电容 DE= RE =1, DI=0, VA=12 V, VB=-7 V VCM = 1500V;图 10-8 VI = VDD/ 2 + 0.4×sin(2πft), f = 1 MHz, VDD = 5 V 48 85 78 100 108 CMTI CI mA kV/µS 2 pF 7.7.2. 接收特性 除非有额外说明,本表格数据均为建议工作条件下的测试结果。 参数 测试条件 VOH 输出电压逻辑高电平 IOH = -4mA; VOL 输出电压逻辑低电平 IOL = 4mA; VIT+(IN) VIT-(IN) VI(HYS) 最小值 VDDA-0.4 正输入阈值 负输入阈值 输入阈值迟滞 -200 II 总线输入电流 IIH 输入高电平漏电流 RE IIL RID 输入低电平漏电流 RE 差分输入电阻 CD 差分输入电容 CI 输入到地电容 VA or VB = 12 V, 其它输入引脚接 0 V VA or VB = 12 V, 关闭电源,其它输入引脚接 0 V VA or VB = –7 V, 其它输入引脚接 0 V VA or VB = –7 V,关闭电源,其它输入引脚接 0 V VIH = 2 V –0.1 –0.1 –20 VIL = 0.8 V –20 A,B 输入 f = 1.5 MHz, Vpp=1V 正弦信号, 通过 A 和 B 测量 CD VI = 0.4V × sin (2πft), f = 1MHz 96 典型值 4.8 0.2 -100 -130 30 0.04 0.06 –0.04 –0.03 最大值 0.4 -20 0.1 0.13 单位 V V mV mV mV mA 20 µA 20 µA KΩ 7 pF 2 pF 供电电流 7.8. 除非有额外说明,本表格数据均为建议工作条件下的测试结果。 参数 A 边供电电流 IDDA B 边供电电流 IDDB 8 测试条件 最小值 典型值 最大值 单位 mA RE =0 or 1, DE=0 or 1 VDDA=3.3V 4.2 RE =0 or 1, DE =0 or 1 VDDA=5V 4.2 mA 6.8 mA RE=0 or 1, DE =0, 无负载 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 上海川土微电子有限公司 7.9. Version 1.0 时序特性 7.9.1. 驱动时序特性 除非有额外说明,本表格数据均为建议工作条件下的测试结果。 参数 tPLH, tPHL 传播延迟 PWD 脉冲宽度失真 |tPLH - tPHL| tr 输出上升时间 tf 输出下降时间 tPZH/ tPZL 驱动关闭使能传播延迟 tPHZ/ tPLZ 驱动开启使能传播延迟 测试说明 最小值 典型值 16 3 12 12 28 28 最大值 48 12.5 25 25 90 90 单位 ns ns ns ns ns ns 最小值 典型值 80 15 2.5 2.5 最大值 165 30 4 4 单位 ns ns ns ns 28 90 ns 43 52 ns 图 10-2, 图 10-3, 图 10-7, Rdiff=54Ω, CL1=CL2=50pF 7.9.2. 接收时序特性 除非有额外说明,本表格数据均为建议工作条件下的测试结果。 参数 tPLH, tPHL 传播延迟 PWD 脉冲宽度失真 |tPLH - tPHL| tr 输出上升时间 tf 输出下降时间 tPHZ, tPLZ 接收关闭传播延迟时间,输出高/低电平至 高阻时间 tPZH, tPZL 接收使能传播延迟时间,输出高阻至高/低 电平时间 测试说明 图 10-4, 图 10-5, 图 10-6, Rdiff=54Ω, CL1=CL2=50pF 输入等效电路 VCCI VCCI VCCI VCCI VCCI 1.5MOhm DE DI,RE 1.5MOhm 图 8-1 输入等效电路 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 9 CA-IS2082B Version 1.0 上海川土微电子有限公司 功能描述 简述 CA-IS2082B 是用于 RS-485 通信的半双工收发器,包含一个驱动器和接收器。具有失效安全,过流保护和过热保护 功能。 9.1. 失效安全 接收器输入短路或开路,或挂接在终端匹配传输线上的所有驱动器均处于禁用状态时(idle) ,CA-IS308x 产品可确 保接收器输出逻辑高电平,这是通过将接收器输入门限分别设置为-50mV 和-200mV 实现的。若差分接收器输入电压(AB)≥-50mV,RO 为逻辑高电平;若电压(A-B)≤-200mV,RO 为逻辑低电平。当挂接在终端匹配总线上的所有发送器都禁 用时,接收器差分输入电压将通过终端电阻拉至 0V。依据接收器门限,可实现具有 50 mV 最小噪声容限的逻辑高电 平。-50 mV 至-200 mV 门限电压是符合±200 mV 的 EIA/TIA-485 标准的。 9.2. 总线上挂接 256 个收发器 标准 RS485 接收器的输入阻抗为 12 kΩ(1 个单位负载),标准驱动器可最多驱动 32 个单位负载。CA-IS308x 收发器的 接收器具有 1/8 单位负载输入阻抗(96 kΩ),允许最多 256 个收发器并行挂接在同一通信总线上。这些器件可任意组合, 或者与其它 RS485 收发器进行组合,只要总负载不超过 32 个单位负载,都可以挂接在同一总线上。 9.3. 驱动器输出保护 通过两种机制避免故障或总线冲突引起输出电流过大和功耗过高。第一,过流保护,在整个共模电压范围内提供 快速短路保护。第二,热关断电路,当管芯温度超过过温阈值时(160℃典型值),强制驱动器输出进入低电平。 9.4. 10 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 上海川土微电子有限公司 Version 1.0 产品测试电路 1/2RL A 27Ω DI VOD B 0V or VDDA 27Ω VOC 1/2RL GNDB 图 10-1 驱动电压测试电路 DE=VDDA A VOD DI B 信号 发生器 RL 54Ω CL 50Ω GNDB GNDA 备注: 1. 图中的 50Ω 电阻是用来匹配。在实际应用中不需要; 2. CL 包含夹具和仪器寄生电容。 图 10-2 驱动传输延时测试电路 VDDA VI 50% 50% tPHL tPLH VOH 90% VOD 50% 50% tr Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 VOL 10% tf 11 CA-IS2082B 上海川土微电子有限公司 Version 1.0 图 10-3 驱动传输延时 A 1.5V 信号发 生器 Vo B CL 15pF 50Ω GNDB GNDA 备注: 1. 图中的 50Ω 电阻是用来匹配。在实际应用中不需要; 2. CL 包含夹具和仪器寄生电容。 图 10-4 接收传输延时测试电路 VDDA 50% 50% VI tPHL tPLH VOH 90% 50% 50% VO VOL 10% tf tr 图 10-5 接收传输延时间 12 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 上海川土微电子有限公司 Version 1.0 VCC 1.5V A 0V B VO 1k Ω VI CL 15pF RE VI S1 VCC 50% 50% tPZH GNDB tPHZ VO 信号 50 Ω VCC 90% 10% 发生器 信号发生 器 VCC A VO 0V B 1.5V RE VI 0V 0V VI VCC 110 Ω 50% 50% 0V S1 15pF tPLZ tPZL GNDB VO VCC 信号 50 Ω 发生器 信号发生 器 50% 10% Output Low 图 10-6 接收开启和关闭时间 A DI VCC B VI RL CL 50pF 110Ω 信号发 生器 50Ω GNDA GNDB 50% tPZH 50% tPHZ 90% VO 50% 0V VOH 0V VDDB RL VDDA 110Ω A DI VO VI B VI 50 Ω 50% 0V tPZL tPHZ VO CL 50% 50pF 信号发 生器 50% 10% VDDB 0V GNDB GNDA 备注: 1. 图中的 50Ω 电阻是用来匹配。在实际应用中不需要。 2. CL 包含夹具和仪器寄生电容。 图 10-7 驱动开启和关闭时间 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 13 CA-IS2082B 上海川土微电子有限公司 Version 1.0 VDDA VDDB DE 1μF 1μF GNDA VDDA A DI + 54Ω B GNDB VOH or VOL - GNDA RO + - CL 1KΩ RE 15pF GNDA GNDB Vcm 图 10-8 半双工(左)CMTI 共模瞬变抗扰度测试电路 14 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 上海川土微电子有限公司 Version 1.0 功能模式 表 11- 1 为 CA-IS2082 B 驱动功能真值表,表 11- 2 为 CA-IS2082B 接收功能真值表。 表 11- 1 驱动功能真值表 VDDA VDDB PU PU PU PU PU PD PU PD PU PU PU PU PU PU PD PD INPUT (DI) H L X X OPEN X X X ENABLE INPUT (DE) H H L OPEN H X X X OUTPUTS A H L Hi-Z Hi-Z H Hi-Z Hi-Z Hi-Z B L H Hi-Z Hi-Z L Hi-Z Hi-Z Hi-Z 备注: 1. 2. 驱动状态时RE引脚接高电平; PU = 上电; PD = 断电; X = 无关; H =高电平; L =低电平; Hi-Z =高阻抗。 表 11- 2 接收功能真值表 VDDA VDDB PU PU PU PU PU PU PU PD PU PD PU PU PU PU PU PU PU PU PD PD DIFFERENTIAL INPUT ENABLE OUTPUT VID = (VA – VB) –0.02 V ≤ VID –0.2 V < VID < –0.02 V VID ≤ –0.2 V X X Open circuit Short circuit X X X (𝐑𝐄) L L L H OPEN L L X L Hi-Z (RO) H ? L Hi-Z Hi-Z H H Hi-Z L Hi-Z 备注: 1. 接收状态时 DE 引脚接低电平; 2. PU = 上电; PD = 断电; X = 无关; H =高电平; L =低电平; Hi-Z =高阻抗。?=不定态; 3. (RE) 引脚内部弱下拉,(RE) 引脚在 OPEN 状态与 L 状态时 RO 引脚输出现象相同。 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 15 CA-IS2082B 上海川土微电子有限公司 Version 1.0 应用线路 1μF 0.1μF 0.1μF 1μF GNDA RO RE DE DI GNDA VDDA VDDB GNDA GNDB RO NC RE B DE CA-IS2082B RL A DI NC NC VDDB GNDA GNDB 1μF 0.1μF GNDB 0.1μF 1μF GNDA RO RE DE DI GNDA GNDB VDDA VDDB GNDA GNDB RO NC B RE DE GNDB CA-IS2082B RL A DI NC NC VDDB GNDA GNDB GNDB 图 12- 1 CA-IS2082B 应用线路 16 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 上海川土微电子有限公司 Version 1.0 封装信息 下图说明了 CA-IS2082B 数字隔离器采用 SSOP16 封装大小尺寸图和建议焊盘尺寸图,尺寸以毫米为单位。 5.00 4.80 0.41 0.64 9 16 1.6 4.01 3.81 6.20 5.79 5.4 PIN I ID 1 8 TOP VIEW RECOMMENDED LAND PATTERN 1.65 1.25 1.75 1.35 0.30 0.20 0.64BSC FRONT VIEW Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 0.25 0.10 1.27 0.41 8° 0° 1.04REF LEFT-SIDE VIEW 17 CA-IS2082B 上海川土微电子有限公司 Version 1.0 焊接信息 TP tP Max. Ramp Up Rate=3 /s TC-5 Temperature TL Tsmax tL Preheat Area Tsmin ts 25 Time Time 25 to Peak 图 14- 1 焊接温度曲线 表 14- 1 焊接温度参数 Profile Feature Pb-Free Assembly Average ramp-up rate(217 ℃ to Peak) 3℃/second max Time of Preheat temp(from 150 ℃ to 200 ℃) 60-120 second Time to be maintained above 217 ℃ 60-150 second Peak temperature 260 +5/-0 ℃ Time within 5 ℃of actual peak temp 30 second Ramp-down rate 6 ℃/second max. Time from 25℃ to peak temp 8 18 minutes max Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 CA-IS2082B 上海川土微电子有限公司 Version 1.0 编带信息 TAPE DIMENSIONS REEL DIMENSIONS A0 B0 K0 W P1 Dimension designed to accommodate the component width Dimension designed to accommodate the component length Dimension designed to accommodate the component thickness Overall width of the carrier tape Pitch between successive cavity centers QUADRANT ASSIGNMENTS FOR PIN 1 ORIENTATION IN TAPE *All dimensions are nominal Device Package Type Package Drawing Pins SPQ CA-IS2080B SSOP B 16 2500 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司 Reel Diameter (mm) 330 Reel Width W1 (mm) A0 (mm) B0 (mm) K0 (mm) P1 (mm) W (mm) Pin1 Quadrant 12.4 6.4 5.2 2.1 8.0 12.0 Q1 19 CA-IS2082B Version 1.0 上海川土微电子有限公司 重要声明 上述资料仅供参考使用,用于协助 Chipanalog 客户进行设计与研发。Chipanalog 有权在不事先通知的情况下,保 留因技术革新而改变上述资料的权利。 Chipanalog 产品全部经过出厂测试。 针对具体的实际应用,客户需负责自行评估,并确定是否适用。Chipanalog 对客户使用所述资源的授权仅限于开发所涉及 Chipanalog 产品的相关应用。 除此之外不得复制或展示所述资源, 如 因使用所述资源而产生任何索赔、 赔偿、 成本、 损失及债务等, Chipanalog 对此概不负责。 商标信息 Chipanalog Inc.®、Chipanalog®为 Chipanalog 的注册商标。 http://www.chipanalog.com 20 Copyright © 2020, Chipanalog Incorporated 上海川土微电子有限公司
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